오늘날 모바일 기기들의 발전과 통신망의 고속화, 광역화와 함께 사용자의 중요한 정보를 유출하거나 특정 기기의 사용을 방해하는 보안 위협도 점점 증가하고 있다. 모바일 기기에서 널리 사용될 것이라 예상되는 임베디드 리눅스 또한 이러한 보안 위협으로부터 안전하지 못하다. 본 논문에서는 임베디드 리눅스를 위협하는 악성 프로그램의 특징에 대해 알아보고 그에 대한 대응책으로 임베디드 시스템의 특성을 고려한 서명 검증 방식을 이용한 악성 프로그램 차단 시스템을 제안한다. 제안하는 시스템은 악성 프로그램 검사 엔진 서버와 LSM 기반의 커널 모듈로 구현된 시스템으로 구성되며, 메모리에 상주하여 악성 프로그램을 감시하는 일반적인 실시간 감시 프로그램과는 달리, 커널 레벨에서 프로그램이 실행되는 순간 파일의 변조 여부를 검사하여 악성 프로그램의 실행을 사전 차단한다. 실험을 통해 제안한 시스템이 적은 오버헤드로 악성 프로그램의 실행을 효과적으로 사전 차단하는 것을 확인하였다.
본 논문에서는 고속 통신 시스템 응용을 위한 12b 100 MS/s CMOS D/A 변환기(DAC) 회로를 제안한다. 제안하는 DAC는 전력소모, 면적, 선형성 및 글리치 에너지 등을 고려하여, 상위 8b는 단위 전류셀 매트릭스 (unit current-cell matrix)로 나머지 하위 4b는 이진 전류열 (binary-weighted array)로 구성하였다. 제안하는 DAC는 동적 성능을 향상시키기 위해 새로운 구조의 스위치 구동 회로를 사용하였다. 시제품 DAC회로 레이아웃을 위해서는 캐스코드 전류원을 단위 전류셀 스위치 매트릭스와 분리하였으며, 제안하는 칩은 0.35 um single-poly quad-metal CMOS 공정을 사용하여 제작되었다. 측정된 시제품의 DNL 및 INL은 12b 해상도에서 각각 ±0.75 LSB와 ±1.73 LSB이내의 수준이며, 100 MS/s 동작 주파수와 10 MHz 입력 주파수에서 64 dB의 SFDR을 보여준다. 전력 소모는 3 V의 전원 전압에서 91 mW이며, 칩 전체 크기는 2.2 mm × 2.0 mm 이다.
레이다 기술의 국산화가 이슈가 되고 연구 개발에 박차를 가하고 있는 가운데 본 논문의 Dual-band 모노 펄스 수신기는 추적 레이다를 기반으로 한 실험적 수행 결과를 바탕으로 하고 있다. Dual-band 레이다를 Single-band 레이다와 비교해 보면 높은 비용과 소비 전력 등의 단점을 갖고 있지만 재밍이나 검파 거리, 이미지 신호 제거, 강우 감쇄 특성 면에서 이점을 가질 수 있다. 수신기는 X-band RF head 모듈, Ka-band RF head 모듈, 그리고 공통 IF모듈로 구성되며 X-band와 Ka-band의 각 신호는 IF 모듈의 스위칭에 의해 선택되어진다. 또한 IF모듈의 국부 신호단에서는 위상 제어기가 장착되어 합 채널을 기준으로 고각과 방위각 채널의 위상을 제어할 수 있도록 하였다. 측정 결과 전체 이득은 $40{\pm}3 dB$였으며, 송신/수신간 격리도는 39 dBc, 동적 영역 110 dB, 그리고 잡음지수는 X/Ka-band 각각 4.5dB/6.9dB로 나타났다.
본 논문에서 입력 버퍼에 설정된 점유 임계치를 동적으로 가변 시켜 최대의 점유도를 갖는 포트를 우선적으로 서비스 하는 입력 버퍼형 ATM 스위치의 경합 제어 방식을 제안 하고 이것의 하드웨어적 실현 방안을 기술 한다. 하드웨어적 실현 방법은 고속화를 위해 단순 구조를 지향 하여 신호 경로단의 경감과 발열량의 절감을 추구 한다. 입력 버퍼에 설정되는 점유 임계치는 매 타임 슬롯 마다 셀의 입려과 경합 제어에 의한 셀의 서비스 결과를 기반으로 가장 점유도가 높은 버퍼가 경합 제어에서 가장 높은 우선권을 갖도록 동적으로 가변 된다. 제안한 경합 제어 방식의 특성을 분석 하기 위해 마코흐(Markov) 체인을 이용한 성능해석을 실시하고 다양한 트래픽 조건에서의 모사 시험을 통하여 제안된 방식과 기존의 방식간에 트래픽에 대한 적응성을 비교, 분석한다.
In recent years, the demand for portable digital devices such as cellular phone, digital camera, and MP3 player has been largely increased. To meet the requirements of such portable applications the information storage devices with smaller size, higher capacity, and lower power consumption are needed. A small form factor (SFF) HDD using a load/unload (L/UL) system is one of the appropriate alternatives to satisfy these requirements. Due to complexity of L/UL process and mechanism, it is required to investigate for better understanding the effects of design parameters. Among the various design parameters, flexible cable and friction force on the L/UL ramp become important to the dynamic characteristics of L/UL process as the system is miniaturized. The program for L/UL simulation which considers the effect of flexible cable and L/UL ramp is needed. Unfortunately, there is hardly any commercial program for the L/UL simulation except the Computer Mechanics Laboratory (CML) air bearing design program and the CML L/UL simulation code. Furthermore, the design parameters such as flexible cable and the L/UL ramp are not considered in the CML L/UL simulation code. So we embody the L/UL simulation considering flexible cable and an L/UL ramp by using the ANSYS/LS-DYNA. In this thesis, the effects of flexible cable and friction force on the dynamic characteristics and the performances of the L/UL process are studied. Numerical simulation and related experiments are carried out and compared each other.
본 논문에서는 수중환경에서의 거리에 따른 전파 손실 특성을 이용한 직교 주파수 분할 다중 접속 방식(Orthogonal Frequency Division Multiple Access, OFDMA) 기반의 새로운 에너지 효율적인 매체 접속 제어(Medium Access Control, MAC) 프로토콜을 제안한다. 제안하는 방식은 센서 노드들을 싱크 노드를 중심으로 싱크 노드와의 거리에 따라 그룹을 나눈 후, 그룹에 서로 다른 주파수 대역을 각각 할당하여 사용하도록 한다. 이러한 방식으로 네트워크 전체의 전송 전력 소모를 줄이고 각 센서 노드에게 최소 허용 신호 대 잡음비 (Accepted Minimum SNR, AMS)를 보장한다. 추가적으로 싱크 노드는 동적 인 부채널 할당 (dynamic sub-channel allocation)으로 데이터 전송률을 향상한다. 모의실험을 통해 제안하는 매체 접속 제어 프로토콜의 수중 센서 네트워크에서의 성능을 확인할 수 있었다.
본 논문에서는 polymerase chain reaction (PCR) 응용에 적합한 저잡음 CMOS 이미지 센서에 사용되는 컬럼-패러럴 analog-to-digital converter (ADC) 어레이를 위한 cascaded-of-integrator feedforward (CIFF) 구조의 단일 비트 2차 델타-시그마 모듈레이터를 제안하였다. 제안된 모듈레이터는 CMOS 이미지 센서에 입사된 빛의 신호에 해당하는 픽셀 출력 전압을 디지털 신호로 변환시키는 컬럼-패러럴 ADC 어레이를 위해 하나의 픽셀 폭과 동일한 10㎛ 컬럼 폭 내에 2개의 스위치드 커패시터 적분기와 단일 비트 비교기로 구현하였다. 또한, 모든 컬럼의 모듈레이터를 동시에 구동하기 위한 주변 회로인 비중첩 클록 발생기 및 바이어스 회로를 구성하였다. 제안된 델타-시그마 모듈레이터는 110nm CMOS 공정으로 구현하였으며 12kHz 대역폭에 대해 418의 oversampling ratio (OSR)로 88.1dB의 signal-to-noise-and-distortion ratio (SNDR), 88.6dB의 spurious-free dynamic range (SFDR) 및 14.3비트의 effective-number-of-bits (ENOB)을 달성하였다. 델타 시그마 모듈레이터의 면적 및 전력 소비는 각각 970×10 ㎛2 및 248㎼이다.
본 논문은 추가 비용 없이 전기자동차(EV) 주행 범위를 확장하기 위해 에너지 효율적인 전기자동차 주행 프로파일을 도출하는 새로운 시스템 수준의 프레임 워크를 소개한다. 이 논문은 먼저 운전 차량에 작용하는 힘과 모터 효율을 고려한 전기차 파워 트레인 모델을 구현한 후, 경로에 의해 정의된 주행 임무에 대한 최소 에너지 주행 프로파일을 도출한다. 이를 위해서 본 프레임워크는 먼저 최적화 문제를 공식화하고, 가중치 계수를 이용한 동적 프로그래밍 알고리즘을 사용하여 에너지 소비와 운전 시간을 모두 최소화하는 주행 프로파일을 도출한다. 본 논문은 주행 시간 제약을 만족시키기 위한 다양한 가중치 계수 도출 방법을 소개한다. 시뮬레이션 결과, 제안 된 스케일링 알고리즘의 연산시간이 이진 검색 알고리즘 및 탐욕 알고리즘보다 각각 34 % 및 50 % 더 작음을 보여준다.
본 논문에서는 작은 면적을 갖는 저전력 스위치-매트릭스 구조의 델타-시그마 D/A 변환기용 준 디지털 FIR 재생필터를 제안하였다. 제안된 재생필터는 계수를 7 비트로 양자화하고 각 비트 값에 대응하는 전류를 생성하는 7 개의 전류원을 사용하는 구조로 205 개의 탭을 가지며 1419 개의 스위칭 트랜지스터로 구현되었다. 제안된 필터는 0.25 um CMOS공정을 이용하여 설계되었으며 전체 칩 면적은 1.5 mm$^{2}$으로 2.5 V에서 3.8 mW의 소비 전력을 갖는다. 모의실험 결과 104 dB의 다이나믹 레인지와 -84 dB의 대역 밖의 노이즈 허용값을 나타내어 고해상도 오디오용 DAC에 적합하다.
고속 저전력 디지털 시스템을 위해 클록 스큐를 최소화하고 동적 파워 소모를 줄이는 새로운 클록 분배 방법을 제안하였다. 제안된 방법은 접힌 라인구조(FCL)과 위상 섞임 회로(phase blending circuit)을 이용하여 Zero-skew 특성을 갖는다. FCL에 적합한 라인 구조를 분석하기 위해, 마이크로 스트립과 코플라너 라인을 FCL형 클록 라인으로 분배되었다. 시뮬레이션 결과는 l0㎜ 떨어져 있는 두 리시버 사이의 최대 클록 스큐가 1㎓에서 10psec보다 적고 20㎜ 떨어져 있는 두 리시버 사이의 최대 클록 스큐는 1㎓에서 60 psec보다 작음을 보였다. 또한, 공정, 전압, 온도 변화에 무관하게 클록 신호들의 스큐가 변하지 않음을 알 수 있었다.
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[게시일 2004년 10월 1일]
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