• 제목/요약/키워드: drivability

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A/T차량의 저속 영역에서 댐퍼클러치 작동에 따른 이상 진동 해석 (Analysis of Abnormal Vibration by a Damper Clutch Operation in Low Speed Ranges of A/T Vehicles)

  • 신창우;김범수;이대흥;정종렬;임원식;차석원
    • 한국자동차공학회논문집
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    • 제21권3호
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    • pp.157-164
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    • 2013
  • A damper clutch in automatic transmission systems has some advantages of fuel economy and dynamic performance. Although a damper clutch operation improves a fuel economy of the vehicles, a positive operation of a damper clutch in a low vehicle speed induces abnormal vibration. This paper analyzed one of reasons for abnormal vibration by a damper clutch operation in low engine speed ranges. A simulation model was designed to confirm the effects of a damper clutch operation under unstable regions of an engine. A theoretical analysis was carried out about an engine operation stability. Simulation was conducted to depict abnormal vibration by a damper clutch operation in unstable regions of an engine performance curve. The effects of an engine operation region for abnormal vibration by a damper clutch was investigated according to the range and the slope of unstable regions. As a result of simulations, a damper clutch operation would be better to avoid an engine unstable regions.

실리콘 선택적 결정 성장 공정을 이용한 Elevated Source/drain물 갖는 NMOSFETs 소자의 특성 연구 (A Study on the Device Characteristics of NMOSFETs Having Elevated Source/drain Made by Selective Epitaxial Growth(SEG) of Silicon)

  • 김영신;이기암;박정호
    • 대한전기학회논문지:전기물성ㆍ응용부문C
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    • 제51권3호
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    • pp.134-140
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    • 2002
  • Deep submicron NMOSFETs with elevated source/drain can be fabricated using self-aligned selective epitaxial growth(SEG) of silicon for enhanced device characteristics with shallow junction compared to conventional MOSFETs. Shallow junctions, especially with the heartily-doped S/D residing in the elevated layer, give hotter immunity to Yt roll off, drain-induced-barrier-lowering (DIBL), subthreshold swing (SS), punch-through, and hot carrier effects. In this paper, the characteristics of both deep submicron elevated source/drain NMOSFETs and conventional NMOSFETs were investigated by using TSUPREM-4 and MEDICI simulators, and then the results were compared. It was observed from the simulation results that deep submicron elevated S/D NMOSFETs having shallower junction depth resulted in reduced short channel effects, such as DIBL, SS, and hot carrier effects than conventional NMOSFETs. The saturation current, Idsat, of the elevated S/D NMOSFETs was higher than conventional NMOSFETs with identical device dimensions due to smaller sheet resistance in source/drain regions. However, the gate-to-drain capacitance increased in the elevated S/D MOSFETs compared with the conventional NMOSFETs because of increasing overlap area. Therefore, it is concluded that elevated S/D MOSFETs may result in better device characteristics including current drivability than conventional NMOSFETs, but there exists trade-off between device characteristics and fate-to-drain capacitance.

Mixed Driving 방식을 이용한 QVGA급 LDI의 Source Driver 설계 (Design of Source Driver for QVGA-Scale LDI Using Mixed Driving Method)

  • 김학윤;고영근;이성우;최호용
    • 대한전자공학회논문지SD
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    • 제46권11호
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    • pp.40-47
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    • 2009
  • 본 논문에서는 mixed driving 방식을 이용하고 이미지 개선을 위해 $\gamma$-correction을 수행하는 QVGA급 TFT-LCD driver IC의 Source Driver를 설계한다. 240 RGB ${\times}$ 320 dots resolution을 가진 source driver는 720개의 채널을 통해 TFT-LCD 패널을 구동하고 18-bit의 RGB 데이터를 사용하여 26만 color를 수행한다. Mixed driving 방식은 종전의 좋은 구동력을 가진 channel amp. driving 방식에 저면적이 가능한 gray amp. driving 방식을 혼합한 방식으로서, 영상이 동일 색상을 가지는 worst case를 감지하여 구동력을 높여주는 방식을 사용함으로써 적절한 구동력과 저면적을 구현하는 설계방식이다. 본 Source Driver는 $0.35{\mu}m$ Magnachip embedded DRAM 공정을 사용하여 설계하였으며 Hspice를 사용하여 시뮬레이션을 하였다. 실험결과, 기존의 gayscale driving 방식에서는 hsync time을 만족시키지 못하는데 비해 $17{\mu}s$의 channel 구동시간으로 충분한 timing margin을 가지고 액정 channel 을 구동할 수 있으면서, 구동 앰프 78개와 제어회로를 갖는 저면적으로 설계되었다.

자동변속기용 임베디드 시스템 성능 시험을 위한 Hardware-in-the Loop 시뮬레이터 구축 (Development of Hardware-in-the-Loop Simulator for Testing Embedded System of Automatic Transmission)

  • 장인규;서인근;전재욱;황성호
    • 제어로봇시스템학회논문지
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    • 제14권3호
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    • pp.301-306
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    • 2008
  • Drivers are becoming more fatigued and uncomfortable with increase in traffic density, and this condition can lead to slower reaction time. Consequently, they may face the danger of traffic accidents due to their inability to cope with frequent gear shifting. To reduce this risk, some drivers prefer automatic transmission (AT) over manual transmission (MT). The AT offers more superior drivability and less shifting shock than the MT; therefore, the AT market share has been increasing. The AT is controlled by an electronic control unit (ECU), which provides better shifting performance. The transmission control unit (TCU) is a higher-value-added product, so the companies that have advanced technologies end to evade technology transfer. With more cars gradually using the ECU, the TCU is expected to be faster and more efficient for organic communication and arithmetic processing between the control systems than the l6-bit controller. In this paper, the model of an automatic transmission vehicle using MATLAB/Simulink is developed for the Hardware in-the-Loop (HIL) simulation with a 32-bit embedded system, and also the AT control logic for shifting is developed by using MATLAB/Simulink. The developed AT control logic, transformed automatically by real time workshop toolbox, is loaded to a 32-bit embedded system platform based on Freescale's MPC565. With both vehicle model and 32-bit embedded system platform, we make the HIL simulation system and HIL simulation of AT based on real time operating system (RTOS) is performed. According to the simulation results, the developed HIL simulator will be used for the performance test of embedded system for AT with low cost and effort.

Dickson Charge Pump with Gate Drive Enhancement and Area Saving

  • Lin, Hesheng;Chan, Wing Chun;Lee, Wai Kwong;Chen, Zhirong;Zhang, Min
    • Journal of Power Electronics
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    • 제16권3호
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    • pp.1209-1217
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    • 2016
  • This paper presents a novel charge pump scheme that combines the advantages of Fibonacci and Dickson charge pumps to obtain 30 V voltage for display driver integrated circuit application. This design only requires four external capacitors, which is suitable for a small-package application, such as smart card displays. High-amplitude (<6.6 V) clocks are produced to enhance the gate drive of a Dickson charge pump and improve the system's current drivability by using a voltage-doubler charge pump with a pulse skip regulator. This regulation engages many middle-voltage devices, and approximately 30% of chip size is saved. Further optimization of flying capacitors tends to decrease the total chip size by 2.1%. A precise and simple model for a one-stage Fibonacci charge pump with current load is also proposed for further efficiency optimization. In a practical design, its voltage error is within 0.12% for 1 mA of current load, and it maintains a 2.83% error even for 10 mA of current load. This charge pump is fabricated through a 0.11 μm 1.5 V/6 V/32 V process, and two regulators, namely, a pulse skip one and a linear one, are operated to maintain the output of the charge pump at 30 V. The performances of the two regulators in terms of ripple, efficiency, line regulation, and load regulation are investigated.

상용승용차 시트프레임 부품의 중량 최적화에 관한 연구 (A Study on the Weight Optimization for the Passenger Car Seat Frame Part)

  • 장인식;민병조
    • 한국자동차공학회논문집
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    • 제14권5호
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    • pp.155-163
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    • 2006
  • Car seat is one the most important element to make comfortable drivability. It can absorb the impact or vibration during driving state. In addition to those factors, it is needed to have enough strength for passenger safety. From energy efficiency and environmental point of view lighter passenger car seat frame becomes hot issue in the auto industry. In this paper, weight optimization methodology is investigated for commercial car seat frame using CAE. Optimized designs for seat frame are developed using commercially available finite element code(ANSYS) and design of experiment method. At first, car seat frame is modelled using 3-D computer aided design tool(CATIA) and simplified for finite element modelling. Finite element analysis is carried out for the case of FMVSS 202 Head Restraint test to check the strength of the original seat frame. Two base brackets are selected as optimized elements that are the heaviest parts in the seat frame. After finite element analysis for the brackets with similar load condition to the previous test optimization technique is applied for 10% to 50% weight reduction. Design of experiment is utilized to obtain optimization design for the bracket based on the modified 50% weight reduction model in which outer shape of the bracket is conserved. Weight optimization models result in the decrease of the strength in spite of weight reduction. The more design points should be considered to get better optimized model. The more advanced optimization technique may be utilized for more parts of the seat frame to increase whole seat frame characteristics in the future.

연약지반 구간에서 지표투과레이더 활용한 교량 접속부 침하량 안전 평가 (Safety Evaluation of the Settlement Amount of the Bridge Earthwork Transition Area Using the Ground Penetrating Radar in the Soft Ground Section)

  • 정국영;조영균;김성래
    • 한국지반환경공학회 논문집
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    • 제23권8호
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    • pp.17-22
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    • 2022
  • 공용 중에 연약지반의 침하로 발생된 교량 접속부의 단차 개선을 위해 도로관리기관에서는 지속적으로 덧씌우기를 실시하고 있다. 본 연구에서는 연약지반 내에 건설된 교량 9개소에 대해 접속부의 침하량을 추정하고자 1GHz 안테나를 차량에 탑재한 지표투과레이더 장비를 이용하였다. 포장 내부 조사가 가능한 지표투과레이더 기술로 아스팔트 도로에서 깊이 1m 수준까지 효과적으로 포장두께의 측정이 가능하였다. 노면 변형 조사결과와는 다르게, 9개 교량 접속부에서 측정된 포장두께 변화량은 최소 50mm에서 최대 600mm로 상당하였으며, 공동(空洞)의 발생 가능성도 높았다. 또한 각 교량 접속부의 부위별로는 증가된 포장두께의 차이가 50~250mm로 나타나 부등침하 위험이 존재하였다. 본 연구에서 지표투과레이더 결과에 근거하여 주행성 개선 및 침하부 유지관리 방안을 제시하였다.

지하박스구조물의 변위거동에 따른 손상영향 평가 (Evaluation on Damage Effect according Displacement Behavior of Underground Box Structure)

  • 최정열;안대희;한재민
    • 문화기술의 융합
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    • 제10권1호
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    • pp.565-570
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    • 2024
  • 최근 도시철도 주변으로 집중되는 신축건물 및 공동구 확장 등과 같은 인접굴착공사로 인해 지하에 건설된 도시철도 지하박스 및 터널구조물의 변형이 발생되고 이로인한 보수, 보강공사가 빈번하게 시행되고 있다. 또한 지하철은 대규모 수송을 담당하고 있어 지하구조물의 안전성 및 주행성에 대한 확보가 매우 중요하다. 이에 자동화계측 시스템을 도입하여 지하박스구조물에 대한 안전성을 관리하고 있다. 그러나 지하박스구조물의 침하 또는 융기 등에 의한 구조물 손상취약부에 대한 분석은 전무한 실정이다. 본 연구에서는 지하박스구조물의 안전성 모니터링을 위한 손상취약부를 분석하고자 한다. 또한 수치해석을 통해 지하박스구조물을 모델링하여 핵심 모니터링 위치를 분석하고자 한다. 따라서 향후 지하박스구조물의 안전성 모니터링을 위한 센서 설치 위치 및 손상 취약부를 제시하고자 한다.

디스플레이 응용을 위한 능동 제어형 전계 에미터 어레이의 회로 모델링 및 시뮬레이션 (Circuit Modeling and Simulation of Active Controlled Field Emitter Array for Display Application)

  • 이윤경;송윤호;유형준
    • 대한전자공학회논문지SD
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    • 제38권2호
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    • pp.114-121
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    • 2001
  • 능동제어형 전계방출 디스플레이의 전자공급원으로서 능동제어형 전계 에미터 어레이의 회로모델이 제안되었다. 능동제어형 전계 에미터 어레이는 전계방출을 안정화시키고 저전력구동을 위한 수소화 된 비정질 실리콘 박막 트랜지스터와 Spindt형 Mo 전계 에미터 어레이로 구성되었고 같은 유리기판 위에 제작되었다. 비정질 박막 트랜지스터와 Spindt형 Mo 전계 에미터 어레이의 전기적 특성으로부터 추출된 기본 모델 변수는 제안된 능동제어형 전계 에미터 어레이 회로모델에 입력되었고 SPICE 회로 시뮬레이터를 사용하여 특성을 분석하였다. 제작된 소자의 측정값과 DC 시뮬레이션 결과를 비교한 결과 두 값이 상당히 일치함으로써 등가회로 모델의 정확성을 확인하였다. 또한 제작된 소자의 transient 시뮬레이션 결과 전계 에미터 어레이의 게이트 커패시턴스와 TFT의 구동능력이 반응시간에 가장 크게 영향을 끼치고 있음을 확인하였다. 제작된 능동제어형 전계방출 에미터 어레이는 pulse width modulation으로 구동하는 경우 15㎲의 반응시간을 얻었고 이 값으로는 4bit/color의 계조(gray scale)표현이 가능하였다.

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광양지역 고강도 강관 항타말뚝의 설계효율 향상 방안 연구 (Design Efficiency Improvement Method Research for High Strength Steel Pipe Pile at Gwangyang Area)

  • 나승민;유한규
    • 대한토목학회논문집
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    • 제31권6C호
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    • pp.231-240
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    • 2011
  • 소재의 고강도화와 항타에너지 상향 반영에 따른 강관말뚝의 거동특성을 분석하기 위하여 광양지역에 다양한 지름과 소재별로 총 10본의 말뚝을 시공하여 동재하시험, 정재하시험, 하중전이시험 등의 다양한 현장재하시험을 수행하였다. 항타관입성을 분석한 결과, PHC말뚝이 가장 많은 항타횟수와 가장 적은 관입깊이를 나타냈으며 고강도 강관말뚝에서 가장 적은 항타횟수와 깊은 관입깊이를 확인할 수 있어 고항타에너지에 의한 효과를 파악할 수 있었다. 동재하시험결과를 말뚝별로 비교한 결과, PHC말뚝과 일반 강관말뚝의 경우에는 재료의 허용축하중이 말뚝의 설계허용지지력을 결정하는 주요 변수인 것을 확인한 반면에 고강도 강관말뚝에서는 지반의 지지력에 의해 말뚝의 설계허용지지력이 결정되는 것을 확인할 수 있었다. 정재하시험과 하중전이시험을 고강도 강관말뚝 2본에 대해서 수행한 결과, 말뚝의 설계효율을 80% 이상의 수준으로 향상할 수 있는 방안을 도출할 수 있었으며 이를 통해 소요 말뚝 본수 절감을 통한 공사비 절감이 가능함을 확인하였다. 대상 지역에서의 주면마찰력 set-up효과를 분석하여 적정 회귀식을 제시하였고 선단지지력에 대해서는 기존 설계식의 한계를 분석하여 향후 기술개발 방향을 제시할 수 있었다.