• 대한전자공학회논문지SD
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• 제39권7호
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• pp.57-65
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• 2002

본 논문에서는 CMOS로 구현된 2.5v 10-bit 300MSPS의 D/A 변환기를 제안하였다. 이를 위해 전체구조는 고속동작에 유리한 전류구동 방식의 8+2 분할 타입으로 상위 8-bit은 Thermometer Code 기법을 이용한 전류셀 매트릭스(Current Cell Matrix)로, 하위 2-bit은 이진 가중 전류열(Binary Weighted Current Array)로 설계하였다. 우수한 다이내믹 특성 및 고속 동작을 만족시키기 위해 낮은 글리치 에너지를 갖는 새로운 전류셀과 BDD(Binary Decision Diagram)에 의한 논리합성 기법을 활용한 새로운 역 Thermometer Decoder를 제안하였다. 제안된 DAC는 $0.25{\mu}m$, 1-Poly, 5-Metal, n-well CMOS 공정으로 제작되었으며, 유효 칩 면적은 $1.56mm^2$이고, 2.5V의 전원전압에서 84mW의 전력소모를 나타내었다. 모의실험 및 측정을 통해 최대 글리치 에너지는 0.9pVsec@fs=100MHz, 15pVsec@fs=300MHz로 나타났다. 또한 출력 주파수가 1MHz, 샘플링 주파수가 300MHz에서의 INL과 DNL은 약 ${\pm}$1.5LSB 이내로, SFDR은 45dB로 측정되었다.

• 한국인터넷방송통신학회논문지
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• 제16권2호
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• pp.151-155
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• 2016

우리는 이 논문에서 ADPCM (adaptive differential pulse code modulation)을 적용함으로써 디밍 콘트롤러를 갖는 LED 드라이버의 설계를 제시한다. ADPCM 장비는 고해상도를 가지고 LED 전류를 정확하게 제어하며, 고조파 전류 펄스의 퍼짐으로 인하여 초래되는 RFI 를 감소시켜 준다. 또한 제어 동작의 정밀도를 높여준다. 이 연구에서 LED에 펄스 전류를 인가함으로써 고효율 에너지의 LED를 제어하는 디지털 제어회로의 설계를 제시한다. 우리가 설계한 LED 전류구동시스템은 디지털 제어 부와 아날로그 SMPS (스위치 모드 파워 서플라이)를 별도로 구현한 두개의 시스템이다. 입력레벨이 0.7 인 경우의 시뮬레이션 결과는 시그마 델타 변조를 하여 얻은 D/A 컨버터의 출력을 나타내었다. 개수가 510 개인 펄스신호의 경우 0.15 % 의 정밀도를 얻을 수 있었다.

• 전자공학회논문지
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• 제52권5호
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• pp.58-65
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• 2015

본 논문에서는 신경 관련 인공 전자기기를 위한 신경 자극 집적회로를 $0.18-{\mu}m$ 표준 CMOS 반도체 공정을 이용하여 설계하였다. 제안 된 신경 자극 회로는 12.8-V 전원을 사용하면서 $10-k{\Omega}$의 부하에 최대 1 mA의 전류까지 전달이 가능하다. 표준 CMOS 공정 기술로 구현을 위해서 저전압 트랜지스터만을 이용하여 설계를 하였고, 고전압에서의 안정적인 동작을 위하여 트랜지스터 스태킹 기술을 적용하였다. 또한, 신경 자극 동작 후 전하 잔여량이 남아 있지 않도록 active charge balancing회로를 포함하였다. 제안 된 단일 채널 자극 집적회로의 경우 디지털-아날로그 변환기, 전류 출력 드라이버, 레벨 시프터, 디지털 제어 부분, 그리고 active charge balancing 회로까지 모두 포함하여 전체 칩 레이아웃 면적은 $0.13mm^2$을 차지하며, 다중 채널 방식의 신경 자극 기능의 체내 이식용 인공 전자기기 시스템에 적용을 하는데 적합하다.

• 한국콘텐츠학회논문지
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• 제7권1호
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• pp.116-123
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• 2007

본 논문은 OLED 패널 소스 구동회로에서 구동 전류의 크기와 폭을 조절하는 새로운 amplitude width modulation(AWM) 방식을 제안하였다. 기존의 소스 구동회로에서 pulse amplitude modulation(PAM) 방식은 DAC 회로 추가로 인해 크기가 커진다는 단점이 있고, pulse width modulation(PWM) 방식은 낮은 그레이 신호 레벨에서 발광 효율이 나쁜 단점이 있다. 이와 같은 단점을 개선하기 위해 본 논문에는 색상 데이터 비트의 MSB를 이용하여 구동 전류의 레벨을 제어하고, 데이터 비트의 LSB를 이용하여 구동 전류의 폭을 조정하는 구동방식을 제안하였다. 제안된 구동 방식은 $0.35-{\mu}m$ 3-poly 4-metal CMOS high voltage 공정을 사용하여 구현하였다. 시뮬레이션 결과는 제안된 AWM 구동 회로가 PAM 방식에 비해 회로 크기를 줄였고 신호 레벨이 낮은 영역에서 PAM과 거의 동일한 발광 효율을 얻었다.

• 한국정보통신학회논문지
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• 제9권5호
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• pp.1073-1081
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• 2005

본 논문은 상위 7비트와 하위 3비트의 segmented 전류원 구조로서 최적화 된 binary-thermal decoding 방식을 이용한 3.3v 10비트 CMOS D/A 변환기를 제안한다. segmeted 전류원 구조와 최적화 된 binary-thermal decoding 방식을 D/A 변환기가 지니므로 가질 수 있는 장점은 디코딩 논리회로의 복잡성을 단순화함으로 칩면적을 줄일 수 있다. 제안된 변환기는 0.35um CMOS n-well 표준공정을 이용하여 제작되었으며, 유효 칩면적은 $0.953mm^2$ 이다. 설계된 칩의 상승/하강시간, 정작시간 및 INL/DNL은 각각 1.92/2.1 ns, 12.71 ns, ${\pm}2.3/{\pm}0.58$ LSB로 나타났다. 또한 설계된 D/A 변환기는 3.3V의 공급전원에서는 224mW의 전력소모가 측정되었다.

• 전기전자학회논문지
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• 제27권1호
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• pp.12-18
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• 2023

각각의 큐빗(qubit)을 개별적으로 상온의 제어 회로에 연결하는 현재의 회로 기술은 양자 컴퓨터의 확장성, 신뢰성을 갖추는 데 있어 한계를 가지고 있으며, 집적도 측면에서 극저온의 CMOS 기술 기반 인터커넥트 회로 기술을 통해 기존 기술 대비 인터커넥트의 복잡도, 시스템 안정도 및 사이즈, 그리고 가격 경쟁력을 획기적으로 개선할 수 있을 것으로 기대되고 있다. 외부의 전기적 자극에 민감하며 양자 상태를 일정 시간 이상 유지할 수 없는 큐빗의 특성으로 인한 문제를 극복하고, 확장성과 신뢰성을 양자 컴퓨터 실현을 위한 CMOS 기술 기반 집적화된 센싱 및 제어 회로 기술에 대해 소개한다.

• 국제초고층학회논문집
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• 제12권2호
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• pp.121-128
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• 2023

Cities cover only 3% of the planet's surface, yet they are responsible for more than 75% of the global emissions. Given the projected urban built area will double by 2060, the carbon emitted from cities will further increase. SOM proposes the Urban Sequoia concept, for buildings that go beyond 'net zero' and absorb carbon from the atmosphere. This concept combines multiple strategies, including the use of an optimised building form with a highly efficient structural system, modularized prefabrication techniques, holistic integration of facade, MEP and interiors' components, bio-based materials, and Direct Air Capture (DAC) technology, to reduce a 40-storey building's whole life cycle carbon emissions by more than 300% over a 100-year lifespan. Calculations of embodied carbon emissions are performed with SOM's in-house Environmental Analysis (EA) Tool to demonstrate the effectiveness of employing Urban Sequoia's design strategies in the design of new buildings using current technologies.

• Journal of information and communication convergence engineering
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• 제10권2호
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• pp.187-193
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• 2012

A 1 GHz CMOS fast-lock phase-locked loop (PLL) is proposed to support the quick wake-up time of mobile consumer electronic devices. The proposed fast-lock PLL consists of a conventional charge-pump PLL, a frequency-to-digital converter (FDC) to measure the frequency of the input reference clock, and a digital-to-analog converter (DAC) to generate the initial control voltage of a voltage-controlled oscillator (VCO). The initial control voltage of the VCO is driven toward a reference voltage that is determined by the frequency of the input reference clock in the initial mode. For the speedy measurement of the frequency of the reference clock, an FDC with a parallel architecture is proposed, and its architecture is similar to that of a flash analog-to-digital converter. In addition, the frequency-to-voltage converter used in the FDC is designed simply by utilizing current integrators. The circuits for the proposed fast-lock scheme are disabled in the normal operation mode except in the initial mode to reduce the power consumption. The proposed PLL was fabricated by using a 0.18-${\mu}m$ 1-poly 6-metal complementary metal-oxide semiconductor (CMOS) process with a 1.8 V supply. This PLL multiplies the frequency of the reference clock by 10 and generates the four-phase clock. The simulation results show a reduction of up to 40% in the worstcase PLL lock time over the device operating conditions. The root-mean-square (rms) jitter of the proposed PLL was measured as 2.94 ps at 1 GHz. The area and power consumption of the implemented PLL are $400{\times}450{\mu}m^2$ and 6 mW, respectively.

• 전기학회논문지
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• 제67권12호
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• pp.1641-1647
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• 2018

In this paper, we describe a portable potentiostat which is capable of cyclic voltammetry(CV) and amperometry for electrochemical dissolved oxygen sensor. In addition, this portable potentiostat can also transmit the measured data wirelessly to android devices such as smart phone, tablet, etc. through Bluetooth. The potentiostat system consists of three parts; a voltage generator circuit which is controlled by Arduino nano and 12-bit DAC(digital to analog converter) to generate necessary electric potential for operating the electrochemical sensor, an oxidation/reduction current measurement circuit, and a Bluetooth module to transmit data wirelessly to an android device. Once measurements are carried out with the android application, the measured data is transmitted to the android device via Bluetooth and displayed using the android app. in real time. In this paper, we report the measured reduction current with a fabricated dissolved oxygen sensor in both saturated-oxygen state and zero-oxygen states. The results of the developed portable potentiostat system are in good agreement with those of the commercial portable potentiostat (${\mu}stat200$, Dropsens inc.). The measured peak reduction currents using the developed potentiostat and the commercial ${\mu}stat200$ potentiostat were $-0.755{\mu}A$ and $-0.724{\mu}A$, respectively. The reduction currents measured at zero-oxygen state were $-0.005{\mu}A$ and $-0.004{\mu}A$. The discrepancy between those two systems seems very small, which implies successful development of a portable and wireless potentionstat.

• 대한전자공학회논문지SD
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• 제48권12호
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• pp.91-96
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• 2011

본 논문에서는 전류 모드 동작에 기반한 IEEE 802.15.4 규격을 만족하는 2.4GHz 저전력 직접 변환 송신기를 제안하고 $0.13{\mu}m$ CMOS 공정을 이용하여 구현하였다. 제안된 송신기는 디지털-아날로그 변환기, 저역통과 필터, 가변 이득 I/Q 상향 혼합기, 구동 증폭기 및 LO 버퍼를 포함하는 주파수 나누기 2회로로 구성되어 있다. 디지털-아날로그 변환기와 저역통과 필터(LPF), 가변이득 I/Q 상향 혼합기의 트랜스컨덕터 단을 하나의 전류 미러 회로로 합친 간단한 구조를 제안하여 전력 소모를 줄이면서 선형성을 향상할 수 있도록 하였다. 구동 증폭기는 캐스코드 타입의 증폭기로 제어 신호를 이용하여 이득을 조절할 수 있게 하였고, 외부 4.8GHz 신호를 받아 주파수 나누기 2 전류 모드 로직 (CML) 회로를 사용하여 2.4GHz I/Q 차동 LO 신호를 생성하도록 설계하였다. 구현한 송신기는 30dB의 이득 조정 범위를 가지면서 0dBm의 최대 출력 신호에서 33dBc의 LO 누설 성분, 40dBc의 3차 하모닉 성분의 특성을 보이며, 구현한 칩의 면적은 $1.76mm{\times}1.26mm$으로 전력소모는 1.2V 단일 전원 전압으로부터 10.2mW이다.