• 제목/요약/키워드: channel bandwidth

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무선 ATM 전송을 위한 MC-CDMA 시스템의 성능 분석 (Performance Analysis of MC-CDMA Systmes for Wireless ATM)

  • 송형규;백종호;조진웅;동용배
    • 한국전자파학회논문지
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    • 제10권4호
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    • pp.487-497
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    • 1999
  • 본 논문에서는 무선 ATM 전송을 위한 MC-COMA 시스댐의 성능을 시융레이션을 통하여 분석하였다. 설 계된 MC-COMA 시스템은 5GHz 주파수대에서 약 18.2 MHz의 대역폭을 사용하여 25 Mbps의 데이터를 지원 하며, Wireless ATM Working Group(WATM WG)에서 제안한 무선 물리 계층의 규격을 만족한다. 채널 부 호화 방법으로서 컨볼루션 부호, TCM. 그리고 Turbo TCM(T-TCM)을 각각 적용하여 성능을 비교 분석한 다 실험 결과로부터 T-TCM을 적용한 경우. 반복 복호를 수행함에 따라 가장 우수한 성능을 보임을 알 수 였다.

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강화된 유전알고리즘을 이용한 제한된 대역폭을 가진 고정채널 할당 문제의 최적화 (Genetic Search for Fixed Channel Assignment Problem with Limited Bandwidth)

  • 박은종;김정환;문병로
    • 한국정보통신설비학회:학술대회논문집
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    • 한국정보통신설비학회 2004년도 하계학술대회
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    • pp.302-307
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    • 2004
  • 이 논문은 제한된 대역폭을 가진 고정 채널 할당 문제를 유전알고리즘을 이용하여 최적화하는 방법을 제시한다. 또한 이 논문에서는 유전알고리즘의 미세조정 능력 향상을 위해 지역 최적화 방법을 고안하였다. 고정채널 할당 문제를 행렬로 표현하여 지역 최적화 알고리즘에서는 채널을 수평 또는 수직으로 움직임으로써 유전 알고리즘의 성능 향상을 꾀한다. 제안된 방법은 기존의 방법보다 뛰어난 성능 향상을 나타냄을 실험결과에서 보일 것이다.

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정규화 포락선 검파기와 얼리-레이트 필터를 적용한 새로운 홉 타이밍 예측기 (A New Hop-Timing Estimator with a Normalized Envelop Detector and an Early-Late Filter)

  • 이주형
    • 한국통신학회논문지
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    • 제32권4C호
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    • pp.355-361
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    • 2007
  • 본 논문에서 정규화 포락선 검파 기법(NED ; Normalized Envelop Detection)과 얼리-레이트 필터(ELF ; Early-Late Filter)가 적용된 새로운 홉 타이밍 예측기를 제안하였다. 제안한 구조의 성능 검증을 위해 컴퓨터 시뮬레이션으로 제안한 시스템과 기존 시스템의 동기 오차 측정 결과를 비교하였다. 시뮬레이션 결과를 통해서 부분 대역 재밍 환경에서 제안 구조가 기존 구조보다 정확하게 동기오차를 예측하는 것을 확인할 수 있었으며, 이러한 경향은 $E_b/N_j$와 재밍점유대역비(rho)가 낮을수록 더욱 뚜렷하였다.

0.18㎛ CMOS 3.1Gb/s VCSEL Driver 코아 칩 설계 (Design of Core Chip for 3.1Gb/s VCSEL Driver in 0.18㎛ CMOS)

  • 양충열;이상수
    • 한국통신학회논문지
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    • 제38A권1호
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    • pp.88-95
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    • 2013
  • 본 논문에서는 $0.18{\mu}m$ CMOS 공정 기술을 이용하여 광트랜시버에 사용된 1550 nm 고속 VCSEL을 구동하는 드라이버 회로를 제안한다. 3.1Gb/s 데이터 속도에서 기존 구조에 비하여 향상된 대역폭, 이득 및 아이 다이어그램을 확인하였다. 본 논문에서는 다중채널 어레이 집적모듈을 갖는 광트랜시버에 응용하기 위한 3.1Gb/s VCSEL 드라이버의 설계 및 레이아웃을 확인한다.

Optimizing Fsync Performance with Dynamic Queue Depth Adaptation

  • Park, Daejun;Kim, Min Ji;Shin, Dongkun
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제15권5호
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    • pp.570-576
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    • 2015
  • Existing flash storage devices such as universal flash storage and solid state disk support command queuing to improve storage I/O bandwidth. Command queuing allows multiple read/write requests to be pending in a device queue. Because multi-channel and multi-way architecture of flash storage devices can handle multiple requests simultaneously, command queuing is an indispensable technique for utilizing parallel architecture. However, command queuing can be harmful to the latency of fsync system call, which is critical to application responsiveness. We propose a dynamic queue depth adaptation technique, which reduces the queue depth if user application is expected to send fsync calls. Experiments show that the proposed technique reduces the fsync latency by 79% on average compared to the original scheme.

모노폴 안테나를 이용한 전자파기반 진단장치 (Diagnosis Based on EM Using Monopole Antenna)

  • 이종문;김혁제;이윤주;손성호;전순익
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2008년도 하계종합학술대회
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    • pp.227-228
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    • 2008
  • A diagnosis based on EM is composed of multi-channel transceiver, antennas in illumination tank, liquid and image reconstruction algorithm for solving inverse scattering problem. The antennas in diagnosis were fabricated and measured in lossy liquid. The 10dB impedance bandwidth of the antenna is 600MHz - 3.5GHz

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인공위성용 2.8GHz 국부발전기에 관한 연구 (Development of a 2.8 GHz Local Oscillator for the Communication Satellite)

  • Seong Joon Kweon;Seong Kyu Lim;Sang Woong Lee;Keuk Whan Ra
    • 전자공학회논문지A
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    • 제31A권5호
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    • pp.58-67
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    • 1994
  • In this paper, It was designed the 2.8GHz local oscillator which convert 14.5 14.8GHz uplink frequency to 11.7 12.0GHz downlink frequency by the receiving mixer on the communication satellite transponder according to the rating of domestic satellite. Mukunghwa 1. To prevent the variation of the communication channel bandwidth, it needs a high stability and low phase noise characteristics. So we designed to get the target frequencey by multipling the output signal from the crystal oscillator. We got the simplicity of the circuit by manufacturing the X4 multiplier with transistor which is ordinarily used as a device of a below X3 multiplier for the efficiency.

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무선채널의 협대역화에 따른 변조방식 고찰 (A Survey on Modulation Methods for Narrow Bandwidth of Wireless Channel)

  • 박상영;이홍섭
    • 전자통신동향분석
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    • 제9권4호
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    • pp.131-138
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    • 1994
  • 최근 무선통신의 활성화에 따라, V/UHF(very/ultra high Frequency) 대역에서 한정된 주파수를 효율적으로 이용하기 위한 방법의 하나로서, 점차 점유 주파수 대역의 폭을 축소하여 보다 많은 이용자를 수용하도록 무선 채널의 협대역화가 추진되고 있다. 본 고에서는 먼저 V/UHF 대역 무선 통신에서 채널의 협대역화에 관련된 기술 중에서 현재까지 사용되고 있는 FM(frequency modulation), AM(amplitude modulation) 변조 방식의 장,단점을 살펴본후, 새로운 LM(linear modulation) 변조 방식에 대한 기술적 배경 및 특성을 알아보았다. LM은 SSR(single side band)-AM이 발전한 것으로서, TTIB(transparent tone-in-band), CLT(Cartesian loop transmitter), FFSR(feed-forward signal regeneration), DSP(digital signal processing)등 4가지의 기술이 결합하여 만들어진 것이다. LM 방식에 사용된 4가지 기술을 소개하고, 기존의 변조 방식에 비해 개선된 사항에 대해 서술한다.

A Novel M-ary Code-Selected Direct Sequence BPAM UWB Communication System

  • Bai, Zhiquan;Kwak, Kyung-Sup
    • ETRI Journal
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    • 제28권1호
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    • pp.95-98
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    • 2006
  • In this letter, a novel M-ary code-selected direct sequence (DS) ultra-wideband (UWB) communication system is presented. Our purpose is to achieve a high data rate by an M-ary code-selected direct sequence bipolar pulse amplitude modulation (MCSDS-BPAM) scheme. In this system, a particular DS code sequence is selected by the $log_2M$/2 bits from the DS gold code set. This scheme can accomplish both a high data rate without increasing the system bandwidth or changing the pulse shape and improve the BER with an increase of modulation level M even at a lower signal-to-noise ratio (SNR). The receiver signal processing algorithm is given for an MCSDS-BPAM UWB system over an ideal AWGN channel and correlation receivers.

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멀티링 설계규칙검사를 위한 효과적인 하드웨어 가속기 (MultiRing An Efficient Hardware Accelerator for Design Rule Checking)

  • 노길수;경종민
    • 대한전자공학회논문지
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    • 제24권6호
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    • pp.1040-1048
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    • 1987
  • We propose a hardware architecture called Multiring which is applicable for various geometrical operations on rectilinear objects such as design rule checking in VLSI layout and many image processing operations including noise suppression and coutour extraction. It has both a fast execution speed and extremely high flexibility. The whole architecture is mainly divided into four parts` I/O between host and Multiring, ring memory, linear processor array and instruction decoder. Data transmission between host and Multiring is bit serial thereby reducing the bandwidth requirement for teh channel and the number of external pins, while each row data in the bit map stored in ring memory is processed in the corresponding processor in full parallelism. Each processor is simultaneously configured by the instruction decoder/controller to perform one of the 16 basic instructions such as Boolean (AND, OR, NOT, and Copy), geometrical(Expand and Shrink), and I/O operations each ring cycle, which gives Multiring maximal flexibility in terms of design rule change or the instruction set enhancement. Correct functional behavior of Multiring was confirmed by successfully running a software simulator having one-to-one structural correspondence to the Multiring hardware.

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