Journal of electromagnetic engineering and science
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제9권3호
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pp.152-158
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2009
We have developed a novel digital feedback predistortion(DFBPD) linearization based on RF feedback PD for the wide bandwidth modulated signals. The wideband PD operation is carried out by combining the DFBPD and memory lookup table(LUT). To experimentally demonstrate the linearization performance of the proposed PD technique for wideband signal, a class-AB amplifier using an LDMOSFET MRF6S23140 with 140-W peak envelope power is employed at 2.345 GHz. For a forward-link 2FA wideband code-division multiple-access signal with 10 MHz carrier spacing, the proposed DFBPD with memory LUT delivers the adjacent channel leakage ratio at an 10 MHz offset of -56.8 dBc, while those of the amplifier with and without DFBPD are -43.2 dBc and -41.9 dBc, respectively, at an average output power of 40 dBm. The experimental result shows that the new DFBPD with memory LUT provides a good linearization performance for the signal with wide bandwidth.
As the demand for higher data-rate chip-to-chip communication such as memory-to-controller, processor-to-processor increases, low cost high-speed serial links\ulcorner become more attractive. This paper describes a 0.25-fm CMOS 1.6Gbps/pin 4-level transceiver using Stub Series Terminated Logic for high Bandwidth. For multi-gigabit/second application, the data rate is limited by Inter-Symbol Interference (ISI) caused by channel low pass effects, process-limited on-chip clock frequency, and serial link distance. The proposed transceiver uses multi-level signaling (4-level Pulse Amplitude Modulation) using push-pull type, double data rate and flash sampling. To reduce Process-Voltage-Temperature Variation and ISI including data dependency skew, the proposed high-speed calibration circuits with voltage swing controller, data linearity controller and slew rate controller maintains desirable output waveform and makes less sensitive output. In order to detect successfully the transmitted 1.6Gbps/pin 4-level data, the receiver is designed as simultaneous type with a kick - back noise-isolated reference voltage line structure and a 3-stage Gate-Isolated sense amplifier. The transceiver, which was fabricated using a 0.25 fm CMOS process, performs data rate of 1.6 ~ 2.0 Gbps/pin with a 400MHB internal clock, Stub Series Terminated Logic ever in 2.25 ~ 2.75V supply voltage. and occupied 500 * 6001m of area.
본 논문에서는 나카가미-m 페이딩 채널에서 정규화된 부반송파의 간격에 따라 구분되는 직교 MC DS- CDMA 시스템과 오브래핑 되지 않는 MC DS-CDMA시스템을 분석하였다. 다중 반송파 시스템에서 발생하는 선택 경로수를 줄이기 위하여 Hybrid SC/MRC 방식이 적용되어 MRC 방식을 사용한 경우와 비교 분석하였다. 분석 결과, Hybrid SC/MRC 방식을 MRC 방식으로 대체할 수 있으며, 주어진 대역폭이 고정되어 있는 경우 부반송파의 수를 증가시키면 부반송파 간격이 증가하고 필요한 대역폭이 더 많이 필요함으로 부반송파의 수는 주어진 대역폭을 고려하여 선택하여야함을 확인하였다.
This paper presents a novel 16-quadrature-amplitude-modulation (QAM) E-band communication system. The system can deliver 10 Gbps through eight channels with a bandwidth of 5 GHz (71-76 GHz/81-86 GHz). Each channel occupies 390 MHz and delivers 1.25 Gbps using a 16-QAM. Thus, this system can achieve a bandwidth efficiency of 3.2 bit/s/Hz. To implement the system, a driver amplifier and an RF up-/down-conversion mixer are implemented using a $0.1{\mu}m$ gallium arsenide pseudomorphic high-electron-mobility transistor (GaAs pHEMT) process. A single-IF architecture is chosen for the RF receiver. In the digital modem, 24 square root raised cosine filters and four (255, 239) Reed-Solomon forward error correction codecs are used in parallel. The modem can compensate for a carrier-frequency offset of up to 50 ppm and a symbol rate offset of up to 1 ppm. Experiment results show that the system can achieve a bit error rate of $10^{-5}$ at a signal-to-noise ratio of about 21.5 dB.
본 논문에서는 주파수 대역을 효과적으로 이용하기 위한 16-QAM과 49-QPR 시스템을 실현하였으며, 구형대역 특성을 갖는 저역통과필터 대신에 raised-cosine 필터를 사용하여 오율과 ISI를 고찰하였다. 주파수 대역을 제한하기 위해 raised-cosine 필터를 사용하면 임의의 스펙트럴 효율을 얻는데 필요한 SNR 을 감소시킬 수 있다. 이를 실험적으로 측정한 결과 49-QPR 시스템의 대역폭 효율이 roll-off계수 a가 각각 0.5. 1을 갖는 경우 16-QAM의 대역폭 효율보다 약 8%와 15%가 향상되었다. 또한 AWGN과 ISI가 존재하는 경우 49-QPR 시스템의 성능해석을 위한 눈그림과 오율식을 유도하였으며, 이들 16-QAM 시스템의 경우와 비교하였다.
Seo, Yongho;Cho, Youngkyun;Choi, Seong Gon;Kim, Changwan
ETRI Journal
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제36권6호
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pp.924-930
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2014
This paper presents a $0.13{\mu}m$ CMOS 3-level envelope delta-sigma modulation (EDSM) RF signal generator, which synthesizes a 2.6 GHz-centered fully symmetrical 3-level EDSM signal for high-efficiency power amplifier architectures. It consists of an I-Q phase modulator, a Class B wideband buffer, an up-conversion mixer, a D2S, and a Class AB wideband drive amplifier. To preserve fast phase transition in the 3-state envelope level, the wideband buffer has an RLC load and the driver amplifier uses a second-order BPF as its load to provide enough bandwidth. To achieve an accurate 3-state envelope level in the up-mixer output, the LO bias level is optimized. The I-Q phase modulator adopts a modified quadrature passive mixer topology and mitigates the I-Q crosstalk problem using a 50% duty cycle in LO clocks. The fabricated chip provides an average output power of -1.5 dBm and an error vector magnitude (EVM) of 3.89% for 3GPP LTE 64 QAM input signals with a channel bandwidth of 10/20 MHz, as well as consuming 60 mW for both channels from a 1.2 V/2.5 V supply voltage.
Simoens, Pieter;Ali, Farhan Azmat;Vankeirsbilck, Bert;Deboosere, Lien;Turck, Filip De;Dhoedt, Bart;Demeester, Piet;Torrea-Duran, Rodolfo;Perre, Liesbet Van der;Dejonghe, Antoine
Journal of Communications and Networks
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제14권1호
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pp.75-90
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2012
Thin client computing trades local processing for network bandwidth consumption by offloading application logic to remote servers. User input and display updates are exchanged between client and server through a thin client protocol. On wireless devices, the thin client protocol traffic can lead to a significantly higher power consumption of the radio interface. In this article, a cross-layer framework is presented that transitions the wireless network interface card (WNIC) to the energy-conserving sleep mode when no traffic from the server is expected. The approach is validated for different wireless channel conditions, such as path loss and available bandwidth, as well as for different network roundtrip time values. Using this cross-layer algorithm for sample scenario with a remote text editor, and through experiments based on actual user traces, a reduction of the WNIC energy consumption of up to 36.82% is obtained, without degrading the application's reactivity.
1차원 클러스터 기반의 시퀀스 등화기(1-D CBSE)는 시퀀스 등화기(MLSE)가 갖는 계산상의 복잡성을 효율적으로 해결하고 비선형 채널에서의 뛰어난 성능 개선을 가져온다. 본 논문에서는 다중 경로 페이딩 채널 추정에 대응하는 1-D CBSE의 클러스터 중심을 추정하기 위한 향상된 훈련 시퀀스 구성 기법을 제안하였다. 새로이 제안된 등화기는 기존의 방식에서 갖는 문제점을 해결하고, 보다 짧은 길이의 훈련 시퀀스를 이용함으로써 대역폭 효율을 증대시키는 향상된 결과를 가져왔다. 제안된 알고리즘의 우수성은, 기존의 방법과 제안된 최적의 훈련시퀀스를 적용한 1-D클러스터 기반의 새로운 중심 추정을 통한 방법을 비교를 통하여 보였다. 특히, 컴퓨터 시뮬레이션에 의한 심볼 에러율(SER)에 기반을 둔 비교 분석을 통하여 살펴보았다.
For the purpose of providing high data rate real-time services, radio transmission technologies (RTT) for ship ad-hoc network (SANET) based on the Recommendation ITU-R 1842-1 are designed. Physical layer parameters of SANET are contrived to meet the requirements of the specification. In order to improve the link reliability for SANET, in this paper, we investigate the performance of the SANET with the multiple antennas, where receive combining (RC), transmit diversity (TD), and beamforming (BF) are employed, respectively. Based on the analysis of the packet error rate (PER) under the highly correlated maritime wireless channel model, we select the efficient multiple antenna schemes for SANET to improve the link reliability. In addition, the optimal MCS levels for the single-carrier (SC) SANET with the bandwidth of 25 kHz, and the multi-carrier (MC) SANET with the bandwidth of 50 kHz and 100 kHz are finalized.
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[게시일 2004년 10월 1일]
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