An analysis of the relationship between a linear amplifier chain and an analog-to-digital converter(ADC) in a digital microwave widevand receiver, with respect to sensitivity and dynamic range issues, is presented. The effects of gain, third-order intermodulation products and ADC characteristics on the performance of the receiver are illustrated and design criteria for the linear amplifier chain given a specified ADC are developed. A computer program is used to calculate theretical receiver performance based on gain and third-order intermodulation product selections. Simulated results are also presented and compared with theoretical values.
This paper presents a compensation method of unbalanced phase currents in interleaved bi-directional converters. Phase currents in interleaved bi-directional converter are apt to be unbalanced due to circuit parameter error and switch operation difference. This problem causes the switch element failure and the reduced efficiency of the converter. Therefore, it is necessary that a certain balance control algorithm is provided in interleaved bi-directional converter system. In this paper, a balance control algorithm based on the circular chain control method is proposed. Further, in order to reduce the number of phase current sensors, this paper shows a simple method in which phase currents can be extracted indirectly through a DC-link current sensor in both charging and discharging modes. The validity and the effectiveness of the proposed phase currents balance control algorithm are illustrated through the simulation results.
본 논문은 절대 시간 측정 가능한 시간 디지털 변환기에 대한 논문으로 제안하는 시간 디지털 변환기는 0.18-um CMOS 공정을 이용하여 설계 되었고 IC로 제작하여 검증하였다. 설계된 시간 디지털 변환기는 라이다 시스템에 적용하기 위하여 긴 측정시간과 절대적인 50ps를 측정할 수 있어야하는데 위상고정루프의 625MHz 클록을 기준클록으로 사용하기 때문에 절대시간의 측정이 가능하며 디지털 보정회로를 이용하여 어떤 상황에서 든 50ps의 분해능을 가질 수 있다. 기준클록을 카운터하여 큰 시간 단위의 측정을 할 수 있어 최대 800ns의 시간이 측정가능하고 딜레이 체인을 이용하여 정밀한 시간 값을 측정 할 수 있다. 결과적으로 제작된 시간 디지털 변환기는 50ps 단위로 시간을 측정할 수 있는데 최대 오차는 INL 0.8-LSB정도이며 1.8V 인가전압에 전력 소모는 약 70mW 정도이다.
부유식 파력발전시스템의 필수요소인 계류시스템에 관한 초기 설계를 수행하였다. 국내 외에서 개발된 부유식 파력발전장치용 계류시스템 사례를 살펴보았으며, 계류시스템 구성 요소에 대하여 분석하였다. 계류시스템의 요소인 앵커와 계류선에 대하여 초기 설계를 수행하였는데, 계류선은 주로 해저면 위에 얹혀 있는 고중량 부분과 부체에 매달려 있는 저중량 부분으로 나누었다. 앵커와 연결되어서 주로 해저면 부근에 있는 일부분은 고중량 체인을 사용함으로써, 부체로부터 전달되는 강제가진에 의한 동적에너지를 감쇠시킬 수 있으며, 앵커의 중량과 부피를 줄일 수 있다. 또한 체인의 모든 부분이 해저면 위로부터로 들려 올려질 경우 앵커에는 수평력과 수직력이 작용하여 앵커의 지지력이 감소하게 되는데, 고중량 체인을 앵커 부근에 배치함으로써 이를 방지할 수 있을 것이다. 부체와 해저면 사이에 매달리는 부분은 저중량 체인을 사용함으로써, 체인의 자중과 거동이 부체의 에너지 생산 기능에 영향을 최소로 미치게 할 수 있을 것이다. 초기 설계된 계류시스템 모델의 안전성 평가를 위하여 정적 및 거동 해석을 수행하였다. 태풍 등의 열악한 해양환경 조건에서 앵커 부근의 체인 장력도 앵커의 지지력을 초과하여 설계된 앵커는 수평 이동되어 기능을 수행하지 못하게 될 것으로 예측되었다. 따라서, 앵커는 중량을 증가시키거나 지지력을 증대시킬 수 있는 방안이 강구되어야 할 것이다. 본 연구 결과는 향후 기능성과 안전성을 만족시키는 계류시스템의 상세 설계를 위한 자료로 이용될 수 있을 것으로 기대된다.
This paper proposes the control method of MPPT(maximum power point tracking) for the wind energy generation system using the duty ratio control of boost type DC-DC converter. For a lower cost and a higher reliability, the wind and the generator velocity sensors are removed. MPPT control is implemented by changing the duty ratio of the boost converter. Chain rule is applied by using each function. The grid side inverter is controlled to regulate unity power factor. The proposed control method was analyzed mathematically and verified by the computer simulation using PSIM.
Journal of information and communication convergence engineering
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제13권4호
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pp.235-240
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2015
A decimation chain for multi-standard reconfigurable radios is presented for 900-MHz and 1,900-MHz dual-band cellular standards with a data interpolator based on the Lagrange method for adjusting the variable data rate to a fixed data rate appropriate for each standard. The two proposed configurations are analyzed and compared to provide insight into aliasing and the signal bandwidth by means of a newly introduced measure called interpolation error. The average interpolation error is reduced as the ratio of the sampling frequency to the signal BW is increased. The decimation chain and the multi-rate analog-to-digital converter are simulated to compute the interpolation error and the output signal-to-noise ratio. Further, a method to operate the above-mentioned chain under a compressed mode of operation is proposed in order to guarantee continuous packet connectivity for inter-radio-access technologies. The presented decimation chain can be applied to LTE, WCDMA, GSM multi-mode multi-band digital front-end which will ultimately lead to the software-defined radio.
Jaewon Kim;Jin Ho Jung;Yong Choi;Jiwoong Jung;Sangwon Lee
Nuclear Engineering and Technology
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제55권2호
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pp.484-492
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2023
Time-to-digital converters (TDCs) based on the tapped delay line (TDL) architecture have been widely used in various applications requiring a precise time measurement. However, the poor uniformity of the propagation delays in the TDL implemented on FPGA leads to bubble error and large nonlinearity of the TDC. The purpose of this study was to develop an advanced TDC architecture capable of minimizing the bubble errors and improving the linearity. To remove the bubble errors, the decimated delay line (DDL) architecture was implemented on the UltraScale + FPGA; meanwhile, to improve the linearity of the TDC, a histogram uniformization (HU) and multi-chain TDL (MCT) methods were developed and implemented on the FPGA. The integral nonlinearities (INLs) and differential nonlinearities (DNLs) of the plain TDCs with the 'HU method' (HU TDC) and with 'both HU and MCT methods' (HU-MCT TDC) were measured and compared to those of the TDC with 'DDL alone' (plain TDC). The linearity of HU-MCT TDC were superior to those of the plain TDC and HU TDC. The experiment results indicated that HU-MCT TDC developed in this study was useful for improving the linearity of the TDC, which allowed for high timing resolution to be achieved.
본 논문에서는 중$\cdot$대용량급을 위한 전압원 인버터의 출력전압 파형을 개선하기 위한 새로운 3상 전압원 인버터를 제안한다. 보조회로로서 사용한 Chain 컨버터로 리플전압을 발생시키고 이를 기존의 12-스? 인버터에 주입하는데 한 대의 링크를 사용하면 12-스? 동작이 36-스?으로 또한 두 대의 링크를 사용하면 60-스?으로 전환된다. 시뮬레이션을 통하여 본 방식의 타당성을 입증하였고 최종논문에서는 실험결과를 제시하고자 한다.
Field programmable gate array 기반 시간-디지털 변환기(Time to Digital Converter)로 가장 널리 사용되는 딜레이 라인(tapped delay line) 방식은 딜레이 라인의 길이가 길어지면 정확도가 떨어지는 단점이 있다. 이에 본 논문에서는 동일한 시간 해상도를 가지면서 딜레이 라인의 길이를 줄일 수 있도록 4 위상 클럭을 사용하고 이중 상태 판별 제어부를 가지는 시간-디지털 변환기 구조를 제안한다. 4 위상 클럭 별로 딜레이 라인 구성 시 발생하는 라인 간 딜레이 오차를 줄이기 위해 입력신호와 가장 가까운 클럭과의 시간 차이만 하나의 딜레이 라인으로 측정하고 어떤 위상 클럭이 사용되었는지를 판별하는 구조를 가졌다. 또한 싱크로나이저 대신 이중 상태 측정 state machine을 이용하여 메타스태이블을 판별함으로써, 싱크로나이저로 인한 딜레이 라인의 증가를 억제하였다. 제안한 시간-디지털 변환기(TDC)의 성능 측정 결과 1 ms의 측정 시간 범위에 대해 평균 분해능 22 ps, 최대 표준편차 90 ps을 가지며 비선형성은 25 ps였다.
Kim, Joouk;Hwang, Sunwoo;Lee, Jae-Bum;Kim, Youngmin
International Journal of Internet, Broadcasting and Communication
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제14권2호
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pp.79-88
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2022
Recently, securing stable supply of fresh food is deemed as one of the important tasks. Accordingly, now the presence of cold chain along with the needs of a comfortable and healthy life is growing as the online market expands and the contactless industry grows, however, cold chain is being studied only in the aspect of ground and sea transportation. And, due to global warming and strengthening global environmental regulations, we believe that it is necessary to convert the existing road-centered logistics system into a railway-centered logistics system, a low-carbon transportation means. Therefore, in this paper we calculated the maximum energy required by the reefer container as a basic research necessary for constructing the low temperature distribution and cold chain based on the reefer container railway, and conducted a study on methods of supplying the reefer container power utilizing 1. tramline, 2. battery, 3. generator. The results of this paper can be utilized as a foundational study for building a cold chain based on a reefer container dedicated to freight trains in the future.
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[게시일 2004년 10월 1일]
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