• 제목/요약/키워드: cell library

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극소형 전자기계장치에 관한 연구전망

  • 양상식
    • 전기의세계
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    • 제39권6호
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    • pp.14-19
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    • 1990
  • 1. CAD system과 PROPS를 접속하여 CADsystem에서 Design된 surface를 사용할 수 있으며 Robot Kinematics를 graphic library화하여 surface배치 수상 및 path generation 및 animation을 통하여 가공작업을 위한 로보트 운동을 simulation할 수 있게 되었다. 2. Denavit-hartenberg transformation form에 의해 여러 Robot Kinematic을 일반적인 형식으로 library화 하였다. 3. 금형 가공의 공정들을 Menu로 만들어서 Expert system을 도입, 손쉽게 Interactive한 작업을 할 수 있게 하였다. 4. 차후의 연구 목표는 로보트 Calibration S/W의 개발 및 실현 그리고 Expert System을 이용한 Robot Program Generator의 완성을 통한 전체 Off-line programming System을 정립하는데 있다. 이를 위해서 더 실제적인 Tool Path Generation과 Expert System을 이용한 가공 조건의 결정 및 User Interface를 위한 Window가 개발되어야 한다. 5. 1차년도에 개발된 Robotonomic Tool System의 유연성을 확장시킨다. 실험결과를 바탕으로 공정 자동화 시스템을 확장시킨다. 6. 연마공정자동화에 필수적인 공구 및 공구 Tip의 표준화 및 자동교환장치를 개발한다. 7. 금형연마 Cell의 구성요소들간의 Interface 및 System Controller에서의 집적화를 시킨다.

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Design and Implementation of the Systolic Array for Dynamic Programming

  • Lee, Jae-Jin;Tien, David;Song, Gi-Yong
    • 융합신호처리학회논문지
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    • 제4권3호
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    • pp.61-67
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    • 2003
  • We propose a systolic array for dynamic programming which is a technique for solving combinatorial optimization problems. We derive a systolic array for single source shortest path Problem, SA SSSP, and then show that the systolic array serves as dynamic Programming systolic array which is applicable to any dynamic programming problem by developing a systolic array for 0 1 knapsack problem, SA 01KS, with SA SSSP for a basis. In this paper, each of SA SSSP and SA 01KS is modeled and simulated in RT level using VHDL, then synthesized to a schematic and finally implemented to a layout using the cell library based on 0.35${\mu}{\textrm}{m}$ 1 poly 4 metal CMOS technology.

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IP module를 위한 UART의 VLSI 설계 (VLSI design of a UART for IP module)

  • 박성일;최병윤
    • 한국멀티미디어학회:학술대회논문집
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    • 한국멀티미디어학회 2002년도 춘계학술발표논문집(상)
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    • pp.1-5
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    • 2002
  • 본 논문에서는 UART(Universal Asynchronous Receiver-Transmitter)를 soft IP(Intellectual Property) 모듈 형태로써 VLSI 설계과정을 통하여 구현하였다. 이 모듈은 현재 각종 통신 디바이스에서 최하 말단에서 직렬 데이터를 시스템으로 받아들이거나 병렬 데이터를 직렬 라인에 실어 보내는 중요한 역할을 담당한다. 본 연구에서 설계한 UART는 간단한 모듈 형태로 제작되어 있어 Verilog-HDL을 사용하여 직렬 송ㆍ수신을 필요로 하는 시스템에 내장되어 사용될 수 있다. 본 논문에서는 설계 순서에 따라 UART를 설계하고 Simulation을 하고 Synopsys Tool을 사용하여 Compile 과 Synthesis 후 Gate Area 와 Belay를 검출해 내었다. 합성결과 0.25$\mu$m 공정의 CMOS Cell Library를 사용하였을 경우 전체 면적은 1,013 gate가 나왔다. 본 논문에서 설계한 UART의 최장경로가 최대 4.12ns로 나타났으며, 최대 동작 클럭 주파수는 200MHz 로써 150Mbps 이상의 전송 속도를 가진다.

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Design of Pipelined Floating-Point Arithmetic Unit for Mobile 3D Graphics Applications

  • Choi, Byeong-Yoon;Ha, Chang-Soo;Lee, Jong-Hyoung;Salclc, Zoran;Lee, Duck-Myung
    • 한국멀티미디어학회논문지
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    • 제11권6호
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    • pp.816-827
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    • 2008
  • In this paper, two-stage pipelined floating-point arithmetic unit (FP-AU) is designed. The FP-AU processor supports seventeen operations to apply 3D graphics processor and has area-efficient and low-latency architecture that makes use of modified dual-path computation scheme, new normalization circuit, and modified compound adder based on flagged prefix adder. The FP-AU has about 4-ns delay time at logic synthesis condition using $0.18{\mu}m$ CMOS standard cell library and consists of about 5,930 gates. Because it has 250 MFLOPS execution rate and supports saturated arithmetic including a number of graphics-oriented operations, it is applicable to mobile 3D graphics accelerator efficiently.

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Potent Inhibition of Human Telomerase by Small Chemical Compounds

  • Kim, Joo-Hee;Kim, Jun-Hyun;Lee, Gun-Eui;Chung, In-Kwon
    • 대한약학회:학술대회논문집
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    • 대한약학회 2003년도 Proceedings of the Convention of the Pharmaceutical Society of Korea Vol.2-1
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    • pp.96-96
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    • 2003
  • Telomerase activity is expressed in most types of cancer cells but not in normal somatic cells, suggesting that telomerase may be an important target for cancer chemotherapy. Inhibition of telomerase results in telomere erosion leading to the subsequent growth-arrest of cancer cells followed by senescence or cell death. In this study, we screened a chemical library for inhibition of human telomerase, identifying two groups of inhibitors. (omitted)

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근세포 분화 조절에 관련된 특이 유전자에 관한 연구 (Studies on Specific Genes Related to the Regulation of Muscle Cell Differentiation)

  • 강성구;김상해
    • 한국동물학회지
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    • 제35권3호
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    • pp.287-294
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    • 1992
  • 배양 중의 골격근 세포는 증식을 거쳐 세포융합을 통해 다핵세포로 분화되므로 세포분화의 연구에 좋은 모델로서 이용되고 있다. 이전 실험에서 근원세포 융합을 억제하는 단일클론항체(MII-3J31)가 제작되었으며(Kim et al., 1992)이 항체에 대한 항원은 분자량이 약 35 kDa인 세포막 단백질로 추정되었다. 본 실험에서는 13일 계배와 성체의 근섬유 mRNA에서 CDNA라이브러리를 제작하여 근원세포 분화에 특이적으로 나타나는 유전자를 추적하였다. 근원세포 융합에 관여하는 단백질에 대한 CDNA는 계배 13일 째의 근원세포 CDNA라이브러리에서 단일클론항체를 사용한 immunoscreening 방법을 이용하여 확인하였다. 이 CDNA의 크기는 약 1.5 kb였다. 한편 13일 계배와성체 근섬유 CDNA 라이브러 리를 이용하여 13일 계배에만 특이하게 유전자 발현 이 일어 나고 성체에서는 나타나지 않는 약 0.8 kb의 CDNA플 찾았다.

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영상의 깜박거림 현상을 최소화하기 위한 순환 루프 필터의 설계 (Design of IIR Loop Filter to minimize A flick Phenomenon of An image)

  • O. Moon;Lee, B.;Lee, H.;Lee, Y.;B. Kang;C. Hong
    • 융합신호처리학회 학술대회논문집
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    • 한국신호처리시스템학회 2000년도 추계종합학술대회논문집
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    • pp.165-168
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    • 2000
  • In this paper, we propose a method, an optimized architecture of a device with an image signal process of a field unit to minimize the flick phenomenon that happens in direction of a color temperature at a color tone change. The proposed IIR loop filter has an optimized architecture and reduced hardware compared with previous filters. In order to achieve the optimization for the hardware complexity. It is designed by time-multiplexing architecture. The proposed IIR loop filter is synthesized by using the STD90 0.35um cell library.

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Cloning and Heterologous Expression of Acetyl Xylan Esterase from Aspergillus ficuum

  • 정혜종;박승문;양문식;김대혁
    • 한국생물공학회:학술대회논문집
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    • 한국생물공학회 2000년도 춘계학술발표대회
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    • pp.153-156
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    • 2000
  • 1. A. ficuum의 genomic library 검색을 통해 Axe 유전자를 포함하고 있는 5.0 kb의 XbaI DNA 절편을 cloning 했다. Cloning 된 절편의 부분 염기서열 결정 결과 약 1.4 kb의 AXE coding 부위를 확인했으며, cDNA cloning과 그 염기서열의 결정을 통해 AXE coding 부위 내에는 두 개의 intron 이 존재함이 확인되었다. 2. AXE coding 부위의 아미노산 잔기 서열 검색 결과 A. awamori의 AXE와 약 92%의 상동성과 95%의 유사성이 있음이 확인 되었다. 3. 약 900 kb의 AXE의 cDNA를 yeast의 YEp352 vector의 GAL1 promoter의 전사 방향으로 cloning한 후 발현시킨 결과 형질전환체에서 acetyl esterase 활성을 확인했으며, 활성도는 숙주균주에 비해 약 4-5배의 높은 OD unit로 나타내는 것을 확인할 수 있었다.

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Carotenoid Intake and Esophageal Cancer Risk: a Meta-analysis

  • Ge, Xiao-Xiao;Xing, Mei-Yuan;Yu, Lan-Fang;Shen, Peng
    • Asian Pacific Journal of Cancer Prevention
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    • 제14권3호
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    • pp.1911-1918
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    • 2013
  • This meta-analysis was conducted to evaluate the association between intake of carotenoids and risk of esophageal cancer. A systematic search using PubMed, Cochrane Library, Web of Science, Scopus, CNKI, and CBM (updated to 6 May 2012) identified ten articles meeting the inclusion criteria with 1,958 cases of esophageal cancer and 4,529 controls. Higher intake of beta-carotene, alpha-carotene, lycopene, beta-cryptoxanthin, lutein, and zeaxanthin reduced esophageal cancer risk with pooled ORs of 0.58 (95% CI 0.44, 0.77), 0.81 (95% CI 0.70, 0.94), 0.75 (95% CI 0.64, 0.86), 0.80 (95% CI 0.66, 0.97), and 0.71 (95% CI 0.59, 0.87), respectively. In subgroup analyses, beta-carotene showed protective effects against esophageal adenocarcinoma in studies located in Europe and North America. Alpha-carotene, lycopene, and beta-cryptoxanthin showed protection against esophageal squamous cell cancer. This meta-analysis suggested that higher intake of carotenoids (beta-carotene, alpha-carotene, lycopene, beta-cryptoxanthin, lutein, and zeaxanthin) is associated with lower risk of esophageal cancer. Further research with large-sample studies need to be conducted to better clarify the potentially protective mechanisms of carotenoid associations risk of different types of esophageal cancer.

차세대 ASIC 라이브러리를 위한 고속 저전력 조건 선택 덧셈기/뺄셈기의 설계 (Design of a Low Power High Speed Conditional Select Adder/Subtracter for Next Generation ASIC Library)

  • 조기선;송민규
    • 대한전자공학회논문지SD
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    • 제37권11호
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    • pp.59-66
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    • 2000
  • 본 논문에서는 DSP에서 필수적인 고속 저 전력 조건 선택 덧셈기/뺄셈기의 마크로 셀 라이브러리를 설계, 구축하였다. 덧셈기의 Carry전달 지연 시간을 최소로 하기 위한 CLA 기법과 연산 가능한 모든 결과 값을 미리 계산한 후 선택하는 조건 선택 기법을 적용하였다. 또한 이러한 설계방법이 8비트에서 64비트까지 자동 생성될 수 있도록 전용 프로그램을 작성하고 셀 기반 설계기법을 도입하여 Auto P&R Tool과 연계하여 자동으로 레이아웃이 가능하도록 하였다. 제안된 덧셈기/뺄셈기는 0.25${\mu}m$, 1-Poly, 5-Metal, N-well CMOS 공정을 사용하여 제작되었으며, 2.5V 단일 공급전압에서 지연시간, 소모 전력을 측정하였다. 측정결과 32 비트 덧셈기/뺄셈기의 경우 3.43ns의 지연시간과 42.8${\mu}w$/MHz의 전력소비를 나타내었다.

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