An effective Carrier-Based PWM scheme that enables the instantaneous quality of each branch point voltage of a diode clamped 4-level inverter to be reduced at a low modulation index is described. This scheme presents a computed zero sequence voltage of PWM by the feedback of both DC-link voltages and load currents. The proposed PWM scheme enables to increase the controllable region of DC-link voltage and makes it possible to operate with small DC-link capacitors. The validity of the proposed PWM scheme is verified by simulation results.
Reddy, M. Harsha Vardhan;Reddy, T. Bramhananda;Reddy, B. Ravindranath;Suryakalavathi, M.
Journal of Power Electronics
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v.15
no.6
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pp.1524-1532
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2015
Conventional space vector pulse width modulation based asymmetrical dual inverter configuration produces high common mode voltage (CMV) variations. This CMV causes the flow of common mode current, which adversely affects the motor bearings and electromagnetic interference of nearby electronic systems. In this study, a simple and generalized carrier based pulse width modulation (PWM) technique is proposed for dual inverter configuration. This simple approach generates various continuous and discontinuous modulating signals based PWM algorithms. With the application of the discontinuous modulating signal based PWM algorithm to the asymmetrical dual inverter configuration, the CMV can be reduced with a slightly improved quality of output voltage. The performance of the continuous and discontinuous modulating signals based PWM algorithms is explored through both theoretical and experimental studies. Results show that the discontinuous modulating signal based PWM algorithm efficiently reduces the CMV and switching losses.
The Transactions of the Korean Institute of Power Electronics
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v.10
no.4
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pp.331-338
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2005
In this paper the novel pulsewidth modulation(PWM) technique for the two-leg and four-leg two-phase inverter is proposed. The conventional space vector PWM technique for two-phase inverter was complex. The proposed PWM for two-leg inverter, which is used by sinusoidal PWM method, is simpler than the conventional SVPWU technique. Also, a simple PWM technique for four-leg two-phase inverter is proposed. Such PWM technique is based on PWM technique for two-leg inverter. Practical verification of theoretical predictions is presented to confirm the capabilities of the new techniques.
The Transactions of The Korean Institute of Electrical Engineers
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v.64
no.5
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pp.718-725
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2015
This paper proposes a novel level-shifted PWM (LS-PWM) strategy for fault tolerant cascaded multilevel inverter. Most proposed fault-tolerant operation methods in many of studies are based on a phase-shifted PWM (PS-PWM) method. To apply these methods to multilevel inverter systems using LS-PWM, two additional steps will be implemented. During the occurrence of a single-inverter-cell fault, the carrier bands scheme is reconfigured and modulation levels of inverter cells are reassigned in this proposed fault-tolerant operation. The proposed strategy performs balanced three-phase line-to-line voltages and line currents when a switching device fault occurs in a cascaded multilevel inverter using LS-PWM. Simulation and experimental results are included in the paper to verify the proposed method.
In this study, a carrier-based pulse-width modulation (PWM) method for two-level voltage source inverters in the over-modulation region is proposed. Based on the superposition principle, the reference voltage vectors outside the linear modulation boundary are adjusted to relocate to the vector hexagon, while their fundamental magnitudes are retained. In accordance with the adjusted reference vector, the corresponding modulated waves are respectively deduced in over-modulation mode I and II to generate the gate signals of the power switches, guaranteeing the linearity of the fundamental output phase voltage in the over-modulation region. Moreover, due to the linear relationship between the voltage vector and the duty ratios, the complicated sector identification and holding angle calculation found in previous methods are avoided in the modulated wave synthesis, which provides great simplicity for the proposed carrier-based over-modulation strategy. Experimental results demonstrate the effectiveness and validity of the proposed method.
Square-wave current source inverter drives suffer from torque pulsation and speed variation at low speed. Attempts to minimize these problems, CSI PWM strategies have been reported. It is shown that these PWM strategies are based on unnecessarily restrictive modulation laws. In this paper, trapezoidal PWM strategy for CSI is investigated theoratically by double fourier series and we proposed Harmonic Speed ripple Factor(HSF) that is independent of motor parameters and load conditions. Speed ripple are considered in T-PWM and square wave inverter by HSF. We obtain modulation index(M) and carrier ratio (CR) for minimum speed ripple.
The Transactions of the Korean Institute of Power Electronics
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v.8
no.1
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pp.89-97
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2003
High frequency common mode voltage produced by PWM inverter fed Induction motor is a major cause of conducted EMI, creation motor ground currents, bearing currents and other harmful products. The zero switching states of inverter control invoke large in comparison with the non-zero switching state of Inverter control. We proposed a common mode voltage reduction method based on sinusoidal PWM technique. PWM signal are generated by comparing respective sinusoidal reference signal with three triangular carrier wave displaced of 120$^{\circ}$. Simulation and experimenta1 result show that common mode voltages in the proposed PWM technique are reduced by approximate 66% more than conventional FWM technique.
This paper deals with the novel DPWM(discontinuous PWM) for 3-level inverter. Although DPWM methods generate higher harmonics than SVPWM they are of special interest because of their lower switching losses. And in the high modulation region the harmonic characteristics of DPWM is superior to the that of CPWM. However when DPWM applies to the 3-level inverter there is the problem that the output state is varied suddenly in the low modulation region($\textrm{m}_{I}$=0~0.5) The novel DPWM that this problem improves will be introduced.
This paper presents two advanced hybrid pulse-width modulation (PWM) strategies for multilevel inverters (MLIs) that provide both common-mode voltage (CMV) elimination and current ripple reduction. The first PWM utilizes sequences that apply one switching state at the double ends of a half-carrier cycle. The second PWM combines the advantages of the former and an existing four-state PWM. Analyses of the harmonic characteristics of the two groups of switching sequences based on a general switching voltage model are carried out, and algorithms to optimize the current ripple are proposed. These methods are simple and can be implemented online for general n-level inverters. Using a three-level NPC inverter and a five-level CHB inverter, good performances in terms of the root mean square current ripple are obtained with the proposed PWM schemes as indicated through improved harmonic distortion factors when compared to existing schemes in almost the entire region of the modulation index. This also leads to a significant reduction in the current total harmonic distortion. Simulation and experimental results are provided to verify the effectiveness of the proposed PWM methods.
Journal of international Conference on Electrical Machines and Systems
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v.1
no.2
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pp.64-69
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2012
This paper presents a hybrid pulse width modulation (PWM) method under low switching frequency conditions based on space vector PWM (SVPWM) and selective harmonic eliminated PWM (SHEPWM), which use asynchronous carrier modulation SVPWM at low frequency, and SHEPWM at high frequency, a square wave after rated conditions. A transitive strategy is proposed to realize a smooth transition of individual modes including SVPWM, SHEPWM and square waves. Experimental results confirm this hybrid modulation method and their transition are reasonable and proper.
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[게시일 2004년 10월 1일]
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