Many industrial operations require continuous or nearly-continuous operation of machines, which if interrupted can result in significant financial loss. The condition monitoring of these machines has received considerable attention recent years. Rapid developments in semiconductor, computing, and communication with a remote site have led to a new generation of sensor called "smart" sensors which are capable of wireless communication with a remote site. The purpose of this research is the development of smart sensor using which can on-line perform condition monitoring. This system is addressed to detect conditions that may lead to equipment failure when it is running. Moreover it will reduce condition monitoring expense using low cost MEMS accelerometer. This sensor can receive data in real-time or periodic time from MEMS accelerometer. Furthermore, this system is capable for signal preprocessing task (High Pass Filter, Low Pass Filter and Gain Amplifier) and analog to digital converter (A/D) which is controlled by CPU. A/D converter that converts 10bit digital data is used. This sensor communicates with a remote site PC using TCP/IP protocols. Wireless LAN contain IEEE 802.11i-PSK or WPA (PSK, TKIP) encryption. Developed sensor executes performance tests for data acquisition accuracy estimations.
We developed a motion capture system to utilize informations on the human walking motion. The system is composed of the mechanical and electronic devices to obtain the joint angle data and the software to analyze the obtained data and to transform the data into the input for a biped walking robot. The mechanical system is composed of a pair of links with 3 revolute joints, on which potentiometers are attached on joint axes to sense rotation angles. Analog signals from potentiometers are transformed into the digital data through the low pass filter and the A/D converter, and then which are stored at the computer. We analyzed the walking characteristics by applying FFT to the digital data, and then performed a 3-D computer simulation using the data. Finally, We apply the processed data to a biped walking robot.
This paper deals with the aliasing problem minimized by using an analog low-pass prefilter have a sampling frequency of 18000 Hz is designed and describes to extract their fundamental frequency components by AFT filter. And them distance relaying algorithm based AFT filter is computational simple, good frequency response and fast convergence in calculation of system apparant impedance. We performed off-line simulation using data from EMTP.
This paper describes a low-voltage and low-power channel selection analog front end with continuous-time low pass filters and highly linear programmable-gain amplifier(PGA). The filters were realized as balanced Gm-C biquadratic filters to achieve a low current consumption. High linearity and a constant wide bandwidth are achieved by using a new transconductance(Gm) cell. The PGA has a voltage gain varying from 0 to 65dB, while maintaining a constant bandwidth. A filter tuning circuit that requires an accurate time base but no external components is presented. With a 1-Vrms differential input and output, the filter achieves -85dB THD and a 78dB signal-to-noise ratio. Both the filter and PGA were implemented in a 0.18um 1P6M n-well CMOS process. They consume 3.2mW from a 1.8V power supply and occupy an area of $0.19mm^2$.
본 논문에서는 먼저 Sensitivity가 가장 낮은 LC Ladder 필터로 부터 FDNR frequency dependent negative resists.) 방식을 이용하여 5차 Butterworth 저역 통과 능동 RC필터를 설계하였으며 능동 RC 필터를 SCF(switched capacito, filter)로 변조하는 과정에서 Bilinear Z변환을 이용하였다. Bilinear Z 변환으로 설계된 SCF에서 aliasing 현상은 피할수 있으나 주파수 대곡이 발생한다. 아나로그 필터를 디지틀 릴터로 변환하면 이러한 영향으로 속단 주파수 영역이 일치하지 않으므로 이것을 적게 하기 위하여 Prewarping을 해준다. 그 결과 Prewarping된 SCF는 Bilinear Z 변환된 SCF보다 각파수 이유이 현저하게 개선됨을 확인하였다.
본 논문에서는 Zero-Crossing 복조기에 적합한 88MHz에서 108MHz 대역 FM 라디오 수신기를 $0.5{\mu}m$ CMOS 공정을 이용하여 설계 및 제작하였다. 본 수신기는 Low-IF 구조를 기초로 설계되었으며, Low-Noise Amplifier (LNA), Down-Conversion Mixer, Phase locked loop (PLL), Low-pass filter (LPF), 비교기를 포함하는 RF/Analog 집적회로로 개발되었다. 측정결과 LNA와 Mixer를 포함하는 RF Block은 23.2dB의 변환 이득과 입력 PldB는 -14dBm였고 전체 잡음지수는 15 dB로 나타났다. IF단 LPF와 비교기를 포함하는 Analog Block은 89dB 이상의 전압 이득을 가지고, IC내부의 레지스터를 제어하여 600KHz에서 1.3MHz까지 100KHz 단위로 Passband 대역를 조절할 수 있도록 설계되었다. 설계된 수신기는 4.5V에서 동작하며, 전체 전류 소모는 15.3 mA로 68.85mW의 전력을 소모한다. 실험결과 성공적으로 FM 라디오 신호를 수신할 수 있었다.
영구자석동기전동기의 쇄교자속 기반 센서리스 제어는 저속에서 위치추정 특성이 우수 하지만 계측된 전류가 ADC를 통해 변환되는 과정에서 발생한 DC offset에 의하여 쇄교자속 추정기의 적분기가 포화되는 문제점을 가지고 있습니다. 이러한 현상을 방지하기 위해 낮은 차단주파수를 갖는 HPF를 사용하여 DC offset 성분을 제거하는 방법이 사용되나, HPF의 낮은 차단주파수로 인해 고속에서 추정 성능이 저하되는 문제점이 있다. 반면 HPF의 차단 주파수를 높이게 되면, 저속에서 위상 앞섬 및 초기기동 실패의 문제가 발생한다. 본 논문에서는 HPF의 차단주파수를 영구자석동기전동기의 운전주파수에 동기화함으로써 낮은 속도에서는 HPF의 차단주파수를 낮게 하여 HPF에 의한 위상 앞섬을 줄이고, 높은 속도에서는 HPF의 차단주파수를 높게 함으로써 높은 DC offset 제거 성능을 통해 운전영역을 200% 확대한다. 또한, 추가적인 위상 보상 알고리즘을 통해 전 운전영역에서 HPF의 위상 앞섬이 1.5도 미만으로 감소되는 방법을 제안한다. 제안된 센서리스 제어 알고리즘은 세탁기용 영구자석동기전동기를 이용한 실험을 통해 검증한다.
본 논문은 생체신호 측정을 위한 저전력/저면적 AFE(analog front-end)에 관한 것이다. 제안된 AFE는 계측증폭기(IA), 대역 통과 필터(BPF), 가변 이득 증폭기(VGA), SAR 타입 A/D 변환기로 구성된다. 전류 분할 기법을 이용한 작은 gm (LGM) 회로와 고 이득 증폭기로 구성된 Miller 커패시터 등가 기술을 이용하여, 외부 수동소자를 사용하지 않고 AC-coupling을 구현하였다. 응용에 따른 BPF의 고역 차단 주파수 변화는 전압 조절기(regulator)를 이용한 출력 전압 변화를 이용하여 $g_m$을 변화하여 구현 시켰다. 내장된 ADC는 커패시터 분할 기법을 적용한 이중 배열 커패시터 방식의 D/A변환기와 비동기 제어 방식을 이용하여 저 전력과 저 면적으로 구현하였다. 일반 CMOS 0.18um 공정을 이용하여 칩으로 제작하였고, 전체 칩 면적은 PAD등을 모두 포함하여 $650um{\times}350 um$이다. 제안된 AFE의 전류 소모는 1.8V에서 6.3uA이다.
자기적인 방법을 이용한 비파괴검사는 강자성체 표면 및 표면 근방의 균열을 탐상하는데 매우 유용하다. 균열을 평가하기 위해서는 시험편상의 누설자속분포를 정량적으로 취득해야 한다. 자기카메라는 큰 리프트오프에서 누설자속분포를 얻기 위하여 제안되었다. 자기카메라는 지원, 자기렌즈, AD 변환기, 인터페이스 및 컴퓨터로 구성되어 있다. 측정 대상체로부터 누설된 자속 또는 흐트러진 자장은 지기렌즈로 집속된 후, 배열된 작은 지기센서에 의하여 아날로그신호로 변환된다. 이러한 아날로그 신호는 AD 변환기에 의하여 디지털신호로 변환되고, 인터페이스 및 컴퓨터에 의하여 저장, 영상화 및 처리된다. 그러나, 지급까지의 자기카메라는 범용 AD변환기를 사용하기 때문에 변환 및 스위칭속도, 검출범위 및 분해능, 직접 메모리 액세스(DMA, direct memory access), 임시저장속도 및 저장량에 한계점을 가지고 있었다. 또한, S/N비를 높이기 위하여 OP-AMP의 도입, 신호의 증폭, 배선의 감소, LPF의 사용과 팥은 개선된 기술이 필요하다. 본 논문은 상술한 조건들을 만족하기 위하여 OP-AMP, LPF, 마이크로프로세서 및 DMA 회로를 포함한 자기카메라 전용 임베디드형 AD 변환기를 제안한다.
본 논문에서는 빠른 천이 시간 및 고해상도 특성을 동시에 만족하기 위해 주로 사용되는 DDS Driven PLL 구조 주파수 합성기의 위상 잡음 분석을 위한 모델링 방안을 제안하였다. 기준 주파수 발진기(reference oscillator) 및 전압 제어 발진기(VCO: Voltage Controlled Oscillator)는 Leeson 모델을 적용하여 측정 데이터를 근사하는 방법을 사용하였고, DDS 칩의 위상 잡음원은 DAC(Digital to Analog Converter) 동작에 근사하여 모델링하였다. PLL의 위상 잡음은 디지털 분주기의 위상 잡음원으로 근사하여 모델링하였으며, 특히 저역 통과 필터(low pass filter)의 각 소자들의 위상 잡음은 전압 제어 발진기의 위상 잡음과 함께 고려하는 방법을 제안하였다. 모델링된 각 잡음 원들을 선형 시스템 영역에서 중첩의 원리를 이용하여 분석함으로써 주파수 합성기 출력의 위상잡음 분포를 예측하였고, 그 결과를 제작된 주파수 합성기의 측정 결과와 비교 평가하였다.
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[게시일 2004년 10월 1일]
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