A fault tolerant structure and its corresponding control strategy for electromagnetic stirring power supplies are proposed in this paper. The topology structure of the electromagnetic stirring power supply contains two-stages. The fore-stage is the PWM rectifier. The back-stage is the fault tolerant inverter, which is a two-phase three-bridge orthogonal inverter circuit while operating normally. When the power switch devices in the inverter are faulty, the structure of the inverter is reconfigured. The two-phase half bridge inverter circuit is constructed with the remaining power switch devices and DC-link capacitors to keep the system operating after cutting the faulty power switch devices from the system. The corresponding control strategy is proposed to let the system work under both normal and fault conditions. The reliability of the system is improved and the requirement of the electromagnetic stirring process is met. Finally, simulation and experimental results verify the feasibility of the proposed fault tolerant structure and corresponding control strategy.
In this paper, the cascade 3-phase IHMCL inverter using two low frequency transformers is proposed. The proposed inverter is constructed by connecting a 3-phase IHCML inverter. the cascade 3-phase IHCML inverter has several advantages. One advantage is that only one input power source is required because of using transformers to isolate. Another advantage is that the switching frequency of the high power switches is almost fundamental frequency of reference and the other the switching frequency of the low power switches is higher. It can be known that cascade 3 phase IHCML inverter has the excellent efficiency and the outstanding electric quality. lastly, we tested the 5kW cascade 3-phase IHCML inverter to clarify the proposed electric circuit and reasonableness of control signal for the proposed inverter.
This paper reports an investigation of pulse width modulation (PWM) techniques for two-phase brushless DC (BLDC) motors fed by a two-phase eight-switch inverter in a fan application. The three-phase BLDC motor is widely applied in industry; however, a lower-cost two-phase BLDC motor and drive circuit has been greatly in demand in recent years. In this paper, we introduce a mathematical model of the two-phase BLDC motor with sinusoidal back electromotive forces (EMFs) based on traditional three-phase BLDC motors. To simplify the drive algorithm and speed up its application, we analyze the principle of block commutation for a two-phase BLDC motor drive in the 180-electrical-degree conduction mode, and we further propose five PWM schemes to improve the commutation performance of the two-phase BLDC drive. The effectiveness of the proposed PWM methods is verified through experiments.
본 논문에서는 평형 2상유도전동기에 대한 시스템 방정식을 유도하고 해석하였으며, 동기좌표계에서 평형 2상유도전동기의 속도제어 특성을 분석하였다. 3상 교류 전동기의 속도제어에 범용적으로 적용하는 벡터제어이론을 "2상 인버터 구동 2상 유도전동기 시스템"에 수정하여 적용하였으며, 이 때 2상 유도전동기 시스템은 수정된 간접 벡터제어이론에 의해 속도 제어하였다. 2상 유도기의 벡터제어의 특성과 근사함을 보여주기 위해 제안 시스템을 시뮬레이션하였다. 최종적으로 실험을 통해서 제안 시스템이 벡터제어에 확실히 적응하는 것을 확인하였다.
In this paper, a new single phase multilevel inverter topology with a single DC source is presented. The proposed topology is developed based on the concepts of the L-Z source inverter and the switched capacitor multilevel inverter. The input voltage to the proposed inverter is boosted by two steps: the first step by an impedance network and the second step by switched capacitor units. Compared to other existing topologies, the presented topology can produce a higher boosted multilevel output voltage while using a smaller number of components. In addition, it provides more flexibility to control boosting factor, size, cost and complexity of the inverter. The proposed inverter possesses all the advantages of the L-Z source inverter and the switched capacitor multilevel inverter like controlling the start-up inrush current and capacitor voltage balancing using a simple switching strategy. The operating principle and general expression for the different parameters of the proposed topology are presented in detail. A phase disposition pulse width modulation strategy has been developed to switch the inverter. The effectiveness of the topology is verified by extensive simulation and experimental studies on a 7-level inverter structure.
A modular three-phase multilevel inverter especially suitable for electrical drive applications has been previously presented. This topology is based on series connection of power cells in which each cell comprised of two inverter legs in series. In this paper, in order to generate the maximum number of voltage levels with reduced number of switches, three algorithms are proposed for determination of the magnitudes of dc voltage sources. In addition, a new hybrid multilevel inverter is proposed that is composed of series connection of the previously presented multilevel inverter and some H-bridges. The proposed topology has been compared with some other presented multilevel inverters. The performance of the proposed multilevel inverter has been verified by simulation and experimental results of a single-phase 39-level multilevel inverter.
This paper presents a new single-phase asymmetrical cascaded multilevel DC-link inverter. The proposed inverter comprises two stages. The main stage of the inverter consists of multiple similar cells, each of which is a half-bridge inverter consisting of two switches and a single DC source. All cells are connected in a cascaded manner with a fixed neutral point. The DC source values are not made equal to increase the performance of the inverter. The second circuit is a folded cascaded H-bridge circuit operating at a line frequency. One of the main advantages of this proposed topology is that it is a modular type and can thus be extended to high stages without changing the configuration of the main stage circuit. Two control schemes, namely, low switching with selective harmonic elimination and sinusoidal pulse width modulation, are employed to validate the proposed topology. The detailed approach of each control scheme and switching pulses are discussed in detail. A 150W prototype of the proposed system is implemented in the laboratory to verify the validity of the proposed topology.
This paper proposed a novel current measurement method for two-phase half-bridge inverter using single current sensor. The proposed method measures DC link input current and a phase current simultaneously and reconstructs each phase currents by simple calculation according to voltage vector. The commutation modes of two-phase half-bridge inverter is analized. The current sampling and reconstructing method is also presented. The proposed method is verified through simulation and experimental results on two-phase induction motor drive system.
This paper describes a 3-Phase Quasi-Resonant DC Link Inverter (3-phase QRI), which has two operating modes, ie. inverting mode and rectifying mode. First the 3-Phase QRI is simplified and the resonant circuit is analyzed in comparison with two resonant DC-to-DC converters. This analysis shows that the maximum voltage of resonant capacitor is limited to twice the input voltage irrespective of operating modes. A new simple control method in rectifying mode is suggested, which does not require any other element in power circuit. The characteristic of 3-Phase Quasi Resonant Inverter has been verified by simulation using the proposed control method.
This paper proposes two SRM driving systems using a variable dc-link voltage controlled by a single-phase inverter. Two SRM converter topologies of a half bridge type and a full bridge type are proposed according to the power circuits of an inverter. The phase current can be controlled by means of a PWM controller at the inverter, and the turn-on/off angle at the phase switches can be controlled by a position sensor at the converter in the drive system. The inverter acts as a peak-current limiter if the transient current exceeds its maximum value. SRMs using the proposed topologies maintain high efficiency due to energy regeneration after the turn-off of power switches. The operational modes of the proposed topologies are verified by simulation and experimental results.
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[게시일 2004년 10월 1일]
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