• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2002년도 추계학술대회 논문집 Vol.15
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• pp.202-205
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• 2002

The photoluminescence (PL) characteristics of the silicon-oxygen(Si-O) superlattice formed by molecular beam epitaxy (MBE) were studied. To confirm the presence of the nanocrystalline Si structure, Raman scattering measurement was performed. The blue shift was observed in the PL peak of the oxygen-annealed sample, compared to the hydrogen-annealed sample, which is due to a contribution of smaller crystallites. Our results determine the right direction for the fabrication of silicon-based optoelectronic and quantum devices as well as for the replacement of silicon-on-insulator (SOI) in high-speed and low-power silicon MOSFET devices in the future.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2005년도 추계종합학술대회
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• pp.619-622
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• 2005

본 논문에서는 서로 다른 Si 두께 ($T_{Si}$ = 27, 50 nm) 를 갖는 SOI (Silicon On Insulator) 기판 위에 다양한 두께의 Ni/Co를 순차적으로 증착한 후 Bulk-Si과의 비교를 통해 Silicide의 형성 특성에 대하여 분석하였다. 우선 급속 열처리 (RTP, Rapid Thermal Processing) 를 통하여 Silicide를 형성한 후 측정결과 Si두께에 따라 Silicide의 특성이 달라짐을 확인하였다. 두꺼운 두께의 Si-film을 갖는 SOI 기판을 사용한 경우 증착된 금속의 두께에 따라 Bulk-Si와 비슷한 면저항 특성을 보였으나, 얇은 두께의 Si-film을 갖는 SOI기판을 사용한 경우에는 제한된 Si의 공급으로 인한 Silicide의 비저항 증가로 인하여 증착된 금속의 두께에 따라 면저항이 감소하다가 다시 증가하는 'V' 자형 곡선을 나타내었다.

• 센서학회지
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• 제7권1호
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• pp.73-82
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• 1998

실리콘 표면 미세가공에 있어서, 새로 개발된 HF 기상식각 공정은 미소구조체들을 띄우는데 매우 효과적임을 입증하였다. 무수 불화수소와 메탄올을 이용한 기상식각 시스템에 대한 기능 및 특성을 기술하였고, 실리콘 미세구조체룰 띄우기 위한 회생층 산화막들의 선택적 식각특성이 고찰되었다. 구조체층으로는 인이 주입된 다결정실리콘이나 SOI 기판의 단결정실리콘을 사용하였다. 회생층으로는 TEOS 산화막, 열산화막, 저온산화막을 사용하였다. 기존 습식식각과 비교해 볼 때, 공정에 기인된 고착현강이나 잔류물질이 없는 미세구조체를 성공적으로 제작하였다.

• 소성∙가공
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• 제13권3호
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• pp.285-289
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• 2004

Micro tensile test specimens of thin film single crystal silicon for the most useful structural materials in MEMS (Micro Electro Mechanical System) devices were fabricated using SOI (Silicon-on-Insulator) wafers and MEMS processes. Dimensions of micro tensile test specimens were thickness of $7\mu\textrm{m}$, width of 50~$350\mu\textrm{m}$, and length of 2mm. Top and bottom silicon were etched using by deep RIE (Reactive Ion Etching). Thin film aluminum markers on testing region of specimens with width of $5\mu\textrm{m}$, lengths of 30~$180\mu\textrm{m}$ and thickness of 200 nm for measuring tensile strain were fabricated by aluminum wet etching method. Fabricated side wall angles of aluminum marker were about $45^{\circ}~50^{\circ}$. He-Ne laser with wavelength of 633nm was used for checking fringed patterns.

• 한국진공학회지
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• 제14권2호
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• pp.91-96
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• 2005

양성자 주입과 웨이퍼접합기술을 접목한 ion-cut기술로서 SOI 웨이퍼를 제조하는 기술을 개발하였다. SRIM 전산모사에 의하면 일반 SOI 웨이퍼 (200nm SOI, 400nm BOX) 제조에는 65keV의 양성자주입이 요구된다. 웨이퍼분리를 위한 최적 공정조건을 얻기 위해 조사선량과 열처리조건(온도 및 시간)에 따른 blistering 및 flaking 등의 표면변화를 조사하였다. 실험결과 유효선량범위는 $6\~9times10^{16}H^+/cm^2$이며, 최적 아닐링조건은 $550^{\circ}C$에서 30분 정도로 나타났다. RCA 세정법으로서 친수성표면을 형성하여 웨이퍼 직접접합을 수행하였으며, IR 조사에 의해 무결함접합을 확인하였다 웨이퍼 분리는 예비실험에서 정해진 최적조건에서 이루어졌으며, SOI층의 안정화를 위해 고온열처리($1,100^{\circ}C,\;60$분)를 시행하였다. TEM 측정상 SOI 구조결함은 발견되지 않았으며, BOX(buried oxide)층 상부계면상의 포획전하밀도는 열산화막 계면의 낮은 밀도를 유지함을 확인하였다.

• 센서학회지
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• 제32권4호
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• pp.223-231
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• 2023

An integrated-optical biochemical sensor structure that can perform homogeneous and surface sensing using a 2×2 balanced-bridge Mach-Zehnder interference structure based on the optimized SOI slot optical waveguide was described, and its performance and characteristics were evaluated. Equations for the two output optical powers were derived and examined using the transfer matrices of a 3-dB coupler and phase shifter (channel waveguide). The length of the 3-dB coupler was determined such that the two output optical powers were same using these formulas. In homogeneous sensing, the effect of the refractive index of an analyte in the range of 1.33-1.36 on the two output optical power distributions was numerically derived, and the sensitivity was calculated based on each output and the difference between the two outputs, the former and the latter being 7.5796-19.0305 [au/RIU] and 15.2601-38.1351 [au/RIU], respectively. In the case of surface sensing, the sensitivity range of the refractive index of 1.337 based on each of the two outputs was calculated as -2.2490--3.5854 [au/RIU] and 1.2194-3.8012 [au/RIU], and the sensitivity range of 4.8048-7.0694 [au/RIU] was confirmed based on the difference between the two outputs.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2009년도 추계학술대회 논문집
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• pp.33-33
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• 2009

Silicon nano-structures have great potential in bionic sensor applications. Atomic force microscopy (AFM) anodic oxidation have many advantages for the nanostructure fabrication, such as simple process in atmosphere at room temperature, compatibility with conventional Si process. In this work, we fabricated simple FET structures with channel width W~ 10nm (nanowire) and $1{\mu}m$ (nano-ribbon) on ~10, 20 and 100nm-thinned silicon-on-insulator (SOI) wafers in order to investigate the surface effect on the transport characteristics of nano-channel. For further quantitative analysis, we carried out the 2D numerical simulations to investigate the effect of channel surface states on the carrier distribution behavior inside the channel. The simulated 2D cross-sectional structures of fabricated devices had channel heights of H ~ 10, 20, and 100nm, widths of L ~ $1{\mu}m$ and 10nm respectively, where we simultaneously varied the channel surface charge density from $1{\times}10^{-9}$ to $1{\times}10^{-7}C/cm2$. It has been shown that the side-wall charge of nanowire channel mainly affect the I-V characteristics and this was confirmed by the 2D numerical simulations.

• 한국정밀공학회지
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• 제30권1호
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• pp.128-133
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• 2013

Si Nanowire (Si-NW) arrays were fabricated by top-down method. A relatively simple method is suggested to fabricate suspended silicon nanowire arrays. This method allows for the production of suspended silicon nanowire arrays using anisotropic wet etching and conventional MEMS method of SOI (Silicon-On-Insulator) wafer. The dimensions of the fabricated nanowire arrays with the proposed method were evaluated and their effects on the Field Effect Transistor (FET) characteristics were discussed. Current-voltage (I-V) characteristics of the device with nanowire arrays were measured using a probe station and a semiconductor analyzer. The electrical properties of the device were characterized through leakage current, dielectric property, and threshold voltage. The results implied that the electrical characteristics of the fabricated device show the potential of being ion-selective field effect transistors (ISFETs) sensors.

• 센서학회지
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• 제9권1호
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• pp.1-8
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• 2000

최근, 자동차가 점점 고급화 되어감에 따라 자동차엔진과 같이 $200^{\circ}C$ 이상의 고온과 부식적인 환경 하에 사용되어 질 수 있는 고성능의 실리콘 가속도센서의 장착이 기대되고 있다. 그러나 실리콘은 본질적으로 온도의 영향이 큰 물질이고, p-n 접합으로 압저항이 형성되기 때문에 $150^{\circ}C$ 이상이 되면 누설전류가 급격하게 증가하여 센서의 성능을 떨어뜨린다. 본 연구에서는 SOI 구조를 이용한 가속도센서의 온도특성을 해석하고, 유한요소법(finite element method)을 이용하여 감도 온도계수(TCS) 및 오프셋전압 온도계수(TCO)의 열잔류응력과의 관련성을 검토하였다. 그 결과, TCS는 압저항의 불순물 농도를 최적화함으로써 줄일 수 있고, TCO는 압저항의 열잔류응력과 불균일한 공정에 관계가 있다는 것을 알았다. 그리고 센서의 중앙지지구조에 있어서 패키징 열잔류응력의 평균값은 약 $3.7{\times}10^4Nm^{-2}^{\circ}C^{-1}$ 정도로 주변지지구조보다 1/10정도 작게 나타났다.

• 센서학회지
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• 제15권1호
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• pp.1-6
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• 2006

We fabricated Si nano-wire MOSFET by using the conventional photolithography with a $1.5{\mu}m$ resolution. Si nano-wire was fabricated by using reactive ion etching (RIE), anisotropic wet etching and thermal oxidation on a silicon-on-insulator (SOI) substrate, and its width is 30 nm. Logarithmic circuit consisting of a NMOSFET and Si nano-wire MOSFET has been constructed for application to high-sensitivity image sensor. Its sensitivity was 1.12 mV/lux. The output voltage swing was 1.386 V.