• 제목/요약/키워드: Random Binary

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홀로그래픽 디지털 정보 저장장치에서의 이차원 인터리빙 구조 (Two-Dimensional Interleaving Structure of Holographic Digital Data Storage)

  • 김민승;한승훈;양병춘;이병호
    • 대한전자공학회논문지SD
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    • 제38권10호
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    • pp.721-727
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    • 2001
  • 본 논문에서 우리는 홀로그래픽 디지털 정보 저장 장치를 위한 2차원 인터리빙 구조를 제안한다. 이 저장장치에서는 다량의 디지털이진 정보를 2차원 정보 영상(1000×1000 bits) 안에 실어서 기록 및 재생, 처리하게 된다. 따라서, 저장 장치에서 발생하는 연집 오류(burst error) 또한 2차원의 형태를 띄게 되며, 이를 극복하기 위해 정보 영상 안에서 효율적인 2차원 인터리빙을 해야 할 필요가 있다. 연집 오류의 형태와 위치가 불규칙적임을 감안하여 각 부호어의 bit들을 2차원 상으로 흩뜨리면, 각 부호어의 bit들은 정삼각 격자 구조를 이루며 분포해야 한다. 이러한 정삼각 격자 형태의 인터리빙을 구현하기 위한 요소와 알고리즘을 제안한다.

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Analog active valve control design for non-linear semi-active resetable devices

  • Rodgers, Geoffrey W.;Chase, J. Geoffrey;Corman, Sylvain
    • Smart Structures and Systems
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    • 제19권5호
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    • pp.487-497
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    • 2017
  • Semi-active devices use the building's own motion to produce resistive forces and are thus strictly dissipative and require little power. Devices that independently control the binary open/closed valve state can enable novel device hysteresis loops that were not previously possible. However, some device hysteresis loops cannot be obtained without active analog valve control allowing slower, controlled release of stored energy, and is presents an ongoing limitation in obtaining the full range of possibilities offered by these devices. This in silico study develops a proportional-derivative feedback control law using a validated nonlinear device model to track an ideal diamond-shaped force-displacement response profile using active analog valve control. It is validated by comparison to the ideal shape for both sinusoidal and random seismic input motions. Structural application specific spectral analysis compares the performance for the non-linear, actively controlled case to those obtained with an ideal, linear model to validate that the potential performance will be retained when considering realistic nonlinear behaviour and the designed valve control approach. Results show tracking of the device force-displacement loop to within 3-5% of the desired ideal curve. Valve delay, rather than control law design, is the primary limiting factor, and analysis indicates a ratio of valve delay to structural period must be 1/10 or smaller to ensure adequate tracking, relating valve performance to structural period and overall device performance under control. Overall, the results show that active analog feedback control of energy release in these devices can significantly increase the range of resetable, valve-controlled semi-active device performance and hysteresis loops, in turn increasing their performance envelop and application space.

A Reactive Cross Collision Exclusionary Backoff Algorithm in IEEE 802.11 Network

  • Pudasaini, Subodh;Chang, Yu-Sun;Shin, Seok-Joo
    • KSII Transactions on Internet and Information Systems (TIIS)
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    • 제4권6호
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    • pp.1098-1115
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    • 2010
  • An inseparable challenge associated with every random access network is the design of an efficient Collision Resolution Algorithm (CRA), since collisions cannot be completely avoided in such network. To maximize the collision resolution efficiency of a popular CRA, namely Binary Exponential Backoff (BEB), we propose a reactive backoff algorithm. The proposed backoff algorithm is reactive in the sense that it updates the contention window based on the previously selected backoff value in the failed contention stage to avoid a typical type of collision, referred as cross-collision. Cross-collision would occur if the contention slot pointed by the currently selected backoff value appeared to be present in the overlapped portion of the adjacent (the previous and the current) windows. The proposed reactive algorithm contributes to significant performance improvements in the network since it offers a supplementary feature of Cross Collision Exclusion (XCE) and also retains the legacy collision mitigation features. We formulate a Markovian model to emulate the characteristics of the proposed algorithm. Based on the solution of the model, we then estimate the throughput and delay performances of WLAN following the signaling mechanisms of the Distributed Coordination Function (DCF) considering IEEE 802.11b system parameters. We validate the accuracy of the analytical performance estimation framework by comparing the analytically obtained results with the results that we obtain from the simulation experiments performed in ns-2. Through the rigorous analysis, based on the validated model, we show that the proposed reactive cross collision exclusionary backoff algorithm significantly enhances the throughput and reduces the average packet delay in the network.

위상 카드와 간섭계를 이용한 광학적 보안 시스템 (Optical Security System Using Phase Mask and Interferometer)

  • 김종윤;김기정;박세준;김철수;배장근;김정우;김수중
    • 대한전자공학회논문지SD
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    • 제38권1호
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    • pp.37-43
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    • 2001
  • 본 논문에서는 컴퓨터와 리소그라피를 이용하여 암호화된 두 개의 위상카드를 제작하고, 마흐-젠더 간섭계를 이용하여 암호화된 이진영상을 복호화하는 방법을 제안하였다. 이때 두 위상카드 중 하나는 기준 영상으로 사용되고 다른 하나는 암호 영상으로 사용된다. 하나의 랜덤 위상 카드를 기준 영상으로 두고 암호화하고자 하는 영상에 맞게 빛의 간섭 현상을 이용하여 암호 영상으로 사용될 위상 카드를 제작하였다. 원 영상의 복원은 경로차가 같도록 구성한 마흐-젠더 간섭계의 두 경로에 기준 영상과 암호 영상을 위치시켜 간섭시킴으로써 영상을 복원할 수 있다. 위상 카드는 광세기 검출기로 볼 수 없을 뿐만 아니라 복제할 수도 없어서 개인 정보보호 및 인증시스템에 매우 유용하게 사용될 수 있다. 간단한 영상에 대한 광실험을 통하여 제안한 시스템의 타당성을 확인하였다.

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BOC 신호 동기화를 위한 새로운 주변 첨두 제거 기법 (A Novel Side-Peak Cancellation Method for BOC Signal Synchronization)

  • 김상훈;윤태웅;이영윤;한태희;윤석호
    • 한국통신학회논문지
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    • 제34권1C호
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    • pp.131-137
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    • 2009
  • Bin offset carrier (BOC) 신호 동기화 과정은 GPS, Galileo와 같은 위성항법시스템에서 가장 중요한 단계이다. BOC 신호 동기화 과정은 일반적으로, 수신 BOC 신호와 단말기의 BOC 신호 사이의 상관함수를 이용하여 이루서진다. 따라서 BOC 자기상관함수의 다중 첨두 문제는 동기화 오차의 주요한 원인이 된다. 최근 Julien에 의해 BOC 상관함수 상의 주변 첨두 크기를 줄일 수 있는 기법이 제안되었다. 그러나 이 기법은 주변 첨두를 완벽히 제거하지 못하며, 적용할 수 있는 신호도 제한적이다. 본 논문에서는 주변 첨두가 완벽히 제거된 새로운 상관함수를 제안하였다. 제안한 상관함수는 sine 위상 및 cosine 위상의 BOC 신호 모두에 적용할 수 있으며, 주변 첨두를 완벽히 제거할 수 있다. 또한 제안한 상관함수를 효율적으로 구현할 수 있는 상관기 구조도 제안하였다.

ART2 알고리즘을 이용한 디지털 워터마킹 (Digital Watermarking using ART2 Algorithm)

  • 김철기;김광백
    • 지능정보연구
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    • 제9권3호
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    • pp.81-97
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    • 2003
  • 본 논문에서는 인간시각시스템의 특성에 기반하여 웨이블릿 변환을 적용하여 멀티미디어 데이터의 소유권 보호를 위하여 시각적으로 눈에 띄지 않는 강인한 워터마킹 기법을 제안하고 있다. 이를 위하여 우선 웨이블릿 변환을 사용하여 level 3에서 원 영상을 분해한 후, 최저파수 대역에 해당하는 LL$_3$대역을 제외한 모든 부 대역에 신경회로망을 사용하여 웨이블릿 분해 계수들을 분류한 다음, 최대값을 갖는 클러스터에 대해서 임계치를 적용한다. 그리고 사용된 워터마크는 워터마크의 시각적 확인을 위하여 가우시안 랜덤 벡터 대신에 이진 로고 형태의 워터마크를 사용하였다. 또한, 본 논문에서는 다중 워터마크의 삽입 및 검출을 테스트하였다. 이를 위하여, 웨이블릿 변환을 이용하여 level 3에서 원 영상을 분해한 후, 최 저주파수 대역에 해당하는 LL$_3$ 대역을 제외한 모든 부대역에 대하여 워터마크를 삽입하였다. 실험에서 우리는 여러 가지 공격에서도 삽입한 워터마크가 강인함을 알 수 있었다.

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MFCM의 성능개선을 통한 블라인드 비선형 채널 등화 (Blind Nonlinear Channel Equalization by Performance Improvement on MFCM)

  • 박성대;우영운;한수환
    • 한국정보통신학회논문지
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    • 제11권11호
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    • pp.2158-2165
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    • 2007
  • 본 논문에서는 비선형 블라인드 채널등화기의 구현을 위하여 가우시안 가중치(gaussian weights)를 이용한 개선된 퍼지 클러스터(Modified Fuzzy C-Means with Gaussian Weights: MFCM_GW) 알고리즘을 제안한다. 제안된 알고리즘은 기존 FCM 알고리즘의 유클리디언 거리(Euclidean distance) 값 대신 Bayesian Likelihood 목적 함수(fitness function)와 가우시안 가중치가 적용된 멤버십 매트릭스(partition matrix)를 이용하여, 비선형 채널의 출력으로 수신된 데이터들로부터 최적의 채널 출력 상태 값(optimal channel output states)들을 직접 추정한다. 이렇게 추정된 채널 출력 상태 값들로 비선형 채널의 이상적 채널 상태(desired channel states) 백터들을 구성하고, 이를 Radial Basis Function(RBF) 등화기의 중심(center)으로 활용함으로써 송신된 데이터 심볼을 찾아낸다. 실험에서는 무작위 이진 신호에 가우시안 잡음이 추가된 데이터를 사용하여 기존의 Simplex Genetic Algorithm(GA), 하이브리드 형태의 GASA(GA merged with simulated annealing(SA)), 그리고 과거에 발표되었던 MFCM 등과 그 성능을 비교 분석하였으며, 가우시안 가중치가 적용된 MFCM_GW를 이용한 채널등화기가 상대적으로 정확도와 속도 면에서 우수함을 보였다.

Optimization of Agrobacterium tumefaciens-Mediated Transformation of Xylaria grammica EL000614, an Endolichenic Fungus Producing Grammicin

  • Jeong, Min-Hye;Kim, Jung A.;Kang, Seogchan;Choi, Eu Ddeum;Kim, Youngmin;Lee, Yerim;Jeon, Mi Jin;Yu, Nan Hee;Park, Ae Ran;Kim, Jin-Cheol;Kim, Soonok;Park, Sook-Young
    • Mycobiology
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    • 제49권5호
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    • pp.491-497
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    • 2021
  • An endolichenic fungus Xylaria grammica EL000614 produces grammicin, a potent nematicidal pyrone derivative that can serve as a new control option for root-knot nematodes. We optimized an Agrobacterium tumefaciens-mediated transformation (ATMT) protocol for X. grammica to support genetic studies. Transformants were successfully generated after co-cultivation of homogenized young mycelia of X. grammica with A. tumefaciens strain AGL-1 carrying a binary vector that contains the bacterial hygromycin B phosphotransferase (hph) gene and the eGFP gene in T-DNA. The resulting transformants were mitotically stable, and PCR analysis showed the integratin of both genes in the genome of transformants. Expression of eGFP was confirmed via fluorescence microscopy. Southern analysis showed that 131 (78.9%) out of 166 transformants contained a single T-DNA insertion. Crucial factors for producing predominantly single T-DNA transformants include 48 h of co-cultivation, pretreatment of A. tumefaciens cells with acetosyringone before co-cultivation, and using freshly prepared mycelia. The established ATMT protocol offers an efficient tool for random insertional mutagenesis and gene transfer in studying the biology and ecology of X. grammica.

심층신경망을 통한 해파리 출현 예측 (The prediction of appearance of jellyfish through Deep Neural Network)

  • 황철훈;한명묵
    • 인터넷정보학회논문지
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    • 제20권5호
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    • pp.1-8
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    • 2019
  • 본 논문은 지구온난화로 인하여 수온이 상승되며 증가한 해파리의 피해를 감소하고자 연구를 진행하였다. 해수욕장에서 해파리의 등장은 해파리의 쏘임 사고로 인한 인명피해와 폐장으로 인한 경제적 손실이 발생할 수 있다. 본 논문은 선행 연구들로부터 해파리의 출현 패턴을 머신러닝을 통하여 예측 가능함 확인하였다. SVM을 이용한 해파리 출현 예측 모델 연구를 확대하여 진행하였다. 심층신경망을 이용하여 해파리 출현 유무 예측인 이진 분류에서 지수화 된 방법인 다중 분류로 확장하고자 하였다. 수집된 데이터의 크기가 작다는 한계점으로 인하여 84.57%라는 예측 정확도의 한계를 부트스트래핑을 이용하여 데이터 확장을 통해 해결하고자 하였다. 확장된 데이터는 원본 데이터보다 약 7% 이상의 높은 성능을 보여주었으며, Transfer learning과 비교하여 약 6% 이상의 좋은 성능을 보여주었다. 최종적으로 테스트 데이터를 통하여 해파리 출현 예측 성능을 확인한 결과, 해파리의 출현 유무를 예측할 시 높은 정확도로 예측이 가능함을 확인하였으나, 지수화를 통한 예측에서는 의미 있는 결과를 얻지 못하였다.

ECC 기반의 공개키 보안 프로토콜을 지원하는 보안 SoC (A Security SoC supporting ECC based Public-Key Security Protocols)

  • 김동성;신경욱
    • 한국정보통신학회논문지
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    • 제24권11호
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    • pp.1470-1476
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    • 2020
  • 모바일 장치와 IoT의 보안 프로토콜 구현에 적합한 경량 보안 SoC 설계에 대해 기술한다. Cortex-M0을 CPU로 사용하는 보안 SoC에는 타원곡선 암호 (elliptic curve cryptography) 코어, SHA3 해시 코어, ARIA-AES 블록 암호 코어 및 무작위 난수 생성기 (TRNG) 코어 등의 하드웨어 크립토 엔진들이 내장되어 있다. 핵심 연산장치인 ECC 코어는 SEC2에 정의된 20개의 소수체와 이진체 타원곡선을 지원하며, 부분곱 생성 및 가산 연산과 모듈러 축약 연산이 서브 파이프라인 방식으로 동작하는 워드 기반 몽고메리 곱셈기를 기반으로 설계되었다. 보안 SoC를 Cyclone-5 FPGA 디바이스에 구현하고 타원곡선 디지털 서명 프로토콜의 H/W-S/W 통합 검증을 하였다. 65-nm CMOS 셀 라이브러리로 합성된 보안 SoC는 193,312 등가 게이트와 84 kbyte의 메모리로 구현되었다.