최근 들어 스마트 팩토리, 차량 내 통신망, 광대역 전력망 등 다양한 응용분야에서 단대단 네트워크 지연시간(End-to-end network delay)에 대하여 엄격한 제한(bound)을 요구하고 있다. 이에 따라 기존 Integrated Services (IntServ) 프레임워크에서의 플로우 기반 스케줄러를 바탕으로 하는 해법들이 다시 제안되고 있다. 하지만 많은 수의 플로우를 구분하여 스케줄 하는 것은 복잡도가 커서 구현하기 어렵다. 차선책인 Class기반 스케줄러는 노드를 지나면서 burst가 기하급수적으로 커지기 때문에 지연시간을 제한하기 어렵다. 이에 따라 트래픽 regulator와 class 기반 스케줄러를 앞뒤로 배치하여 burst의 크기를 줄이면서 동시에 스케줄러의 복잡도를 낮추려는 연구가 등장하고 있다. 본 연구에서는 이러한 regulator와 스케줄러가 하나의 서버에서 간단히 구현되는 방안을 제시하고 성능을 분석하여 대규모 네트워크에서도 수 ms 이내의 최대 delay를 보장함을 보였다.
본 논문에서는 센서 투명성을 지원하는 센서노드 운영체제에서 MCU가 슬립모드일 때 센서의 전원도 같이 차단할 수 있는 전력관리 기법을 제안한다. 전원 차단이 가능한 센서인지를 구별하기 위해 센서의 종류를 이벤트 센서와 폴링 센서로 구분하고 이들을 지원하기 위한 스케쥴러를 설계하였다. 성능 분석을 위해 기존 센서네트워크 운영 체제인 Nano-Q+에서 센서에 대한 표준 인터페이스를 지원하는 센서 투명성 기능을 구현하고, MCU와 함께 센서를 자동으로 슬립모드로 바꿀 수 있는 전력 관리자를 설계, 구현하여 성능을 분석하였다.
JSTS:Journal of Semiconductor Technology and Science
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제9권1호
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pp.1-7
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2009
This paper describes design of high energy efficiency 32 bit parallel processor core using instruction-levels data gating and dynamic voltage scaling (DVS) techniques. We present instruction-levels data gating technique. We can control activation and switching activity of the function units in the proposed data technique. We present instruction-levels DVS technique without using DC-DC converter and voltage scheduler controlled by the operation system. We can control powers of the function units in the proposed DVS technique. The proposed instruction-levels DVS technique has the simple architecture than complicated DVS which is DC-DC converter and voltage scheduler controlled by the operation system and a hardware implementation is very easy. But, the energy efficiency of the proposed instruction-levels DVS technique having dual-power supply is similar to the complicated DVS which is DC-DC converter and voltage scheduler controlled by the operation system. We simulate the circuit simulation for running test program using Spectra. We selected reduced power supply to 0.667 times of the supplied power supply. The energy efficiency of the proposed 32 bit parallel processor core using instruction-levels data gating and DVS techniques can improve about 88.4% than that of the 32 bit parallel processor core without using those. The designed high energy efficiency 32 bit parallel processor core can utilize as the coprocessor processing massive data at high speed.
HIGHT (HIght security and light weighHT) 암호는 기밀성을 요구하는 네트워크 환경에서 사용할 수 있도록 국내에서 개발된 저전력 경량화 64비트 블록 암호 알고리즘이다. 본 논문은 키스케쥴러에 사용되는 LFSR 및 역 LFSR의 4개의 병렬 출력을 허용할 수 있는 구조를 제안하였다. 또한, 각 라운드 연산에 필요한 4개의 서브키를 동일 클럭 사이클에 생성할 수 있도록 구성하였다. 따라서, 전체 HIGHT 암호 프로세서가 단일 시스템 클럭에 의해 제어할 수 있다. VHDL을 이용하여 회로를 합성한 후, 검증한 결과 제안된 키 스케쥴러의 회로 크기는 기존 키 스케쥴러에 비해 9% 감소되었다.
워크플로우 관리자는 대량의 계산용 그리드 자원을 데스크탑 컴퓨터에서 개인이 편리하게 워크플로우를 만들고 수행할 수 있게 해주는 유용한 도구이다. 보통 데이터는 스테이지-인, 프로세스, 스테이지-아웃의 순서로 순차적으로 진행되며 워크플로우 시스템은 이 과정을 자동화해준다. 그러나 최근의 e-science에서는 사용되는 데이터 량이 급속하게 증가하고 있고 원하는 출력물을 얻기 위해 여러 번의 과정을 수행하면서 데이터 이동 시간이 전체 수행시간의 많은 부분을 차지하게 되어 스테이징 과정의 개선이 중요한 이슈가 되고 있다. 본 논문에서는 스테이징 과정을 개선하고, 이를 이용하여 가능한 한 많은 작업들을 동시 수행시키는 스케줄러를 설계하였다. 또한 모의실험을 통해 제안한 스케줄러의 성능이 10~40%까지 향상됨을 보였다.
본 논문은 IEEE 802.16 기반의 TDD-OFDMA 하향링크의 서비스 커버리지 향상을 위한 단순 릴레이 협력 자원 관리(SRARA Simple-Relay Aided Resource Allocation) 구조를 제시하고, 채널 스케줄러가 적용되었을 때의 성능 향상을 서비스 커버리지 및 유효 섹터 수율 측면에서 분석하였다. 단순 이동 릴레이는 고정 릴레이와 달리, 송신 전력 수준이 낮고, 기지국으로부터 받은 데이터를 다른 이동 단말로 전달할 수 있는 기능만 가지며, 낮은 송신 전력 수준 때문에 제한된 개수의 부채널만을 사용할 수 있다. 모의실험에서는 PF (Proportional Fair) 및 TGS (Throughput Guarantee Scheduling) 채널 스케줄러가 고려된 SRARA 구조에 대하여, 서비스 커버리지 및 유효 섹터 수율을 평가하였다. 릴레이의 송신 전력은 500 mW와 1 W에 대해서 고려하였고, 릴레이가 사용할 수 있는 부채널의 수는 1개 또는 2개로 제한되었다. 상대적으로 낮은 송신전력인 500 mW에서는, 릴레이가 1개의 부채널로 모든 전력을 다 사용하는 방식이, 2개의 부채널로 전력을 나누어 사용하는 방식보다 커버리지 성능 향상이 우수하였다. 1 W 경우에는, 릴레이가 2개의 부채널을 사용할 때 더 많은 커버리지를 제공하였다. 상대적으로 낮은 QoS 요구조건인 64 kbps에서는 릴레이에 의한 커버리지 향상이 스케줄러 설계에 의한 커버리지 향상보다 많았지만, 128 kbps 요구조건에서는 제한된 자원만을 활용하는 릴레이보다는 TGS에 의한 서비스 영역의 향상이 크게 나타났다.
최근 무선 통신 기술이 발달함에 따라 유비쿼터스 환경과 그와 관련된 실용화 기술에 대한 관심이 크게 고조되고 있다. 그리고 유비쿼터스의 개념이 기존 IT 분야에 접목되면서 유비쿼터스 환경을 근간으로 한 자동화 시스템의 필요성이 부각되고 있다. 또한, 환율 상승과 고유가로 인해 대형 건물과 공공 기관에서의 에너지 절약 방안 수립에 대한 필요성이 강력히 대두되고 있다. 본 논문에서는 RFID/USN 기술을 이용하여 에너지 절약을 위해 전등, 난방기 그리고 에어컨과 같은 건물 내 전자기기의 전력 소비를 효율적으로 관리하는 절전관리 시스템을 제안한다. 제안하는 시스템은 USN을 이용하여 전자기기에 대한 중앙 관리 및 상태 정보를 감시하고, USN을 이용하여 주변 환경 및 전력 소비에 대한 실시간 정보를 수집한다. 특히, 제안하는 시스템은 실시간 수집 된 정보를 분석하여 최상의 절전 효과를 가지는 지능형 스케줄러를 제공한다. 마지막으로, 본 논문은 제안하는 시스템을 다양한 환경에서 실험해 보고 기존 시스템과의 차별성과 현실성을 보인다.
In this paper, we implement and construct a kernel on handhold systems. The goal of this project is to develop issues related to the development of small devices: embedded kernel, power management, user interface issues, networking, and the development of applications for small devices. We explain basic system configuration, kernel activity, device drivers and developing environment in this paper. We also explain detail scheduler activity.
We proposed a load unbalancing scheduling method for energy-efficient multi-core embedded systems considering DVFS (Dynamic Voltage/Frequency Scaling) power consumption and task characteristics. It is a new kind of scheduler which combines load balancing and load unbalancing technique. The purpose of the method is to effectively utilize energy without much effect in performance. In this paper, we conduct experiments on energy consumption and performance using the previous load balancing and unbalancing techniques and our proposed technique. The proposed technique reduced energy consumption more than 13.7% when compared to other algorithms. As a result, the proposed technique shows low energy consumption without much decline in the performance and is adequate for energy-efficient multi-core embedded systems.
In this study, we proposed a fuzzy gain scheduler with intelligent learning algorithm for a reactor control. In the proposed algorithm, we used the gradient descent method to learn the rule bases of a fuzzy algorithm. These rule bases are learned toward minimizing an objective function, which is called a performance cost function. The objective of fuzzy gain scheduler with intelligent learning algorithm is the generation of adequate gains, which minimize the error of system. The condition of every plant is generally changed as time gose. That is, the initial gains obtained through the analysis of system are no longer suitable for the changed plant. And we need to set new gains, which minimize the error stemmed from changing the condition of a plant. In this paper, we applied this strategy for reactor control of nuclear power plant (NPP), and the results were compared with those of a simple PI controller, which has fixed gains. As a result, it was shown that the proposed algorithm was superior to the simple PI controller.
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[게시일 2004년 10월 1일]
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