• 한국철도학회:학술대회논문집
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• 한국철도학회 1999년도 추계학술대회 논문집
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• pp.302-309
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• 1999

This paper is intended to provide a method to design control software fur the TCMS, train control and monitoring system. The TCMS with this control software will be applied KOREA Standard EMU. The control software is designed by SCADE Case tool to concern safety and reliability. The function for the EMU is implemented in software easily programmed, using a functional block, graphic programming language. the control software has modular design and each module is tested with SCADE simulator. This time we focus a HVAC(heater, ventilation and air conditioner controller) control module, present a design method and a simulation method for that module.

• 한국초전도ㆍ저온공학회논문지
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• 제8권2호
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• pp.17-19
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• 2006

A novel clock distribution technique for pipelined-RSFQ logics using variable Bias Currents of JTLs as delay-medium is newly proposed. RSFQ logics consist of several logic gates or blocks connected in a pipeline structure. And each block has variable delay difference. In the structure, this clock distribution method generates a set of clock signals for each logic blocks with suitable corresponding delays. These delays, in the order of few to tens of pS, can be adjusted through controlling bias current of JTL of delay medium. While delays with resistor value and JJ size are fixed at fabrication stage, delay through bias current can be controlled externally, and thus, is heavily investigated for its range as well as correct operation within current margin. Possible ways of a standard delay library with modular structure are sought for further modularizing Pipelined-RSFQ applications. Simulations and verifications are done through WRSpice with Hypres 3-um process parameters.

• 전기전자학회논문지
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• 제23권4호
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• pp.1321-1327
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• 2019

본 논문에서는 GF(p) 상에서 모듈러 제곱근 (MSQR) 연산의 효율적인 하드웨어 구현에 대해 기술한다. MSQR 연산은 타원곡선 기반의 EC-ElGamal 공개키 암호를 위해 평문 메시지를 타원곡선 상의 점으로 매핑하기 위해 필요하다. 본 논문의 방법은 NIST 표준으로 규정된 5가지 크기의 GF(p) 타원곡선을 지원하며, 192-비트, 256-비트, 384-비트 그리고 521-비트 크기의 Kobliz 곡선과 슈도 랜덤 곡선들은 모듈러 값의 특성을 기반으로 오일러 판정법을 적용하고, 224-비트 크기의 경우에는 Tonelli-Shanks 알고리듬을 간략화시켜 적용하였다. 제안된 방법을 ECC 프로세서의 32-비트 데이터 패스를 갖는 유한체 연산회로와 메모리 블록을 이용하여 구현하였으며, FPGA 디바이스에 구현하여 하드웨어 동작을 검증하였다. 구현된 회로가 50 MHz 클록으로 동작하는 경우에, 224-비트 슈도 랜덤 곡선의 경우에는 MSQR 계산에 약 18 ms가 소요되고, 256-비트 Kobliz 곡선의 경우에는 약 4 ms가 소요된다.

• 정보보호학회논문지
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• 제12권5호
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• pp.15-25
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• 2002

본 논문에서는 AES Rijndael 블록 암호 알고리즘을 구현하는 고속 암호 프로세서를 설계하였다. 기존 Rijndael 알고리즘의 고속 동작을 제약하는 라운드 키 계산에 따른 성능 저하 문제를 제거하기 위해, 연산 라운드 구조를 수정하여 라운드 키 계산 동작을 1 라운드 이전에 온라인 방식으로 처리하는 방식을 사용하였다. 그리고 128, 192, 256 비트 키를 지원하는 모듈화된 라운드 키 생성회로를 설계하였다. 설계된 암호 프로세서는 라운드 당 1 클록을 사용하는 반복 연산 구조를 갖고 있으며, 다양한 응용 분야에 적용하기 위해 기존 ECB, CBC 모드와 함께 AES의 새로운 동작 모드로 고려되고 있는 CTR 모드를 지원한다. Verilog HDL로 모델링된 암호 프로세서는 0.25$\mu\textrm{m}$ CMOS 공정의 표준 셀 라이브러리로 합성한 결과 약 51,000개의 게이트로 구성되며, 시뮬레이션 결과 7.5ns의 최대 지연을 가지고 있어서 2.5V 전압에서 125Mhz의 동작 주파수를 갖는다. 설계된 프로세서는 키 길이가 128 비트인 ECB 모드인 경우 약 1.45Gbps의 암.복호율의 성능을 갖는다.

• 한국전산구조공학회논문집
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• 제33권5호
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• pp.311-318
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• 2020

본 논문에서는 모듈화(Module)된 부품을 활용한 탄성받침 성능개선기법에 대하여 소개하였다. 각각의 모듈화된 장치들이 지진 강도 및 이동 변위에 따른 단계별 거동을 함으로써 받침의 성능을 개선하게 된다. 모듈화된 장치들은 초기전단저항 블럭, 완충장치, 변위수용가이드, 낙교방지블럭이 있으며, 탄성받침에 추가적으로 적용되었다. 이 장치는 지진의 규모에 따라 4단계로 거동하며, 1차로 설계변위를 수용하고, 2차, 3차에서는 대규모 지진을 수용하며, 4차로는 대규모의 지진에 대해서 낙교방지가 가능하도록 설계되어 탄성받침의 용량 제한을 증가시킨다. 본 논문에서는, 개발기술인 PRB 지진격리장치를 유한요소해석을 통해 해석하여 격리장치의 이론적인 거동이 구현되는지와, 대규모 지진에 해당하는 하중을 견딜 수 있는지 확인하였다. 그리고 이를 바탕으로 실험을 통해 성능평가를 진행하여 두 결과의 비교 분석을 통해 PRB 지진격리장치가 탄성받침의 성능을 개선할 수 있는지 검증하였다.

• Elastomers and Composites
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• 제39권2호
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• pp.131-141
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• 2004

본 연구에서는 폐기되는 고전압용 전선으로부터 얻어질 수 있는 XLPE(crosslinked polyethylene)의 재활용에 관하여 고찰하였다. XLPE 스크랩 및 폐기물의 분쇄를 위해 약 $100{\mu}m$ 이하부터 약 $1000{\mu}m$까지 입자크기의 조절이 가능한 두 종류의 분쇄기를 사용하였다. 모듈라 치합형 동방향회전 이축 스크류식 압출기(modular intermeshing co-rotating twin screw extruder)를 이용하여 폐 XLPE의 조성, 폐 XLPE의 입자크기 및 종류, 스크류 조합, 매트릭스 수지의 종류(LDPE, HDPE, PP, PS) 조건을 변화시키면서 배합물을 제조하고 그들의 기계적 및 유변학적 특성과 파단면을 조사하였다. 일반적으로 내외 전도층을 포함한 폐 XLPE 배합물의 충격강도는 내외 전도층을 제외한 배합물보다 충격강도가 작은 것으로 나타났다. 또한, XLPE의 함량이 증가하고 입자크기가 작아 질수록 배합물의 충격강도가 증가하였다. 특히, LDPF의 경우 XLPE를 약 80 wt%까지 충전하여도 정상조건의 압출공정이 가능하였다. 스크류조합에 따른 배합물의 충격강도는 니딩디스크 블록(kneading disc block)의 수가 많을수록 높은 값을 나타내었다. 전체적으로 XLPE의 양이 증가할수록 배합물의 용융점도가 증가하였으나, 압출 전단속도 범위에서 shear thinning 경향을 나타내었다. 폐 XLPE를 범용 고분자수지와 혼합할 경우, LDPE, HDPE, PP 및 PS 모든 배합물에서 충격강도가 증가하였다. 특히, PS/XLPE 배합물의 경우에는 충격강도가 2 배정도 향상되는 효과를 보여주었다.

• 한국통신학회논문지
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• 제17권8호
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• pp.796-804
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• 1992

본 논문은 레지스터 인서션 링 구조를 사용한 Backbone 네트워크의 디자인에 관하여 연구하였다. 고속의 레지스터 인서션 Backbone 링 네트워크는 적은 비용으로 간단한 모듈라 구조와 Concurrent Communication을 통하여 네트워크간의 빠른 속도의 데이타 통신을 가능케하여 준다. 큰 네트워크를 형성하기 위하여 국부 지역 통신망(근거리 통신망, Local Area Network:LAN)들과 접속되어 있는 브릿지 노드들이 Pint-to-Point로 연결되어 레지스터 인서선 Backbone링을 형성한다. 본 논문에서 제안된 브릿지 노드는 불필요하게 데이타 메시지가 링으로 유입되는 것을 막기 위하여 Local Address Filtering을 하여 Backbone링의 통신량을 현저하게 줄이며, Remote Adress Filtering을 하여 LAN 세그먼트내의 통신량을 감소시키므로 그 성능 특성을 극대화 시킨다. 또한 본 논ㅁ누에서는 네트워크의 Reconfiguration을 쉽게 하기 위하여 자동 학습 기능이 고안되었다. 그리고 Throushput 분석에 의해서 Backbone 링에 사용되는 전송매체의 Bandwidth를 예측하여 설계하는 방법이 연구되었다.

• 한국정보통신학회논문지
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• 제24권11호
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• pp.1470-1476
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• 2020

모바일 장치와 IoT의 보안 프로토콜 구현에 적합한 경량 보안 SoC 설계에 대해 기술한다. Cortex-M0을 CPU로 사용하는 보안 SoC에는 타원곡선 암호 (elliptic curve cryptography) 코어, SHA3 해시 코어, ARIA-AES 블록 암호 코어 및 무작위 난수 생성기 (TRNG) 코어 등의 하드웨어 크립토 엔진들이 내장되어 있다. 핵심 연산장치인 ECC 코어는 SEC2에 정의된 20개의 소수체와 이진체 타원곡선을 지원하며, 부분곱 생성 및 가산 연산과 모듈러 축약 연산이 서브 파이프라인 방식으로 동작하는 워드 기반 몽고메리 곱셈기를 기반으로 설계되었다. 보안 SoC를 Cyclone-5 FPGA 디바이스에 구현하고 타원곡선 디지털 서명 프로토콜의 H/W-S/W 통합 검증을 하였다. 65-nm CMOS 셀 라이브러리로 합성된 보안 SoC는 193,312 등가 게이트와 84 kbyte의 메모리로 구현되었다.

• Structural Engineering and Mechanics
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• 제17권3_4호
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• pp.393-408
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• 2004

There exists a clear need to monitor the performance of civil structures over their operational lives. Current commercial monitoring systems suffer from various technological and economic limitations that prevent their widespread adoption. The wires used to route measurements from system sensors to the centralized data server represent one of the greatest limitations since they are physically vulnerable and expensive from an installation and maintenance standpoint. In lieu of cables, the introduction of low-cost wireless communications is proposed. The result is the design of a prototype wireless sensing unit that can serve as the fundamental building block of wireless modular monitoring systems (WiMMS). An additional feature of the wireless sensing unit is the incorporation of computational power in the form of state-of-art microcontrollers. The prototype unit is validated with a series of laboratory and field tests. The Alamosa Canyon Bridge is employed to serve as a full-scale benchmark structure to validate the performance of the wireless sensing unit in the field. A traditional cable-based monitoring system is installed in parallel with the wireless sensing units for performance comparison.

• Journal of Power Electronics
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• 제17권1호
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• pp.242-252
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• 2017

This paper deals with the blocking of DC-fault current during DC cable short-circuit conditions in HVDC (High-Voltage DC) transmission systems utilizing Modular Multilevel Converters (MMCs), where a new SubModule (SM) topology circuit for the MMC is proposed. In this SM circuit, an additional Insulated-Gate Bipolar Translator (IGBT) is required to be connected at the output terminal of a conventional SM with a half-bridge structure, hereafter referred to as HBSM, where the anti-parallel diodes of additional IGBTs are used to block current from the grid to the DC-link side. Compared with the existing MMCs based on full-bridge (FB) SMs, the hybrid topologies of HBSM and FBSM, and the clamp-double SMs, the proposed topology offers a lower cost and lower power loss while the fault current blocking capability in the DC short-circuit conditions is still provided. The effectiveness of the proposed topology has been validated by simulation results obtained from a 300-kV 300-MW HVDC transmission system and experimental results from a down-scaled HVDC system in the laboratory.