In this work, amorphous carbon thin films were deposited for hard mask applications by a reactive particle beam (RPB) assisted sputtering system at room temperature. The depositing characteristics of the films were investigated as functions of operating parameters such as reflector bias voltage and RF plasma power. It was confirmed that the deposition rate increased with increasing the reflector bias voltage and RF plasma power. By an atomic force microscope (AFM), it was revealed that the surface roughness was also increased. The total stress in films was determined by the use of the substrate curvature and its result will be discussed.
본 연구에서는 MILC 및 FALC를 도핑 타입에 따른 온도별 패턴별 인가 전압별로 진행하여 현미경 및 FESEM 관찰을 함으로써 그 메커니즘을 규명하고자 하였다. LPCVD를 이용하여 $1000\;{\AA}$ a-Si 을 glass에 입힌 후 photolithography법 또는 Hard Mask법으로 Ni $200\;{\AA}$ 을 선택적으로 증착하였으며 Pt 전극을 Sputtering법으로 제작하였다. $33\;{\sim}\;200\;V/cm$의 전기장 하에서 MILC 속도가 2배 정도 증가되는 현상이 관찰되었으며 또한 인접패턴에 의해 FALC 속도가 영향을 받는 현상이 관찰되었다. 또한 전자가 움직이는 방향으로 MILC 선단영역 전후에 Void가 발생하는 영역이 존재함을 발견하였다. FESEM 분석을 통하여 FALC 영역 및 Void 영역을 관찰한 결과 도핑 종류에 따라 결정화 양상이 다른 것이 관찰되었으며 Void 분석결과 Charged vacancy가 어닐링시 결집되어 나타나는 것으로 분석할 수 있었다.
This paper describes the design and implementation of a passive transponder chip for RFID applications. Passive transponders do not have their own power supply, and therefore all power required for the operation of a passive transponder must be drawn from the field of the reader. The designed transponder consists of a full wave rectifier to generate a dc supply voltage, a 128-bit mask ROM to store the information, and Manchester coding and load modulation circuits to be used for transmitting the information from the transponder to the reader. The transponder with a size 410 x 900 ${\mu}$m$^2$ has been fabricated using 0.65 ${\mu}$m 2-poly, 2-metal CMOS process. The measurement results show the data transmission rate of 3.9 kbps at RF frequency 125 kHz.
In this study, a new simplified technology for fabricating high density trench gate DMOSFETs using only three mask layers and TEOS/nitride spacer is proposed. Due to the reduced masking steps and self-aligned process, this technique can afford to fabricate DMOSFETs with high cell density up to 100 Mcell/inch$^2$ and cost-effective production. The resulting unit cell pitch was 2.3∼2.4${\mu}$m. The fabricated device exhibited a excellent specific on-resistance characteristic of 0.36m$\Omega$. cm$^2$ with a breakdown voltage of 42V. Moreover, time to breakdown of gate oxide was remarkably increased by the hydrogen annealing after trench etching.
We developed three dimensional Monte carlo ion implantation simulator which simulate distributions of impurities under the ion implantation on the tilted multi-layered layer. Our simulation reveals three dimensional shadow effect and sidewall scattering effect due to the geometrical shapes. For the evaluation of the developed three dimensional Monte carlo ion implantation simulator, calculations with 100,000 ions have been performed for the island and hole structures with a thin oxide of 100$\AA$ and nitride of 2000$\AA$. The simulation results showed that the distribution of ion decreases near the conner of the hole structure covered with a nitride layer and increases near the conner for the island structure open to oxide. Moreover, three dimensional distributions of ions were obtained with varying incident energy, tilt and rotation angle, mask depth and three-dimensional structure geometry.
Substrates of SAW filter are mainly single crystal such as LiNbO$_3$, LiTaO$_3$. However, fabrication of crystal is difficult and cost is very high. In this study, crystal was substituted for piezoelectric ceramics which has simple fabrication process. The same SAW filter mask was photolithographed on crystal(LiNbO$_3$) substrate and ceramic(PZT4, PZT5A and PZT8) substrate in order to compare experimental value with theoretical value. The difference of center frequency was only 3.7%. PZT8 showed good bandwidth properties. It is considered that PZT8 has higher mechanical quality factor and propagation velocity than PZT4, PTT5A.
This paper reports on the fabrication and characteristics of recessed gate GaN MESFETs fabricated using a photoelectrochemical wet etching method. The unique etching process utilizes photo-resistive mask and KOH based etchant. GaN MESFETs with successfully recessed gate structure was characterized in terms of dc and RF performance. The fabricated GaN MESFET exhibits a current saturation at $V_{DS}$ = 4 V and a pinch-off at $V_{GS}$ =-3V The peak drain current of the device is about 230mA/mm at 300 K and the value is remained almost same for 500K operation. The $f_{T}$ and $f_{max}$ from the device are 6.357Hz and 10.25 GHz, respectively.y.y.
한국결정성장학회 1998년도 PROCEEDINGS OF THE 15TH KACG TECHNICAL MEETING-PACIFIC RIM 3 SATELLITE SYMPOSIUM SESSION 4, HOTEL HYUNDAI, KYONGJU, SEPTEMBER 20-23, 1998
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pp.91-95
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Selectivity of SiC deposition on a Si substrate partially covered with a masking material was investigated by introducing HCl gas into hexamethyldisilane/H2 gas system during the deposition. the schedule of the precursor and HCl gas flows was modified so that the selectivity of SiC deposition between a Si substrate and a mask material should be improved. It was confirmed that the selectivity of SiC deposition was improved by introducing HCl gas. Also, the pulse gas flow technique was effective to enhance the selectivity.
Solder bump was electroplated on wafer for flip chip application. The process is as follows. Ti/Cu were sputtered and thick PR was formed by several coating PR layer. Fine pitch vias were opened using via mask and then Cu stud and solder bump were electroplated. Finally solder bump was formed by reflow process. In this paper, we opened 40㎛ vias on 57㎛ thick PR layer and electroplated solder bump with 70㎛ height and 40㎛ diameter. After reflow process, we could form solder bump with 53㎛ height and 43㎛ diameter. In plating process, we improved the plating uniformity within 3% by using ring contact instead of conventional multi-point contact.
This work aimed to develop ITO (Indium Tin Oxide) thin films ablation with a KrF Eximer laser required for the application in flat panel display, especially patterning into small geometry on a large substrate area. The threshold fluence for ablating ITO on glass substrate is about 0.1 J/cm$^2$. And its value is much smaller than using third harmonic Nd:YAG laser. Through the optical microscope measurement the surface color of the damaged ITO is changed into dark brown and irradiated spot is completely isolated form the undamaged surroundings by laser light. The XPS analysis showed that the relative surface concentration of Sn and In were essentially unchanged (In :Sn=5:1) after irradiating Eximer laser. Using aluminium mask made by second harmonic Nd:YAG laser the ITO patterning is carried out.
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[게시일 2004년 10월 1일]
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