• 한국컴퓨터산업학회논문지
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• 제7권3호
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• pp.205-215
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• 2006

본 논문에서는 최근의 64비트 마이크로프로세서에 대해서 PLA설계법 및 검사가 쉽고 용이하도록 하는 방법에 대해서 논하였다. VLSI에서 RAM. ROM. PLA를 사용한 설계법이 정착 되어가고 있으며 PLA는 논리설계와 회로변경 및 검사가 용이하기 때문에 성능과 가격이 중요하다. 향후에도 PLA는 VLSI 설계의 기본요소로서 중요한 위치를 점유할 것이다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제15권6호
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• pp.658-663
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• 2015

In the previous work, we have proposed an integrate-and-fire neuron circuit and synaptic device based on the floating body MOSFET [1-3]. Integrate-and-Fire(I&F) neuron circuit emulates the biological neuron characteristics such as integration, threshold triggering, output generation, refractory period using floating body MOSFET. The synaptic device has short-term and long-term memory in a single silicon device. In this paper, we connect the neuron circuit and the synaptic device using current mirror circuit for summation of post synaptic pulses. We emulate spike-timing-dependent-plasticity (STDP) characteristics of the synapse using feedback voltage without controller or clock. Using memory device in the logic circuit, we can emulate biological synapse and neuron with a small number of devices.

• 실천공학교육논문지
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• 제9권2호
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• pp.99-106
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• 2017

STEAM 과학예술융합교육에서 가장 중요한 것은 과학기술에 대한 학생들의 흥미와 이해를 높이는 일이다. 본 논문에서는 STEAM 융합 교육에 적용할 수 있는 기초 회로 시스템 설계와 제어 방법을 제안한다. 브레드 보드를 이용한 회로 시스템 설계 실습은 국내 교육과정의 고등학교 및 대학교 수준의 해당 학과에서 필수 교육과정으로 지정하고 있다. 하지만 실제 실습에는 회로 시스템 설계와 제어 방법을 쉽게 이해할 수 있는 STEAM 융합 형태의 구현 예제가 부족하다. 따라서, 미디어 아트 형태의 회로 시스템을 구현하고 제어하는 방법을 제안하고 시험하였다.

• 한국정보통신학회논문지
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• 제3권4호
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• pp.787-794
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• 1999

본 논문에서는 기존의 동적 CMOS 논리회로보다 동작속도가 타르고 면적이 작은 새로운 EMMODL (enhanced NORA MODL)의 설계방법을 제시하고, 이를 이용하여 32 비트 CLA(carry lookahead adder)를 구현하였다. 제안된 회로는 MODL(multiple output domino logic)의 출력 인버터를 제거하여 면적을 줄이고 동작속도를 증가시킬 수 있다. 0.8um 이중금속 CMOS 공정으로 구현된 CLA는 시차문제가 발생하지 않았고, 3.9nS 이내에 32 비트 연산이 가능하였다.

• 센서학회지
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• 제26권3호
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• pp.209-213
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• 2017

The delay-insensitive Null Convention Logic (NCL) asynchronous design as one of innovative asynchronous logic design methodologies has many advantages of inherent robustness, power consumption, and easy design reuses. However, transistor-level structures of conventional NCL gate cells have weakness of high area overhead and high power consumption. This paper proposes a new NCL gate based on power gating structure. The proposed $4{\times}4$ NCL multiplier based on power gating structure is compared to the conventional NCL $4{\times}4$ multiplier and MTNCL(Multi-Threshold NCL) $4{\times}4$ multiplier in terms of speed, power consumption, energy and size using PTM 45 nm technology.

• 대한전기학회논문지:시스템및제어부문D
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• 제49권6호
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• pp.316-321
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• 2000

In this paper, we proposed MBDD(Modified Binary Decision Diagram) as a multi-level logic synthesis method and a vertex of MBDD to NMOS transistors matching. A vertex in MBDD is matched to a set of NMOS transistors. MBDD structure can be achieved through transformation steps from BDD structure. MBDD can represent the same function with less vertices less number of NMOS transistors, consequently capacitance of the circuit can be reduced. Thus the power dissipation can be reduced. We applied MBDD to a full odder and a 4-2compressor. Comparing the 4-2compressor block with other synthesis logic, 31.2% reduction and 19.9% reduction was achieved in numbers of transistors and power dissipation respectively. In this simulation we used 0.8 ${\mu}{\textrm}{m}$ fabrication parameters.

• 전자공학회논문지B
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• 제32B권6호
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• pp.868-875
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• 1995

This paper presents a method of constructing the multiple-valued combinational logic systems(MVCLS) by decision diagram. The switching function truth table of MVCLS is transformed into canonical normal form of sum-of-products(SOP) with literals at first. Next, the canonical normal form of SOP is transfered into multiple-valued logic decision diagram(MVLDD). The selecting of variable ordering is very important in this stage. The MVLDDs are quite different from each other according to the variable ordering. Sometimes the inadequate variable ordering produces a very large size of MVLDD means the large size of circuit implementation. An algorithm for generating the proper variable ordering produce minimal MVLDD and an example shows the verity of the algorithm. The circuits are realized with T-gate acceording to the minimal MVLDD.

• 대한전자공학회논문지
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• 제14권5호
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• pp.1-6
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• 1977

synchronizer의 입력단에 비동기된 두 신호가 인가되었을 때 일어나는 Metastable 현상에 대한 회로의 해석과 Metastable point에서 stable state로 천이되는 과정에서 일어나는 현상을 해석하였으며, 이러한 mishappen 상태에 의해 기인하는 logic failure를 개선하기 위한 방법으로써, Inverter Method, open collector Method를 사용하여 올바른 논리를 이론과 실험을 통하여 구현하였다.

• 한국정보통신학회:학술대회논문집
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• 한국정보통신학회 2013년도 춘계학술대회
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• pp.675-676
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• 2013

본 논문에서는 TDBM과 CMTEDD를 사용하여 다중출력조합디지털논리시스템 설계방법의 한가지를 제안하였다. 또한, CBDD와 CMTEDD를 기반으로 최종 조합디지털논리시스템 구성을 멀티플렉서를 사용하여 구현하였다. 제안한 방법은 기존의 방법에 비해 모듈사이의 내부결선을 효과적으로 줄일 수 있으며 입력변수의 쌍과 출력함수의 쌍에 의해 게이트 수를 줄일 수 있는 장점이 있다.

• 전기학회논문지
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• 제62권6호
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• pp.845-851
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• 2013

Because the existing control system has been operating for about 20 years, it is necessary to upgrade the system for stable and efficient operation. But, there is a difficulty in maintenance by difference of manufacturer of each main control systems for boiler, turbine and generator. This developed IMCS(Integrated Monitoring and Control System) consists of more than 10,000 inputs and outputs for large scale thermal power plant. This paper consists of the development journey of IMCS MBC(mill and burner control) ; core binary protection & monitoring logic including prevention circuit of boiler explosion & implosion. In this project, the IMCS for boiler, turbine and generator was developed on basis of one communications platform. In this paper, the whole journey of development of IMCS MBC is dealt with designing software and hardware, coding application software, and validating software and hardware.