The advanced in semiconductor, hardware, and software technologies enables the integration of more com- plex systems and the increasing design complexity. As system design complexity becomes more complicated, System-level design based on the If block and processor model is more needed in most of the RTL level or low level. In this paper, we present a novel approach fur the system-level design, which satisfies the various required constraints and an optimization method of image encoder based on codesign of function, algorithm, and architecture. In addition, we show an MPEG-4 encoder as a design case study. The best tradeoffs between algorithm and architecture are necessary to deliver the design with satisfying performance and area constraints. The evaluations provide the effective optimization of motion estimation, which is in charge of an amount of performance in the MPEG-4 encoder module.
본 논문은 W-CDMA 무선 채널의 특성 중 Code domain을 분석을 하기 위한 시스템구현이다. 시스템 구성은 크게 RF부와 FPGA부, DSP부로 구성이 된다. FPGA는 RF부를 통한 신호를 I/Q분리 및 scambling code를 계산한다. DSP는 scambling code에 의한 역 확산된 신호는 OVSF코드를 이용하여 코드 영역의 전력을 계산을 한다. 실험 및 성능 테스트로는 W-CDMA발생기에 의한 실험 결과 Code domain power 측정 정확도가 $\pm$1dB 이내의 분석이 가능하였다.
Journal of information and communication convergence engineering
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제9권1호
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pp.59-63
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2011
Conventional noise reduction filtering schemes realize limited improvements of the peak signal-to-noise ratio (PSNR) in the low-level noisy images. The flatness degree and the edge information are effectively used to estimate the noise volume. We propose a noise estimator for reducing noise in the AWGN (additive white gaussian noise) corrupted images using three intermediate image maps (FGM(flatness gray map), FIM(flatness index map), NEM(noise estimate map)). The proposed noise estimator is fed into the conventional noise reduction filters as a pre-processor. The performance of noise reduction is tested in the various AWGN corrupted images.
We propose an automatic inspection system for hologram with multiple patterns. The system hardware consists of illuminations, camera, and vision processor. Multiple illuminations using LEDs are arranged in different directions to acquire each image of patterns. The system software consists of pre-processing, pattern generation, and pattern matching. The acquired images of input hologram are compared with their reference patterns by developed matching algorithm. To compensate for the positioning error of input hologram, reference patterns of hologram for different position should be generated in on-line. We apply a frequency transformation based CGH(computer-generated hologram) method to generate reference images. For the fast pattern matching, we also apply the matching method in the frequency domain. Experimental results for hologram of Korean currency are then presented to verify the usefulness of proposed system.
In this paper, we design and implement a XML management system based on OODBMS that supports structured information retrieval of XML documents. We also propose an object oriented modeling to store and fetch XML documents, to manage image data, and to support versioning for the XML document management system(XMS). The XMS consists of a repository manager that maintains the interfaces for external application programs, a XML instance storage manager that stores XML documents in the database, a XML instance manager that fetches XML documents stored in the database, a XML index manager that creates index for the structure information and the contents of documents, and a query processor that processes various queries.
최근 수년간 의료영상분야는 국내외적으로 급격한 발전을 거듭하고 있다. 특히 자기공명영상장치 (Magnetic Resonance Imaging), X-ray CT(Computed Tomography)와 단층촬영장치는 인체내부를 비침습적(non-invasive)으로 영상화함으로써 해부학적인 질병진단에 많은 장점을 가지고 있다. 이와같은 단층영상 재구성에는 역매트릭스법(matrix inversion). 반복재구성법(interative method), 역투영 법(back-projection), 2차원 Fourier 변환법(2D FFT), 중첩재구성법(Filtered back-projection) 등의 다양한 알고리즘을 사용하고 있다. 본 연구에서는 X-ray CT에서의 단층영상재구성 기법 중 널리 사용되고 있는 Filtered Back Projection 기법의 연산순서도와 연산량을 분석하고 이를 시뮬레이션을 통하여 확인하고 실시간 영상재구성을 위하여 범용 Digital Signal Processor의 병렬처리시스템 구성에 기반된 최적 Architecture를 선정하고자 한다.
최근 카메라 센서는 ISP(Image Signal Processor)를 별도로 사용하지 않고 SOC(System on Chip) 방식으로 설계를 하여 소형화를 추구하고 있지만, High Resolution의 카메라가 개발 요구되어지면서 센서 Pixel 및 스위칭 트랜지스터의 집적화가 심화되고 있다. 이러한 고집적화는 카메라 센서 내 발열 관리에 대한 관심을 높여주고 있다. 본 논문에서는 우선 SOC 센서가 ISP를 탑재한 센서이므로 프로세서 발열 관리 기법에 대해 먼저 소개를 한 후, SOC 방식 센서를 대상으로 열이 발생되는 관련 조건을 확인 검사하고, 분석한 결과를 보인다. 또한 이러한 분석 결과를 토대로 발열을 제어 할 수 있는 방법으로 DAC(Digital Analog Converter)를 사용하여 센서 내 사용되는 전류 증폭을 최소화 한 설계 방식에 대해 분석해 보았으며, 전류 증폭을 최소화한 결과 최대 PCLK(Pixel Clock)에서도 열화에 따른 Noise(Hot Pixel)를 개선시킬 수 있었다.
전자식전발분사노즐로 급속압축장치 내에서 실현한 축대칭 자유분무.화염에 고속도 사진의 화상해석을 적용하여 다음과 같은 결론을 얻었다. 1. 고속도 사진의 화상해석에 의해 구한 디이젤분무의 축방향의 연료농도분포는 분무의 선단부를 제외하면 준정상이론에 의한 분포와 정성적으로 일치한다. 2. 화염중심축방향의 그을음 농도는 연과의 농도가 비교적 낮은 분무의 선단부에서 높은 농도를 나타내며, 그 농도는 거의 분사종료시에 최대로 되어, 그 후 시간경과에 따라 저하한다. 3. 양파모델을 축대칭 분무.화염에 적용하여 분무.화염내부의 반경방향의 그을음 농도와 연료농도분포를 비교해 보면 그을음 농도의 가장 높은 부분은 연료농도가 가장 높은 중심부보다 화염반경의 2/3의 위치에서 최대로 되었다
A study on the static type train simulator will include the training of new drives requires that the environment of the cab, controls placement, etc. must highly realistic so that driver can readily transfer his training experience to the real world. The simulator computer sends video disc speed command to a Video PC processor. A video switcher select the output of the on-line player. This selection is done with loss of vertical synchronization, meaning the picture will not noticeable roll or jump as the simulation mover from disc to disc. The video image quality remain contestant through the simulated speed range from zero to 100km/h. Flicker is avoided in the scene by the use of a TBC(Time Base Corrector) which causes the display of one video field at a time. Thus, no interfield jitter is present when the scene is stopped.
International Journal of Computer Science & Network Security
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제22권2호
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pp.193-198
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2022
Face Detection is one of the most important aspects of image processing, it considers a time-consuming problem in real-time applications such as surveillance systems, face recognition systems, attendance system and many. At present, commodity hardware is getting more and more heterogeneity in terms of architectures such as GPU and MIC co-processors. Utilizing those co-processors along with the existing traditional CPUs gives the algorithm a better chance to make use of both architectures to achieve faster implementations. This paper presents a hybrid implementation of the face detection based on the local binary pattern (LBP) algorithm that is deployed on both traditional CPU and MIC co-processor to enhance the speed of the LBP algorithm. The experimental results show that the proposed implementation achieved improvement in speed by 3X when compared to a single architecture individually.
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[게시일 2004년 10월 1일]
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