• Journal of Advanced Marine Engineering and Technology
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• 제35권2호
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• pp.278-287
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• 2011

본 논문은 IMO에서 선박정보 통합 및 안전 운항을 목적으로 채택한 SOLAS(Safety of Life at Sea) 선박의 표준 프로토콜인 NMEA 2000을 기반으로 한 게이트웨이를 구현하였다. 이를 위해 CAN, RS232, USB, Ethernet을 Xilinx에서 제공되는 MicroBlaze와 FPGA를 이용해 Vertex4기 반 ML401 보드에 포팅하고 NMEA 2000 스택을 탑재하였다. 다양한 프로토콜을 수신하여 변환할 수 있도록 요구되는 통신 속도를 준수하여 설정하였다. 게이트웨이에서 변환된 데이터의 검증을 위해 PC 기 반의 모니터링 프로그램을 제작하고 NMEA 2000 네트워크의 데이터를 PC에서 수신할 수 있도록 네트 워크를 구성하였다. PC에서 수신된 데이터를 모니터링 프로그램을 통해 분석하고 게이트웨이의 성능을 검증하였다.

• 한국정보처리학회논문지
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• 제6권1호
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• pp.193-202
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• 1999

음성뿐만 아니라 데이터, 화상 및 영상 등의 고품질 서비스를 제공하는 제 3세대 이동통신(IMT-2000 : International Mobile Telecommunications-2000)은 2000년대 초에 전체 통신 서비스의 50% 정도를 점유할 것으로 예견된다. 한편 개인의 이동성을 보장할 수 있는 UPT(Universal Personal Telecommunications) 서비스는 다양한 종류의 유무선망을 단일 번호로써 을 수 있는 중요한 서비스로 인식되고 있다. 본 논문은 차세대 지능망 서비스를 지원하는 IMT-2000 교환기의 시스템 구조 및 소프트웨어 블록 형상을 제안하고 지능망 기능 지원에 필요한 교환기 내부의 서비스 교환 기능을 설계한다. 또한 제안된 구조와 서비스 교환 기능을 적용하여 차세대 지능망 서비스의 대표적인 서비스인 UPT 서비스의 호 시나리오를 설계한다. 특히 IMT-2000 교환기 내부 소프트웨어 블록간 호 흐름에 바탕을 둔 UPT 서비스기능 구현에 초점을 두어 UPT 서비스 호 시나리오를 설계한다.

• Journal of Advanced Marine Engineering and Technology
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• 제35권2호
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• pp.288-294
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• 2011

본 논문에서는 FPGA기반의 SoC보드(Xilinx Virtex-4 ML401 EVM)를 이용한 전력인버터제어시스템을 설계하였다. 선박에 전력시스템을 적용하기 위해서 선박의 최신 통신 프로토콜인 NMEA 2000 표준 프로토콜을 적용하였으며 전력 시스템의 성능을 평가하기 위한 PC기반의 모니터링 프로그램을 제작하였다. 전력 제어시스템은 FPGA기반의 임베디드 SoC보드상에서 이중프로세서(Dualprocessor)형태로 설계하였으며 이중프로세서를 적용함으로써 실시간 제어 감시가 가능하다. 이중프로세서 중 하나는 전력 제어를 위한 PWM신호생성 및 전력 회로내의 주요 전력 파라미터를 센싱 하는 제어용 프로세서로 동작하며(Control processor) 다른 프로세서는 제어프로세서의 각종 전력 센서 파라미터와 제어 파라미터들을 이중포트 램(Dual Port RAM)을 이용하여 정보를 공유하고 외부 NMEA 2000프로토콜 기반의 모니터링 장치와 네트워크 기반의 통신을 수행하는 통신용 프로세서(Communication processor)로 구성된다. 본 논문에서 제작한 전력 제어시스템은 선박내의 분산발전,송배전 및 전압 레귤레이션 시스템에 적용 될 수 있다.

• 한국정보통신학회논문지
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• 제7권4호
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• pp.646-651
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• 2003

본 논문에서는 IMT2000 및 위성 DVB등 여러 규격에서 표준으로 채택된 터보 부호에서 사용되는 터보 인터리버의 성능에 대하여 비교분석하였다. BER 성능평가를 위해 레일리 페이딩 채널에서 고정소수점방식으로 컴퓨터 모의실험을 수행하였다. 공정한 비교를 위해 가능한한 인터리버의 크기를 같게 설정하였다. 모의실험결과 인터리버의 크기가 클수록 W-CDMA에서 사용하는 인터리버가 CDMA2000 및 위성 DVB용으로 사용하는 터보 인터리버에 비해 성능이 우수하다는 것을 확인하였다. 이러한 현상은 인터리버의 크기가 증가할 수록 더욱 두드러졌다.

• 대한전기학회논문지:시스템및제어부문D
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• 제54권8호
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• pp.498-500
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• 2005

In a CDMA system, the capacity is variable and mainly depends on multiple access interference. The multiple access interference has a deep relationship with transmitted or received power The capacity of CDMA2000 1x system is considered to be limited by the forward link capacity Different rate data traffic requires different transmitted power and rate controlling enables the system utilize radio resource more efficiently. A very simple rate control algorithm for data calls in CDMA2000 1x system is proposed. In the proposed algorithm, by monitoring the total transmit power, we can simply adjust data rate to channel conditions and efficiently use radio resources. The proposed algorithm is easy to implement in power controlled CDMA systems.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2005년도 심포지엄 논문집 정보 및 제어부문
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• pp.221-223
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• 2005

In a CDMA system, the capacity is variable and mainly depends on multiple access interference. The multiple access interference has a deep relationship with transmitted or received power. The capacity of CDMA2000 1x system is considered to be limited by the forward link capacity. Different rate data traffic requires different transmitted power and rate controlling enables the system utilize radio resource more efficiently. A very simple rate control algorithm fer data calls in CDMA2000 1x system is proposed. In the proposed algorithm, by monitoring the total transmit power, we can simply adjust data rate to channel conditions and efficiently use radio resources. The proposed algorithm is easy to implement in power controlled CDMA systems.

• Journal of Advanced Marine Engineering and Technology
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• 제34권4호
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• pp.522-531
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• 2010

선박에서 발생되는 다양한 형태의 디지털 정보를 그 특성에 따라 적절하게 처리하기 위해서는 용도에 적합한 네트워크의 구성이 필요하다. 이러한 필요성에 부합하는 표준으로 NMEA 2000과 IEC 61162-4가 있다. NMEA 2000은 실시간 데이터의 처리에 적합한 표준이고, IEC 61162-4는 데이터의 통합 관리에 적합한 표준이다. 따라서, NMEA 2000 데이터를 통합하여 관리하기 위해서는 IEC 61162-4 포맷으로 변환하여야 한다. 본 논문에서는 이러한 변환을 위한 참조화일 및 알고리즘을 제시하고 그 구현 결과를 기술한다.

• Journal of Communications and Networks
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• 제8권2호
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• pp.169-174
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• 2006

In this paper, the algorithm of a methodology for the calculation of spectrum requirements was implemented. As well, the influence of traffic distribution ratio among radio access technology groups, spectral efficiency, and flexible spectrum usage (FSU) margin was analyzed in terms of the spectrum requirements, with a view toward for future development of international mobile telecommunication (IMT)-2000 and systems beyond IMT-2000. The calculated spectrum requirement in the maximum spectral efficiency case is reduced by approximately 40% compared to a minimum spectral efficiency case. The effect of the distribution ratio on the required spectrum is smaller than the effect of the spectral efficiency. As the flexible spectrum usage margin increases by 1.0 dB, the total spectrum requirement decreases by 0.9 dB. The required spectrum for the market input parameter, ${\rho}$ = 0.5 is 801.63 MHz, while the required spectrum for ${\rho}$ = 1.0 is 6295.4 MHz. This is equivalent to an increase of 785.32 %.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2000년도 추계종합학술대회 논문집(2)
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• pp.273-276
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• 2000

Recently, Turbo code has been considered for channel coding in IMT-2000(International Mobile Telecommunication-2000) system, because it offers better error correcting capability than the traditional convolution/viterbi coding . In this paper, a turbo code decoder for speech transmission in IMT-2000 system with frame size 192 bits, constrait length K=3, generator polynomials G(5,7) and code rate R=1/3 is designed using SOVA(Soft Output Viterbi Algorithm) and block interleaver

• 융합신호처리학회논문지
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• 제9권4호
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• pp.321-328
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• 2008

본 논문에서는 차세대 정지영상 압축 표준 JPEG2000 CODEC의 Wavelet 변환부와 양자화기의 하드웨어 구조를 제안하고 선계하였다. 본 논문의 칼라 2-D DWT 프로세서는 JPEG 2000 Hard-wired Encoder에 적용하기 위해 제안하였다. JPEG 2000DWT(Discrete Wavelet Transform)에서는 Daubechies 9/7 filter를 사용하였고 2-B DWT의 변환과 복원과정에서의 오차가 ${\pm}1$LSB 이내로 들어갈 수 있게 설계하였다. 기존에 설계되었던 filter의 하드웨어 구조에서 하드웨어 복잡도를 높이는 곱셈기를 사용하지 않고 shift-and-adder 구조를 사용하였다. 이것은 DWT 변환에서 가장 많은 연산을 차지하는 filter의 동작 속도를 향상시킬 수 있으며 하드웨어 복잡도도 낮출 수 있다. 본 시스템은 표준화된 하드웨어 설계 언어인 Verilog-HDL을 사용하여 설계하였고, Synopsys사의 Design Analyzer와 TSMC $0.25{\mu}m$ ASIC Library를 사용하여 검증하였다.