RFID는 초소형 IC 칩에 식별정보를 입력하고 무선주파수를 이용하여 칩이 부착된 각 사물의 정보를 인식하고 추적, 관리할 수 있는 유비쿼터시대의 핵심기술이다. 그러나 RFID 시스템은 사용자가 의식하지 못하는 사이에 타인에 의해 개인정보는 물론 상황정보까지 수집되고 이용될 수 있기 때문에 프라이버시침해 문제와 정보보안의 대책이 시급한 실정이다. 뿐만 아니라, 유선상에서 사용되는 보안강도가 높은 여러 암호화 알고리즘은 태그의 다양한 제약 때문에 직접 적용되기 어렵다. 본 논문에서는 국제 표준화에 따른 ISO/IEC 18000-6의 표준안을 바탕으로 RFID 태그의 설계와 설계 과정에서 드러난 RFID 시스템이 가지고 있는 문제점을 분석해보았으며 또한 설계한 태그에 적용 할 수 있는 암호화 알고리즘에 대해서 고찰하였다.
RFID(Radio Frequency IDentification)는 무선을 사용하는 인식기술로 정보를 수집하는 리더와 정보를 전달하는 태그로 구분된다. RFID기술은 단순히 ID만을 전달하던 수동형 RFID에서 센싱정보와 같은 부가 정보를 전달할 수 있는 능동형 RFID기술로 발전해가고 있다. 능동형 RFID기술의 표준으로는 433.92MHz 대역을 사용하는 ISO/IEC 18000-7이 있으나 이것은 단일채널시스템으로 하나의 리더가 여러개의 태그를 인식하는데 한계가 있다. 이러한 한계를 극복하기 위한 하나의 방법으로 다중 채널을 사용할 수 있는 2.4GHz대역 RFID기술이 있을 수 있다. 만약 리더가 다중 인터페이스를 가진다면 각각의 인터페이스가 서로다른 채널을 사용하게 함으로써 다수의 태그를 고속으로 인식할 수 있을 것이다. 그러나 만약 다수의 인터페이스를 가지는 리더라 할지라도 태그들이 특정인터페이스에 집중될 경우 다중 인터페이스에 의한 성능개선은 이루어지지 않을 것이다. 본 논문에서는, 다중 인터페이스 RFID리더에서 인터페이스간 부하 분배를 위한 프로토콜의 설계와 구현을 통해 고속의 태그 수집을 보이겠다.
제어시스템에 대한 사이버 위협 사례가 증가함에 따라 제어시스템 사이버 보안에 대한 필요성이 증가하고 있다. 현재 국내외에서 다양한 사이버 보안 관련 교육과 제어시스템 관련 교육이 수행되고 있다. 그러나 제어시스템의 특성과 참가자의 특성을 온전히 반영하기에 아쉬움이 있다. 본 논문에서는 제어시스템의 특성을 반영하기 위하여 다양한 제어시스템을 분석하였다. 분석 내용과 IEC62443에서 제시된 제어시스템 모델을 이용하여 제어시스템 훈련 환경을 제안한다. 그리고 참가자의 학습 성과를 향상하기 위해 참가자 특성을 분석하고, 교육 분야의 ARCS 학습 모델을 활용한 융합소통 훈련 기법을 제안하였다. 그리고 제안한 훈련환경과 훈련기법을 이용한 교육훈련 시나리오를 제시하였다. 제안한 내용을 통해 보안전문가와 제어시스템 전문가의 상호 이해를 바탕으로 한 협업 모델을 실무에 적용하여 최종적으로 제어시스템 사이버 보안 능력을 향상시킬 수 있을 것이라고 기대한다.
철도 시스템의 안전성 표준인 IEC 62278은 위험원 분석을 통해서 철도 시스템이 가질 수 있는 위험원을 예방하거나 또는 제어하도록 요구한다. 만약 위험원 분석이 충분하지 않으면 사고가 발생할 가능성이 높기 때문에, 위험원 분석을 보다 철저히 수행할 필요가 있다. 본 논문에서는 기존의 신뢰성 기반 방법과 시스템 이론적 방법을 상호 결합한 하이브리드 위험원 분석을 제안한다. 제안하는 방법은 기존 위험원 방법을 상호 보완하는 것으로서, 시스템 구성 요소의 고장으로 인한 위험원과 구성 요소들 간의 상호작용으로 인해 발생되는 제어 위험원을 함께 분석한다. 열차간의 속도를 자동 제어하는 다중 적응형 순항 제어 장치의 안전 보호 시스템 개발에 적용한 결과, 기존 방법들 보다 안전 요구사항을 더 많이 추출하여, 위험원으로부터 시스템을 보호함을 확인하였다.
H.264/AVC는 ITU-T와 ISO/IEC의 최신 동영상 압축 코덱 규격으로 MPEG-2보다 2배 이상의 압축률과 고화질로 최근 그 적용 영역을 넓혀 가고 있다. 본 논문에서는 H.264/AVC에서 압축 성능을 높이기 위해 사용된 기법중 하나인 인트라 예측에 대해 설명하고 인트라 예측 모드 연산을 효율적으로 수행하기 위한 인트라 예측기의 구조를 제안하다. 제안된 인트라 예측기는 공통 연산기와 전처리 연산기를 사용하여 연산량을 줄이고, 효율적인 레지스터를 사용하여 외부 메모리와의 접근을 최소화 하였다. 제안된 인트라 예측기는 Verilog-HDL을 이용하여 설계하였으며 적합한 테스트 벡터를 이용하여 검증 되었다. 제안된 인트라 예측기는 기존에 비해 약 60%의 향상된 결과를 얻었다.
RFID(Radio Frequency IDentification)는 무선을 사용하는 인식기술로 정보를 수집하는 리더와 정보를 전달하는 태그로 구분된다. RFID기술은 단순히 ID만을 전달하던 수동형 RFID에서 센싱정보와 같은 부가 정보를 전달할 수 있는 능동형 RFID기술로 발전해가고 있다. 컨테이너 터미널과 같은 환경에서 다수의 리더가 동시에 동작하여 다수의 태그를 인식하기 위해서는 리더가 각기 다른 채널을 가져야 한다. 그러나 기존 단일채널 시스템인 ISO/IEC18000-7과 같은 표준에서는 표준의 특성상 다수의 채널을 사용할 수가 없다. 이 같은 문제를 해결하기 위해 다수의 채널을 사용할 수 있는 2.4GHz 대역을 사용하였다. 그리고 리더들이 사용하는 채널을 동적으로 할당함으로써 채널의 사용을 효과적으로 할 수 있는 방법을 제안하였다. 제안한 알고리즘을 Taxas Instrument사의 CC2500DK를 통해 구현함으로써 실제 알고리즘이 동작하는 모습을 보이겠다.
배전분야 전력계통에 적용되는 보호기기류는 변전소 차단기, 배전선로의 리클로저, 최소 전류 용량 회로, 고장구간 차단기 등이 있다. 이들은 부분 정전이나 대규모 사고를 방지하고 선로의 순간고장 또는 영구고장 발생 시 정상 계통이 건전성을 유지할 수 있도록 광역 정전 파급을 방지한다. 그러나 사고가 발생할 경우 변전소 차단기와 배전선로 보호기기 간의 보호협조 미비로 인하여 광역 정전을 초래할 수 있다. 더 좋은 전력시스템의 건전성을 확보하기 위하여 1주기(16ms) 이내로 동작하는 차단기를 개발할 필요성이 요구된다. 본 연구에서는 친환경 가스절연 방식의 고속도 차단기를 개발하였으며, IEC 62271-111 표준에 기반한 시험에서 우수한 결과를 얻었다. 이 기기는 고장구간을 정확하고 빠르고 신속하게 분리하여 광역 정전 예방에 기여할 것으로 기대된다.
본 연구는 소프트웨어 품질 특성인 기능적합성, 신뢰성, 사용성, 이식성, 유지보수성, 성능효율성, 보안성, 호환성 중에서 신뢰성에 대한 평가 방안을 연구하였다. 소프트웨어 품질 측정에 있어 신뢰성의 정량적 평가 방안을 제시한다. 본 연구는 소프트웨어 품질 특성 중 하나인 신뢰성 평가 중 성숙성에 포함되는 고장률을 측정하는 방법에 대해서 소개하고 고장 데이터의 형태에 따라 고장률이 어떻게 변화하는지에 대해 실험데이터를 가지고 연구한 내용이다. 소프트웨어 테스팅을 중심으로 매일의 고장 수를 중심으로 소프트웨어 신뢰성 성장 모델에 적용하여 고장률을 측정하여 고장 데이터의 형태에 따라 비교 분석하였다. 6일간의 테스트를 통해서 발견된 고장 시간을 중심으로 고장률을 측정하고 측정결과를 이용해서 국제표준 ISO/IEC 25023에서 제시하고 있는 고장률과 비교 하였으며 데이터 형태에 따라 적용방안을 검토하였다.
고품질 소프트웨어의 요구 증가로 국제표준, 산업 기능안전(IEC 61508), 자동차(ISO 26262), 무기체계 내장형 소프트웨어 지침 등 품질 인증 요구가 많다. 스타트 업, 벤처, 중소 업체들은 비용 및 인력 측면에서 체계적인 품질 획득이 어려움이 있다. 그들 업체에게 자동 테스트 케이스 생성은 비용, 시간, 인력 문제에도 소프트웨어 품질을 향상할 수 있는 해법으로 제시 될 수 있다. 이를 위해, 시스템 및 소프트웨어 설계 검증이 가능한 "의사 결정표" 기반 테스트 케이스 자동화를 제안한다. 이는 OMG의 표준 기법인 메타모델과 모델 변환 기법을 사용해 각각 의사 결정표(Model)와 테스트 케이스(Text)의 메타모델 설계 및 모델변환을 정의한다. 즉 의사 결정표 입력으로 테스트 케이스 발생 자동화이다. 이를 통해 MC/DC 커버리지등도 쉽게 적용 가능하다.
CHAM은 ISO/IEC 표준 블록암호 운영 모드에서 암호화 함수가 복호화 함수보다 자주 사용되는 점을 고려하여 암호화 속도를 강조하여 설계되었다. 현대 범용 프로세서 구조의 슈퍼스칼라 아키텍처에서는 연산 구성이 동일하더라도 연산의 순서가 달라지면 처리 속도가 달라질 수 있다. 본 논문에서는 ARX 기반 블록암호인 CHAM의 연산 순서를 재배치한 구조 CHAM-like 구조들에 대해 범용 프로세서 환경에서 단일 블록 구현과 병렬 구현에 대한 구현 효율성과 안전성을 분석한다. 본 논문에서 제시한 구조는 암호화 속도 관점에서 최소 약 9.3%에서 최대 약 56.4% 효율적이다. 안전성 분석은 CHAM-like 구조들에 차분 공격과 선형 공격에 대한 저항성을 평가한다. 보안마진 관점에서 차분 공격은 3.4%, 선형 공격은 6.8% 차이를 보여 효율성 차이에 비해 보안 강도는 비슷함을 보인다. 이러한 결과는 ARX 기반 블록암호 설계 관점에서 활용가능하다.
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[게시일 2004년 10월 1일]
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