• Proceedings of the Korean Vacuum Society Conference
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• 2010.02a
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• pp.405-405
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• 2010

Thermocouple 을 통해 Inductively coupled plasma 에 노출된 실리콘 기판 표면온도를 공정조건 변화 에 따라 실시간 (in-situ) 측정하였다. 이를 바탕으로 공정변화에 따른 플라즈마 내 활성종의 거동을 연구하였다. 더 나아가 기판의 표면온도변화 및 활성종의 거동해석을 토대로 공정변화에 의한 딥 실리콘 구조형성 메커니즘을 해석하였다. 플라즈마에 노출된 기판표면 온도를 상승시키는 주 활성종은 positive ion 이며 ICP power, Bias power, 플라즈마 압력 변화에 따라 positive ion 의 밀도 및 가속에너지가 변화하는데 이러한 거동변화는 기판의 표면온도를 변화시킴을 알 수 있었다. 딥 실리콘 구조의 측벽 및 바닥에 형성되어 있는 passivaiton layer 즉 $SiO_xF_y$(silicon oxyflouride) 는 온도에 매우 민감한 물질이며 이는 딥 실리콘 구조 내부로 입사하는 positive ion 거동변화에 따라 그 성질이 변화하여 deep Si 구조 형상을 변화시킴을 알 수 있었다. 기판표면 온도가 $0^{\circ}C$ 이하의 극저온으로 유지된 상황에서 플라즈마를 방전할 경우 positive ions 의 가속에너지로 인해 기판표면온도가 상승하며 액화질소 유량증가를 통해 다시 기판의 표면온도를 유지시킬 수 있었다. 이를 통해 플라즈마 방전 전과 방전 후의 기판 표면온도는 상온의 기판뿐만 아니라 극저온의 기판에서도 다름을 알 수 있었다. 냉각환경 변화에 따른 딥 실리콘 구조형성 메커니즘을 positive ions 거동 그리고 온도 감소에 의한 $SiO_xF_y$ 성질 변화를 이용해 해석할 수 있었다.

• Clean Technology
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• v.27 no.3
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• pp.240-246
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• 2021

The waste etching solution for chip on film (COF) contained about 3.5% copper, and it was recovered through cementation using iron samples. The effect of cementation with plate, chip, and powder iron samples was investigated. The molar ratio (m/r) of iron to copper was used as a variable in order to increase the recovery rate of copper. As the molar ratio increased, the copper content in the solution rapidly decreased at the beginning of the cementation reaction. Before and after the reaction, the copper content of the solution was determined by Inductively Coupled Plasma (ICP) using copper concentration according to time. After cementation at room temperature for 1 hour, the recovery rate of copper had increased the most in the iron powder sample, having the largest specific surface area of the samples, followed by the chip and plate samples. The recovered copper powder was characterized for its crystalline phase, morphology, and elemental composition by X-ray diffraction (XRD), scanning electron microscopy (SEM), and Energy-dispersive X-ray spectroscopy (EDS), respectively. Copper and unreacted iron were present together in the iron powder samples. The optimum condition for recovering copper was obtained using iron chips with a molar ratio of iron to copper of 4 giving a recovery rate of about 98.4%.

• Journal of the Korean Chemical Society
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• v.45 no.4
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• pp.341-350
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• 2001

Aluminum Hydroxide was employed as a thermal retardent and flame retardent for Chloropolyethylene (CPE) rubbery materials which is the construction material of automotive oil cooler hose. and then cure characteristics, physical properties, thermal resistance and flame retardation of compounded rubber were investigated, and optimum mixing conditions of rubber and flame retarding agent were deduced from the experimental results. CPE rubber material which has excellent properties of chemical corrosion resistance and cold resistance and inexpensive in price was used to prepare rubber specimen. The by-product of ething, produced from the process of surface treatment of aluminum was processed to aluminum hydroxide via crushing and purification, which is characterized by XRD, PSA, SEM and ICP-AES techniques in terms of phase, size, distribution, morphology and components of particles and then mixed to CPE rubber materials in the range of 0~80 phr. Hardness, tensile strength, elongation and thermal properties of compounded rubber specimens were tested. The optimum mixing ratio of rubber to additives to give maximum effect on thermal resistance and flame retardation, within the range of tolerable specification for rubber materials, was determined to be 40 phr. The flame retardation of CPE rubber materials was found to be increased by 5 times at this mixing ratio.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.37 no.11
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• pp.18-24
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• 2000

(Ba,Sr)$TiO_3$ thin films have attracted great interest as new dielectric materials of capacitors for ultra-large-scale integrated dynamic random access memories (ULSI-DRAMs) such as 1 Gbit or 4 Gbit. In this study, inductively coupled $BCl_3/Cl_2/Ar$ plasmas was used to etch (Ba,Sr)$TiO_3$ thin films. RF power/dc bias voltage=600 W/-250 V and chamber pressure was 10 mTorr. The $Cl_2/(Cl_2+Ar)$ was fixed at 0.2 the (Ba,Sr)$TiO_3$ thin films were etched adding $BCl_3$. The highest (Ba,Sr)$TiO_3$ etch rate is $480{\AA}/min$ at 10 % $BCl_3$ to $Cl_2/Ar$. The change of Cl, B radical density measured by optical emission spectroscopy(OES) as a function of $BCl_3$ percentage in $Cl_2/Ar$. The highest Cl radical density was shown at the addition of 10% $BCl_3$ to $Cl_2/Ar$. To study on the surface reaction of (Ba, Sr)$TiO_3$ thin films was investigated by XPS analysis. Ion bombardment etching is necessary to break Ba-O bond and to remove $BaCl_2$. There is a little chemical reaction between Sr and Cl, but Sr is removed by physical sputtering. There is a chemical reaction between Ti and Cl, and $TiCl_4$ is removed with ease. The cross-sectional of (Ba,Sr)$TiO_3$ thin film was investigated by scanning electron microscopy (SEM), the etch slope is about 65~70$^{\circ}$.

• Journal of the Microelectronics and Packaging Society
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• v.21 no.3
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• pp.67-71
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• 2014

An attempt to grow high quality GaN on silicon substrate using metal organic chemical vapor deposition (MOCVD), herein GaN epitaxial layers were grown on various Si(111) substrates. Thin Platinum layer was deposited on Si(111) substrate using sputtering, followed by thermal annealing to form Pt nano-clusters which act as masking layer during dry-etched with inductively coupled plasma-reactive ion etching to generate nano-patterned Si(111) substrate. In addition, micro-patterned Si(111) substrate with circle shape was also fabricated by using conventional photo-lithography technique. GaN epitaxial layers were subsequently grown on micro-, nano-patterned and conventional Si (111) substrate under identical growth conditions for comparison. The GaN layer grown on nano-patterned Si (111) substrate shows the lowest crack density with mirror-like surface morphology. The FWHM values of XRD rocking curve measured from symmetry (002) and asymmetry (102) planes are 576 arcsec and 828 arcsec, respectively. To corroborate an enhancement of the growth quality, the FWHM value achieved from the photoluminescence spectra also shows the lowest value (46.5 meV) as compare to other grown samples.

• Proceedings of the Materials Research Society of Korea Conference
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• 2003.03a
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• pp.62-62
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• 2003

고밀도 유도결합 플라즈마(high density inductively coupled plasma) 식각은 GaAs 이종접합 양극성 트랜지스터(HBTs)와 고속전자 이동도 트랜지스터(HEMTs)와 같은 GaAs 기반 반도체의 정교한 패턴을 형성하는데 더욱 많이 이용되고 있다 본 연구는 고밀도 플라즈마 소스(source)인 평판형(planar) 고밀도 유도결합 플라즈마 식각장치를 이용하여 $BCl_3$ 와 $BCl_3/Ar$ 가스에 따른 GaAs 식각결과를 비교 분석하였다. 공정변수는 ICP 소스 파워를 0-500W, RIE 척(chuck) 파워를 0-150W, 공정압력을 0-15 mTorr 이었다. 그리고 가스 유량은 20sccm(standard cubic centimeter per minute)으로 고정시킨 상태에서 Ar 첨가 비율에 따른 GaAs의 식각결과를 관찰하였다. 공정 결과는 식각률(etch rate), GaAs 대 PR의 선택도(selectivity), 표면 거칠기(roughness)와 식각후 표면에 남아 있는 잔류 가스등을 분석하였다. 20 $BCl_3$ 플라즈마를 이용한 GaAs 식각률 보다 Ar이 첨가된 (20-x) $BC1_3/x Ar$ 플라즈마의 식각률이 더 우수하다는 것을 알 수 있었다. 식각률 증가는 Ar 가스의 첨가로 인한 GaAs 반도체와 Ar 플라즈마의 충돌로 나타난 결과로 예측된다. $BCl_3$ 와 $BC1_3/Ar$ 플라즈마에 노출된 GaAs 반도체 모두 표면이 평탄하였고 수직 측벽도 또한 우수하였다. 그리고 표면에 잔류하는 성분은 Ga와 As 이외에 $Cl_2$ 계열의 불순물이 거의 발견되지 않아 매우 깨끗함을 확인하였다. 이번 발표에서는 $BCl_3$ 와 $BCl_3/Ar$ 플라즈마를 이용한 GaAs의 건식식각 비교에 대해 상세하게 보고 할 것이다.

• Journal of the Korean Institute of Electrical and Electronic Material Engineers
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• v.26 no.5
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• pp.335-340
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• 2013

In this study, the plasma etching of the TaN thin film with $CH_4/BCl_3/Ar$ gas chemistries was investigated. The etch rate of the TaN thin film and the etch selectivity of TaN to $SiO_2$ was studied as a function of the process parameters, including the amount of $CH_4$. X-ray photoelectron spectroscopy (XPS) and Field-emission scanning electron microscopy (FE-SEM) was used to investigate the chemical states of the surface of the TaN thin film.

• Journal of the Korean Vacuum Society
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• v.6 no.1
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• pp.91-96
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• 1997

The electrical characteristics and the plasma parameters of planar inductively coupled plasmas (ICP) have been measured. The resistance of the total load including the coil and the plasma varied from 1 to 4 W and the inductance from 1.5 m to 2 mH when the power was changed from 100 to 1000 W and the pressure from 1 to 10 mTorr. The density of electron measured by Langmuir probe was over $10^{11}/\textrm{cm}^3$ and the temperature varied between 3 and 5 eV as the process conditions were changed. Bias modulation was adopted as a new method to improve the selectivity of $SiO_2$on Si in $C_4F_8$ (octafluorocyclobutane) plasma. The selectivity was improved as the duty ratio decreased, but the etch rate of $SiO_2$decreased below 400$\AA$/min. $H_2$addition to $C_4F_8$ plasma showed that the etch selectivity could be higher than 50 and the etch rate of $SiO_2$over 2000$\AA$/min when 60% $H_2$was added.

• Proceedings of the Korean Vacuum Society Conference
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• 2012.02a
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• pp.463-463
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• 2012

ITRS (international technology roadmap for semiconductors)에 따르면 MOS(metal-oxide-semiconductor)의 CD (critical dimension)가 45 nm node이하로 줄어들면서 poly-Si/$SiO_2$를 대체할 수 있는 poly-Si/metal gate/high-k dielectric이 대두된다고 보고하고 있다. 일반적으로 high-k dielectric를 식각시 anisotropic 한 식각 형상을 형성시키기 위해서 plasma를 이용한 RIE (reactive ion etching)를 사용하고 있지만 PIDs (plasma induced damages)의 하나인 PIED (plasma induced edge damage)의 발생이 문제가 되고 있다. PIED의 원인으로 plasma의 direct interaction을 발생시켜 gate oxide의 edge에 trap을 형성시키므로 그 결과 소자 특성 저하가 보고되고 있다. 그러므로 본 연구에서는 이에 차세대 MOS의 high-k dielectric의 식각공정에 HDP (high density plasma)의 ICP (inductively coupled plasma) source를 이용한 원자층 식각 장비를 사용하여 PIED를 줄일 수 있는 새로운 식각 공정에 대한 연구를 하였다. One-monolayer 식각을 위한 1 cycle의 원자층 식각은 총 4 steps으로 구성 되어 있다. 첫 번째 step은 Langmuir isotherm에 의하여 표면에 highly reactant atoms이나 molecules을 chemically adsorption을 시킨다. 두 번째 step은 purge 시킨다. 세 번째 step은 ion source를 이용하여 발생시킨 Ar low energetic beam으로 표면에 chemically adsorbed compounds를 desorption 시킨다. 네 번째 step은 purge 시킨다. 결과적으로 self limited 한 식각이 이루어짐을 볼 수 있었다. 실제 공정을 MOS의 high-k dielectric에 적용시켜 metal gate/high-k dielectric CMOSFETs의 NCSU (North Carolina State University) CVC model로 구한 EOT (equivalent oxide thickness)는 변화가 없으면서 mos parameter인 Ion/Ioff ratio의 증가를 볼 수 있었다. 그 원인으로 XPS (X-ray photoelectron spectroscopy)로 gate oxide의 atomic percentage의 분석 결과 식각 중 발생하는 gate oxide의 edge에 trap의 감소로 기인함을 확인할 수 있었다.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.02a
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• pp.287-287
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• 2011

ITRS(international technology roadmap for semiconductors)에 따르면 MOS (metal-oxide-semiconductor)의 CD(critical dimension)가 45 nm node이하로 줄어들면서 poly-Si/SiO2를 대체할 수 있는 poly-Si/metal gate/high-k dielectric이 대두되고 있다. 일반적으로 metal gate를 식각시 정확한 CD를 형성시키기 위해서 plasma를 이용한 RIE(reactive ion etching)를 사용하고 있지만 PIDs(plasma induced damages)의 하나인 PICD(plasma induced charging damage)의 발생이 문제가 되고 있다. PICD의 원인으로 plasma의 non-uniform으로 locally imbalanced한 ion과 electron이 PICC(plasma induced charging current)를 gate oxide에 발생시켜 gate oxide의 interface에 trap을 형성시키므로 그 결과 소자 특성 저하가 보고되고 있다. 그러므로 본 연구에서는 이에 차세대 MOS의 metal gate의 식각공정에 HDP(high density plasma)의 ICP(inductively coupled plasma) source를 이용한 중성빔 시스템을 사용하여 PICD를 줄일 수 있는 새로운 식각 공정에 대한 연구를 하였다. 식각공정조건으로 gas는 HBr 12 sccm (80%)와 Cl2 3 sccm (20%)와 power는 300 w를 사용하였고 200 eV의 에너지로 식각공정시 TEM(transmission electron microscopy)으로 TiN의 anisotropic한 형상을 볼 수 있었고 100 eV 이하의 에너지로 식각공정시 하부층인 HfO2와 높은 etch selectivity로 etch stop을 시킬 수 있었다. 실제 공정을 MOS의 metal gate에 적용시켜 metal gate/high-k dielectric CMOSFETs의 NCSU(North Carolina State University) CVC model로 effective electric field electron mobility를 구한 결과 electorn mobility의 증가를 볼 수 있었고 또한 mos parameter인 transconductance (Gm)의 증가를 볼 수 있었다. 그 원인으로 CP(Charge pumping) 1MHz로 gate oxide의 inteface의 분석 결과 이러한 결과가 gate oxide의 interface trap양의 감소로 개선으로 기인함을 확인할 수 있었다.