Recently, power-electronics equipments or machine that microprocessor is included and computers have been installed continuously in industrial process or region of electronics customer. So concern for power quality, especially sags has been increased. Because those equipments are very sensitive to sags. The sag is phenomenon that magnitude of load voltage temporarily decreases because of power system fault. If a certain equipment in industrial process have any trouble result from sag, it can cause utility to be charged for enormous economics loss. Therefore it need to analyze the characteristic of sag and then mitigation method for sags in distribution system in oder to increase reliability. This paper gives an overview of sags characteristic due to short circuit fault in distribution system and after a general discussion of the various forms mitigation, gives a sags mitigation method with concentrating on mitigation-device interface method, especially FCL that is Fault Current Limiter.
전압저하는 전력계통상의 사고에 의해 부하전압의 크기가 일시적으로 감소하는 현상으로서 주로 단락회로 사고에 의해 발생한다. 산업공정에서 하나의 장비가 전압저하에 의해서 문제를 일으킨다면 네트워크처럼 연결된 전체설비에 파급적인 영향을 미치기 때문에 그로 인한 경제적 손실은 상당히 크게 발생한다. 따라서 전압저하를 효과적으로 대처할 수 있는 방법이 전력품질 향상을 위해서 상당히 중요하게 대두되고 있다. 본 논문에서는 배전계통에서 단락사고로 발생한 전압저하 현상을 저감하고자 FCL(Fault Current Limiter)장치를 사용하여 전압저하 현상을 효과적으로 대처할 수 있는 방법을 제시하고, PSCAD/EMTDC 컴퓨터 시뮬레이션 프로그램을 이용하여 전압저하 저감효과를 분석하였다.
A high energy arcing fault event occurred in the medium-voltage (13.8 kV and 4.16 kV) metalclad switchgears in a nuclear power plant not only affecting switchgear but also connected equipment due to the arc energy. The high energy arcing fault also causes a fire that influences the safety function of the unit. Therefore, from the safety point of view, it is necessary to evaluate the influences of high energy arcing fault events on the safety functions of nuclear power plants. The purpose of this paper is to elaborate the characteristics of high energy arcing faults and propose a high energy arcing fault mitigation scheme for medium voltage networks in nuclear power plants.
Misaligned wind-wave and seismic loading render offshore wind turbines suffering from excessive bi-directional vibration. However, most of existing research in this field focused on unidirectional vibration mitigation, which is insufficient for research and real application. Based on the authors' previous work (Sun and Jahangiri 2018), the present study uses a three dimensional pendulum tuned mass damper (3d-PTMD) to mitigate the nacelle structural response in the fore-aft and side-side directions under wind, wave and near-fault ground motions. An analytical model of the offshore wind turbine coupled with the 3d-PTMD is established wherein the interaction between the blades and the tower is modelled. Aerodynamic loading is computed using the Blade Element Momentum (BEM) method where the Prandtl's tip loss factor and the Glauert correction are considered. Wave loading is computed using Morison equation in collaboration with the strip theory. Performance of the 3d-PTMD is examined on a National Renewable Energy Lab (NREL) monopile 5 MW baseline wind turbine under misaligned wind-wave and near-fault ground motions. The robustness of the mitigation performance of the 3d-PTMD under system variations is studied. Dual linear TMDs are used for comparison. Research results show that the 3d-PTMD responds more rapidly and provides better mitigation of the bi-directional response caused by misaligned wind, wave and near-fault ground motions. Under system variations, the 3d-PTMD is found to be more robust than the dual linear TMDs to overcome the detuning effect. Moreover, the 3d-PTMD with a mass ratio of 2% can mitigate the short-term fatigue damage of the offshore wind turbine tower by up to 90%.
비활성 그리고 황성 단층지역의 내부와 주변에서 발생하는 응력장의 변화에 대한 수치적 분석이 수행되었다. 존재하는 비활성 단층지역 근처에서의 응력장은 단층의 방향과 단층화된 암반과 주위의 비단층화된 암반의 탄성적 특성 사이의 대조에 따라 변화한다. 활성 단층지역 주위의 응력장에 대한 분석에서, 만약 단층지역의 항복응력이 초과된다면, 단층지역 내에서의 국부화된 전단응력은 주위의 비단층화된 암반에서의 평균응력 보다 작게 되는 단층 내에서의 평균응력의 감소를 유발시킨다. 따라서 이러한 응력경사는 단층지역내로 유체의 흐름을 기대할 수 있다.
Recently, power-electronics equipments or machine that microprocessor is included and computers have been installed continuously in industrial process or region of electronics customer. So concern for power quality, especially sags has been increased. Because those equipments are very sensitive to sags. The sag is phenomenon that magnitude of load voltage temporarily decreases because of power system fault. If a certain equipment in industrial process have any trouble result from sag, it can cause utility to be charged for enormous economics loss. Therefore it need to analyze the characteristic of sag and then mitigation method for sags in distribution system in odor to increase reliability. This paper gives an overview of sags characteristic due to short circuit fault in distribution system and after a general discussion of the various forms mitigation, gives a sags mitigation method with concentrating on changing the distribution system like spot network, on-site generation.
The sag is phenomenon that magnitude of load voltage temporarily decreases because of power system fault. If a certain equipment in industrial process have any trouble result from sag. it can cause utility to be charged for enormous economics loss. Therefore it need to analyze the characteristic of sag and then mitigation method for sags in distribution system in odor to increase reliability. This paper gives an overview of sags characteristic due to short circuit fault in distribution system and after a general discussion of the various forms mitigation, gives a sags mitigation method with concentrating on changing the distribution system like spot network, on-site generation.
SRAM-based FPGAs are very sensitive to single event upset(SEU) induced by space irradiation. To mitigate SEU effects, space applications employ some mitigation schemes. The triple modular redundancy(TMR) is a well-known mitigation scheme. It uses one or three voters as well as three identical blocks performing the same work. The voters can mask out one error in the outputs from the three replicated blocks. One SEU error in TMRed circuits can be masked but it needs to be detected for some reasons such as to analyze the SEU effects in the satellite or to recover the circuits from the error before additional error occur. In this paper, we developed a fault detection circuit and reporting system to detect a fault on the TMRed circuits. To verify our error detection circuit and reporting circuit, we performed an irradiation test at MC-50 Cyclotron. Experimental results showed that error detection circuit can detect a fault on the TMRed test circuit in radiation environment.
Obsolescent control systems for power systems are evolving into intelligent systems and connecting with smart devices to give intelligence to the power systems. As networks of the control system are growing, vulnerability is also increasing. The communication network of distribution areas in the power system connects closely to vulnerable environments. Many cyber-attacks have been founded in the power system, and they could be more critical as the power system becomes more intelligent. From these environment, new communication network architecture and mitigation method against cyber-attacks are needed. Availability and Fault Tree analysis used to show that the proposed system enhances performance of current control systems.
International Journal of Aeronautical and Space Sciences
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제3권2호
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pp.31-39
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2002
In this paper, KOMPSAT-2 on-board fault and ground recovery management design is addressesed in terms of hardware and software components which provide failure detection and spacecraft safing for anomalies which threaten spacecraft survival. It also includes ground real time up-commanding operation to recover the system safely. KOMPSAT-2 spacecraft fault and recovery management is designed such that the subsequent system configuration due to system initialization is initiated and controlled by processors. This paper will show that KOMPSAT-2 has a new design feature of CPU SEU mitigation for the possible upsets in the processor CPUs as a part of on-board fault management design. Recovery management of processor switching has two different ways: gang switching and individual switching. This paper will show that the difficulties of using multiple-processor system can be managed by proper design implementation and flight operation.
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[게시일 2004년 10월 1일]
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