Rotor of rotating machinery is the highly damaged part. Fault of 7 different types was confirmed as the main causes of rotor damage from the pump failure history data in domestic and U.S. nuclear. For each fault types, simulation testing was performed and fault signals were collected form the sensors. To calculate the statistical parameters of time-domain & frequency-domain, measured signals were analyzed by using the discrete wavelet transform, fast fourier transform, statistical analysis. Total 84 parameters were obtained. And Effectiveness factor were used to evaluate the discrimination capacity of each parameter. From the effectiveness factor, RAW-P4/RAW-P7/WT2-NNL/WT2-EE/WT1-P1 showed high ranking. Finally, these parameters were selected as the feature parameters of intelligent fault diagnostics for rotor.
In this paper, a fault diagnosis method is proposed for self-diagnostics of PLC(Programmable Logic Controller), process controller in industrial fields, and diagnosis of its external devices such as sensors and actuators. The aim of this research is proposition of systematic method of fault diagnosis of PLC control system and development of its equipment. A PLC fault diagnosis algorithm consists of self-diagnostics given by PLC makers, Inpuot/Output tracking method by analyzing sequence PLC programs, searching method of past fault cases in database using an expert system, and diagnosis of PLC units such as CPU, DI, and DO board. Finally usability of PLC fault diagnostic system is verified by testing a MELSEC PLC.
적응적 랜덤 테스팅 (Adaptive Random Testing, ART)은 입력 도메인 내에 테스트 케이스를 넓고 고르게 분산시키는 방법을 통해 입력 도메인 내에 존재하는 오류 패턴을 순수 랜덤 테스팅 (Random Testing, RT)보다 효율적으로 찾아내기 위한 테스트 케이스 선택 기법이다. 테스트 케이스 선택에 많은 연산량을 필요로 하는 초기 ART 기법인 거리 기반 ART (Distance-based ART, D-ART)와 제한 영역 기반 ART (Restricted Random Testing, RRT)의 개선을 위해 입력 도메인을 반복 분할하는 기법들이 제안되었고, 이 기법들은 낮은 연산량 및 성능 향상등의 효과를 가져왔다. 하지만, 입력 도메인 반복 분할 기반 기법에서도 기존 ART 기법에서 나타나는 테스트 케이스 분포 불균일 문제가 존재하고, 이는 기법의 확장성에 장애 요소로 작용한다. 따라서 본 논문에서는 반복 분할 기반 기법에서 나타나는 테스트 케이스 분포의 특성을 파악하고, 이를 적정 수준으로 제어하기 위한 입력 도메인 확장 정책을 제안하였으며, 실험을 통해 2차원 입력 도메인에서 3%, 3차원 입력 도메인에서 10% 수준의 성능 향상을 확인하였다.
IDDQ 테스트는 CMOS VLSI 회로에서 발생 가능한 여러 종류의 물리적 결함을 효율적으로 검출 할 수 있는 테스트 방식이다. 본 논문에서는 CMOS에서 발생 빈도가 가장 높은 합선고장을 효과적으로 검출할 수 있는 IDDQ 테스트 알고리즘을 이용하여 패턴 생성기를 개발하였다. 고려한 합선고장 모델은 회로의 레이아웃 정보에 의존하지 않으며, 내부노드 혹은 외부노드에 한정시킨 합선고장이 아닌 테스트 대상회로의 모든 노드에서 발생 가능한 단락이다. 구현된 테스트 패턴 생성기는 O(n2)의 복잡도를 갖는 합선고장과 전압 테스트 방식에 비해 상대적으로 느린 IDDQ 테스트를 위해서 새롭게 제안한 이웃 조사 알고리즘과 고장 collapsing 알고리즘을 이용하여, 빠른 고장 시뮬레이션 시간과 높은 고장 검출율을 유지하면서 적은 수의 테스트 패턴 생성이 가능하다. ISCAS 벤치마크 회로의 모의실험을 통하여 기존의 다른 방식보다 우수한 성능을 보였다.
컴퓨터가 여러 분야에 사용되어지고 그들의 정확한 운영이 종종 사업의 성공과 인간의 안전에 결정적이다. 높은 품질의 소프트웨어를 개발하는 것은 상당히 중요하다. 최근 게임이 대중화 되어지면서 게임 소프트웨어의 평가에 대한 관심이 높아지게 되었다. 게임 소프트웨어는 다양한 장르에 따라서 다소의 특징적인 면이 다르기 때문에 게임 소프트웨어를 평가 하는데는 상당한 어려움이 있다. 환경변화로 인해서 온라인 게임은 널리 대중화 되었다. 현재 온라인 게임 소프트웨어는 해외 시장을 개척하고 있다. 회사에서는 개발된 제품에 대하여 베타테스트를 거쳐서 좀더 신뢰성이 높은 제품을 개발하려고 최선을 다하고 있으나 몇 개월간의 베타테스트를 거친 제품도 사용자 측에서는 사용 중 다양한 오류들을 경험하게 된다. 게임의 경우는 게임 환경과 기능성에서 오는 오류가 다양하므로 이것을 평가하기에는 어려움이 많다. 본 연구에서는 게임 소프트웨어를 평가하는데 있어서 경험하게 되어지는 환경적인 요인과 기능적인 오류를 점검하여 품질평가 메트릭에 적용하는 방법에 대하여 연구하였다. 사용자 관점에서 설문조사를 실시하였으며 설문조사 결과를 종합분석하여 게임 소프트웨어의 버그 체크리스트 작성하였다. 또한 버그체크리스트를 품질 평가 메트릭에 적용하였다. ISO/IEC 9126을 기준으로 품질평가모델을 구성하였으며 특히 신뢰성에 대한 평가를 정량화 하기 위해서 버그체크리스트는 IS0/IEC 9126의 신뢰성 평가 메트릭에 적용하는 방안을 제시하였다.
One of the problems with the fault diagnosis of transformers based on dissolved gas is the inability to match the result of the different standards of fault diagnosis with real world standards. In this paper, the results of the different standards are analyzed using fuzzy logic and then compared with the empirical test. The proposed method is based on the standards and guidelines of the International Electrotechnical Commission (IEC), the Central Electric Generating Board (CEGB), and the American Society for Testing and Material (ASTM) and its main task is to assist the conventional gas ratio method. The comparison between the suggested method and existing methods indicates the capability of the suggested method in the on-line fault diagnosis of transformers. In addition, in some cases the existing standards are not able to diagnose the fault. For theses instances, the presented method has the potential of diagnosing the fault. In this paper, the information of three real transformers is used to show the capability of the suggested method in diagnosing the fault. The results validate the capability of the presented method in fault diagnosis of the transformer.
A new fault location algorithm based on stationary wavelet transform and its verification experiment results are described for HVDC submarine cables in this paper. For wavelet based fault location algorithm, firstly, 4th level approximation coefficients decomposed by wavelet transform function are superimposed by correlation, then the distance to the fault point is calculated by time delay between the first incident signal and the second reflected signal. For the verification of this algorithm, the real experiments based on various fault conditions and return types of fault current are performed at HVDC submarine cable test yard located in KEPCO(Korea Electric Power Corporation) Power Testing Center of South Korea. It proves that the fault location method proposed in this paper is very simple but very quick and accurate for HVDC submarine cable fault location.
Lee Chan-Joo;Park Jong-Bae;Shin Joong-Rin;Radojevic Zoran
Journal of Electrical Engineering and Technology
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제1권1호
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pp.35-41
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2006
This paper presents a new numerical algorithm for fault location estimation and for faults recognition based on the synchronized phasors. The proposed algorithm is based on the synchronized phasor measured from the synchronized PMUs installed at two-terminals of the transmission lines. In order to discriminate the fault type, the arc voltage wave shape is modeled numerically on the basis of a great number of arc voltage records obtained by transient recorder. From the calculated arc voltage amplitude it can make a decision whether the fault is permanent or transient. The results of the proposed algorithm testing through computer simulation are given.
본 연구에서는 소프트웨어 제품 테스팅 과정에서 관측고장시간에 근거한 결함 발생률을 고려한 소프트웨어 신뢰성 모형에 대하여 연구 하였다. 신뢰성 분야에서 많이 사용되는 S-분포모형을 이용한 새로운 결함 확률을 추가한 문제를 제시하였다. 수명분포는 유한고장 비동질적인 포아송과정을 이용하였다 본 논문의 결함 발생률을 고려한 소프트웨어 고장 자료 분석에서는 고장 시간 자료를 적용하였으며 모수추정 방법은 최우추정법을 이용하여 결함 발생 확률에 대한 관계와 신뢰도를 추정 하였다.
Phase-locked loops (PLLs) are among the most important mixed-signal building blocks of modern communication and control circuits, where they are used for frequency and phase synchronization, modulation, and demodulation as well as frequency synthesis. The growing popularity of PLLs has increased the need to test these devices during prototyping and production. The problem of distinguishing and classifying the responses of analog integrated circuits containing catastrophic faults has aroused recent interest. This is because most analog and mixed signal circuits are tested by their functionality, which is both time consuming and expensive. The problem is made more difficult when parametric variations are taken into account. Hence, statistical methods and techniques can be employed to automate fault classification. As a possible solution, we use the back propagation neural network (BPNN) to classify the faults in the designed charge-pump PLL. In order to classify the faults, the BPNN was trained with various training algorithms and their performance for the test structure was analyzed. The proposed method of fault classification gave fault coverage of 99.58%.
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[게시일 2004년 10월 1일]
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