• 제목/요약/키워드: Digital error correction

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Optimal Localization through DSA Distortion Correction for SRS

  • Shin, Dong-Hoon;Suh, Tae-Suk;Huh, Soon-Nyung;Son, Byung-Chul;Lee, Hyung-Koo;Choe, Bo-Young;Shinn, Kyung-Sub
    • 한국의학물리학회지:의학물리
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    • 제11권1호
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    • pp.39-47
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    • 2000
  • 신경 외과적 수술의 한분야인 정위적 방사선 수술은 두 개강 내의 병변의 위치 계산 후, 고선량의 방사선을 조사하여 병변을 치료하는 방법이기 때문에, 효과적인 수술을 위해서는 병변의 정확한 위치 정보가 무엇보다도 중요하다. 본 연구에서는 DSA(Digital Subtraction Angiography) 영상이 내재적으로 이미지 왜곡이라는 문제점을 가지고 있기 때문에, 이것의 보정을 통하여 더욱 정확한 target 위치를 계산하였다 이미지 왜곡을 보정하기 위하여 grid 팬텀을 제작하였고, localization 알고리즘의 정확도를 평가하기 위하여, target 팬텀을 제작하였다. Image Intensifier의 앞쪽에 grid 팬텀을 부착하고, target 팬텀을 Leksell Frame에 고정시킨 후, DSA 영상을 얻었다. 본 실험을 위하여 개발된 프로그램을 이용하여, Anterior and Posterior, Left and Right 영상에서 bilinear transform을 적용하여 왜곡을 보정한 후, target 위치를 계산하였다. 그리고, 이와 같은 방법을 통하여 계산된 target 위치 좌표와 target 팬텀의 절대 좌표의 비교를 통하여 localization 오차가 계산되었다. 이번 실험의 결과는 왜곡을 보정하지 않은 경우, localization 오차는 $\pm$0.41mm, 왜곡 보정을 한 경우는 $\pm$0.34mm이었다. 따라서 본 연구에서 개발된 알고리즘 정밀도가 인정되며, 환자의 치료에 적합한 것으로 사료된다.

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디지털 데이터 전송에서의 오류 검출 및 수정에 관한 연구 (A Study on the Error Detection and Correction for Digital Data Transmission)

  • 우익제;신두진;박대섭;허욱열
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 1999년도 추계학술대회 논문집 학회본부 B
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    • pp.721-723
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    • 1999
  • In this paper, for the more accurate data communication, Voting Algorithm is used to detect and correct some error. Voting is a fundamental operation in the realization of ultrareliable systems that are based on multi-channel computations. Finally, the per formance of this algorithm is analyzed theoretically and some simulation results are presented to demonstrate the efficiency of the proposed algorithm.

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효율적인 오류검출 방식의 낸드 플래시 컨트롤러 (A NAND Flash Controller with Efficient Error Detection Unit)

  • 백청택;이용환
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2007년도 추계종합학술대회
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    • pp.768-771
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    • 2007
  • 낸드 플래시 메모리는 최근 많은 디지털 기기에서 사용되고 있으며 그 용량과 성능면에서의 발전이 급격이 이루어지고 있다. 낸드 플래시 메모리는 읽고 쓰기 회수에 제한이 있어 이 수명이 다하면 데이터의 신뢰성을 보장하기 어렵다. 이 때문에 낸드 플래시 데이터의 오류를 검출하는 ECC(Error Correction Code) 알고리즘의 적용이 필수적이다. 기존에는 ECC 알고리즘을 논리 게이트로 구현하였으나 본 논문에서는 룩업 테이블 방식을 사용하여 신뢰성과 데이터 처리 시간을 향상시키고자 한다.

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주파수 영역에서 2중부호화 R-S부호의 부호방식에 관한 연구 (A Study on Decoding Method of the R-S Code for Double-Encoding System in the Frequency Domain)

  • 전경일;김남욱;김용득
    • 한국통신학회논문지
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    • 제14권3호
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    • pp.216-226
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    • 1989
  • 本 論文에서는 誤謬訂正符號로 사용하는 2重符號의 復號方式을 기술하였다. 2중부호화 방식은 두 종류의 同符號 또는 단순한 부호를 사용하여 構成한다. 이 부호는 정정능력이 높고 복호방식이 간단하다. 本 論文에서는 $C_1$(32, 28, 5), $C_2$(32, 26, 7) Reed-Solomon부호를 2중부호화시켜 주파수 영역에서 오류정정 과정을 컴퓨터로 模寫하였다. 復號 알고리즘을 주파수 영역에서 실현하는 과정에서 제안된 방법이 최근 개발되고 있는 디지털 신호처리 기술에 적용할 수 있음을 증명하였다.

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Design and Architecture of Low-Latency High-Speed Turbo Decoders

  • Jung, Ji-Won;Lee, In-Ki;Choi, Duk-Gun;Jeong, Jin-Hee;Kim, Ki-Man;Choi, Eun-A;Oh, Deock-Gil
    • ETRI Journal
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    • 제27권5호
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    • pp.525-532
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    • 2005
  • In this paper, we propose and present implementation results of a high-speed turbo decoding algorithm. The latency caused by (de)interleaving and iterative decoding in a conventional maximum a posteriori turbo decoder can be dramatically reduced with the proposed design. The source of the latency reduction is from the combination of the radix-4, center to top, parallel decoding, and early-stop algorithms. This reduced latency enables the use of the turbo decoder as a forward error correction scheme in real-time wireless communication services. The proposed scheme results in a slight degradation in bit error rate performance for large block sizes because the effective interleaver size in a radix-4 implementation is reduced to half, relative to the conventional method. To prove the latency reduction, we implemented the proposed scheme on a field-programmable gate array and compared its decoding speed with that of a conventional decoder. The results show an improvement of at least five fold for a single iteration of turbo decoding.

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AJAX+XML 기반의 모니터링 시스템 (Realtime Monitoring System using AJAX + XML)

  • 최윤정;박승수
    • 디지털산업정보학회논문지
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    • 제5권4호
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    • pp.39-49
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    • 2009
  • Nowadays, according to rapid development of computing environments, information processing and analysis system are very interesting research area. As a viewpoint of data preparation-processing-analysis in knowledge technology, the goal of automated information system is to satisfy high reliability and confidence and to minimize of human-administrator intervention. In addition, we expect the system which can deal with problem and abnormal error effectively as a fault detection and fault tolerance. In this paper, we design a monitoring system as follows. A productive monitoring information from various systems has unstructured forms and characteristics and crawls informative data by conditions and gathering rules. For representing of monitering information which requested by administrator, running-status can be able to check dynamically and systematic like connection/closed status in real-time. Our proposed system can easily correct and processing for monitoring information from various type of server and support to make objective judgement and analysis of administrator under operative target of information system. We implement semi-realtime monitering system using AJAX technology for dynamic browsing of web information and information processing using XML and XPATH. We apply our system to SMS server for checking running status and the system shows that has high utility and reliability.

A 45 nm 9-bit 1 GS/s High Precision CMOS Folding A/D Converter with an Odd Number of Folding Blocks

  • Lee, Seongjoo;Lee, Jangwoo;Song, Minkyu
    • JSTS:Journal of Semiconductor Technology and Science
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    • 제14권4호
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    • pp.376-382
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    • 2014
  • In this paper, a 9-bit 1GS/s high precision folding A/D converter with a 45 nm CMOS technology is proposed. In order to improve the asymmetrical boundary condition error of a conventional folding ADC, a novel scheme with an odd number of folding blocks is proposed. Further, a new digital encoding technique is described to implement the odd number of folding technique. The proposed ADC employs a digital error correction circuit to minimize device mismatch and external noise. The chip has been fabricated with 1.1V 45nm Samsung CMOS technology. The effective chip area is $2.99mm^2$ and the power dissipation is about 120 mW. The measured result of SNDR is 45.35 dB, when the input frequency is 150 MHz at the sampling frequency of 1 GHz. The measured INL is within +7 LSB/-3 LSB and DNL is within +1.5 LSB/-1 LSB.

시스템 초기화(Calibration)에 따른 항공레이저측량의 정확도 평가 (The Evaluation of Accuracy for Airborne Laser Surveying via LiDAR System Calibration)

  • 이대희;위광재;김승용;김갑진;이재원
    • 한국측량학회:학술대회논문집
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    • 한국측량학회 2004년도 춘계학술발표회논문집
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    • pp.15-26
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    • 2004
  • The calibration for systematic error in LiDAR is crucial for the accuracy of airborne laser scanning. The main error is the misalignment of platforms between INS(Inertial Navigation System) and Laser scanner For planimetrical calibration of LiDAR, the building is good feature which has great changes in height and continuous flat area in the top. The planimetry error(pitch, roll) is corrected by adjustment of height which is calculated from comparing ground control points(GCP) of building to laser scanning data. We can know scale correction of laser range by the comparison of LiDAR data and GCP is arranged at the end of scan angle where maximize the height error. The area for scale calibration have to be large flat and have almost same elevation. At 1000m for average flying height, The Accuracy of laser scanning data using LiDAR is within 110cm in height and ${\pm}$50cm in planmetry so we can use laser scanning data for generating 3D terrain surface, expecically digital surface model(DSM) which is difficult to measure by aerial photogrammetry in forest, coast, urban area of high buildings

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영상의 모서리 방향을 이용한 전송 오차의 복원 (A restoration of the transfer error that used edge direction of an image)

  • 이창희;류희삼;나극환
    • 전자공학회논문지 IE
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    • 제44권1호
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    • pp.15-19
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    • 2007
  • 본 연구는 전송 오차의 이미지 복원에 관한 방법으로 정지영상 또는 내부프레임 정정을 위한 모서리 방향 보간법에 기초한 오차 복원 기술의 개선을 목표로 한다. 여기서 제안된 방법은 블록의 모서리 방향 검출 방법은 스웨터의 손상된 부분을 남아 있는 부분과 맞추어가는 모서리 방향을 이용하는 것에 근거한다 처리 후 데이터 정보에 남은 에러 픽셀을 마지막 단계로 비선형 미디안 필터를 사용하여 보간 하였다. 실험 결과는 제안된 방법의 높은 회복 성향과 낮은 계산 시간은 실시간 영상 처리의 실현 가능성을 나타낸다.

비디오 신호 인터페이스를 위한 CMOS ADC의 설계 (A Design of CMOS ADC for Video Interface)

  • 안승헌;권오준;임진업;최중호
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2003년도 하계종합학술대회 논문집 II
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    • pp.975-978
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    • 2003
  • 본 논문에서는 비디오 신호 인터페이스를 위해 10비트 50MHz ADC 를 설계하였으며 DCL(digital-error correction logic)을 갖는 3-3-3-4 구조의 파이프라인 방식을 사용하였다. SHA(sample and hold amplifier)와 MDAC (multiplying digital-to-analog converter)에 쓰이는 증폭기는 높은 이득을 갖도록 gain-boosting 기법을 적용하였으며, 전력소모와 면적을 줄이기 위해 capacitor scaling 기법을 적용하였다. 본 ADC 는 0.35 μm double-poly four-metal n-well CMOS 공정으로 설계 및 제작하였으며, 전체 회로는 3.3V 단일 전원 전압에서 동작하도록 설계하였다. 측정 결과 5MHz 의 입력을 인가하였을 때 SNDR 은 56.7dB, 전체 전력 소모는 112mW 이며, 입출력 단의 패드를 포함한 전체 칩 면적은 2.6mm×2.6mm이다.

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