The Journal of the Institute of Internet, Broadcasting and Communication
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v.18
no.6
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pp.91-97
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2018
This paper presents implementation possibilities of digital IoT doorlock systems via VLC(Visible Light Communication)'s color grid. The color grid-based VLC modulation scheme which are discussed in this paper utilize the straightness of light and abundant frequency resources which are the properties of the light. Performance results in this paper are compared to that of conventional modulations with Bit Error Rate (BER) and Signal to Noise Ratio (SNR) simulations. With respect to a channel model, the proposed modulation schemes select the nearest Line Of Sight (LOS) except Non Line Of Sight (NLOS). Experiments in this paper show error rates of received symbols by changing power dB at a distance of 3m between Tx and Rx in an indoor environment. Through performance results and experiments, this paper demonstrates superiority of the proposed color grid-based modulation schemes.
Journal of the Korea Institute of Information and Communication Engineering
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v.15
no.1
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pp.33-40
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2011
In this paper, underwater acoustic communication experiment was carried out to test a performance of single carrier digital modulation schemes. The communication experiment was performed at real sea and tested modulation schemes are ASK, FSK with non-coherent detection and QPSK with coherent detection. A modulated image data was transmitted with data rates of 600bps~3Kbps. From the results of BER of the demodulated signal, ASK and FSK show the achievable BER of $10^{-3}{\sim}10^{-4}$ without compensation techniques and QPSK show that of $10^{-4}$ with linear equalizer.
Based on the space vector pulse width modulation (SVPWM) theory, this paper realizes an easier SVPWM strategy, which is equivalently implemented by CBSPWM with zero-sequence voltage injection. The traditional SVPWM strategy has no effect on controlling the neutral-point voltage balance. In order to solve the neutral-point voltage unbalance problem for neutral-point-clamped (NPC) three-level inverters, this paper proposes a neutral-point voltage balance controller. The proposed controller realizes controlling the neutral-point voltage balance by dynamically calculating the offset superimposed to the three-phase modulation waves of an equivalent SVPWM strategy. Compared with the traditional SVPWM strategy, the proposed neutral-point voltage balance controller has a strong ability to balance the neutral-point voltage, has good steady-state performance, improves the output waveforms quality and is easy for digital implementation. An experiment has been carried out on a NPC three-level inverter prototype based on a digital signal processor-complex programmable logic device (DSP-CPLD). The obtained experimental results verify the effectiveness of the proposed neutral-point voltage balance controller.
Computed radiography(CR) has been widely used in the field of diagnostic radiography since digital X-ray image was introduced. The imaging performance of CR system was studied by analyzing the digital image data of the CR images which are the outcomes of the whole imaging system composed of image plate(IP), laser digitizer, analoge-digital convertor, and a given image processing unit. In this study, we used a conventional CR system made by Agfa. From the flat field image of 150$\times$150 image pixels, signal-to-noise ratio(SNR) was calculated. SNR of the CR image increases in proportion to logarithm value of the X-ray exposure irradiated on the IP. SNR is less than about 6 at the exposure below 0.2mR and is more than 10 at the exposure above 0.54mR. In our study, most of images obtained by the smaller exposures less than 2.0mR can not be readable. In general, the minimum value of the SNR ranges from 3 to 5. We obtained modulation transfer function(MTF) by analyzing the bar pattern image which was made under conditions as follows: X-ray tube potential was 55kVp, the IP exposure was 0.54 mR, and the distance between X-ray source to IP was 2m, where bar pattern was located on the IP. MTF is 23% at 2.5lp/mm spatial frequency. Provided that the MTF of noise equivalent modulation is 10%, the CR system has the limiting spatial resolution of 3.2lp/mm. If the image sharpness is evaluated by the spatial frequency where MTF is 50%. the corresponding spatial frequency is 0.5$\sim$0.75lp/mm. MTFA(Modulation Transfer Function Area) is 1.0lp/mm. Compared with the Fuji CR whose MTFA is 1.1lp/mm, Agfa CR in this study shows almost same MTFA performance.
Journal of the Institute of Electronics Engineers of Korea TC
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v.43
no.12
s.354
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pp.9-15
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2006
In this paper, signal processing techniques for noncoherent impulse-radio-based UWB (IR-UWB) communication system are proposed to provide system implementation of low power consumption and low complexity. The proposed system adopts a simple modulation technique of OOK (on-oft-keying) and noncoherent signal detection based on signal amplitude. In particular, a technique of a novel high speed digital sampler using a stable, lower reference clock is developed to detect nano-second pulses and recover digital signals from the pulses. Also, a 32 bits Turyn code for data frame synchronization and a convolution code as FEC are applied, respectively. To verify the proposed signal processing techniques for low power, low complexity noncoherent IR-UWB system, the proposed signal processing technique is implemented in FPGA and then a short-range communication system for wireless transmission of high quality MP3 data is designed and tested.
The SDH (Synchronous Digital Hierarchy) has been rapidly acknowledged as a world wide transmission standard replacing the existing PDH infrastructure. A bit stuffing is used for synchronization between a PDH signal and a SDH node, and a pointer justification is used for synchronization between one SDH node and the other SDH node. During above processes - a bit stuffing and a pointer processing -, a stuffing jitter and a pointer Jitter are produced and the generated jitter can cause transmission error. In this study, a stuffing jitter and a pointer jitter are modeled and analyzed. A Sigma-Delta modulation is described and an advanced jitter reduction technique using a Sigma-Delta modulation technique in the Synchronizer, Pointer Processor and Desynchronizer is provided.
The Transactions of the Korean Institute of Electrical Engineers B
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v.52
no.12
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pp.608-615
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2003
This paper describes an implementation of a DSP (Digital Signal Processor) controlled random carrier frequency modulation for the PWM inverter for acoustic noise reduction of induction motors. Real-time generation of the random variable and RPWM(Random PWM) along with the speed control was achieved by DSP TMS320C31. The experimental results show that the voltage and current harmonics are spread to a wide band area and the power spectrum of the acoustic switching noise was spread to create a more appealing, less annoying sound. Also, the speed response of the implemented method and the conventional method is nearly similar to each other from the viewpoint of the v/f constant control.
Despite the advantages offered by multilevel inverters, one of the main drawbacks that prevents their widespread use is their circuit complexity as the number of power switches employed is usually high. This paper presents a new multilevel inverter topology with a considerable reduction in the number of power switches used through the switch-sharing approach. The fact that the proposed inverter applies two bidirectional power switches for sharing among the three phases does not prevent it from producing seven levels in the line-to-line output voltage waveforms. A modified scheme of space vector modulation via the application of virtual voltage vectors is developed to generate the PWM signals of the power switches. The performance of the proposed inverter is investigated through MATLAB/SIMULINK simulations and is practically tested using a laboratory prototype with a DSP-based modulator. The results demonstrate the satisfactory performance of the inverter and verify the effectiveness of the modulation method.
Transactions on Electrical and Electronic Materials
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v.11
no.1
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pp.20-23
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2010
The analog front end (AFE) of a radio frequency identification transponder using the ISO 14443 type A standard with a 100% amplitude shift keying (ASK) modulation is proposed in this paper and verified by circuit simulations and measurements. This AFE circuit, using a 13.56 MHz carrier frequency, consists of a rectifier, a modulator, a demodulator, a regulator, a power on reset, and a dynamically enabled digital phase locked loop (DPLL). The DPLL, with a charge pump enable circuit, was used to recover the clock of a 100% modulated ASK signal during the pause period. A high voltage lateral double diffused metal-oxide semiconductor transistor was used to protect the rectifier and the clock recovery circuit from high voltages. The proposed AFE was fabricated using the $0.18\;{\mu}m$ standard CMOS process, with an AFE core size of $350\;{\mu}m\;{\times}\;230\;{\mu}m$. The measurement results show that the DPLL, using a demodulator output signal, generates a constant 1.695 MHz clock during the pause period of the 100% ASK signal.
A 4+12+16 amplitude phase shift keying (APSK) modulation outperforms other 32-APSK modulations in a nonlinear additive white Gaussian noise (AWGN) channel because of its intrinsic robustness against AM/AM and AM/PM distortions caused by the nonlinear characteristics of a high-power amplifier. Thus, this modulation scheme has been adopted in the digital video broadcasting-satellite2 European standard. And it has been considered for high rate transmission of telemetry data on deep space communications in consultative committee for space data systems which provides a forum for discussion of common problems in the development and operation of space data systems. In this paper, we present an improved bits-to-symbol mapping scheme with a better bit error rate for a 4+12+16 APSK signal in a nonlinear AWGN channel and propose a simple signal detection algorithm for the 4+12+16 APSK from the presented bit mapping.
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[게시일 2004년 10월 1일]
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