본 논문은 0-5 볼트의 범위에서 실시간 아날로그 ECG 신호를 생성하는 FPGA 하드웨어 기반 ECG 시뮬레이터를 설계하고 기능 및 특성을 기술하였다. 시뮬레이터에 의해 생성된 ECG 신호는 실험실 실험, 의료 기기 교정 및 연구에 사용되거나 다양하게 응용할 수 있다. 시뮬레이터의 ECG 신호는 신호 데이터를 생성하기 위하여 기존의 24bit 양자화로 획득한 후 실 데이터로 사용할 때에는 1kHz의 샘플링과 8비트로 분해, 양자화 되었다. 제안 시뮬레이터는 xilix Spartan-3를 이용하여 구현하였으며 PC와 설계 FPGA 시뮬레이터 간에 RS-232를 통하여 데이터를 전송할 수 있도록 하였다. 전송된 데이터는 메모리에 저장하고 저장된 데이터는 DAC(0808) 통하여 아날로그 ECG 신호로 출력되게 하였다. 또한 두 개의 버튼 수위를 통하여 심박수(HR)를 UP-DOWN할 수 있도록 하였다. 설계된 시스템의 평가를 위하여 기존의 심전도 입력을 사용하여 출력신호와 QRS파형의 획득을 위한 미분회로 통과 결과를 평가한 결과 적합한 결과를 얻을 수 있었다.
A dynamic model has been developed to simulate dynamic operation of a real double-effect absorption chiller. Dynamic behavior of working fluids in main components was modeled in first-order nonlinear differential equations based on heat and mass balances. Mass transport mechanisms among the main components were modeled by valve throttling, 'U' tube overflow and solution sub-cooling. The nonlinear dynamic equations coupled with the subroutines to calculate thermodynamic properties of working fluids were solved by a numerical method. The dynamic performance of the model was compared with the test data of a commercial medium chiller. The model showed a good agreement with the test data except for the first 5,000 seconds during which different flow rates of the weak solution caused some discrepancy. It was found that the chiller dynamics is governed by the inlet temperatures of the cooling water and the chilled water when the heat input to the chiller is relatively constant.
본 연구에서는 Schwartz의 가치체계 이론(1992)에 근거하여 개인적 가치가 SNS 이용자의 동기적 특성 및 행태적 반응에 미치는 효과를 분석하였다. 본 조사 결과 크게 '개방성,' '상호호혜성,' '자기 향상성,' '규범 준수성,' '안전성'의 5가지 가치차원이 주요하였으며, 이들 각 가치차원은 SNS 이용동기, 사회적 자본, 광고반응, 구전의도 등에 차별적 영향을 미치는 것으로 나타났다. 또한 이들 제 가치차원을 중심으로 SNS 이용자들을 군집화한 결과 '경험 추구형,' '상호의존적 공감형,' '자기 향상형,' '규범 준수형'의 4개의 가치집단으로 세분화되었다. 각 가치집단은 SNS 인식 및 행태적 특성에 있어서 차별적 특징을 보여주었을 뿐만 아니라, SNS 서비스 유형과도 체계적인 관련성을 갖는 것으로 나타났다. 본 연구의 결과 Schwartz의 가치체계이론은 SNS 이용과 관련된 심리적 기제를 이해하는데 매우 유용한 틀로 활용될 수 있음을 보여주었다.
본 논문에서는 다중 사용자 다중 안테나 하향링크 시스템에서 maximal ratio transmission (MRT) 기법 사용 시, 에너지 효율을 최대화하는 최적의 송신 안테나 수에 대해 알아본다. Full channel state information at the transmitter (CSIT) 환경에서 평균 채널 이득, 각 단말 간 채널 독립성, 평균 path loss를 사용하여 최적화 식을 근사하고 편미분을 이용하여 closed form으로 최적의 송신 안테나 수를 구한다. 또한 limited feedback 환경에서는 동일한 방법으로 근사한 목적함수에 대하여 bisection method를 이용하여 최적의 송신 안테나 수를 찾는다. 모의실험 결과를 통해, 구해진 최적의 송신안테나 수가 exhaustive search로 찾은 최적의 송신안테나 수에 비해 오차가 크지 않음을 확인하고, 단말의 피드백 비트 수가 최적의 송신 안테나 수에 미치는 영향을 분석한다.
연안의 무분별한 개발로 인해 해안의 침식 및 퇴적의 경향이 발생되고 있어 해안선 변화에 따른 자연보존 및 개발의 대책 수립이 요구되고 있다. 본 연구에서는 강원도 강릉시 연안 지역을 선정하여 약 2개월의 주기적인 간격으로 6회의 DGPS 측량을 실시하였고, 관측 자료는 강릉상시관측소를 기준으로 약 50cm 정확도로 후처리하여 1998년 수치지형도 및 2006년 수치해도와 상호 비교하였다. DGPS 측량값들은 수치지형도 해안선과 비교하여 볼 때 국부적으로는 강문항 도류제 설치부근과 남항진의 남측에 침식이 발생하였고 남항진 지역의 방파제 부근에는 많은 해안 퇴적이 일어났으며, 다른 지역의 경우도 부분적으로 해안 퇴적이 발생하고 있음을 알 수 있었다. 따라서 GIS 자료입력에 알맞은 데이터 취득 방법으로 DGPS를 이용하여 수평자료 획득이 용이하고, 해안 개발에 따른 장기적이고 지속적인 관측을 통한 시계열적 해안선 변화를 측정하는데 효과적으로 사용될 수 있을 것이다.
본 논문은 가변구조모델추종제어(VSMFC)계 설계의 새로운 방법을 고찰한 것이다. 설계 개념은 가변구조계(VSS)와 슬라이드모드 이론을 사용하여 비선형 시변다변수계가 파라미터 변동이 있을지라도 모델추종을 정확히 하게끔 제어측이 가변구조를 갖게 하는 것이다. 본 논문의 방법을 실제 물리계에 적용할 때 컴퓨터 계산시간의 감소와 파라미터변동에 무관한 동적응답을 기대할 수 있다. 이론의 유효성을 밝히기 위해 VSMPC를 1000MWe의 불등경수형 원자로(BWE)에 적용하였다. 즉 원자로의 출력요구가 정격출력의 85∼90% 범위에서 변할 때 부하추종출력제어가 원활히 이루어지는가를 컴퓨터 시뮬레이션하였다. 12개의 비선형미분방정식으로 동특성이 주어지는 원자로에서 6차계 선형모델을 85% 정격치에서 구하고 여러범위에 걸쳐서 부하변동이 있을 때 파라미터변동을 극복하면서도 출력제어를 원활히 하는가를 연구하였다.
본 논문은 뇌임펄스전압에 대한 누전 차단기의 오동작 특성에 관한 것으로 한국공업규격 KS C 4613의 규정과 서지보호장치를 갖는 모의회로의 조건에서 누전차단기의 부동작 특성을 실험적으로 조사하고 검토하였다. 실험 결과, 본 연구에 사용한 30[A]용 고감도형 누전 차단기인 모든 시료는 증폭회로의 전원부에 설치된 서지보호장치에 의해 입사되는 차동모드의 뇌임펄스전압에 차단되는 성능을 가지고 있었다. 4종의 시료는 KS C 4613에 정의된 뇌임펄스 부동작시험조건을 만족시키지 못하였으며, 그때의 오동작을 유발한 전압은 약 5∼6.5[kV]로 비교적 높았다. 서지보호장치가 설치된 경우를 모의한 시험조건에서는 3종의 누전차단기가 오동작하였으며, 누전차단기가 오동작을 일으키는 전압도 약 3∼5[kV] 정도로 비교적 낮았다.
본 논문에서는 VLSI의 내장 회로로 사용하기에 적합한 CMOS 8 비트 폴딩-인터폴레이팅 AD 변환기를 설계하였다. 폴딩 AD 변환기의 비선형성을 개선하기 위하여 입력신호의 폴딩-인터폴레이팅에 의한 신호처리가 차례로 2 번 반복되는 2 단 구조를 사용하였다. 이 구조에서는 2 번째 폴딩 회로로서 트랜지스터 차동쌍을 이용한다. 2 단 폴딩 ADC는 디지틸 출력을 얻기 위한 전압비교기와 저항의 개수를 현저히 줄일 수 있으므로 칩 면적, 소비전력, 동작속도 둥에서 많은 장점을 제공한다. 설계공정은 0.25$\mu$m double-poly 2 metal n-well CMOS 공정을 사용하였다. 모의실험결과 2.5V 전원 전압을 인가하고 250MHz의 샘플링 주파수에서 45mW의 전력을 소비하였으며 INL과 DNL은 각 각 $\pm$0.2LSB, SNDR은 10MHz 입력신호에서 45dB로 측정되었다.
정보통신의 발달과 인터넷의 확산으로 인해 정보보안의 필요성이 증대되면서 다양한 암호알고리즘이 개발되어 활용되고 있다. 이와 더불어 암호 공격 기술도 발전하여서, 공격에 강한 알고리즘에 대한 연구가 활발하게 진행되고 있다. Substitution Permutation Networks(SPN)등의 블록 암호알고리즘에서 교환계층의 선형변환행렬이 Maximum Distance Separable(MDS) 코드를 생성하면 차분공격과 선형공격에 강한 특성을 보인다. 본 논문에서는 선형변환행렬이 MDS 코드를 생성하는가를 판단하는 새로운 알고리즘을 제안한다. 선행변환행렬의 입력코드는 GF(2$^n$)상의 원소들로 이들을 변수로 해석할 수 있다. 하나의 변수를 다른 변수들의 대수식으로 변환하고 대입하여 변수를 하나씩 소거한다. 변수가 하나이고 모든 계수가 ‘0’이 아니면 선형변환 행렬은 MDS 코드를 생성한다. 본 논문에서 제안한 알고리즘은 기존의 모든 정방부분행렬이 정칙인지를 판단하는 알고리즘과 비교하여 곱셈 및 역수 연산수를 많이 줄임으로서 수행 시간을 크게 감소 시켰다.
본 논문에서는 셀프-캐스코드 구조를 이용한 LDO 레귤레이터를 제안하였다. 셀프-캐스코드 구조의 소스 측 MOSFET의 채널 길이를 조절하고, 드레인 측 MOSFET의 바디에 순방향 전압을 인가함으로써 최적화하였다. 오차 증폭기 입력 차동단의 셀프-캐스코드 구조는 높은 트랜스컨덕턴스를 가지도록, 출력단은 높은 출력 저항을 가지도록 최적화하였다. 제안 된 LDO 레귤레이터는 $0.18{\mu}m$ CMOS 공정을 사용하였고, SPECTERE를 이용하여 시뮬레이션 되었다. 제안 된 셀프-캐스코드 구조를 이용한 LDO 레귤레이터의 로드 레귤레이션은 0.03V/A로 기존 LDO의 0.29V/A보다 급격하게 개선되었다. 라인 레귤레이션은 2.23mV/V로 기존 회로보다 약 3배 향상되었다. 안정화 속도는 625ns로 기존 회로보다 346ns 개선되었다.
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[게시일 2004년 10월 1일]
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