• 제목/요약/키워드: DTV tuners

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DTV 튜너를 위한 CMOS Fractional-N 주파수합성기 (A CMOS Fractional-N Frequency Synthesizer for DTV Tuners)

  • 고승오;서희택;박종태;유종근
    • 전기전자학회논문지
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    • 제14권1호
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    • pp.65-74
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    • 2010
  • 최근 TV 방송의 새로운 시장인 DTV 시장이 넓어지면서 DTV 튜너에 대한 요구도 많아지고 있다. DTV 튜너를 설계하는 데에는 많은 어려운 부분이 있지만, 가장 어려운 부분 중에 하나가 주파수합성기이다. 본 논문에서는 DTV 튜너를 위한 주파수합성기 회로를 $0.18{\mu}m$ CMOS 공정을 사용하여 설계하였다. 설계한 주파수합성기는 DTV(ATSC)의 주파수 대역(54~806MHz)을 만족한다. 하나의 VCO를 사용하여 광대역을 만족시킬 수 있는 구조를 제안하고, LO pulling 효과를 최소화 하기위하여 1.6~3.6GHz 대역에서 동작하도록 설계하였다. 또한 고주파 대역과 저주파 대역에서의 VCO 이득의 차이와 주파수 간격의 변화를 줄여 안정적인 광대역 특성을 구현하였다. 모의실험 결과, 설계한 VCO의 이득은 59~94MHz(${\pm}$17.7MHz/V,${\pm}$23%)이고, 주파수 간격은 26~42.5MHz (${\pm}$8.25MHz/V,${\pm}$24%)이며, tuning range는 76.9%이다. 설계된 주파수합성기의 위상잡음은 100kHz offset에서 -106dBc/Hz이고, 고착시간은 약 $10{\mu}s$ 정도이다. 설계된 회로는 1.8V 전원전압에서 20~23mA의 전류를 소모하며 칩 면적은 PAD를 포함하여 2.0mm${\times}$1.8mm이다.

DTV 튜너를 위한 48MHz~1675MHz 주파수합성기 설계 (Design of a 48MHz~1675MHz Frequency Synthesizer for DTV Tuners)

  • 고승오;서희택;권덕기;유종근
    • 한국정보통신학회논문지
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    • 제15권5호
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    • pp.1125-1134
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    • 2011
  • 본 논문에서는 DTV 응용을 위한 광대역 주파수 합성기 회로를 $0.18{\mu}m$ CMOS 공정을 사용하여 설계하였다. 설계한 주파수 합성기는 DTV의 모든 주파수 대역을(48MHz~1675MHz) 만족한다. 하나의 VCO만을 사용하여 광대역을 만족시킬 수 있는 구조를 제안하였으며, 고주파 대역과 저주파 대역에서의 VCO 이득의 차이와 주파수 간격의 변화를 줄여 안정적인 광대역 특성을 구현하였다. 모의실험 결과, VCO의 발진주파수 범위는 1.85GHz~4.22GHz이며, 4.2GHz에서 위상잡음은 100kHz offset에서 -89.7dBc/Hz이다. VCO 이득은 62.4~95.8MHz/V(${\pm}21.0%$)이고 주파수 간격은 22.9~47.9MHz(${\pm}35.3%$)이다. 설계된 주파수합성기의 고착시간은 약 $0.15{\mu}s$이다. 제작된 칩을 측정한 결과 VCO는 2.05~3.4GHz의 대역에서 발진하는 것을 확인하였다. 설계된 주파수 보다 shift down 되었지만 마진을 두어서 설계를 하였기 때문에 DTV 튜너로 사용할 수 있는 주파수 대역은 만족한다. 설계된 회로는 1.8V 전원 전압에서 23~27mA의 전류를 소모한다. 칩 면적은 PAD를 포함하여 $2.0mm{\times}1.5mm$이다.

A Stability-Secured Loop Bandwidth Controllable Frequency Synthesizer for Multi-Band Mobile DTV Tuners

  • Kim, Kyeong-Woo;Akram, Muhammad Abrar;Hwang, In-Chul
    • IEIE Transactions on Smart Processing and Computing
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    • 제4권3호
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    • pp.141-144
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    • 2015
  • A broadband radio frequency synthesizer for multi-band, multi-standard mobile DTV tuners is proposed, it's loop bandwidth can be calibrated to optimize integrated phase noise performance without the problem of phase noise peaking. For this purpose, we proposed a new third-order scalable loop filter and a scalable charge pump circuit to minimize the variation in phase margin during calibration. The prototype phase-lock loop is fabricated in 180nm complementary metal-oxide semiconductor shows that it effectively prevents phase noise peaking from growing while the loop bandwidth increases by up to three times.

디지털 TV 실내수신 환경 분석 (Analysis on DTV Indoor Reception Environments)

  • 서영우;유호진;박민호;박준성;김규영;서종수
    • 방송공학회논문지
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    • 제13권5호
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    • pp.636-650
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    • 2008
  • 지상파 디지털 방송신호는 기존 아날로그 방식과 달리 상당히 낮은 C/N(Carrier to Noise Ratio)에서도 좋은 화질의 수신이 가능하다. 최근 디지털 튜너 기술의 발전과 함께 수신 가능한 임계 전계강도가 낮아지는 추세에서 실내 안테나를 이용한 실내수신 가능 세대가 늘어나고 있다. KBS에서는 주택환경에 따른 실내에서의 DTV 수신환경을 조사하기 위해 수도권지역에서 DTV 실내 수신환경에 대한 필드테스트를 실시하였다. 측정 대상 가구는 통계청의 자료에 의해 가구 비율을 선별하여 거리별로 총 58개 지점을 선정하였으며, 일반적으로 사용자들이 많이 사용하는 방식의 지향성, 무지향성 안테나와 많이 보급되고 있는 칩셋(chip set)이 내장된 셋톱박스(set top box)를 이용하여, 다양한 수신 조건에서 측정을 수행하였다. 본 논문에서는 측정 결과의 분석을 통해 각 측정 지점에서의 지형적 요인, 가옥의 구조 등에 따른 수신 전계강도의 변화와 공동주택의 층별 차이, 주변 건물의 입지조건 등에 따른 수신환경의 변화 등을 확인하였고, 실내 수신환경에 적합한 전파 조건 및 수신 방법 등을 정리하였다. 조사결과는 지상파 DTV의 실내 수신 확대를 위한 기본 자료로서 활용될 예정이다.