Poly(vinylidene fluoride-trifluoroethylene)(P(VDF-TrFE)) 고체 전해질 층의 어닐링 온도가 고분자 멤리스터의 전기적 특성에 미치는 영향을 분석하였다. 형태적 분석에서 100℃ 어닐링 온도를 갖는 P(VDF-TrFE) (100P(VDF-TrFE)) 박막 대비 200℃ 어닐링 온도를 갖는 P(VDF-TrFE) (200P(VDF-TrFE)) 박막의 표면 거칠기가 약 5배 크고 두께는 약 20% 작은 것으로 나타났다. 100P(VDF-TrFE)를 갖는 멤리스터 (M100) 대비 200P(VDF-TrFE) 멤리스터 (M200)의 set voltage는 약 50% 감소하였고, reset voltage의 크기는 약 30% 증가하였다. 또한, M200이 M100보다 더 나은 메모리 유지 특성을 갖는 것으로 나타났다. 이러한 차이는 M100 대비 M200 내부의 강한 국소 전기장 때문인 것으로 판단된다. 본 연구는 고분자 멤리스터의 어닐링 온도의 중요성을 제시함에 의의가 있다.
폴리실라잔 고체 전해질 층과 은(Ag) 활성 전극의 공정이 멤리스터의 전기적 특성에 미치는 영향을 살펴보았다. 더 높은 온도에서 어닐링된 고체 전해질을 갖는 멤리스터가 더 낮은 온도에서 어닐링된 고체 전해질을 갖는 소자보다 더 높은 set voltage 및 더 나은 메모리 유지 특성을 보였다. 어닐링 온도 증가에 따른 set voltage의 증가 및 메모리 유지 특성의 향상은 각각 고체 전해질 층 내부의 빈 공간의 감소 및 균일도 증가 때문인 것으로 사료된다. 고체 전해질 층을 비교적 높은 온도에서 어닐링 할지라도, 폴리실라잔 용액의 농도가 지나치게 높은 경우에는 멤리스터의 저저항상태가 유지되지 못했다. 마지막으로, 용액공정으로 형성한 Ag 활성 전극을 갖는 멤리스터는 진공공정으로 형성한 Ag 활성 전극을 갖는 소자와 달리 WORM 특성을 갖는 것으로 나타났다. 이러한 WROM 특성은 용액공정 Ag 활성 전극에 존재하는 형태적 결함 때문인 것으로 사료된다.
본 연구에서는 코팅 공정에 사용되는 슬롯다이(slot-die)에 대해 조건에 따른 코팅 성능을 연구하였다. 슬롯다이 코팅은 코팅 되는 필름의 속도, 코팅액의 점도 그리고 슬롯다이로 주입 되는 압력에 따라 코팅 품질이 많이 달라진다. 따라서 본 논문에서는 CFD 코드를 이용하여 안정적인 코팅을 위한 최적의 조건을 찾았다. 다양한 코팅액의 점도와 슬롯다이 입구의 압력 그리고 코팅 필름의 속도에 대해서 해석을 수행하였다. 그 결과로 $5kgf/cm^2$의 압력과 100cps 의 점도 그리고 20m/min 의 속도 조합에서 가장 안정적으로 코팅액이 잘 도포되었다.
This study investigates the effects of multi-axial diagonal forging (MADF) processing number on the microstructures of AA1100 fabricated using MADF processes. The cast AA1100 was annealed at $400^{\circ}C$ for 3hrs in $N_2$ atmosphere and cut into $25mm^3$ cubes for the MADF processes. The MADF process consist of plane forging with a thickness reduction of 30% and a diagonal forging with a diagonal forging angle of 135 degrees. In order to analyze the microstructural variations based on the number of repetitions, 1, 2, 3 and 4 cycles of the MADF process were performed. AA1100 specimens were successfully deformed without cracking of the surface for up to 4 cycles of MADF. The grain size, average misorientation and average grain orientation spread (GOS) of MADF processed materials were analyzed using EBSD technique. The results showed that MADF process effectively refined the microstructure of AA1100 with an initial average grain size of $337.4{\mu}m$. The average grain sizes of specimens which were MADF processed for 2, 3, 4 cycles were refined to be $1.9{\mu}m$, $1.6{\mu}m$, $1.4{\mu}m$, respectively. The grain refinement appeared saturated when AA1100 got MADF processed over 2 cycles. When the specimen was subjected to two or more cycles of MADF, the degree of decrease in the average grain size drastically decreased with an increase in the number of cycle due to the softening phenomena such as dynamic recovery or dynamic recrystallization during processing.
This study investigated the effects of the processing number of multi-axial diagonal forging (MADF) on the microstructural changes of OFC fabricated by MADF processes. The as-extruded OFC was cut to $25mm^3$ cube for the MADF processes. The MADF process consists of plane forging with a thickness reduction of 30% and diagonal forging with a diagonal forging angle of $135^{\circ}$. In order to analyze the microstructural evolutions according to the number of repetitions, 1, 2, 3 and 4 cycles of the MADF process were performed. OFC specimens were successfully deformed without surface cracking for up to 4 cycles of MADF. The grain size, average misorientation and average grain orientation spread (GOS) of MADF processed materials were analyzed using EBSD technique and their Vicker's hardness were also measured. The results showed that MADF process effectively refined the microstructure of OFC with initial average grain size of $84.2{\mu}m$. The average grain sizes of specimens MADF processed for 1, 2, 3, 4 cycles were refined to be $8.5{\mu}m$, $2.2{\mu}m$, $1.5{\mu}m$, $1.1{\mu}m$, respectively. The grain refinement seemed to be saturated when OFC was MADF processed over 2 cycles. In the case of specimens subjected to two or more cycles of MADF, the degree of decrease in average grain size was drastically reduced as the number of cycles increased due to softening phenomena such as dynamic recovery or dynamic recrystallization during processing. The degree of increase in average Vicker's hardness was also dramatically reduced as the number of cycles increased due to the same reason.
본 논문에서는 다중 대역에서 매크로-마이크로 주파수 튜닝이 가능한 소형의 패치 모노폴 안테나를 소개하였다. 제안된 재구성 안테나는 PCB 기판(FR-4: $\varepsilon_r=4.4$ and tan $\delta=0.02$) 위에 미앤더(meander) 형태의 안테나로 설계하였고, Wibro(2.3~2.4 GHz)와 WLAN a/b(2.4~2.5 GHz/5.15~5.35 GHz)대역에서 일정한 이득을 유지하면서 각각의 서비스 대역에서 동작한다. 두 개의 다이오드, 핀 다이오드와 버렉터 다이오드가 주파수 튜닝을 위해 안테나 상에 내장되었으며, 핀 다이오드는 2 GHz와 5 GHz의 대역을 스위칭(매크로 튜닝)하기 위해 사용되었으며, 버렉터 다이오드는 2.3~2.5 GHz와 5.15~5.35 GHz의 서비스 대역 내 미세 주파수 튜닝(마이크로 튜닝)을 위하여 사용되었다. 또한, 두 주파수 대역(2 GHz와 5 GHz) 사이에서의 불요 공진(spurious resonance)은 미앤더(meander) 사이의 갭을 조정하여 제거되었다. 안테나는 각각의 서비스 대역에서 2 dBi 이상의 일정한 이득을 보인다. 제안된 안테나의 측정 결과는 매크로-마이크로 주파수 튜닝 기술이 재구성 가능한 다중 대역 다중 모드(Multi-Mode Multi-Band: MMMB) 무선 통신 시스템에서 유용하게 사용될 수 있음을 보여준다.
In this paper, a conceptual design and a detailed design of novel cylindrical magnetic levitation stage is introduced. This is came from planar-typed magnetic levitation stage. The proposed stage is composed of cylinder-typed permanent magnet array and semi-cylinder-typed 3 phase winding module. When a proper current is induced at winding module, a magnetic levitation force between the permanent magnet array and winding module is generated. The proposed stage can precisely move the cylinder to rotations and translations as well as levitations with the magnetic levitation force. This advantage is useful to make a nano patterning on the surface of cylindrical specimen by using electron beam lithography under vacuum. Two methods are used to calculate required magnetic levitation forces. The one is 2D FEM analysis, the other is mathematical modeling. This paper shown that results of two methods are similar. An assistant plate is introduced to reduce required currents of winding module for levitations in vacuum. The mathematical model of cylindrical magnetic levitation stage is used for dynamic simulation of magnetic levitations. A lead-lag compensator is used for control of the model. Simulation results shown that the detail designed model of the cylindrical magnetic levitation stage with the assistant plate can be controlled very well.
Kim, Jong-Oh;Jeong, Geum-Jae;Son, Eun-Ik;Jo, Du-Min;Kim, Myung-Sub;Chun, Dong-Hae;Kim, Young-Mog;Ryu, Uh-Chan
Current Optics and Photonics
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제6권2호
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pp.202-211
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2022
In the pasteurization of escalator handrails using ultraviolet (UV) sterilizers, a combination of light distribution and escalator speed has priority over other important factors. Furthermore, since part of the escalator handrail has a curved structure, proper design is needed to improve the sterilization rate on the surfaces touched by users. In this paper, two types of sterilizers satisfying these conditions are manufactured with 275-nm UV-C LEDs, after modeling the three-dimensional (3D) structure of an escalator handrail and simulating optical distributions of UV-C irradiation on the handrail's surface according to light-emitting diode (LED) positions and reflector variations in the sterilizers. Pasteurization experiments with the UV-C LED sterilizers are conducted on six types of gram-positive and gram-negative bacteria, with exposure times of 0.2, 5, and 15 s at an actual installation distance of 20 mm. The sterilization rates for the gram-positive bacteria are 10.63% to 27.94% at 0.2 s, 89.44% to 96.30% at 5 s, and 99.64% to 99.88% at 15 s. Those for the gram-negative bacteria are 57.70% to 77.63% at 0.2 s, 98.90% to 99.49% at 5 s, and 99.88% to 99.99% at 15 s. The power consumption of the UV-C LED sterilizer is about 8 W, which can be supplied by a self-generation module instead of an external power supply.
본 논문에서는 유럽에서 사용되는 이동형 디지털 방송인 DVB-T/H 신호를 수신 및 신호처리 가능한 DVB-T/H SiP를 제작하였다. DVB-T/H SiP는 칩이 PCB 내부에 삽입될 수 있는 IC-임베디드 PCB 공정을 적용하여 설계되었다. DVB-T/H SiP에 삽입된 DVB-T/H IC는 신호를 수신하는 RF 칩과 어플리케이션 프로세서에서 활용할 수 있도록 수신된 신호를 변환하는 디지털 칩 2개를 원칩화한 모바일 TV용 SoC 이다. SiP 에는 DVB-T/H IC를 동작하기 위해 클럭소스로써 38.4MHz의 크리스탈을 이용하고, 전원공급을 위해 3MHz로 동작하는 DC-DC Converter와 LDO를 사용하였다. 제작된 DVB-T/H SiP는 $8mm{\times}8mm$ 의 4 Layer로 구성되었으며, IC-임베디드 PCB 기술을 사용하여 DVB-T/H IC는 2층과 3층에 배치시켰다. 시뮬레이션 결과 Ground Plane과 비아의 확보로 RF 신호선의 감도가 개선되었으며 SiP로 제작하는 경우에 Power 전달선에 존재하는 캐패시터와 인덕터의 조정이 필수적임을 확인하였다. 제작된 DVB-T/H SiP의 전력 소모는 평균 297mW이며 전력 효율은 87%로써 기존 모듈과 동등한 수준으로 구현되었고, 크기는 기존 모듈과 비교하여 70% 이상 감소하였다. 그러나 기존 모듈 대비평균 3.8dB의 수신 감도 하락이 나타났다. 이는 SiP에 존재하는 DC-DC Converter의 노이즈로 인한 2.8dB의 신호 감도 저하에 기인한 것이다.
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[게시일 2004년 10월 1일]
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