JSTS:Journal of Semiconductor Technology and Science
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제7권4호
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pp.281-286
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2007
In this paper, sub-circuits for 24 GHz phase locked 100ps(PLLs) using $0.5{\mu}m$ SiGe HBT are presented. They are 24 Ghz voltage controlled oscillator(VCO), 24 GHz to 12 GHz regenerative frequency divider(RFD) and 12 GHz to 1.5 GHz static frequency divider. $0.5{\mu}m$ SiGe HBT technology, which offers transistors with 90 GHz fMAX and 3 aluminum metal layers, is employed. The 24 GHz VCO employed series feedback topology for high frequency operation and showed -1.8 to -3.8 dBm output power within tuning range from 23.2 GHz to 26 GHz. The 24 GHz to 12 GHz RFD, based on Gilbert cell mixer, showed 1.2 GHz bandwidth around 24 GHz under 2 dBm input and consumes 44 mA from 3 V power supply including I/O buffers for measurement. ECL based static divider operated up to 12.5 GHz while generating divide by 8 output frequency. The static divider drains 22 mA from 3 V power supply.
레이저 스캔과 사진측정법 등의 기술이 3D 모델링에 광범위하게 적용됨에 따라 리토폴로지는 3D 모델링 프로세스에서 매우 중요한 부분이 되었다. 하지만 리토폴로지 사용방법이 부적당한 경우 제작과정에서 많은 시간의 낭비를 초래한다. 3D 모델링의 유형에 따라 각각 가장 적합한 리토폴로지 방식과 소프트웨어를 선택하여 3D 모델링의 리토폴로지 효율성을 높이는 방안을 탐구하는 것이 본 연구의 목적이다. 시장에 현존하는 리토폴로지 소프트웨어에 따라 수동식, 자동식, 래핑식 세 가지로 분류하였다. 이를 기반으로 이 세 가지 리토폴로지 방식의 특성과 각각 포함한 소프트웨어의 특징을 살펴보았다. 스태틱메시, 스켈레탈메시, 하드서페이스 모델링에 대해서 위의 세 가지 리토폴로지 방식으로 사례 제작을 진행했다. 세 가지 리토폴로지 방식이 각이 포함한 소프트웨어의 장단점을 요약하고 수동식의 결과가 좋고 자동식의 속도가 빠르며, 래핑식은 미리 존재하는 베이스 메시가 필요로 하며 유형별 3D 모델링에 가장 적합한 리토폴로지 방식을 제공한다. 본 연구는 리토폴로지 작업 및 3D 모델링의 제작 효율 높이기에 도움이 된다고 기대한다.
본 논문에서 0.5$\mu\textrm{m}$ GaAs MESFET을 이용하여 5GHz대 무선랜에 사용 가능한 MMIC 가변이득 저잡음 증폭기를 설계 및 제작하였다. 이득과 잡음성능이 우수한 증가형 GaAs MESFET과 선형성이 좋은 공핍형 MESFET 조합의 캐스코드 구조로 저잡음 증폭기를 설계하기 위하여 Turlington의 점근선법을 이용하여 MESFET의 비선형 전류 전압특성에 대한 거동 모델 방정식을 도출하였다. 이로부터 캐스코드 증폭기의 공통 소오스 FET는 4${\times}$50$\mu\textrm{m}$ 크기의 증가형 MESFET으로 공통 게이트 FET는 2${\times}$50$\mu\textrm{m}$ 크기의 공핍형 MESFET으로 설계하였다. 제작된 가변이득 저잡음 증폭기의 잡음지수는 4.9GHz에서 2.4dB, 가변 이득범위는 17dB이상, IIP3는 -4.8dBm이며, 12.8mW의 전력을 소비하였다.
본 논문에서는 이중대역 무선랜 응용을 위한 SPDT(single-pole double-throw) 스위치를 설계 및 제작하였다. 높은 격리도와 송신단의 선형성을 개선하기 위해 적층-게이트(stacked-gate)를 이용하는 비대칭구조를 제안하였다. 제안한 SPDT 스위치의 트랜지스터의 게이트-폭과 제어전압 그리고 적층-게이트의 개수는 모의실험을 통해 최적의 값으로 설계되었고, 500mS/mm의 Gmmax와 150GHz의 fmax를 갖는 $0.25{\mu}m$ GaAs pHEMT 공정을 이용하여 제작하였다. 설계된 스위치는 $DC\~6GHz$ 대역에서 0.9dB 이하의 삽입손실과 송신시 40dB 이상의 격리도와 수신시 25dB 이상의 격리도를 나타내었고, -3/0V 제어전압으로 23dBm의 입력 PldB 를 보였다. 제작된 SPDT 스위치는 $1.8mm{\times}1.8mm$의 면적을 갖는다.
The present paper consists of two parts. Since the recent paper [4] proved that an Alexandroff $T_0$-space is a semi-$T_{\frac{1}{2}}$-space, the first part studies semi-open and semi-closed structures of the Khalimsky nD space. The second one focuses on the study of a relation between the LS-property of ($SC^{n_1,l_1}_{k_1}{\times}SC^{n_2,l_2}_{k_2}$, k) relative to the simple closed $k_i$-curves $SC^{n_i,l_i}_{k_i}$, $i{\in}\{1,2\}$ and its normal k-adjacency. In addition, the present paper points out that the main theorems of Boxer and Karaca's paper [3] such as Theorems 4.4 and 4.7 of [3] cannot be new assertions. Indeed, instead they should be attributed to Theorems 4.3 and 4.5, and Example 4.6 of [10].
3D애니메이션에서 표현 할 수 있는 캐릭터 애니메이션의 범위가 점점 다양, 정교해지고 복잡해짐에 따라 애니메이팅 퀄리티에 가장 직접적으로 영향을 줄 수 있는 리깅의 중요성은 더욱 더 커져가고 있다. 또한 3D애니메이션 제작 프로덕션과정에서 퀄리티 이상으로 중요한 부분이 모든 제작 공정의 신속성이며 가장 많은 인원이 투입되고 가장 오랜 시간이 걸리는 애니메이팅 프로세스를 위하여 테크니컬 디렉터(TD)들의 정확하고 신속한 리깅 프로세스 파이프라인 구축과 애니메이팅 과정 중 발생하는 오류와 수정사항에 대하여 즉각적인 대처와 적용의 중요성은 더욱 대두되고 있다. 테크니컬 디렉터란 3D애니메이션 제작이 고도화 되어가면서 새로 등장한 직업으로 각 제작 프로세스간의 흐름을 원활하게 하고 작업의 효율성과 기술적 지원을 하는 직무이다. 해외 메이저 애니메이션 스튜디오의 경우 파이프라인 테크니컬 디렉터, 리깅 테크니컬 디렉터, 렌더팜 테크니컬 디렉터 등 세분화하여 인력을 운용하고 있다. 해외 메이저 스튜디오 같은 경우 대부분 인하우스(In-house) 소프트웨어를 자체 개발하여 리깅, 애니메이션 프로세스를 처리하고 있고 소프트웨어의 개발 코드를 가짐으로서 작품의 방향성에 적합하게 프러덕션 파이프라인을 자유롭게 개발, 변형해 애니메이터들이 애니메이팅을 하는데 있어 최적의 환경을 구축해 주기 위한 노력을 하고 있다. 그러나 자체 인하우스(In-house)소프트웨어를 개발하거나 테크니컬 디렉터를 고용 할 여력이 없는 영세업체들, 개인 창작자들, 학생들이 작품에 적합한 리깅 프로세스를 개발하고 적용, 안정화시키기에는 너무 많은 노력과 비효율적인 시간, 자본이 들기 마련이다. 본 연구에서는 시중에 출시된 여러 오토 리깅 툴 중에 본 연구의 대상이 되는 사람들에게 가장 적합한 오토 리깅 툴을 제시하고 3D 캐릭터 리깅에 대한 지식이 부족한 사람들에게 가장 정확하고 신속한 오토 리깅 프로세스 설정 방법을 제시하며 프로덕션 파이프라인에 오토 리깅 툴을 사용 시에 그 효율성에 대하여 고찰하였다.
본 논문에서는 위상 공간 분석을 통해 3D 벡터 필드를 표현하는 방법을 제안한다. 이 방법은 상미분 방정식과 벡터 필드 위상과의 연결에 기초를 두고 있다. 위상 공간 분석은 위상 공간 형태의 자율 방정식 시스템의 기하학적 보간법이 되어야 한다. 이 방정식 시스템의 모든 해는 공간에서의 곡선이 아니라 곡선을 따라가는 점의 움직임과 일치한다. 이러한 분석은 이 논문의 기반이다. 새로운 방법은 3차원 벡터필드에서 육면체 셀을 5 또는 6개의 사면체 셀로 분해하는 것을 요구한다. 임계점은 각 사면체의 간단한 선형 시스템을 풀어서 간단하게 구할 수 있다. 각 사면체의 일반해에 의해 그려지는 전체 곡선과 사면체의 한 면을 포함하는 평면과의 교차점을 계산함으로써 탄젠트 곡선은 구해진다.
본 연구에서는 유한요소해석을 통해 대면적 표면처리가 가능한 경량 광폭 임펠러를 설계하였으며 구조적 안정성을 확인하였다. 먼저 위상최적화를 통해 경량 브라켓 해석모델을 수립하였으며, 구조해석을 통해 최적의 모델을 선정하였다. 3차원 경량 광폭 임펠러의 굽힘변형 해석을 수행하였으며 허용변형량 범위에 포함되었다. 또한 진동해석을 수행하여 1차 모드 고유진동수를 얻었으며 위험속도식에 대입하여 안전 운전속도(RPM) 기준을 제시하였다. 궁극적으로 본 연구의 해석적 기법이 경량 광폭 임펠러 설계에 유효함을 확인하였다.
This paper proposes the analysis and design of a DC-side symmetrical zero-current-switching (ZCS) Class-D current-source driven resonant rectifier to improve the low power-factor and high line current harmonic distortion of lighting applications. An analysis of the junction capacitance effect of Class-D ZCS rectifier diodes, which has a significant impact on line current harmonic distortion, is discussed in this paper. The design procedure is based on the principle of the symmetrical Class-D ZCS rectifier, which ensures more accurate results and provides a more systematic and feasible analysis methodology. Improvement in the power quality is achieved by using the output characteristics of the DC-side Class-D ZCS rectifier, which is inserted between the front-end bridge-rectifier and the bulk-filter capacitor. By using this symmetrical topology, the conduction angle of the bridge-rectifier diode current is increased and the low line harmonic distortion and power-factor near unity were naturally achieved. The peak and ripple values of the line current are also reduced, which allows for a reduced filter-inductor volume of the electromagnetic interference (EMI) filter. In addition, low-cost standard-recovery diodes can be employed as a bridge-rectifier. The validity of the theoretical analysis is confirmed by simulation and experimental results.
본 논문에서는 의료기기용 MedRadio 대역의 저전력 저잡음 증폭기를 제안한다. 제안한 저잡음 증폭기는 전류 재사용 저항 피드백 증폭기 구조를 채택하여 $g_m$을 증폭시키고 소스 인덕터 없이 입력 매칭을 가능하도록 하였다. 추가적으로 제안한 직렬 저항, 인덕터, 커패시터 입력 매칭 네트워크의 Q-factor를 통해 저잡음 증폭기의 전압 이득을 증가시켜 잡음 지수를 최소화 했다. 로드저항이 없는 구조를 채택하여 낮은 전원 전압으로 전력 소모를 줄였다. 제안한 MedRadio 대역 저전력 저잡음 증폭기는 $0.13{\mu}m$ CMOS 공정을 사용하여 설계하였고, 전원 전압 1 V에서 0.18 mA의 전류를 소모하면서 0.85 dB의 잡음 지수, 30 dB의 전압 이득, -7.9 dBm의 IIP3의 성능을 보인다.
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[게시일 2004년 10월 1일]
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