조명 변화에 적응적인 움직임 탐색 및 보상 방법과 2차원 다이렉트 모드 (2D Direct Mode)를 이용한 MVC (Multi-view Video Coding) 방법을 제안한다. 먼저, 공간적 및 시간적으로 인접한 영상으로부터 휘도 화소 값의 움직임 탐색 및 보상을 수행하기 위한 새로운 SAD (Sum of Absolute Difference) 측정 방법을 제안한다. 조명 변화에 적응적인 움직임 탐색 및 보상은 움직임 벡터의 정확도를 높이고, 비트의 절감을 위하여 새로운 SAD 계산식을 사용한다. 다음으로, 시점 간의 예측 시에 사용될 수 있는 2차원 다이렉트 모드는 MPEG-4 AVC의 시간적 다이렉트 모드 (Temporal Direct Mode)로부터 확장된 방식이다. 본 논문에서 제안된 MVC 방법은 MPEG-4 AVC의 Simulcast 부호화와 비교하여 약 0.8dB의 PSNR (Peak Signal-to-Noise Ratio) 향상을 보였다.
저잡음 증폭기, 믹서, 로컬 증폭기와 온도보상회로를 포함하는 다채널 수신 블록이 단일 MMIC 칩으로 설계 및 제작되었다. 이 국내개발 MMIC 칩을 송수신 모듈내에 장착하고 제작하여 송수신 모듈의 잡음지수와 변환이득 등을 측정하였으며, 또한 상용 칩을 장착하여 제작한 송수신모듈의 측정 결과와 이를 비교하였다. 결과적으로 국내개발 MMIC 칩을 이용한 송수신모듈이 상용 MMIC 칩을 이용한 송수신 모듈보다 잡음지수 및 평탄도 등에서 국내 개발 칩이 더 변환이득 특성이 좋으며, 채널당 이득 차이는 각각 0.5dB과 1.5dB이고 위상 차이는 각각 1.06도와 3.93도로 비교적 국내 개발 칩이 우수한 특성을 보였다.
본 논문에서는 광대역 동축-마이크로스트립 선로에서 전송 손실을 최소화하는 수직 트랜지션(transition)의 설계 기법을 제안하였다. 동축-마이크로스트립 선로의 수직 트랜지션은 동축 선로와 인쇄 회로 기판이 수직으로 연결되는 구조로서 인쇄형 안테나 혹은 마이크로스트립 기판을 사용하는 마이크로파 송수신 장치 등에 널리 사용된다. 제안한 설계 방법은 넓은 대역폭을 가지면서 전송 손실을 최소화하는 방법으로, 접지 개구면(ground aperture)의 지름, 프로브(probe)의 지름, 접지 개구면의 오프셋과 스텁(stub) 길이를 설계 변수로 설정하여, 시뮬레이션을 통하여 설계 값을 구하였다. 동축 선로와 마이크로스트립 기판은 일반적으로 널리 사용되는 SMA 커넥터와 PTFE 재질의 두께 0.254, 0.508 및 0.787 mm 기판을 사용하였다. 시뮬레이션 결과로부터 구한 설계 변수 값들을 입증하기 위하여 SMA 동축 커넥터와 0.787 mm 두께의 기판을 사용하여 수직 트랜지션 시험 블록을 제작하였다. 이 트랜지션의 특성을 측정한 결과 $0.05{\sim}20GHz$주파수 범위에서 반사 계수가 -22 dB 이하이고, 전송 손실이 0.45 dB 이하인 만족할만한 결과를 얻었다.
Electrical resistivity and piezoelectric properties were investigated in Lead Zirconate-Titante(PZT) with Nb$_2$O$\sub$5/dopant, fabricated from conventional mixed-oxide powders and molten salt synthesis. The resistivity and electromechanical coupling factor(K$\sub$p/) were increased with increasing Nb content. The reason for increasing of the electrical resistivity below the Curie Temperature(TC). It is believed that the Curie Temperature(Tc). It is believed that the p-type electrical conduction in PZT is due to lead vacancies. The electromechanical coupling factor(K$\sub$p/) and piezoelectric constant d$\sub$33/ were improved. This behavior can be explained as a compensation effect and Nb$\^$5+/ can serve as a donar and contribute electrons to the conduction process. As a result, the optimized Nb$_2$O$\sub$5/ dopants on the PZT specimens were 0.75 wt%.
본 논문에서는 HDTV와 같이 고해상도 및 고속의 동작을 동시에 요구하는 고화질 영상시스템 응용을 위한 10비트 200MS/s 65nm CMOS ADC를 제안한다. 제안하는 ADC는 고속 동작에서 저 전력 소면적 구현에 적합한 4단 파이프라인 구조를 기반으로 설계되었으며, 입력단 SHA 회로에서는 1.2V의 낮은 단일 전원 전압에서도 높은 입력 신호를 처리하기 위해 4개의 커패시터를 기반으로 설계하여 $1.4V_{p-p}$의 입력 신호를 ADC 내부 회로에서는 $1.0V_{p-p}$으로 낮추어 사용할 수 있도록 하였다. 또한 높은 전압이득을 갖는 증폭기를 필요로 하는 SHA와 MDAC1은 출력 임피던스가 감소하는 65nm CMOS 공정의 제약 사항을 극복하기 위해 통상적인 2단 증폭기 대신 3단 증폭기 구조를 기반으로 설계하였으며 200MS/s 높은 동작 속도를 고려하여 RNMC 및 multipath 주파수 보상기법을 추가하여 설계하였다. 전력 소모 최소화를 위해 스위치 기반의 바이어스 전력최소화 기법을 sub-ranging flash ADC에 적용하였고, 기준 전류 및 전압 발생기를 온-칩으로 집적하는 동시에 외부에서도 인가할 수 있도록 하여 시스템 응용에 따라 선택적으로 사용할 수 있도록 하였다. 제안하는 시제품 ADC는 65nm CMOS 공정으로 제작되었으며, 측정된 DNL 및 INL은 10비트 해상도에서 각각 최대 0.19LSB, 0.61LSB 수준을 보이며, 동적 성능으로는 150MS/s와 200MS/s의 동작 속도에서 각각 54.4dB, 52.4dB의 SNDR과 72.9dB 64.8dB의 SFDR을 보여준다. 시제품 ADC의 칩 면적은 $0.76mm^2$이며, 1.2V 전원 전압과 200MS/s의 동작 속도에서 75.6mW의 전력을 소모한다.
본 논문에서는 랜덤 수 생성 회로를 통해 Relaxation Oscillator의 주파수를 불규칙하게 변환하여 EMI Noise를 최소화하는 방법을 제시한다. 또한, DC-DC Converter에 이 기법이 적용되었을 때의 효과와 이 결과가 RF Receiver system에 미치는 효과를 Noise 측면에서 연구하였다. 제안하는 Relaxation Oscillator 출력 중심주파수는 7.9 MHz이고, 온도보상기법을 적용하여 온도변화에 따라 주파수가 보상되도록 설계하였다. 이 칩은 $0.18{\mu}m$ 공정으로 설계하였고, 칩의 면적은 $220{\mu}m{\times}280{\mu}m$이다. 전류 소모는 공급전압인 1.8 V에서 $500{\mu}A$이다.
파장 분할 다중 전송을 위한 분산 제어 (DM; dispersion management)가 적용된 전송 링크에서 특정 중계 구간에만 RDPS(residual dispersion per span)가 집중된 구조를 통한 시스템 성능 개선 정도를 RDPS가 모든 중계 구간에서 균일한 구조에서의 시스템 성능과 비교하여 살펴보았다. 80 km의 14개 단일 모드 광섬유 중계 구간 중 RDPS가 집중되는 중계 구간을 제외한 나머지 중계 구간의 RDPS가 0 ps/nm인 전송 링크에서 5번째~13번째 중계 구간의 RDPS가 300 ps/nm로 집중되고 6번째~13번째 중계 구간의 RDPS가 1,320 ps/nm로 집중되면 최상의 시스템 성능 개선이 이루어지는 것을 확인하였다. 또한 두 경우 모두 precompensation에 의해 결정되는 최적의 NRD(net residual dispersion)는 10 ps/nm이고, postcompensation에 의해 결정되는 최적의 NRD는 -10 ps/nm인 것을 확인하였고, 눈 열림 패널티(EOP; eye opening penalty)가 1 dB 이하가 되는 유효 입사 전력의 범위가 RDPS가 균일한 링크에 비해 집중 RDPS가 300 ps/nm인 경우 2 dB, 1,320 ps/nm인 경우 6 dB 정도 개선되는 것을 확인하였다.
분 논문에서는 해상 이동업무에 할당되어 있는 VHF 대역에서 선박과 육상간 및 선박과 선박간에 ${\pi}$/4-DQPSK 변조방법을 이용하여 디지털 데이터 및 e-mail을 교환하기 위한 기저대역 수신부 설계에 대하여 논한다 해상 통신 장치는 상대적으로 큰 주파수 불안정성을 허용하기 때문에, 상대적으로 큰 주파수 편이를 갖을 수 있는 수신 및 주파수 편이 등의 동기파라미터를 추정하고 이를 보상할 수 있는 기능을 갖도록 기저대역 수신기를 설계하였다. BER의 모의실험을 통하여 설계한 기저대역 수신기는 20% 이상의 정규화 주파수 편이가 존재하더라도 AWGN 채널환경하에서 0.5dB 이내의 성능열화가 있음을 확언 하였다.
웨이블릿 방식의 비디오 압축에서 과도한 메모리 요구 사항을 감소시키기 위해 본 논문은 저 복잡도의 임베디드 압축(Embedded Compression : EC) 알고리즘을 적용한다. 본 논문의 EC 알고리즘은 화질 열화가 거의 무손실에 가깝도록 하기 위해 고정 압축률 50%를 사용한다. 본 논문의 EC 기법을 통해 EC가 적용되지 않은 웨이블릿 비디오 인코더와 비교하여 이산 웨이블릿 변환 과정에서 발생하는 임시적인 저주파 웨이블릿 계수들의 메모리의 접근과 크기를 50%로 줄일 수 있다. 또한, 포워드 적응형 양자화(FAQ)와 고정 길이 코드 기반의 EC 알고리즘은 웨이블릿과 SPHIT(Set Partitioning in Hierarchical Trees) 사이의 버퍼의 크기와 대역폭을 50%까지 절약할 수 있다. 시뮬레이션 결과를 통해, 비디오 코더의 목표 비트율이 1 과 0.5 bpp 인 경우에 본 논문에서 적용한 EC 알고리즘에 의한 평균적인 PSNR 저하가 각각 0.179와 0.162 dB 임을 알 수 있다.
본 논문에서는 배열 안테나 기반의 MVDR (minimum variance distortionless response) 항 재밍 GPS (global positioning system) 수신기에서 안테나 경로 사이에 존재하는 이득, 위상, 지연 편차를 교정하기 위한 안테나 교정 기법을 제안한다. 제안하는 기법은 다중 안테나 시스템에서 안테나 경로들 사이의 이득, 위상, 지연 편차를 추정하고 이를 보상한다. 경로 간 이득, 위상, 지연 편차를 정확히 추정하기 위해 좋은 상관 특성을 갖는 파일럿 신호가 사용된다. 교차 상관에 기반하여 지연 편차가 먼저 추정되며 이후에 이득과 위상 편차가 추정된다. 정밀한 지연 편차 추정 및 보상을 위해 보간기법을 사용하는데 이산 푸리에 변환 (DFT) 기반의 보간기법으로 계산 복잡도를 감소시킨다. 제안된 기법은 MATLAB을 이용한 컴퓨터 모의실험을 통해 검증한다. 모의실험 결과에 따르면 제안하는 기법을 적용하면 이득, 위상 시간 지연 편차를 각각 0.01 dB, 0.05 도, 0.5 ns 이내로 줄일 수 있다.
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[게시일 2004년 10월 1일]
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