폴딩은 면에 기하학적 형태를 부여하는 동시에 역학적 효율을 증대시킬 수 있다. 본 연구의 목적은 건축의 조형성에 영향을 미칠 수 있는 폴딩을 구조와 형태의 매개로서 탐구하고, 그 역할과 가능성을 고찰하는 것이다. 따라서 먼저 폴딩의 특성과 패턴형성의 요소 및 이를 이용한 공간의 구성양식을 살펴본다. 또한 절판구조와 막구조에서 보이는 폴딩의 변형과 응용 방법을 파악함으로써 조형요소로서 역할과 가능성을 확인하고, 전개성을 응용한 형태로서 전개구조의 가능성을 확인한다.
단백질 폴딩 연구에 유용하도록 유비퀴틴 단백질의 페닐알라닌 45를 트립토판으로, 발린 26을 알라닌으로 변이시킨 HubWA 단백질을 모델로 삼아 소수성 상호작용이 단백질 폴딩 반응에 끼치는 영향을 탐구하였다. HubWA의 소수성 아미노산 중 14 개를 알라닌으로 치환한 변이 단백질을 제조하였고 이들 중 폴딩 연구에 적절한 4 개의 변이 단백질(V5A, I13A, V17A, I36A)을 얻어서 폴딩 반응의 진행 과정을 stopped-flow 장치로 측정하였다. 변이 단백질 V17A의 폴딩 반응은 HubWA와 마찬가지로 three-state 메커니즘을 따르며, V5A, I13A, I36A의 반응은 two-state 폴딩 메커니즘을 따르는 것으로 관찰되었다. 이는 HubWA 단백질의 폴딩 반응은 지엽적으로 구조적인 안정성을 지닌 부분이 존재하는 중간 단계가 먼저 형성된 다음 이들이 서로 퍼즐을 맞추는 것과 같은 방식으로 폴딩이 일어나는 collision-diffusion 메커니즘을 따르다가 소수성이 약한 아미노산으로 치환하였을 때 구조적인 안정성을 지닌 중간 단계가 관찰되지 않지만 폴딩 핵의 형성과 핵 주위로 native 구조가 형성되는 반응이 짝지어서 일어나는 nucleation-condensation 메커니즘으로 전환되는 것으로 해석되었다. 이러한 관찰은 단백질의 폴딩 경로는 지엽적인 구조의 안정성에 따라 서로 다른 메커니즘을 띨 수 있음을 시사한다.
단백질 폴딩 반응에서 정전기적 상호작용의 역할을 라이신 29를 알라닌으로 치환한 변이 유비퀴틴을 사용하여 탐색하였다. 유비퀴틴의 입체구조에서 라이신 29의 곁사슬은 글루탐산 16과 아스파르산 21의 곁사슬과 근접한 거리에 있어서 곁사슬끼리 정전기적 상호작용을 통하여서 삼차원 입체구조를 안정화시킬 것으로 예측되었다. 라이신을 알라닌으로 치환하여 정전기적 상호작용을 제거하였을 때 유비퀴틴의 native state의 구조적 안정성이 ~20% 감소한 점은 라이신 29에 의한 정전기적 상호작용이 단백질 삼차구조의 안정성에 상당히 기여하고 있다는 점을 시사하였다. 폴딩 반응의 진행 과정을 stopped-flow 장치로 측정한 folding kinetics 실험은 이전에 관찰된 것과 마찬가지로 unfolded state에서 native state로 진행하는 과정에 중간단계를 거치는 three-state on-pathway 메커니즘을 따르는 것으로 나타났다. 더욱이 라이신 29에 의한 정전기적 상호작용이 중간단계의 구조적 안정성에 기여하는 정도가 native state의 구조적 안정성에 기여하는 정도의 ~55%인 것으로 나타났다. 이는 유비퀴틴 폴딩의 중간단계의 구조도 라이신 29에 의한 정전기적 상호작용에 의하여 상당히 안정화 된다는 것을 의미하며 따라서 정전기적 상호작용이 단백질 삼차원 입체구조의 골격이 완성된 폴딩의 마지막 단계에 형성되어 단백질 native state의 안정성에만 기여하는 것이 아니라 중간단계가 형성되는 폴딩 반응의 초기에도 형성되어 폴딩 반응을 이끌어가는데도 기여한다는 것을 의미한다.
본 논문에서는 휴대폰에서 GSM/DCS/Bluetooth 대역에서 사용되는 내장형 안테나에 관한 것으로 폴딩형태의 루프를 기본 구조로 한다. 폴딩형 루프의 중심에 급전과 단락점을 대칭적으로 형성하여 1/4 파장의 정수배가 되는 주파수에서 공진이 가능하도록 하였다. 이 루프구조의 한쪽 종단에서 개방형 스터브를 구현하였는데 이는 루프구조의 공진기에 개방형 스터브에 의하여 공진 주파수를 낮추는 기능을 갖는다. 또한 개방형 스터브는 PIFA 구조의 기능을 하여 GSM 대역에서 새로운 공진을 추가하여 대역폭의 증대를 가져온다.
최근 모바일 기기의 활성화에 따라 M-learning (Mobile learning)이 활성화되고 있다. M-learning을 기반으로 한 코스웨어나 모듈 설계 시 학습자의 적극적 참여와 의미 있는 상호작용의 기회 제공과 실제적 환경에서의 교육활동을 지원하는 것에 초점을 맞추어야 한다. 근접발달영역이론 (Zone of Proximal Development : ZPD)이란 독자적으로 문제를 해결함으로써 결정되는 실제적 발달수준과 성인의 안내나 보다 능력 있는 또래들과 협동하여 문제를 해결함으로써 결정되는 잠재적 발달수준간의 거리이다. 한편, 스캐폴딩은 학습자의 근접발달영역을 변화시키며, 학습자가 스스로 학습할 수 있도록 도와주는 구체적인 방식이라 할 수 있다. 또한 스캐폴딩 (Scaffolding)은 학습자가 구조를 조직하고 새로운 지식을 구성하도록 교수자 또는 촉진자가 도와주면서 교수자와 학습자간에 상호작용하는 과정이다. 본 연구에서는 근접발달영역이론을 이용하여 모바일로 교사가 학습자에게 스캐폴딩을 제공하는 수업모형을 제안한다. 본 모형의 특징은 다음과 같다. 첫째, 문제해결을 위한 스캐폴딩만이 아니라 문제 해결 후 격려 스캐폴딩을 제공하여 학습력 강화가 이뤄지도록 하였다. 둘째, 교사와 학습자 사이에 다양한 스캐폴딩을 제공하여 상호작용을 강화하였다. 셋째, 자신에게 맞는 개별학습, 반복 학습이 가능하고 자기 주도적 학습이 강화되도록 하였다.
본 논문에서는 VLSI의 내장 회로로 사용하기에 적합한 CMOS 8 비트 폴딩-인터폴레이팅 AD 변환기를 설계하였다. 폴딩 AD 변환기의 비선형성을 개선하기 위하여 입력신호의 폴딩-인터폴레이팅에 의한 신호처리가 차례로 2 번 반복되는 2 단 구조를 사용하였다. 이 구조에서는 2 번째 폴딩 회로로서 트랜지스터 차동쌍을 이용한다. 2 단 폴딩 ADC는 디지틸 출력을 얻기 위한 전압비교기와 저항의 개수를 현저히 줄일 수 있으므로 칩 면적, 소비전력, 동작속도 둥에서 많은 장점을 제공한다. 설계공정은 0.25$\mu$m double-poly 2 metal n-well CMOS 공정을 사용하였다. 모의실험결과 2.5V 전원 전압을 인가하고 250MHz의 샘플링 주파수에서 45mW의 전력을 소비하였으며 INL과 DNL은 각 각 $\pm$0.2LSB, SNDR은 10MHz 입력신호에서 45dB로 측정되었다.
Ubiquitin 폴딩 반응의 초기에 나타나는 transient 폴딩 intermediate 상태의 열역학적인 특성을 연구하였다. 온도와 화학변성제의 농도를 바꾸어주면서 측정한 폴딩 kinetics의 결과로부터 unfolded 상태와 intermediate 상태의 평형상수 및 자유에너지를 quantitative kinetic modeling을 통하여서 구하였으며 또한 온도에 따른 자유에너지의 변화로부터 unfolded 상태에서 intermediate 상태로 전환될 때의 열역학적 함수인 ${\Delta}H,\;{\Delta}S,\;{\Delta}C_p$를 구하였다. Ubiquitin이 unfolded 상태에서 intermediate 상태가 될 때의 ${\Delta}C_p$는 unfolded 상태에서 native 상태로 되는 과정의 ${\Delta}C_p$의 약 80% 정도 되었다. 이것은 intermediate가 native 상태에 가까운 매우 조밀한 구조를 이루고 있는 ensemble state임을 나타낸다. 상온에서의 ${\Delta}H$는 양의 값을 보였다. 이는 ubiquitin의 unfolded 상태에서 소수성 잔기 주위에 위치한 물 분자의 규칙적인 구조가 intermediate 상태가 될 때 와해되기 때문이라고 여겨진다. 이러한 양의 enthalpy는 자유로워진 물 분자에 의한 전체 계의 entropy의 증가에 의하여서 보상되어 unfolded 상태에서intermediate 상태로의 전환은 음의 자유에너지를 갖게 되며 폴딩 반응의 초기에 관찰되는 것으로 여겨진다.
본 논문에서는 기존 폴딩 구조의 A/D 변환기(ADC)가 지닌 경계조건 비대칭 오차를 극복하기 위해 홀수개의 폴딩 블록을 사용한 1.2V 8b 800MSPS CMOS ADC를 제안한다. 제안하는 ADC는 저 전력소모를 위해 폴딩 구조에 저항열 인터폴레이션 기법을 적용하고, 높은 folding rate(FR=9)를 극복하기 위해 cascaded 폴딩 구조를 채택하였다. 특히 폴딩 ADC의 주된 문제인 아날로그 신호의 선형성 왜곡과 offset 오차 감소를 위해 홀수개의 폴딩 블록을 사용하는 신호처리 기법을 제안하였다. 또한 스위치를 사용한 ROM 구조의 인코더를 채택하여 $2^n$ 주기를 가지지 않는 디지털 코드를 일반적인 바이너리 코드로 출력하였다. 제안하는 ADC는 $0.13{\mu}m$ 1P6M CMOS 공정을 사용하여 설계되었으며, 유효면적은 870um$\times$980um이다. 입력주파수 10MHz, 800MHz의 변환속도에서 150mW의 낮은 전력소모 특성을 보이며 SNDR은 44.84dB (ENOB 7.15bit), SFDR은 52.17dB의 측정결과를 확인하였다.
본 논문에서는 비터비 검출기의 복잡도와 전력소모를 감소시킬 수 있는 폴딩 비터비 검출기를 제안하였다. 제안된 폴딩 비터비 검출기는 상태 천이도가 대칭적인 것을 이용하여 상태는 서로 반전된 값을 갖는 것끼리 묶어지며, 확률거리의 경우 서로 부호가 반대인 값끼리 묶여진다. 제안된 폴딩 비터비 검출기를 EPRML 읽기 채널에 적용할 경우 확률거리 계산에 필요한 두 개의 가산기를 하나의 가감산기로 대체하여 기존의 GVA 알고리즘에 비해 하드웨어 복잡도를 37.4% 감소시킬 수 있었다. 또한 불필요한 전력소모의 원인이 되는 글리치 발생을 신호 재배치와 병렬 구조와 같은 상위 수준의 저전력 기법을 적용하여 억제한 결과 12.7%의 전력소모 감소를 나타내었다.
본 논문은 하드웨어 곱셈 연산을 최적화 한 리프팅 기반의 9/7 웨이블릿 필터의 VLSI 구조를 제안한다. 제안하는 구조는 범용 곱셈기를 사용하는 기존의 리프팅 기법과 달리 웨이블릿 계수에 패턴 탐색 기법의 Lef$\grave{e}$vre 알고리즘을 적용하였으며, MCM(Multiple constant multiplication)과 폴딩 방식을 9/7 DWT 필터에 적용하여 효율적으로 하드웨어 설계가 이루어 질수 있도록 제안하였다. 이러한 구조는 하드웨어 자원을 100% 활용하는 이점을 지니며, 이전의 성능에 비해 화질 열화 없이 단순한 하드웨어 구조, 속도, 면적, 전력소모 측면에서 효율적이다. 비교 실험을 위해 Verilog HDL을 통해 구현하였으며, $0.18{\mu}m$ CMOS 공정의 스탠다드 셀을 이용하여 합성하였다. 제안한 구조를 기존의 구조와 200MHz의 합성 타겟 클럭 주파수에서 비교하였을 때 면적, 전력소모 측면에서 60.1%, 44.1% 감소하였으며, 이를 통해 이전의 리프팅 기법에 비해 하드웨어 구현에 보다 최적화된 구조임을 보여준다.
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[게시일 2004년 10월 1일]
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