본 논문에서는 셀룰라시스템 환경에서 특히, 채널추정에러가 존재하는 환경에서 D2D 통신을 위한 전력제어 알고리즘 성능을 분석한다. 채널추정에러의 성능분석을 위해 가우시안 채널 추정에러를 모델링하였으며, 이는 SIR 성능이 확률적 분포를 가지도록 한다. 실제 전송환경에서는 송신단과 수신단 사이의 채널환경 변화로 인해 채널 추정 에러는 불가피하다. 이러한 채널추정 에러가 D2D 단말 전력제어 알고리즘에 어떻게 영향을 주는지 실험을 통하여 분석하도록 한다.
본 논문은 이동통신상에서 송신측의 송신 채널 에러정보를 수신측에서 송신측으로 전달하는 음성패킷을 이용하여 송신측에 알려주어 압축과정에 이용하게 할 수 있는 방법을 제안한다. ACELP(Algebraic CELP)구조 방식을 가지고 있는 음성압축기들 중 G.729을 사용하며 음성 패킷정보 중 Pitch Delay와 Fixed Codebook를 이용하여 전송음성 패킷안에 상대방의 송신 채널정보를 싣는다. 수신측에서 받은 패킷이 Erasure로 판단되었을 때 패킷정보들 중 Fixed Codebook Index를 만들게 되는 4개의 Optimal 펄스 중 2개의 펄스만 사용하며 나머지 2개의 펄스는 약속된 임의의 위치에 위치시킨 후 송신측에 전송시킨다. 상대방에서 약속에 맞는 위치의 펄스를 보내왔을 때를 체크함으로써 자신의 송신채널 상태를 알 수 있게 된다 송신채널에$5\%$ Erasure 채널 에러가 발생했을 때 채널정보를 가진 패킷의 음질은 약 0.1dB 정도 떨어지게 된다. 하지만 음성압축 전송 시 송신채널의 정보를 이용하여 무선채널에러에 강하게 할 수 있다.
H.263 부호화 기법에 비해 H.263+에서의 주용 특징중 하나는 에러 강인성으로, 그중에서 계층부호화 모드는 한 개의 송신 영상에 대해서도 복호기와 전송로에 따라 여러 가지 화질의 재생 영상을 얻을 수 있는 기능, 즉 에러 및 패킷 손실 발생 가능 채널에서 비디오 정보 전송시 디코더측에서 사용 가능한 다양한 비트율, 해상도, 디스플레이 율을 허용함으로써 비디오 정보에 대한 전송을 향상시키는 기법이다. FEC(Forward Error Correction)기법에 의한 부가적인 비트 삽입에 제한적인 저 대역폭 네트워크 및 무선 통신망과 같은 네트워크 환경에서는 ATM(Asynchronous Transfer Mode)망에서와 같인 계층부호화된 비트 스트림의 기본 계층에 대해 무손실 전송이 어려우므로, 고급계층과 동등한 채널을 통해 전송시 기본계층 및 고급계층 모두에 대해서는 에러가 발생 할 수 있다. 따라서, 본 연구에서는 저대역폭 비디오 전송을 위해 계층 부호화 모드중 SNR(Signal to Noise Ratio) 계층부호화로 부호화된 비트스트림을 에러 발생가능 채널로 전송시 각 계층에 대한 에러의 영향력을 실험한다.
디지털 음성 통신에서 송신하는 음성 패킷의 전송 에러율을 알면 송신 채널 상황에 적합한 압축 동작을 통하여 전체 통신의 품질을 향상시킬 수 있다. 그러나 현재의 이동통신과 인터넷 통신에서는 음성 패킷의 전송 에러정보를 알려주는 프로토콜이 지원되지 않는다. 본 논문에서는 이를 해결하기 위하여 채널의 전송 에러 정보를 음성 패킷에 삽입하여 실시간으로 전달하는 방법을 제안한다. 제안하는 채널 에러 정보 삽입 방법은 ACELP (algebraic code-excited linear predictin) 코드벡터의 펄스 위치의 상관 관계를 이용하며, 이를 통하여 추가정보 삽입에 의한 음질 저하를 막고 오인식율을 줄일 수 있다. 다양한 음성 데이터를 이용하여 제안한 방법의 성능을 측정하였으며 음질의 저하가 거의 발생하지 않고 정보의 검출 능력과 오인식율에서 만족할 만한 성능을 가지는 것을 확인하였다.
802.11과 같은 무선 네트워크에서는 전송오류에 의한 패킷손실이 많이 발생한다. 802.11 MAC 프로토콜에서는 에러 복구를 위해 ARQ방식을 통한 재전송을 통하여 에러를 정정하나 채널 에러 율이 증가하면 재전송 방식의 효율은 급격히 저하된다. 또한 재전송을하는데 있어서 다시 RTS와 CTS를 전송하여 데이터를 보낼 수 있는 채널을 확보해야 하므로 상당한 전송부하가 발생한다. 이에 재전송 없이 효율적인 에러 복구를 위해서는 FEC방식이 필요하다. 그러나 정적인 FEC방식은 연속적으로 변화하는 무선 채널의 전송 오류율에알맞은 정정 코드를 채택하지 못해 과도한 대역폭 낭비로 인하여 효율이 떨어지는 문제가 있다. 이러한 문제를 개선하기 위해서는 채널의 상태에 따라 정정 코드를 동적으로 변경하는 것이 필요하다. 본 논문은 FEC방식을 802.11 MAC 프로토콜에 적용할 수 있는 방안에 대해서 기술하고 채널 에러 변화에 따라 능동적으로 정정 코드 양을 조절하여 재 전송하는적응적 FEC 알고리즘을 제안한다. 본 논문에서 제안한 적응적 FEC 알고리즘을 802.11 MAC 프로토콜에 적용하여 성능을 측정한 결과 최대 80%정도 성능이 향상된 것을 확인할 수 있었다.
본 논문에서는 채널추정에러가 존재하는 셀룰라시스템 환경에서 D2D 통신을 위한 전력제어 알고리즘 운용방안을 제안한다. 전력제어의 목적은 요구하는 SIR 값을 유지하는 것이다. 하지만, 채널 추정에러 환경에서의 SIR 성능은 확률적 분포를 가지게 된다. 이러한 확률적 SIR 성능 분포를 고려하여, 채널추정에러를 보상하는 가변적인 SIR 적용과 재전송 기법을 복합하여 D2D 통신을 위한 전력제어 기법을 제안하도록 한다.
OFDM 시스템에서 전송채널의 추정은 보통 파일럿 심볼을 사용하여 이루어진다. 그러나 채널 추정 에러로 인하여 비트 오류율이 증가된다. 본 논문에서는 파일럿 심볼을 사용하는 OFDM 시스템에서 신호가 주파수 선택적 Rayleigh 채널을 통하여 전송될 때 데이터의 비트 오류율을 구한다. 채널추정 에러로 인하여 정확한 채별 추정의 이상적인 경우에 비하여 실제 시스템에서 $\overline{\gamma_b}$가 대략 2.5 dB 정도 더 소요된다.
무선 네트워크에서는 전송오류에 의한 패킷손실이 많이 발생한다. 이러한 전송오류를 복구하기 위해 ARQ방식이나 FEC방식이 사용된다. 그러나 채널의 에러율이 증가하면 ARQ와 같은 재전송 방식의 효율은 급격히 저하된다. 이와는 달리 정정코드를 덧붙이는 FEC방식은 ARQ 방식에 비해서 채널의 에러율이 높은 환경에서 효율적인 에러 복구가 가능하다. 그러나 이러한 FEC방식도 항상 일정한 크기를 가지는 정적인 FEC방식일 경우 변화하는 무선 채널의 상태에 알맞은 정정 코드를 채택하지 못해 FEC방식의 단정인 대역폭 낭비를 초래하게 된다. 본 논문에서는 이러한 정적인 FEC방식의 단점을 개선하기 위해, 무선 채널의 전송 오류율에 따라 FEC의 정정도를 동적으로 변화시키는 동적 FEC(dynamic FEC) 알고리즘을 Mote라고 불리는 노드로 구성된 실제 센서 네트워크에 구현했다. 동적 FEC 알고리즘은 무선 채널을 모델링해서 시뮬레이션 결과에서는 성능이 향상되었고, 실제 센서 네트워크에서 실험한 결과 에러율이 낮은 환경에서는 비슷한 성능음 가지게 된다.
본 논문에서는 수직 자기기록 채널에서 연집에러에 따른 LDPC(low density parity check) 부호의 성능을 분석한다. 수직 자기기록 채널에서 연집에러가 발생하면 수신부에서는 채널상태정보(channel state information)를 통하여 연집에러 부분을 알아낸 후 채널검출기의 연판정(Log Likelihood Ratio) 값을 0으로 초기화하는 방법을 사용한다. 패리티 검사 행렬은 부호율이 0.94인 (4336,4096)와 (8672,8192)를 사용한다. 그리고 채널 검출기는 연산량이 적은 SOVA(soft output Viterbi algorithm)를 사용한다.
본 논문에서는 IEEE 802.113 무선 LAN 용 CODEC 회로를 설계하고, VHDL 코딩 과 FPGA에 의한 회로설계 검증에 관해 기술한다. IEEE 802.11a WLAN CODEC의 구조는 크게 데이터 보호를 위한 스크램블러/디스크램블러, 채널 에러에 대한 정보보호를 위한 Convolutional 부호기와 Viterbi 복호기로 구성된 채널 코덱, 그리고 연집에러를 랜덤 에러로 변화시키는 인터리버/디인터 리버로 구성된다. 본 논문에서는, 이와 같은 CODEC의 각 부분을 하드웨어로 구현하기 위한 새로운 회로구성을 제안하고, 그 성능을 VHDL 코딩에 의한 시뮬레이션과 FPGA에 의한 하드웨어 검증 결과를 제시한다.
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[게시일 2004년 10월 1일]
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