OFDMA 방식은 다중 사용자가 서로 다른 부반송파를 통해 동시에 신호를 전송하는 방식으로서, 주파수 효율이 높고, 간단한 단일 탭 등화기로 고속 전송 시 급격히 증가하는 인접 서브캐리어 간 간섭의 보상이 가능하며, FFT를 사용하여 고속으로 구현할 수 있기 때문에 최근 고속 데이터 무선 통신을 위한 전송방식으로 사용되고 있다. 하지만 이러한 OFDMA 시스템의 장점은 부반송파간의 직교성이 유지되는 경우에만 가능하며, 직교성이 깨지는 경우에는 인접 채널 간섭이 발생되어, 시스템 성능을 저하시키게 된다. 따라서 OFDM 시스템에서는 주파수 및 시간 동기의 중요성이 크게 강조된다. 본 논문에서는 효율적인 동기 성능을 위하여 802.16d/e 및 WiBro 시스템에서 사용되는 프리앰블을 분석하여 기존에 사용되던 방식에 비해 정확도가 높은 Timing Metric 을 유도함으로써 보다 확실한 시간 동기 알고리즘을 제안하고, 시간영역에서 소수배 주파수 옵셋 추정만이 가능한 문제점을 해결하기 위해 정수배 주파수 옵셋 추정이 가능한 주파수 동기화 구조를 제안한다. 제안된 시간 및 주파수 동기 알고리즘을 적용한 시스템의 모의실험을 통하여 OFDMA 시스템에서의 인접 채널 간 간섭에 의한 성능 열화가 저하됨을 알 수 있다.
본 논문은 60 GHz 슬라이딩-IF 구조 RF 송수신기를 위한 40 GHz CMOS PLL 주파수 합성기 설계를 다룬다. 광대역에서 안정적인 주입동기식 주파수 합성기 동작을 위하여 인덕티브 피킹 기법을 이용한 주파수 분주기가 설계되었다. 광대역 주파수 분주기는 PLL이 전압 제어 발진기의 전체 주파수 범위에서 안정적으로 동기되는 것을 보장한다. 또한, 전압 제어 발진기와 주입동기식 주파수 분주기 사이의 원치 않는 간섭을 없애기 위하여 주입동기식 버퍼를 설계하여 적용하였다. 설계된 PLL 주파수 합성기는 65 nm CMOS 공정을 이용하여 설계되었으며, 37.9~45.3 GHz 출력 주파수 범위를 갖는다. 1.2 V 전원 전압에서 버퍼 포함 74 mA의 전류를 소모한다.
쇄교자속 기반 센서리스 제어는 저속에서 위치 추정 특성이 우수해 낮은 속도의 운전 영역을 가지는 애플리케이션에 많이 쓰인다. 그러나 계측 정보 오차와 모터 파라미터 변동으로 DC-offset이 발생하는 문제가 있다. 이러한 현상을 방지하기 위해 운전 주파수를 고려한 낮은 차단주파수를 갖는 HPF를 사용했으나, 낮은 DC 저감률로 인해 추정 자속에 DC 성분이 남는 문제점이 있다. 따라서 본 논문에서는 HPF의 차단주파수를 모터 운전주파수에 동기화하여 DC-offset 저감률을 높이고 DC-offset이 시스템에 미치는 정도에 따라 선택적으로 차단주파수를 가변함으로써 위상 앞섬도 감소시키는 방법을 제안한다. 제안된 방법은 Matlab/Simulink에 의해 검증된다.
OFDMA 하향링크 시스템에서 시간, 주파수 동기 오프셋이 존재하는 환경에 강인한 채널추정 기법을 제안한다. 본 논문에서는 시간 동기, 주파수 동기, 및 채널추정을 동시에 수행하는 방법을 제안함으로써, 시간 및 주파수 동기화 과정에서 생기는 에러가 채널 추정 과정에 주는 영향을 최소화하였다. 시뮬레이션 결과 제안된 채널추정 기법은 time windowing과 time advancement를 통해서 inter-carrier interference (ICI)와 inter-symbol interference(ISI)를 제거하고 동기화 과정간의 조화를 이룸으로써 기존의 채널추정 기법들에 비해 약 3dB 성능이 향상되었다.
본 논문에서는, 지상파 3D HDTV 방송 전송을 위한 VSB(Vestigial Side Band) 변조방식의 심벌 타이밍 및 반송파 동기부 구조를 제안하고 그 성능을 검증해 보았다. 제안하는 동기부의 동작은 다음과 같다. 먼저 반송파 주파수 옵셋에 독립적인 심벌 타이밍 복구 알고리즘으로 타이밍 동기를 이룬다. 그리고 제안하는 프레임 검출 방법으로 프레임의 시작점을 알아내고, 반송파 주파수 옵셋 복구에 필요한 훈련 열을 얻어낸다. 마지막으로, 얻어진 훈련 열을 이용하여 반송파 주파수 옵셋과 반송파 위상 옵셋을 복구한다. 컴퓨터 모의실험 결과, 제안하는 동기부 구조는 이상적으로 동기를 이루었을 때의 BER(bit error rate)성능과 근접한 성능을 나타내었다.
본 논문에서는 주파수 도약 방식 시스템에 적합한 비트 동기 방식을 제안한다. 제안한 비트 동기 방식은 에러 심볼 검출기를 고안하여 이를 기존의 디지털 루프 필터와 결합한 ADPLL 방식이다. 제안된 비트 동기방식은 홉류트 잡음과 임펄스 잡음 등과 같은 잡음 구간에서는 비트 추적을 억제함으로써 디지털 루프 필터의 성능을 향상시키고, 주파수 도약 시스템에서의 동기 확률을 개선시켰다. 모의 실험 결과, 제안한 비트 동기 방식이 기존의 방식에 비해서 더욱 개선된 성능을 보여줌을 입증하였다.
본 논문에서는 주파수 도약 방식 시스템에 적합한 비트 동기 방식을 제안한다. 제안한 비트 동기 방식은 적응 윈도우를 이용한 에러 심볼 검출기를 고안하여 이를 기존의 디지털 루프 필터와 결합한 ADPLL 방식이다. 제안된 비트 동기 방식은, 홉뮤트 잡음과 임펄스 잡음 등과 같은 잡음 구간에서, 비트 추적을 억제하여 디지털 루프 필터의 성능을 향상시키고, 주파수 도약 시스템에서의 동기 확률을 개선시켰다. 모의 실험 결과, 제안한 비트 동기 방식이 기존의 방식에 비해서 더욱 개선된 성능을 보여줌을 입증하였다.
본 논문에서는 다중 경로 페이딩 채널을 고려한 환경에서 디지털 M/W전송 시스템의 동기에 관한 모의 시뮬레이터를 구성하여 주파수 동기를 수행하였고, 송신단과 수신단의 주파수 허용 편차(오실레이터 간 오차 범위)로 발생되는 주파수 옵셋에 보상 알고리즘을 적용하여 신호 성좌도(constellation)의 성능 개선 정도를 평가하였다. 성능 분석 결과, 송 수신단의 주파수 허용 편차가 큰 상태에서는 주파수 옵셋을 보상해도 주파수 허용 편차가 이미 크기 때문에 잔류 주파수의 영향을 상대적으로 많이 받게 됨을 알 수 있었다. 결과적으로 송수신단의 주파수 허용 편차에 따라 잔류 주파수 옵셋이 시스템 성능에 큰 영향을 미치게 됨을 알 수 있었다. 본 결과물은 향후 방송중계용 시스템의 대역 이전 시 필요한 주파수 동기 기준으로 활용 가능할 것이다.
본 논문에서는 수중 음향통신에서 Binary Phase Shift Keying(BPSK) 변조방식에 대한 프레임 동기 구조를 제안하였다. 제안된 프레임 동기 구조는 크게 두 가지로 나뉜다. 우선, 비동기 방식 상관과 Sliding 고속 푸리에 변환 방식으로 프레임의 대략적인 위치와 주파수 옵셋을 획득한다. 두번째는 주파수 오차를 신호에 보상한 후, 동기 방식 상관으로 정확한 프레임의 위치를 확인한다. 프레임 동기 구조의 성능 확인을 위해 해상실험을 수행하였다. 수신신호는 채널 특성으로 인해 전력이 크게 감소함을 확인하였으며, 이를 통해 비동기 방식 상관과 Sliding 고속 푸리에 변환 방식의 한계를 확인하였다. 결과적으로, 주파수 오차를 보상한 후 동기 방식 상관방식을 사용함으로써 안정적인 프레임 동기를 획득할 수 있었다.
본 논문에서는 전압 제어 특성을 이용하여 광대역에서 사용 가능한 주입 동기 발진기를 제안하였다. 주입 동기 발진기의 공진 회로에 바렉터 다이오드를 포함시켜 다이오드의 바이어스 전압을 제어하여 자유 발진 주파수를 가변 가능하도록 하였으며, 이를 통해 주입 동기 신호의 입력 레벨이 낮더라도 광대역에서 동작이 가능하도록 하였다. 제안된 주입 동기 발진기는 0.8 mm 두께를 갖는 FR-4 기판을 사용하여 제작되었으며, 0~5 V의 제어 전압을 주어졌을 때, 자유 발진 주파수는 2.39~2.52 GHz로 가변이 가능하였다. 주파수 고정시 -10 dBm의 입력 신호 레벨에서 주파수 동기 범위가 50 MHz 이상이며, 주파수 가변을 통해 -30 dBm의 낮은 주입 신호레벨에서 90 MHz의 주파수 동기 범위를 얻을 수 있었다.
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[게시일 2004년 10월 1일]
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