본 논문에서는 가변 펌핑 클록 주파수를 이용한 모바일 D랩용 고효율 승압 전압 발생기를 제안한다. 제안된 승압 전압 발생기는 효율을 높이기 위해서 3단 Cross-coupled 점하 펌프를 사용하였으며, 또한 최종 출력 전압의 승압 시간을 줄이기 위해 기존의 승압 전압 발생기에서 사용되는 고정된 펌핑 클록 주파수 대신 전압 제어 발생기를 사용하여 펌핑 클록 주파수을 가변하였다. 따라서 제안된 승압 전압 발생기는 1.2 V 전원 전압, 최대 2 mA의 부하 전류, 1 nF의 부하 캐퍼시터 조건에서 24.0-${\mu}s$안에 3.0 V의 최종 출력 전압을 승압할 수 있다. 실험 결과 제안된 승압 전압 발생기는 에너지 소비를 26% (1573 nJ $\rightarrow$ 1162 nJ), 승압 시간을 29% (33.7-${\mu}s$$\rightarrow$ 24.0-${\mu}s$) 감소시켰다. 따라서 제안된 승압 전압 발생기를 사용함으로써, 높은 에너지 효율과 빠른 승압을 동시에 구현할 수 있다.
일반적으로 기준전압 생성기는 쌍안정성을 가지므로 이를 올바른 상태에서 동작시키기 위해서는 적절한 시동회로가 필요하다. 본 논문에서는 저전압 기준전압 발생기를 위한 새로운 시동회로를 제안한다. 제안한 시동회로는 기준전압발생기의 상태를 결정하기 위하여 기준전압 발생기의 BJT에 흐르는 전류를 측정한다. 기준전압발생기가 올바른 상태에 있을 때 이 전류가 가지는 값은 잘 정의되므로 이를 통하여 회로의 상태를 신뢰성 있게 결정할 수 있다. 전류는 내부에 오프셋 전압을 갖는 비교기를 이용하여 측정하였다. 130nm CMOS 공정을 이용하여 설계를 하였으며, 레이아웃에서 추출한 기생 성분을 포함하는 Monte-Carlo 시뮬레이션을 통해 회로의 성능을 검증 하였다. 제안된 시동회로를 사용하는 기준전압발생기에 850mV 이상의 전원 전압이 가해질 경우, 소자에 미스매치가 있더라도 안정적으로 기준전압 생성기가 시동하는 것을 확인하였다.
본 논문에서는 X-band 주파수 대역을 위한 직교 신호 발생 전압제어 발진기(Quadrature VCO)를 제안하였다. 제안된 직교신호 발생 전압제어 발진기는 $0.13{\mu}m$ CMOS 공정을 사용하였다. 본 논문에서 제안된 직교 신호 전압제어 발진기는 두 개의 cross-coupled된 차동의 전압제어 발진기와 두 개의 차동 완충기로 구성 되어있다. 이 직교 전압제어 발진기는 4 bit의 capacitor bank와 varactor의 제어 전압으로 주파수를 가변한다. Varactor의 Q-factor를 선형적으로 변화시키기 위해, varactor 에 각각의 다른 bias voltage를 인가하였다. 이 직교 전압제어 발진기는 6.591 GHz에서 8.012 GHz까지의 주파수 가변 범위를 가진다. 이 직교 전압제어 발생기는 7.150 GHz의 출력 주파수를 가질 때 1MHz offset에서 -101.04 dBc/Hz의 Phase noise를 가진다. 공급 전압은 1.5V를 사용 하였고 QVCO core에서 6.5~8.5 mA의 전류를 소모한다.
본 논문에서는 저항과 BJT를 사용하지 않고 sub-threshold 영역에서 동작하는 저전압, 저전력 기준전압 발생기를 설계하였다. CTAT 전압 발생기는 두 개의 NMOS 트랜지스터를 이용하여 구성하였고, 충분한 영역의 CTAT 전압을 발생시키기 위해 바디 바이어스 회로를 이용하였다. PTAT 전압 발생기는 PTAT 전압을 생성하기 위해 MOS 트랜지스터 입력 쌍의 서로 다른 사이즈 비를 이용하는 차동증폭기 형태로 구성하였다. 제안한 회로는 $0.18-{\mu}m$ 표준 CMOS 공정으로 설계되었다. 시뮬레이션 결과로 290mV의 출력 기준 전압을 가지며, -$20^{\circ}C$ 에서 $120^{\circ}C$의 온도 변화에서 92 ppm/$^{\circ}C$의 전압 변화 지수와 전원전압 0.63V에서 15.7nW의 소모 전력을 갖는 것을 확인하였다.
최근 고 에너지 저장 및 발생장치의 개발은 군사용에서 산업용으로 응용되면서 각종 첨단 설비가 개발되고 있다. 본 논문에서는 전자빔 발생기로 쓰이는 Gyroklystron용 대전력, 고전압, 전류 펄스 전원장치로 입력부, 특고압 발생부, 고압 정류부 및 IGBT 펄스 스위치 구성하고 그 설계 및 개발 자료에 대하여 기술하였다. 대전력 고전압 전류펄스 전원장치를 위한 각 구성 부분의 제어 및 설계 특징은 다음과 같다. 입력부인 IGBT Inverter는 펄스 전원장치의 제어를 위하여 출력 고전압을 Feedbark System에 의해 펄스 설정 전압을 유지하도록 제어하며, 또한 펄스 출력중에 직류 고전압부의 전압강하, 즉 펄스 진압의 Drop이 커지는 것을 방지하기 위하여 Fast Dynamics를 갖도록 Feedback System을 구성하였다. 단상 특고압 승압용 변압기 3대를 직렬접속한 특고압 발생부는 PWM 제어된 전압을 입력받아 특고압으로 승압시키며 고압 펄스성 전압과 매우 높은 dV/dt 전압이 인가되므로 Stray Capacitance가 최소가 되어야 하며 절연파괴로부터 보호될 수 있어야 한다. 고압 정류부는 Inverter와 특고압 변압기에 의하여 전원이 공급되므로 교류전압의 교번 순간에 매우 높은 전압변동률을 가지는 Fast Recovery High Voltage Rectifier로 설계 제작되어졌다. 펄스 스위치인 IGBT 스위치는 Gate Driver에 의해 구동되어 지며 주어진 펄스 사양을 만족시키게 된다. 특히 소자의 전압특성을 고려하여 120KV의 전압 값을 갖도록 설계, 제작하였다.
넓은 가변 범위를 가지는 LC 탱크 전압 제어 발진기에 관해 본 논문에서 소개하고자 한다. LC 탱크 전압 제어 발진기의 발진을 소멸시키는 밀러 증폭기의 ESR을 제거함으로써 넓은 가변 범위를 얻을 수 있다. LC 탱크 전압 제어 발진기는 발진기 코어와 버퍼, 밴드갭(bandgap) 기준 전압 발생기 그리고 드라이브 증폭기로 구성되어 있다. 발진기 코어는 1.3mA의 전류를 소모하고 약 1GHz의 가변 범위를 가진다. 출력주파수의 가변 범위내에 발진기의 출력 전력은 3dBm 이내로 변한다. 이러한 LC 탱크 전압 제어 발진기는 BiCMOS 공정을 이용하여 제작되었고 2.7V 단일 전원에서 31.5mW의 전력을 소모한다.
본 논문은 전기기기에 순간전압저하를 발생 하였을 경우 응동특성에 대한 영향을 계측하였다. 실험 방법은 AVR에서 Sag 발생기인 IPC에 입력한 후, IPC에서 전압의 크기와 시간을 조정하여 실험기기에 순간전압 강하를 발생하였다 실험기기는 PLC, 전자접촉기, 400[W]고압방전램프를 시험하였다. PLC시험에서 무부하와 정격부하에 따라 특성 의 변화가 생겼으며, 정격부하에서 Voltage Sag의 영향을 더 받았다 전자접촉기의 시험은 위상을 $0^{\circ},\;30^{\circ},\;60^{\circ},\;90^{\circ}$로 변화하여 Voltage Sag 발생시켜 계측하였으며, 위상의 변화에 따라 특성곡선이 변화하였다. 고압방전램프시험은 고압나트륨램프와 수은램프, 메탈헬라이드에 Voltage Sag를 발생시켰다. 방전램프의 시험결과 고압나트륨램프의 특성곡선이 가장 안정적으로 나타났다. 본 실험을 통해 순간전압저하에 대한 저압기기의 특성을 실험적으로 입증하여 전력시스템의 설계에 영향을 미칠 것이라 기대된다.
본 논문은 독립 운전 모드에서 전압 고조파 보상을 위한 비례 다중 공진 제어 기반의 전압 제어에 대해 다루고 있다. 독립 운전 모드에서 인버터는 계통과의 연계 없이 전체 지역적 부하의 수요를 담당해야 하기 때문에 전압원으로서 정의된다. 그런데 이때 부하가 불평형 또는 비선형 부하인 경우 역상차, 영상차 또는 특정 고조파 전류가 발생하며 이로 인해 출력 전압이 왜곡된다. 본 논문에서는 앞서 언급한대로 전압 고조파 보상을 위해 흔히 사용되는 비례적분 제어기 대신 고조파 보상 제어의 단순화를 위해 비례 공진 제어기를 사용하였다. 하지만 이와 같은 비례 공진 제어를 실용적인 텀으로서 추가될 경우 전압 매그니튜드 추종 에러가 발생하게 되므로 본 논문에서는 추가적으로 실용적인 비례 공진 제어기가 갖는 단점을 극복하고자 비례 적분 기반의 간단한 전압 회복 기법에 대해 제안하며 제안된 제어 방식은 PSiM 시뮬레이션과 실험을 통해 입증되었다.
반도체 소자가 소형화 되면서 소자의 신뢰성을 유지하고 전력 소모를 줄이기 위해 기가-비트 DRAM의 동작 전압은 1.5V 이하로 줄어들 것으로 기대된다. 따라서 기가-비트 DRAM을 구현하기 위해 저전압 회로 설계 기술이 요구된다. 이 연구에서는 지금까지 발표된 저전압 DRAM 회로 설계 기술에 대한 조사결과를 기술하였고, 기가-비트 DRAM을 위해 4가지 종류의 저전압 회로 설계 기술을 새로이 제안하였다. 이 4가지 저전압 회로 설계 기술은 subthreshold 누설 전류를 줄이는 계층적 negative-voltage word-line 구동기, two-phase VBB(Back-Bias Voltage) 발생기, two-phase VPP(Boosted Voltage) 발생기와 밴드갭 기준전압 발생기에 대한 것인데, 이에 대한 테스트 칩의 측정 결과와 SPICE 시뮬레이션 결과를 제시하였다.
본 논문에서는 초전도 전류제한기의 전압, 전류 등급증대를 위한 방안으로 자기결합을 이용한 초전도 전류 제한기의 특성을 분석하였다. 1차 코일과 초전도 소자가 연결된 2차 코일이 자기적으로 결합된 구조로서 사고가 발생되면 초전도 소자에 흐르는 전류가 임계전류 값을 넘게 될 경우 초전도 소자의 ��치로 인한 저항 발생으로 사고 전에 억제되었던 철심내부 자속이 발생하여 각 코일에 전압이 유기되며 이로 인해 사고 전류가 제한되는 특성을 가지고 있다. 자기결합을 이용한 초전도 전류 제한기의 용량을 증대시키기 위해서는 초전도 전류제한기의 2차권 선수를 작게 하는 것이 각 초전도 소자들의 전압부담을 균일하게 유지하고, 발생저항을 작게 하여 소자의 전력부담을 줄일 수 있다는 것을 확인하였다.
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[게시일 2004년 10월 1일]
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