• Journal of the Korean Institute of Telematics and Electronics C
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• v.36C no.12
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• pp.11-19
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• 1999

Fractal image compression algorithm has been studied mostly not in the view of hardware but software. However, a general processor by software can't decode fractal compressed images in real-time. Therefore, it is necessary that we develop a fast dedicated hardware. However, design examples of dedicated hardware are very rare. In this paper, we designed a quadtree fractal-based compressed image decoder which can decode $256{\times}256$ gray-scale images in real-time and used two power-down methods. The first is a hardware-optimized simple post-processing, whose role is to remove block effect appeared after reconstruction, and which is easier to be implemented in hardware than non-2' exponents weighted average method used in conventional software implementation, lessens costs, and accelerates post-processing speed by about 69%. Therefore, we can expect that the method dissipates low power and low energy. The second is to design a power dissipation in the multiplier can be reduced by about 28% with respect to a general array multiplier which is known efficient for low power design in the size of 8 bits or smaller. Using the above two power-down methods, we designed decoder's core block in 3.3V, 1 poly 3 metal, $0.6{\mu}m$ CMOS technology.

• Journal of the Korea Institute of Information and Communication Engineering
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• v.15 no.1
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• pp.115-125
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• 2011

Cryptographic hash functions are also called one-way functions and they ensure the integrity of communication data and command by detecting or blocking forgery. Also hash functions can be used with other security protocols for signature, authentication, and key distribution. The SHA-1 was widely used until it was found to be cryptographically broken by Wang, et. al, 2005. For this reason, NIST launched the SHA-3 competition in November 2007 to develop new secure hash function by 2012. Many SHA-3 hash functions were proposed and currently in review process. To choose new SHA-3 hash function among the proposed hash functions, there have been many efforts to analyze the cryptographic secureness, hardware/software characteristics on each proposed one. However there are few research efforts on the SHA-3 from the point of power consumption, which is a crucial metric on hardware module. In this paper, we analyze the power consumption characteristics of the SHA-3 hash functions when they are made in the form of ASIC hardware module. Also we propose power efficient hardware architecture on Luffa, which is strong candidate as a new SHA-3 hash function. Our proposed low power architecture for Luffa achieves 10% less power consumption than previous Luffa hardware architecture.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.25 no.5A
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• pp.743-750
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• 2000

In this paper, low-power block filtering architecture for digital If down sampler and up sampler is proposed. Software radio technology requires low power and cost effective digital If down and up sampler. Digital If down sampler and up sampler are accompanied with decimation filter and interpolation filter, respectively. In the proposed down sampler architecture, it is shown that the parallel and low-speed processing architecture can be produced by cancellation of inherent up sampler of block filter and down sampler. Proposed up sampler also utilizes cancellation of up sampler and inherent down sampler of block filtering structure. The proposed architecture is compared with the conventional polyphase architecture.

• Proceedings of the Korean Information Science Society Conference
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• 2001.10c
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• pp.94-96
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• 2001

저전력 시스템에 대한 연구는 회로 수준에서부터 응용 소프트웨어 수준에 이르기까지 다양한 각도에서 이루어지고 있다. 본 연구에서 는 특히 운영 체제 수준, 즉 $\mu$C/OS-II(MicroC/OS-II) 커널 코드의 다양한 함수들에 대한 에너지 소비값을 추출하며 이 결과를 바탕으로 운영체재의 각 모듈별 에너지 소비를 분석한다. 이를 위하여 ARM7TDMI 마이크로 콘트롤러를 이용하여 제작된 시스템에 $\mu$C/OS-IIl 운영체제를 이식하고 SES(SNU Energy Scanner)툴을 이용하여 수행된 운영체제 코드의 각 모듈 즉 태스크 관리, 인터럽트 처리, IPC등에 대한 에너지 소비를 얻고 이 결과를 분석한다.

• Proceedings of the Korea Information Processing Society Conference
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• 2014.04a
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• pp.130-132
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• 2014

저 전력 기술에 기반한 무선 센서 네트워크 (Wireless Sensor networks, WSN) 기술은 유비쿼터스 사회의 중요한 핵심 기술 중 하나이다. 본 논문에서는 이러한 WSN에 기반한 응용으로서 국경 감시 및 제어 시스템을 제안한다. 시스템은 센서노드, 게이트웨이, 서버, 모바일 애플리케이션으로 구성된다. 모바일 애플리케이션은 사용자모드와 관리자모드로 나뉘어, 일반 사람들도 스마트폰을 통해 국경침범을 감시하고 주변 환경에 대한 정보를 얻을 수 있다. 관리자모드에서는 센서노드의 유동적 작동을 위해 원격으로 소프트웨어 업데이트를 할 수 있다. 또한 저 전력 센서노드의 확장성을 위해 멀티 홉 라우팅 프로토콜을 적용하여 구현하였다.

• Proceedings of the KIEE Conference
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• 2002.11d
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• pp.76-79
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• 2002

본 논문에서는 고성능 AC 서보 모터에 대하여 제어 시스템을 구현하고, 제어기를 설계한다. 하드 웨어구성은 모터 전용 저전압 DSP칩인 TMS320LF2407 칩을 이용한다. TMS320LF2407는 최근의 저전력 구동 추세에 따라 3.3V를 구동 전압으로 이용하는 DSP 칩이다 연산 처리 속도는 40MIPS로 빠른 연산 처리능력을 가지고 있지만 주변 소자들과의 인터페이스(보통 5V로 동작)와 노이즈에 대한 대책을 고려하여야 한다. 본 논문에서는 이러한 전압 호환과 노이즈를 가능한 제거한 서보 모터 제어기를 구성하며, 또한 유효 전압 인가시간의 관점에서 바라본 개선된 공간 벡터 PWM방식을 적용함으로써 계산과정과 프로그램을 간단히 하고, 전류제어를 소프트웨어 방식으로 처리하여 복잡한 하드웨어를 간략화 시키고자 한다 이런 과정에 의하여 앞으로 요구될 수 있는 고성능 다기능을 위한 효용성을 높이고자 한다.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2012.10a
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• pp.749-752
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• 2012

Recent social issues is energy issues, green computing has attracted attention. Active research on the power consumption of computer profiling is one of the various approaches for green computing. As a representative tool PowerAPI, PowerTop, JouleMeter, pTop, and EnergyChecker. These studies can be used to measure the power consumption of each computer device because it is based on a pure software. Based on this profiling process at the level of power consumption by performing the power consumption of each program can be analyzed. Therefore to identify the processes that consume a lot of power and control the total power consumption by reducing, also when designing the program, based on data profiling power enables the design of low-power programs, and ultimately can be oriented green computing. In this paper, by comparing and analyzing the associated representative studies, the ideal process level will draw on the characteristics of the power consumption profiler.

• Proceedings of the Korean Information Science Society Conference
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• 2005.11a
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• pp.937-939
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• 2005

본 논문에서는 임베디드 프로세서인 ATmega128과 W3100A 이더넷 칩을 이용하여 범용 웹 모니터링 시스템을 구현하였다. 카메라를 이용한 동영상 오디오, RS-422 통신, 디지털/아날로그 신호의 입출력 등 다양한 제어 모니터링 정보를 통합하여 범용으로 사용할 수 있고, 소형, 저가, 저전력 소모가 가능하도록 설계, 구현하였다. 클라이언트 프로그램은 Java Applet으로 개발 하여 별도의 소프트웨어 설치 없이 웹브라우저를 통하여 접속되고, 원격지의 영상 및 각종 기기들의 상태를 실시간으로 모니터링하여 GUI기반의 각종 메뉴를 사용하여 원격 시스템을 편리하게 제어 할 수 있다.

• Electronics and Telecommunications Trends
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• v.28 no.2
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• pp.1-10
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• 2013

1980년대와 1990년대가 서버와 데스크톱 중심 컴퓨팅의 시대였다고 한다면 2000년대 들어 모바일 분야를 포함하는 임베디드 프로세서 시장이 급격히 확장되며 임베디드 중심 시대로 산업구조가 재편되고 있다. 그리고, 2010년대에는 임베디드 프로세서 시장이 더욱 확대되고 기술도 더불어 발전되고 있는데, 최근 기술을 주도하고 있는 뜨거운 용어 중의 하나가 이기종 멀티코어 컴퓨팅이라 할 수 있다. 시장이 요구하는 고성능 컴퓨팅을 수용하고 임베디드 기기의 특성상 저전력을 실현해야 하는 현실적 문제를 해결하기 위한 이기종 멀티코어 하드웨어가 임베디드 기기에도 적용을 앞다투고 있는 상황이며, 적절한 응용 콘텐츠에 맞춰 이기종 멀티코어 하드웨어를 활용하기 위한 소프트웨어에 대한 관심과 발전도 발 맞춰 진행되고 있다. 이에 본고에서는 임베디드 기기 분야에 한정하여 이기종 멀티코어 하드웨어와 소프트웨어의 기술 동향을 살펴보고자 한다.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.42 no.2 s.332
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• pp.31-40
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• 2005

The Multi-Threshold CMOS (MTCMOS) technology provides a solution to the high performance and low power design requirements of mobile computing applications. In this paper, we (i) motivate the post-mask-tooling performance enhancement technique combined with the MTCMOS leakage current suppression technology, and (ii) develop a practical MTCMOS ASIC design methodology which fine-tunes and integrates best-in-class techniques and commercially available tools to fix the new design issues related to the MTCMOS technology. Towards validating the proposed techniques, a Personal Digital Assistant (PDA) processor has been implemented using the methodology, and a 0.18um Process. The fabricated PDA processor operates at 333MHz which has been improved about $23\%$ at no additional cost of redesign and masks, and consumes about 2uW of standby mode leakage power which could have been three orders of magnitude larger if the MTCMOS technology was not applied.