본 연구에서는 나노구조 이중게이트 FinFET에 대하여 문턱전압이동 특성 및 드레인유기장벽저하(Drain Induced Barrier Lowering; DIBL)특성을 분석하였다. 분석을 위하여 분석학적 전류모델을 개발하였으며 열방사전류 및 터널링전류를 포함하였다. 열방사전류는 포아슨방정식에 의하여 구한 포텐셜분포 및 맥스월-볼쯔만통계를 이용한 캐리어분포를 이용하여 구하였으며 터널링 전류는 WKB(Wentzel-Kramers-Brillouin)근사를 이용하였다. 이 두 모델은 상호 독립적이므로 각각 전류를 구해 더함으로써 문턱 전압을 구하였다. 본 연구에서 제시한 모델을 이용하여 구한 문턱 전압 이동값이 이차원 시뮬레이션값과 비교되었으며 잘 일치함을 알 수 있었다. 분석 결과 10nm 이하에서 특히 터널링의 영향이 증가하여 문턱전압이동 및 DIBL이 매우 현저하게 나타남을 알 수 있었다. 이러한 단채널현상을 감소시키기 위하여 채널두께 및 게이트산화막의 두께를 가능한한 얇게 제작하여야함을 알았으며 이를 위한 산화공정개발이 중요하다고 사료된다.
본 노문에서는 S밴드 (1.5 3.9 GHz)에서 주로 사용되어지는 마이크로스트립 패치 안테나에서 복사특성의 성능저하를 방지함과 동시에 소형화방법이 연구되었다. 연구는 마이크로스트립 단일 패치 안테나에서 패치의 중앙 부분을 제거함으로써 정사각형 링(Square-ring) 형태를 가지는 마이크로스트립 안테나의 형태에 관하여 수치적인 방법으로 수행되었다. 또한 링 구조를 가지는 정사각형 마이크로스트립 안테나를 연구함에 있어서 안테나 임피던스, 공진주파수, 대역폭 등을 제어하기 위한 부수적인 파라미터들이 연구되었다. 단일 정사각형 링 마이크로스트립안테나에 있어서 패치의 중앙부분이 제거됨에 따라 입력 임피던스가 증가되고, 공진주파수와 대역폭이 감소되는 현상이 관찰되었고, 안테나의 Directivity 에는 적게 영향을 미치는 것으로 나타났다. 또한 Moment Method 방식의 Zeland 사이의 IE3D 소프트웨어를 이용하여 안테나와 전송선로간의 임피던스 정합과 대역폭의 증가를 위해 다른 개체의 정사각형의 단일 패치와 링 형태의 패치가 각각 쌓아 올려지는 적층(stacked) 구조 형태로 설계, 최적치를 도출하여 단일 패치의 마이크로스트립 안테나보다 향상된 대역폭과 이득을 얻을 수 있음이 연구되었다. 또한 수치적인 시뮬레이션 결과와 실제의 측정을 수행한 결과를 서로 비교함으로써 잘 일치함을 증명하였다.
최근에 재난현장에는 사물인터넷기반의 다양한 장비나 장치들이 많이 활용되고 있으며, 이중에서도 드론이 심심찮게 활용이 되고 있다. 우리나라의 경우도 산림보호활동이나 화재가 발생하는 지역에 드론을 활용하여 재난대응을 하고 있다. 특히나 작년 네팔에서 지진으로 많은 인명과 재산 손실을 보았는데 이때 지난지역을 수색하는 등, 드론의 역할이 상당히 컸던 것으로 회자되고 있다. 본 논문은 최근에 산악구조 활동으로 생존자의 탐색을 위한 드론의 도입을 준비하며 모니터링 하였던 내용을 정리하고자 한다. 드론에 대한 국내의 현황을 먼저 알아보고, 실제적으로 몇 가지 필요한 요소를 나열한다. 산악구조활동에서 드론에 대한 제약인 최소 3km 이상의 원거리 탐색과 최소 30분 이상의 비행, 영상의 선명도, 열화상 등 재난구조에 필수적인 요소이다. 결과적으로 현재의 재난구조용 드론은 국내의 기술 기반이 취약하여 비행위주이고, 응용분야에 대한 깊이 있는 기술이전이 함께 이루어져야 만 드론에 대한 재난구조의 역할이 아닌가 판단한다.
동시 스위칭 잡음(SSN: Simultaneous Switching Noise)을 줄이기 위한 새로운 기법을 제안한다. 새롭게 제안하는 구조는 이중 층 파워 라인(DLPL: Dual Layer Power Line) 구조를 이용하여 실리콘 상에 상호 인덕터(mutual inductor)를 구현하여 SSN을 줄일 수 있다. 여기서 제안하는 DLPL은 상호 인덕터가 서로 가깝게 위치하여 커플링(coupling)을 높일 수 있으며 순간적인 많은 전류가 서로 반대 방향으로 동시에 흐르게 하여 두 파워 라인 사이에 상호 인덕턴스를 만들어 내며, 이러한 상호 인덕터는 스위칭 잡음을 줄이는 역할을 한다 SPICE 시뮬레이션을 통해 상호 인덕터의 커플링 계수(coupling coefficient)가 0.8 이상일 경우 이전에 보고된 해결 방안들과 비교할 때 63%까지 스위칭 잡음을 더욱 감소 시킬 수 있었다. 또한 이 DLPL 기법은 PCB 회로설계에」=적용시킬 수 있는 이점을 가지고 있다.
본 논문에서는, 오프셋 카세그레인 반사판 안테나가 물리적 크기의 증가없이 Ku와 Ka 이중대역 신호를 다룰 수 있는 구조로 설계된다. 계산시간 및 구현비용을 고려하여, 주반사판 대신에 부반사판에 Ka대역 신호는 반사시키고 Ku대역은 통과시키는 주파수 선택성을 부여한다. 쌍곡선 부반사판 표면의 주파수 선택표면은 8각형 금속 링을 위 아래로 둔 다층매질의 단위 쎌의 주기적 형태로 구성된다. 정밀한 전자기 모의시험을 통해 제안한 구조가 19 GHz와 45 GHz에서 동작함을 확인한다.
Floating guard ring(FGR) 구조를 갖는 avalanche photodiode(APD)는 제작이 매우 간단하고 제작된 소자의 신뢰성이 뛰어나기 때문에 고감도 특성의 고속동작 수광소자로 적합하다. 본 연구논문에서는 FGR APD의 구조설계, 제작공정 및 특성 측정 결과에 대해 논의하였다. FRG-APD는 이중확산 방법으로 제작하였으며 FGR이 가드링으로서 동작함을 2차원 이득특성 측정으로부터 확인할 수 있었다. 제작된 APD는 35GHz의 이득-대역폭 곱을 나타내었으며 2.5Gbps NRZ(Non-return-to-zero) 광신호에 대한 수신감도는 비트오율이 $10^{-9}$일 때 -31.9dBm이었다.
본 논문에서는 의사 인터디지털 계단형 임피던스 공진기(Pseudo-Interdigital Stepped Impedance Resonator: PI-SIR)와 개방 루프 링 공진기(Open-Loop Ring Resonator: OLRR)를 이용한 마이크로스트립 이중 대역 대역 통과 여파기를 제안한다. PI-SIR을 이용하여 이중 대역 여파기의 첫 번째 통과 대역과 두 번째 통과 대역을 설계하고, OLRR을 이용하여 두 번째 통과 대역 특성을 강화한다. PI-SIR 구조에서 특성 임피던스 비와 전기적 길이 비를 이용하면 첫 번째 통과 대역과 두 번째 통과 대역을 쉽고 정확하게 조정할 수 있다. 2.45 GHz와 5.8 GHz에서 동작하는 이중 대역 여파기의 설계 결과와 측정 결과로부터 제안된 여파기가 유용하다는 것을 알 수 있다.
본 연구에서는 이중게이트 MOSFET 제작시 가장 중요한 요소인 채널도핑농도가 문턱전압이하 영역에서 전송 특성에 미치는 영향을 분석하고자 한다. 포아슨방정식을 이용한 분석학적 전송모델을 사용하였다. 문턱전압이하의 전류전도에 영향을 미치는 열방사전류와 터널링전류에 대하여 분석하였으며 본 연구의 모델이 타당하다는 것을 입증하기 위하여 서브문턱스윙 값과 채널도핑 농도의 관계를 Medici 이차원 시뮬레이션값과 비교하였다. 결과적으로 본 연구에서 제시한 전송특성 모델이 이차원 시뮬레이션모델과 매우 잘 일치하였으며 이중게이트MOSFET의 구조적 파라미터에 따라 전송특성을 분석하였다.
본 논문에서는 H-형 커플링 슬롯을 가진 광대역 이중 편파 마이크로스트립 안테나를 제안하였다. 제안된 안테나는 통신사업자들이 경쟁적으로 공공장소에 구축하고 있는 hot-spot zone과 같은 제한된 장소에서 많은 통신 단말기가 동시에 사용되면 상호 간섭이나 다중경로 페이딩에 의한 전송품질의 열화 발생을 방지할 수 있다. 설계된 안테나는 2.7GHz 이하의 주파수 대역에서 33.98%의 임피던스 대역폭($SWR{\leq}2$)과 8.58 dBi (at 2.11 GHz)의 최대 이득을 갖는 것을 측정결과를 통하여 확인하였다. 제안된 안테나는 단순한 구조로 다중 주파수 대역을 수용할 수 있으며 다양한 상업적인 적용이 가능하도록 대량생산의 장점을 갖는다.
RAID는 디스크 배열 상에 데이터를 이중으로 저장하거나 패리티를 사용하는 기법으로 디스크에 장애가 일어났을 경우 이를 복구하는 구조로 되어 있다. 본 논문에서는 지능형 I/O 구조를 갖는 고성능 I/O 서브시스템에서 CPU로부터 대부분 I/O 작업 부하를 줄이고 동시 에 I/O 성능을 향상시키는 방안에 대하여 연구한다. 지능형 I/O 장치의 디스크 스케줄링 디자인에 관한 초당 MB 처리율, 최대 I/O 응답시간 등의 실험 통하여 새로운 스케줄링 기법 에 의해 성능을 개선한다.
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[게시일 2004년 10월 1일]
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