본 논문에서는 위상 변이 LLC 공진 컨버터를 이용하여 주파수의 변동을 제한하며 링크 전압을 기변함으로써 효율을 높이고자 한다. 전부하에 걸쳐 효율이 약 0.26~0.69 만큼 상승하였고 특히나 50% 부하 조건에서는 제안 된 컨버터를 통해 titanium level 을 달성하였다. 또한 높은 링크 전압에 대해서는 위상 변이 방법을 통하여 효과적으로 전압 조정을 할 수 있음을 확인하였다.
위상고정루프에 대해 선형 위상-도메인 모델링을 진행하여 시스템의 안정성을 고려한 각 블록의 설계 매개 변수들을 설정한 이후 빠른 동작 특성을 확인하기 위해 Verilog-HDL 기반의 모델링을 수행할 수 있다. 이때 단순한 동작 특성뿐 아니라 위상잡음 및 비선형 특성까지 모델링에 반영할 수 있는데, 본 논문에서는 디지털-시간 변환기(DTC)의 비선형 특성 및 디지털 조정 발진기(DCO)의 위상잡음 모델링을 추가로 소개한다. 동작 모델을 사용하여 시스템 레벨의 설계를 마치면 시간-도메인 영역에서 과도 응답 시뮬레이션을 진행하여 설계 타당성을 확인할 수 있으며, 출력 신호 결과를 위상잡음 그래프로 나타내어 이를 이상적인 위상잡음 그래프와 비교함으로써 동작과 성능에 대한 검증이 가능함을 나타내었다. 시간-도메인 영역에서 시뮬레이션 소요시간 비교를 위해 TSMC 0.18-㎛ 공정을 사용한 아날로그 위상고정루프의 설계 결과와 비교하였으며, 6 us의 과도 응답 해석을 진행했을 때 1.43초로 트랜지스터 레벨의 아날로그 설계 방식(692초) 대비 484배 빠른 시뮬레이션 시간을 나타내었다.
본 논문에서는 PFC 부스트 컨버터의 역률 및 고조파 왜율 개선을 위한 전류 제어기 이득 조정 기법을 제안한다. PFC단은 입력 전압의 변화에 따라 인덕터 전류의 크기가 달라져 부스트 인덕터의 인덕턴스가 변화하게 되어 전류 루프의 주파수 특성이 변화하게 된다. 이러한 현상으로 인한 전류 루프의 이득 변화를 분석하였다. 이를 기반으로 입력 전압에 따라 전류 제어기의 이득을 조정해 줌으로써, 충분한 위상마진을 확보함과 동시에 PF와 THD 성능을 개선한다. TI사의 TMS320F28027 MCU를 이용한 실험을 통해 제안된 기법의 유용성을 검증한다.
현대 산업현장에서 80%이상 사용되는 PID(proportional integral derivative) 제어기는 제어성, 적응성, 제어이득 조정 등의 특정이 있어나 제어 대상에 대한 PID 제어 계수를 경험적 방법인 수동으로 동조해야하는 문제점이 있다. 이를 개선하기 위해 본 논문에서 PID제어기의 최적 자동동조를 위한 릴레이 동조 방법을 제안한다. 기존의 한계감도법과 과도응답 법으로 초기계수를 결정하는 방법보다 유연성과 적용성이 높고, 이를 마이크로프로세서(DSP : TMS-320C32)에 적용하여 소프트웨어적으로 릴레이의 기능이 이루어지도록 설계했다. 이는 Ziegler-Nichols 계수조정법이 갖는 적용대상의 제약성을 극복한 방법이며, 릴레이에 의해 출력을 강제 진동시키고 출력의 진폭과 주기를 이용하여 PID 계수를 조정하고, 또 상대안정성의 척도인 위상여유를 고려하므로 시스템의 상대안정성과 견실성을 향상시킬 수 있음을 확인하였다.
본 논문에서는 개선된 바랙터 결합 선로를 제안하고, 이 구조를 사용한 주파수 합성기를 설계 제작하였다. 제안된 결합 선로는 기존 구조에 추가적인 $\lambda$/4 전송 선로를 이용하여 바랙터에서 반사되는 잡음신호를 제거하는 구조이다. 제작한 주파수 합성기는 Ku-band 대역에서 헤어핀 공진기를 사용하였으며, PLL을 사용하여 주파수를 고정하였다. 제안된 구조로 제작한 헤어핀 발진기의 경우, 38 MHz의 주파수 조정 범위와 100 kHz offset에서 -97 dBc/Hz의 위상 잡음을 나타내었다. 이러한 측정 결과는 제작한 기존 구조의 바랙터 결합 선로를 가지는 헤어핀 발진기보다 30 MHz 개선된 주파수 조정 범위와 8 dB 개선된 위상 잡음 특성을 가지는 것으로 확인되었다.
Diesel power plants are frequently used as a power supplier on the island and the isolated places where electric power is required. The heat efficiency of the low speed 2 stroke diesel engines is higher than those of 4 stroke diesel engines or other heat engines and further its mobility and durability is also better than other engines. They can be also easily repaired and maintained. With these advantages, demand for the use of the low speed 2 stroke diesel engine as a power source is increasing. However, there are some disadvantages with these diesel engines such as the bigger vibrating excitation forces generated by higher combustion pressure in cylinder and by the inertia force of the reciprocating parts. Further, engine vibrations are transfered into their adjacent buildings and manufacturing factories and eventually produces local vibrations. In order to reduce X-mode vibration of engine body, several methods have been introduced in the recent researches. In this paper, accordingly, a new vibrationcontrol method applying a synchrophaser and a top bracing between two diesel engines is adopted in order to reduce these structural vibrations of diesel power plant. It was experimentally verified that the structural vibrations were greatly reduced by the phase adjustment for the 6th order X-mode vibration with the synchrophaser and the top bracing.
교류전기철도 급전시스템에 병렬급전방식을 적용할 경우, 전동차 부하로 인한 전압강하 및 최대순시부하를 감소시켜 급전구간을 연장하고 급전용량을 향상시킬 수 있다는 장점이 있다. 그러나 변전소 간에 위상차가 있을 경우 순환전력이 발생하기 때문에 적용이 제한되며, 전동차 운행에 따른 부하 분포에 따라 변전소 부하 불균형이 커져서 급전용량이 저하되는 문제점이 있다. 본 논문에서는 변전소 위상차 및 전동차 부하분포에 따라 변동하는 순환전력을 실시간 제어하고 변전소 부하 불균형을 해소하기 위하여 사이리스터 제어 위상조정장치 (TCPAR: Thyristor Controlled Phase Angle Regulator, 이하 TCPAR)를 적용하는 방식을 제안하고, 이를 구현하기 위한 검토를 수행하였다. 전기철도 급전 시스템에 TCPAR을 적용하기 위한 제어 기법으로서, 변전소 공급전력을 입력으로 이용하여 변전소 위상차 및 전동차 부하 분포에 따라 변동하는 순환전력과 변전소 부하 불균형을 효과적으로 억제하는 제어모델을 제시하였다. PSCAD/EMTDC를 이용한 시뮬레이션 결과, 전기철도 병렬급전에 제안한 TCPAR을 적용함으로써 변전소 위상차 및 전동차 부하분포에 따라 변동하는 순환전력 및 변전소 부하 불균형을 효과적으로 억제시킬 수 있다는 것을 확인하였다. 제안 기법을 전기철도 병렬급전에 적용할 경우, 병렬급전 적용 범위를 확대하고 급전용량을 증가시킬 수 있을 것으로 기대된다.
이동통신환경에서 수신신호의 진폭과 위상성분은 다중경로에 의한 페이딩(Fading) 영향을 받는다. 본 논문에서는 송수신 신호의 위상 차를 위상에러로 가정하고 Tikhonov 확률밀도함수를 이용하여 PLL(Phase Locked Loop)이득의 변화에 대한 DS/CDMA(Direct Sequence/code Division Multiple Access) DPSK(Differential Phase Shift Keying)시스템의 성능을 분석하였다. 그 결과, 위상에러를 고려하지 않은 DPSK시스템과 비교하여 수신기의 PLL이득을 조정함으로써 시스템의 성능을 향상시킬 수 있음을 알 수 있었다. 시스템의 비트 포율이 10-2에서 PLL이득이 1㏈에서 4.8㏈, 7㏈에서는 0.4㏈의 성능차를 보이며 30㏈에서는 두 시스템의 성능이 일치하게되어 PLL이 요구하는 이득의 상한이 30㏈임을 입증하였다.
본 논문에서는 SPD(Sampling Phase Detector) 소자를 위상검출기로 사용하여, 기준 신호원 700 MHz SAW(Surface Acoustic Wave) 발진기에 16.8 GHz의 VTDRO(Voltage Tuned Dielectric Resonator Oscillator)를 안정화하는 위상 고정 회로를 설계하였다. 이러한 위상 고정 방법은 루프 필터만으로 직접적으로 위상 고정할 경우 잠금 시간(lock time)의 문제로, 루프 필터뿐만 아니라 구형파의 시변하는 전류원을 사용 위상 고정하게 된다. 이러한 구동 회로와 루프 필터는 서로 상관 관계가 있어, 이의 체계적인 조정을 필요로 한다. 본 논문에서는 이러한 구동 회로와 루프 필터의 체계적인 설계 방법을 제시하였다. 제작된 PLDRO(Phase Leered DRO)는 안정된 16.8 GHz의 중심 주파수에서 약 6.3 dBm의 출력 전력을 갖고, 위상 잡음은 100 kHz offset에서 -101 dBc/Hz 성능을 보인다.
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[게시일 2004년 10월 1일]
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