대형 시스템의 건전성 평가를 위한 동적 재하시험에 있어서 변위를 측정하는 것보다 가속도를 측정하는 것이 수월하나 대부분의 공학적 기준은 응력과 비례관계를 지니는 변화를 기준으로 하고 있다. 본 연구에서는 시스템의 재하시험시 측정된 가속도신호를 이용하여 변위응답을 산정하는데 그 목적을 두고 적분을 위한 신호처리시 발생되는 문제점을 정상상태 및 천이영역에 대하여 규명하였다. 기존의 연구에서 고려하지 못하였던 초기조건의 항을 도입함으로써 시간영역의 적분과 주파수영역의 적분결과가 일치함을 해석적으로 입증하였으며 이동하중을 받는 보의 동적거동에 대하여 제시된 타당성을 검증하였다.
추계론적 해석은 구조계 내의 해석인수에 존재하는 공간적 또는 시간적 임의성이 구조계 반응에 미치는 영향에 대한 고찰을 목적으로 한다. 확률장은 구족계 내에서 특정한 확률분포를 가지는 것으로 가정된다. 구조계 반응에 대한 이들 확률장의 영향 평가를 위하여 통계학적 추계론적 해석과 비통계학적 추계론적 해석이 사용되고 있다. 본 연구에서는 비통계학적 추계론적 해석방법 중의 하나인 가중적분법을 제안하였다. 특히 구조계의 공간적 임의성이 큰 특성을 가지고 있는 반무한영역에 대한 적용 예를 제시하고자 한다. 반무한영역의 모델링에는 무한요소를 사용하였다. 제안된 방법에 의한 해석 결과는 통계학적 방법인 몬테카를로 방법에 의한 결과와 비교되었다. 제안된 가중적분법은 자기상관함수를 사용하여 확률장을 고려하므로 무한영역의 고려에 따른 해석의 모호성을 제거할 수 있다. 제안방법과 몬테카를로 방법에 의한 결과는 상호 잘 일치하였으며 공분산 및 표준편차는 무한요소의 적용에 의하여 매우 개선된 결과를 나타내었다.
새로운 램프-적분을 이용한 용량차-시간차 변환기를 제안했다. 제안된 회로는 상하대칭으로 두개의 전류 미러, 두 개의 슈미트 트리거, 그리고 제어 논리-회로로 구성된다. 전체 회로를 개별 소자들로 꾸며, 실험한 결과, 제안된 변환기의 센서 커패시터가 295㎊에서 375㎊까지의 커패시턴스 변화에서 1%보다 작은 시간간격(펄스 폭)의 선형 오차를 가진다는 것을 알았다. 제안된 변환기가 335㎊의 센서 커패시턴스를 가질 때, 측정된 용량차와 시간차는 각각 40㎊와 0.2ms이었다. 이 시간차를 빠르고 안정된 클럭으로 카운트함으로써 고 분해능을 제공한다는 것을 알았다. 새로운 램프-적분을 이용한 용량차-시간차변환기를 사용하여 디지털 습도 조절기를 설계하고 실험하였다. 제안된 회로는 전원 전압이나 온도 변화에도 불구하고 용량차에는 거의 영향을 받지 않는다. 또한, 제한된 회로는 적은 수의 MOS 소자로 실현되므로, 작은 칩 면적 위에 집적화 할 수 있는 특징을 갖는다. 따라서 이 회로는 온-칩(on-chip) 인터페이스 회로로 적합하다.
저전압 아날로그 전류모드 능동필터의 기본블럭으로 응용될 수 있는 새로운 구조를 갖는 연속시간 전류모드 적분기를 제안한다. 제안된 전류모드 적분기를 Zele등이 설계한 기존 전류모드 적분기와 비교하여, 단위이득 주파수, 부하구동능력 및 소비전력이 개선될 수 있음을 소신호 해석 및 시뮬레이션을 통하여 입증하였다. 제안된 전류 모드 적분기를 이용하여 전류모드 3차 저역 능동필터를 설계하고, 설계된 능동필터를 ORBIT사의 $1.2{\mu}{\textrm{m}}$ double-poly double-metal CMOS n-well 공정을 이용하여 칩으로 제작하였다. 제작된 전류모드 능동필터의 측정결과, 단일 3.3V의 공급전압을 인가시 44.5MHz의 -3dB 차단주파수와 3.3mW의 소비전력 특성을 나타내었으며, 필터의 전체 칩면적은 $0.12mm^2$ 였다.
본 논문에서는 설계 요구가 높고, 전력 소모가 높은 opamp를 이용하는 기존의 능동형 적분기를, 수동형 적분기로 대체하여 고속의 저전력, 고해상도 특성을 갖는 incremental delta-sigma ADC를 소개한다. 능동형 적분기에서 수동형 적분기로의 변환을 위해, 기존의 능동형 적분기의 특성을 분석하였다. 이를 바탕으로 opamp의 설계 요구를 낮추고, 더 나아가 opamp를 사용하지 않는 저전력의 수동형 적분기를 제안하였다. 65nm 공정을 이용하여 수동형 적분기로 구성된 1차 single-bit incremental delta-sigma ADC를 설계하였다. Transistor-level 시뮬레이션 결과, 이는 supply 전압이 1.2V인 상황에서 modulator만 0.6uW, digital filter를 포함한 ADC 전체에서 6.25uW를 소모하며 BW 22KHz, SNDR 71dB, dynamic range 74.6dB을 달성하였다.
본 논문에서는 오버샘플링 A/D변환기의 핵심 회로인 Σ-△변환기를 0.6㎛ CMOS공정을 이용하여 설계하였다. 설계과정은 우선 모델을 개발하여 S-영역에서 적절한 전달함수를 구한 후, 이를 시간 영역의 함수로 변환하여 연산 증폭기의 DC 전압이득, 슬루율과 같은 비 이상적인 요소들을 인가하여 검증하였다. 제안된 시그마-델타 변환기(Sigma-delta modulator, Σ-△변환기)는 음성 신호 대역에 대하여 64배 오버샘플링하며, 다이나믹 영역은 110 dB이상, 최대 S/N비는 102.6 dB로 설계하였다. 기존의 4차 Σ-△ 변환기는 잡음에 대한 전송영점의 위치를 3,4차 적분기단에 인가하는데 반하여 제안된 방식은 잡음에 대한 전송영점을 1,2차 적분기단에 인가함으로써 전체적인 커패시터의 크기가 감소하여 회로의 실질적인 면적이 감소하며, 성능이 개선되고, 소모 전력이 감소하였다. 또한 단위시간에 대한 출력값의 변화량이 3차 적분기의 경우에 비하여 작으므로 동작이 안정적이고, 1차 적분기의 적분 커패시터의 크기가 크므로 구현이 용이하며, 잡음에 대한 억제효과를 이용하여 3차 적분기단의 크기를 감소시켰다. 본 논문에서는 모델 상에서 전체적인 전달함수를 얻고, 신호의 차단주파수를 결정하며, 각 적분기의 출력신호를 최대화하여 적분기 출력신호의 크기를 증가시키고, 최대의 성능을 가지는 잡음에 대한 전송영점을 결정하는 기법을 제안한다. 설계된 회로의 실질적인 면적은 5.25 ㎟이고, 소모전력은 5 V 단일전원에 대하여 10 mW이다.
본 논문에서는 3차원 모델링을 이용하여 원공을 갖는 알루미늄 판의 패치 보강효과에 대해 알아보고자 한다. 구조물의 노후화로 인해 높은 응력을 받는 부재의 응력 특이점에서 내구력이 급격하게 저하되거나 때로는 부재의 정적파괴를 유발시키는 원인을 제공한다. 이로 인해 과거에는 손상된 모재에 보강 재료를 연결시키기 위하여 리벳 또는 볼트와 같은 기계적 연결을 통해 보강하였으나 최근에는 접착패치보강 기법이 그 주류를 이루고 있다. 패치 보강시 일면 패치 보강으로 인하여 면외 휨 효과가 발생된다. 판의 두께 방향에 따른 응력집중계수를 별도로 분석하였다. 기존의 3차원 솔리드 요소는 해의 정확성은 뛰어난 반면에 상당한 컴퓨터 시간을 요구하는 단점을 가지고 있다. 이러한 문제를 극복하기 위해서, 본 논문에서는 각 층의 변위장을 2차원 형상함수와 1차원 형상함수의 조합으로 구성하여, 면내거동에 대한 p-세분화와 면외거동에 대한 p-세분화를 분리시키는 방식을 취한다. 또한, 에너지 함수의 적분시 Gauss-Lobatto 적분법을 사용하여 절점의 위치에서의 응력점을 구하는 경우, 외삽과정을 계산하는 단계를 생략하면서도, 해의 정확성 측면에서는 거의 차이가 없기 때문에 좀 더 효율적인 수치적분이 될 수 있다.
본 논문은 손실 매질 내에 매설된 선 전류 안테나에 의한 크기가 큰 완전도체 표적의 산란파를 해석하기 위한 전장적분식을 도출하였다. Sommerfeld 형태의 적분은 어떤 해석영역에 대하여 계산의 어려움과 제약들을 가지고 있으며, 많은 계산시간이 필요하다. 반면 최대 경사적분은 빠른 결과의 산출을 제공하였으며, 또한 그 계산 결과는 모든 해석 영역에 적용 가능하다. 임의의 완전도체 표적의 산란파는 최대경사적분법과 MOM 방법이 사용되었으며, 계산 결과는 가우시안 구적법과 GPOF 방법에 의해 비교되었다.
평면판 요소에 균일한 혹은 선형적인 세기를 갖는 쏘오스 또는 다이폴이 분포된 경우, Stokes 정리를 이용하여, 표면 특이점 분포방법에서 나타나는 표면 적분식을 선적분 형태로 변환할 수 있다. 더우기 판요소가 다각형인 경우, 유기 포텐시얼과 유기속도를 구하기 위한 이 선적분의 closed-forms을 유도하였다. 이들 적분식의 해석적 계산을 통해 계산시간을 단축하고 수치해의 정도를 향상시킬 수 있을 것이다. 몇개의 계산예를 통해 해석적 적분 계산이 수치적 적분보다 우수함을 알 수 있다.
연속시간 전류모드 기저대역 채널선택 필터 설계를 위하여 전류이득과 단위이득 주파수를 개선시킨 저전압 선형 캐스코드 전류모드 적분기를 제안하였다. 제안된 전류모드 적분기는 CMOS 상보형 회로로 구성된 완전 차동 형태의 입 출력단으로 구성하였으며, 여기에 캐스코드 트랜지스터를 추가시킴으로써 바이어스 단을 구성하여 선형영역에서 동작시켜 저전압 구조에 적합하도록 설계하였다. 이 때 바이어스 전압을 선택적으로 제어하여 주파수 대역이 가변될 수 있도록 설계하였다. 시뮬레이션 결과를 통해 설계한 선형 캐스코드 전류모드 적분기가 저전압 동작, 전류 이득 및 단위이득 주파수 등 모두 만족할 만한 특성을 가지고 있음을 확인하였다.
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[게시일 2004년 10월 1일]
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