• Title/Summary/Keyword: 성능 시뮬레이터

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Design Methodology of System-Level Simulators for Wideband CDMA Cellular Standards (광대역 CDMA 셀룰러 표준을 위한 시스템 수준 시뮬레이터의 설계 방법론)

  • Park, Sungkyung
    • Journal of the Korea Society for Simulation
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    • v.22 no.1
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    • pp.41-51
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    • 2013
  • This tutorial paper presents the design methodology of system-level simulators targeted for code division multiple access (CDMA) cellular standards such as EV-DO (Evolution-Data Only) and broadcast multicast service (BCMCS). The basic structure and simulation flow of system-level simulators are delineated, following the procedure of cell layout, mobile drops, channel modeling, received power calculation, scheduling, packet error prediction, and traffic generation. Packet data transmissions on the forward link of CDMA systems and EV-DO BCMCS systems are considered for modeling simulators. System-level simulators for cellular standards are modeled and developed with high-level languages and utilized to evaluate and predict air interface performance metrics including capacity and coverage.

A Design and Implementation of Flash Memory Simulator (플래시 메모리 시뮬레이터의 설계 및 구현)

  • Jeong, Jae-Yong;Noh, Sam-Hyuk;Min, Sang-Lyull;Cho, Yoo-Kun
    • Journal of KIISE:Computing Practices and Letters
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    • v.8 no.1
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    • pp.36-45
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    • 2002
  • This paper introduces the design and implementation of a flash memory simulator to emulate a real flash memory. Since this simulator provides exact execution time information and parameter testing functions as well as the type, total capacity, block size, and page size of flash memory, it can be used as a real flash memory as viewed by the operating system. Furthermore, the simulator provides time logging functions of the internal routines of the flash memory management software allowing the monitoring of bottlenecks within the software. Finally, we show the performance measurements of applications under the Linux operating systems on both the simulator and a test board verifying the simulator's use as a replacement for real flash memory.

Implementation of RTOS Simulator With Execution Time Estimation (실행시간 추정 가능한 RTOS 시뮬레이터의 구현)

  • 김방현;류성준;김종현;남영광;이광용
    • Proceedings of the Korea Society for Simulation Conference
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    • 2002.05a
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    • pp.125-129
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    • 2002
  • 실시간 운영체제(Real-Time Operating System: 이하 RTOS라 함) 개발환경에서 제공하는 도구 중에 하나인 RTOS 시뮬레이터는 타겟 하드웨어가 호스트에 연결되어 있지 않아도 호스트에서 응용프로그램의 개발과 디버깅을 가능하게 해주는 타겟 시뮬레이션 환경을 제공해 줌으로서, 개발자로 하여금 빠른 시간 내에 응용프로그램을 개발할 수 있도록 지원하며 하드웨어 개발이 완료되기 전에도 응용프로그램을 개발할 수 있게 해 준다. 그러한 이유로 현재 대부분의 상용 RTOS 개발환경에서는 RTOS 시뮬레이터를 제공하고 있다. 그러나 현재 상용 RTOS 시뮬레이터들은 대부분 RTOS의 기능적인 부분들만 호스트에서 동작하도록 구현되어 있어서 RTOS나 RTOS 응용프로그램이 실제 타겟에서 실행될 때의 실질적인 시간 추정이 불가능하다. 이러한 문제점은 실시간 시스템이 정해진 시간 내에 결과를 출력해야 하는 시스템임을 감안한다면 RTOS 시뮬레이터의 가장 큰 결점이 되기 때문에 실행시간 추정 기능을 가지면서 실용화도 가능한 RTOS 시뮬레이터가 필요하다. 본 연구에서는 이러한 문제점을 해결하여 RTOS와 RTOS 응용프로그램이 실제 타겟에서 처리될 때의 실행시간 추정이 가능하고 상용화가 가능한 기계 명령어 기반(machine instruction-based)의 RTOS 시뮬레이터를 연구 개발하였다. 나아가 실행시간의 주요 요소인 파이프라인과 캐쉬의 영향도 고려함으로서 실행시간 추정의 정확도를 향상시켰다 본 연구에서 사용된 RTOS는 한국전자통신연구원(ETRI)에서 2000년에 개발된 Q+이고, Q+가 동작하는 타겟 하드웨어는 ARM 계열의 StrongARM SA-110 마이크로프로세서와 21285 주제어기가 장착된 EBSA-285 보드이다. 측정하면서 수행하였다. 검증 결과 random 상태에서는 문헌자료에 부합되는 예측결과를 보여주었으나, intermediate와 constant 상태에서는 문헌보다 다소 낮은 속도를 보여주었다 이러한 속도차는 추후 현장 데이터를 수집하여 보다 실질적인 검증을 통하여 조정되어야 할 것으로 판단된다.지발광(1.26초)보다 구애발광(1.12초)에서 0.88배 감소하였고, 암컷에서 정지발광(2.99초)보다 구애발광(1.06초)에서 0.35배 감소하였다. 발광양상에서 발광주파수는 수짓의 정지발광에서 0.8 Hz, 수컷 구애발광에서 0.9 Hz, 암컷의 정지발광에서 0.3 Hz, 암컷의 구애발광에서 0.9 Hz로 각각 나타났다. H. papariensis의 발광파장영역은 400 nm에서 700 nm에 이르는 모든 영역에서 확인되었으며 가장 높은 첨두치는 600 nm에 있고 500에서 600 nm 사이의 파장대가 가장 두드러지게 나타났다. 발광양상과 어우러진 교미행동은 Hp system과 같은 결과를 얻었다.하는 방법을 제안한다. 즉 채널 액세스 확률을 각 슬롯에서 예약상태에 있는 음성 단말의 수뿐만 아니라 각 슬롯에서 예약을 하려고 하는 단말의 수에 기초하여 산출하는 방법을 제안하고 이의 성능을 분석하였다. 시뮬레이션에 의해 새로 제안된 채널 허용 확률을 산출하는 방식의 성능을 비교한 결과 기존에 제안된 방법들보다 상당한 성능의 향상을 볼 수 있었다., 인삼이 성장될 때 부분적인 영양상태의 불충분이나 기후 등에 따른 영향을 받을 수 있기 때문에 앞으로 이에 대한 많은 연구가 이루어져야할 것으로 판단된다.태에도 불구하고 [-wh]의미의 겹의문사는 병렬적 관계의 합성어가 아니라 내부구조를 지니지 않은 단순한 단어(minimal $X^{0}$

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Design and Implementation of Simulator for Link-16 Network Operational Performance Analysis (Link-16 네트워크 운용성능분석을 위한 시뮬레이터 설계 및 구현)

  • Lee, Sangtae;Wi, Sounghyouk;Kim, Youngseung;Lee, Jungsik;Jee, Seungbae;Lee, Seungchan
    • Journal of the Korea Society for Simulation
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    • v.28 no.4
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    • pp.33-43
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    • 2019
  • Link-16 is a data link that provides joint interoperability to the US Navy, Air Force and NATO. Currently, the military relies entirely on foreign SW and tools for test environment, tactical simulation training and interoperability verification test for Link-16 operation. Therefore, it is necessary to develop Link-16 based operation environment test tool. In this paper, Link-16 network operational performance analysis simulator was developed by analyzing the function of Link-16 foreign tools. It also implements the SIMPLE standard interface for interworking with foreign SW and tools. The functional model for Link-16 network operation performance analysis consists of pre-analysis, real-time operational analysis, and post-analysis functional model. Each functional model test was performed through SIMPLE interworking with foreign SW and tools. Link-16 network operation performance analysis If we replace foreign SW through simulator, we can perform tactical training, network design verification and operation (scenario) verification for our military.

Simulator Development for LED Display Design (LED전광판 디자인을 위한 시뮬레이터 개발)

  • Chin, Seong-Ah
    • Journal of the Korea Academia-Industrial cooperation Society
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    • v.11 no.12
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    • pp.5023-5028
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    • 2010
  • In this paper, an image based LED design simulator is proposed to reduce LED design cost mostly contingent on a design expert. Current techniques about LED design schemes have mostly treated text-based LED simulators. The proposed method is to provide novel and easy simulator for LED designers. At first, image filters including histogram equalization, bicubic interpolation. and scaling are employed. Color mapping and special effects are added as well. Experimental results classified into several categories along with running times are shown to validate the proposed methods.

System Configuration of Ship-handling Simulator Based on Distributed Data Processing Network -With Particular Reference to Twin-Screw and Twin-Rudder Ship- (분산처리네트워크에 기반한 선박조종 시뮬레이터의 시스템 구축에 관한 연구 -2축2타선박을 대상으로-)

  • Kyoung-Ho Sohn;Yong-Min Kim;Seung-Yeul Yang;Ki-Young Hong
    • Journal of the Korean Institute of Navigation
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    • v.25 no.4
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    • pp.443-453
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    • 2001
  • 선박조종시뮬레이터는 해기사의 교육 훈련, 항만 수로 설계 시 안전성 평가, 선박설계시 조종성능의 검토등으로 널리 활용되고 있다. 본 논문은 최근 한국해양대학교에서 개발한 선박조종시뮬레이터를 소개하고 개발 과정과 활용에 대하여 논의한다. 본 시뮬레이터는 Operation Panel, Instructor's Console, Ship Dynamics Calculation, 3D Bridge View, 2D Bird's Eye View 및 Navigational Indicators의 6구성요소로 이루어져 있으며, 이를 위해 8대의 퍼스널 컴퓨터가 배치되어 있다. 모든 구성요소들은 효율적인 정보 교환을 위하여 분산처리네트워크 방식으로 연결되어 있다. 또한, 본 논문은 항만내에서의 저속 시 조종운동 수학모델과 가상현실 모델링에 대해서도 논의한다. 마지막으로, 부산항에 대한 2축2타선박의 접안 조종 시뮬레이션 예를 보여주고 있다.

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Modeling and Simulation of a Permanent Magnetic Synchronous Generator Wind Power System (영구자석 동기형 풍력발전 시스템의 모델링 및 시뮬레이터 개발)

  • Lee, Sang-Hyeok;Lee, Jun-Ho;Kim, Chun-Sung;Lee, Sang-Hun;Park, Sung-Jun
    • Proceedings of the KIPE Conference
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    • 2010.07a
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    • pp.182-183
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    • 2010
  • 풍력발전 시스템은 무제한적인 공간에 설치가 가능하다는 점과 기후 변화에 대응할 수 있는 원천적인 에너지원으로 각광을 받고 있다. 본 논문에서는 영구자석 동기형 풍력발전 시스템의 구성요소인 풍력발전기, 컨버터, 인버터를 모델링하고, 풍력발전 시스템의 성능 해석을 위한 PSIM 시뮬레이터를 개발하였다. 제안된 시뮬레이터는 PSIM 시뮬레이션을 통해 제안된 풍력발전 시스템 모델링과 시뮬레이터의 타당성을 검증하였다.

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Modeling of CPC/COLSS for YGN#3,4 simulator (영광#3,4호기 시뮬레이터의 노심보호 및 감시계통 모델링)

  • Kim, Dong-Uk
    • Journal of Institute of Control, Robotics and Systems
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    • v.4 no.3
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    • pp.400-405
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    • 1998
  • 본 논문에서는 한국형 원자력 발전소의 기준모델인 영광 3,4호기 운전원 훈련용 시뮬레이터의 모델링 절차와 ABB-CE 원전의 독특한 계통인 CPC/COLSS (Core protection Calculator/Core Operating Limit Supervisory System) 계통에 대한 모델링을 전개허고 있다. CPC/COLSS는 원자로를 포함하는 냉각재계통(NSSS)과 핵연료의 건전성을 보장하기위한 계통으로서 감시및 보호 과정에서의 계산을 디지털화시킴으로서 정확성과 함께 원자로의 안정성을 향상시킨 특색있는 계통이다. 따라서 영광 3,4호기 시뮬레이터에서는 CPC/COLSS 계통에 대한 정확한 모델링을 하여 시험을 통해 성능및 기능에 대한 검증을 마침으로서 CPC/COLSS 시뮬레이션 모델 개발이 성공적으로 되었고 영광 3,4호기 운전 특성에 맞는 시뮬레이터를 개발하였다.

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A Parallelising Algortithm for Matrix Arithmetics of Digital Signal Processings on VLIW Simulator (VLIW 시뮬레이터 상에서의 디지털 신호처리 행렬 연산에 대한 병렬화 알고리즘)

  • Song, Jin-Hee;Jun, Moon-Seog
    • The Transactions of the Korea Information Processing Society
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    • v.5 no.8
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    • pp.1985-1996
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    • 1998
  • A parallelising algorithm for partitioning and mapping methods of matrix/vector multiplication into linear processor array/VLW simulator is presented in this paper. First we discuss the mapping methods for input matrix or vector into the arbitrarily size of processor arrays. Then, we show partitioning the algorithmss of the large size of computational problem into the size of the processor array. We execute the algorithm on VLIW simuhator and show to effectiviness of algorithm. The result which we achived better parallelising performance on our VLIW simulator dsign than on linear processor array.

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Development of HVDC System Simulator Using MATLAB (MATLAB을 이용한 HVDC 시스템 시뮬레이터 개발)

  • Cho, Shin;Park, In-Gyu;Ahn, Tae-Chop
    • Proceedings of the KIEE Conference
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    • 2005.07b
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    • pp.1346-1348
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    • 2005
  • 디지털 프로세서의 성능이 크게 향상됨에 따라 HVDC(High Voltage Direct Current) 시스템의 제어에 고급 지능형 제어 기술의 적용이 연구되고 있다. 이러한 연구의 일환으로, 본 논문에서는 MATLAB을 이용한 HVDC 시스템 시뮬레이터의 개발 결과를 소개한다. 시뮬레이터는 MATLAB의 프로그램 언어와 행렬 연산 기능을 이용하였으며, 회로의 수식화는 전압원 및 스위칭 소자, 변압기를 포함할 수 있는 수정된 마디 해석법(modified nodal analysis)을 사용하였고, 적분법은 Backward Euler 적분법을 사용하여 수치적 진동(numerical oscillation) 문제가 발생하지 않도록 하였다. 개발 결과, 본 시뮬레이터가 향후의 HVDC 시스템 지능형 제어 기술 연구에 유용하게 활용될 것으로 기대한다.

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