• Title/Summary/Keyword: 사용가능시간

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lmplementation of Smart Cart with Automatic Calculation (자동 계산이 가능한 스마트 카트의 구현)

  • Kim, Tae-Sun;Jo, Jun-Hyeok;Kim, Min-Su;Lee, Ju-Seon
    • Proceedings of the Korean Society of Computer Information Conference
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    • 2018.01a
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    • pp.125-126
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    • 2018
  • 최근 대형마트 측에서는 계산대의 지연 시간 문제를 해결하기 위해 셀프 계산대라는 방식을 도입했지만 사용하는데 번거로운 점과 사용과정의 어려움을 느끼는 소비자들이 많아서 이 또한 근본적인 문제를 해결해주지 못하고 있는 실정이다. 본 논문은 이러한 문제점들을 해결하기 위해 자동화 계산이 가능한 스마트 카트를 제작하고자 한다. 스마트 카트를 도입함으로써 마트에서의 번거로운 과정과 대기시간의 지연으로 인해 생기는 소비자들의 불만을 해결해 주고자 한다. 또한 소비자의 빠른 순환으로 인해 마트의 이윤을 얻어 줄 수 있는 자동화 계산이 가능한 스마트 카트를 제작하고자 한다.

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An Extended SQL for Updating XML data (XML 데이터의 갱신을 지원하는 확장된 SQL)

  • 조영주;강지훈
    • Proceedings of the Korean Information Science Society Conference
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    • 2002.10c
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    • pp.82-84
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    • 2002
  • XML은 자기 서술적인 표현 언어라는 중요한 장점을 가지고 있기 때문에 인터넷 관련 응용들에서 정보의 표현 및 문서 교환의 표준으로 빠른 속도로 자리잡아 가고 있다. 본 논문에서는 SQL에 XPath 표현 중 일부를 추가하여 SQL을 확장함으로써 XML 문서에 대한 질의를 가능하게 하였고, 또한 SQL의 CRUD(Create, Read. Update, Delete) 기능을 그대로 사용함으로써 XML 문서의 변경이 가능한 XML 질의를 위한 새롭게 확장된 SQL을 제안하였다. 그리고 폭 넓게 사용되고 있는 ORDBMS 환경에서 XML 색인 정보를 자동 생성 관리하는 XML 저장 관리기 및 확장된 SQL 처리기를 설계하고 구현하였다. 본 논문에서 제안하는 확장된 SQL 처리기는 XML 원문 자체의 보관을 원칙으로 하여 완벽한 문서 복구 등에 따르는 부담을 제거하였고, XML 저장 문서에 대한 원본성 및 무결성을 쉽게 유지할 수 있도록 하였으며, 색인 정보를 자동 생성 관리함으로써 파일 처리 시간과 XML 트리 운행 시간 및 XPath 파싱 처리 시간을 줄였다. 또한, “path”라는 키워드를 추가로 관리함으로써 ORDBMS 환경에서 XML 질의를 위한 SQL 변환 과정에서 PATH의 깊이 만큼 조인이 중첩되는 문제를 배제하여 조인이 발생할 가능성을 줄이는 방법을 제시하였다.

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Analysis of Magnetic Resonance Signals from Diffusion Weighted Imaging using Compressed Sensitivity Encoding Technique (압축감도 부호화를 사용한 확산강조영상에서의 자기공명신호 분석)

  • Jang, ji-sung;Choi, kwan-woo;Jeong, mi-ae
    • Proceedings of the Korea Contents Association Conference
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    • 2019.05a
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    • pp.231-232
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    • 2019
  • 최근 압축감도 부호화라는 새로운 기술의 개발로 인하여 기존보다 더 빠른 검사시간에 자기공명영상 검사가 가능하게 되었다. 감도 부호화를 이용한 터보 스핀 에코 확산강조 자기공명영상과 비교하였을 때, 압축감도 부호화를 사용한 확산강조영상에서 영상평가와 자기공명 신호 분석을 통해 적절한 영상품질을 유지하면서, 검사시간을 줄 일수 있어 확산강조영상에서에 유용하게 사용되리라 사료된다.

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Memory Architecture Design and Experiments for Image Real-Time Transmission in Zigbee Environment (Zigbee환경에서 이미지의 실시간 전송을 위한 메모리 구조 설계 및 그 실험)

  • Lim, Hee-sung;Lee, Jong-sung;Lee, Kang-whan
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2009.10a
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    • pp.589-591
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    • 2009
  • 본 논문에서 제안하고 있는 RT-WISN(Real Time-Wireless Image Sensor Network)는 과거의 무선이미지 전송 기술에 비해 적은 전력을 소모하고 빠른 전송이 가능하게 하는 기술이다. 제안된 RT-WISN은 IEEE802.15.4 표준을 따르고 있으며, 현재 본 연구실에서 개발하고 있는 UoC(Ubiquitous on Chip) 메모리 구조를 응용하여 사용하고 있다. 본 논문에서 제안하고 있는 RT-WISN은 전송하고자 하는 대상이 되는 영상정보의 움직임 변화를 영상 전송 임계값 값을 사용하여 데이터 전송 시기를 결정함으로써 기존의 시스템에 비해 노드의 에너지를 보다 효율적으로 관리할 수 있는 기법 이다. 또한 본 논문에서는 제안된 전용 프로세서를 사용하여 보다 넓은 대역폭에서 필요한 영상 데이터를 효율적으로 전송할 수 있어 전송 시간 제어에 보다 용이함을 제공 한다. 무선센서 네트워크에서 이런 점들은 각 노드들의 생존 시간을 향상하게 되고, 고속의 전송이 가능하게 하는 장점으로 작용하게 된다. 본 논문에서는 Peer-to-Peer 상에서 실제 설계된 메모리 구조를 사용하여 이미지를 무선으로 전송하고 그 전송 시간과 도달률을 측정하여 RT-WISN이 무선 센서 네트워크에서의 검출된 영상 정보의 전송에 적합함을 보인다.

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The Usability of Mobile Baduk-Game on the Cube (휴대폰기반 사용성을 고려한 6 면바둑게임)

  • Sung, Jae-Kyung;Kim, Yong-Guk
    • Proceedings of the Korean Information Science Society Conference
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    • 2006.10b
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    • pp.24-29
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    • 2006
  • 본 연구에서는 기존의 바둑게임을 모바일에 적합한 6면체 표면에서 가능한 게임으로 사용성을 고려하여 구현 하였다. 모바일 버튼의 단순 조작만으로 가능한 게임이다. 바둑이 모바일용으로 대중화 되지 못한 원인인 제한된 스크린에서 가독성의 한계와 게임 소요 시간을 짧게 개선하여 모바일에 적합하도록 하였다. 기존의 평면바둑판을 가로세로 5줄로 주사위형 6면으로 입체화 하였다. 화면 인터페이스는 바둑판의 6면 중 3면이 동시에 보이는 입체도와 6면을 펼친 전개도가 있다. 입체도는 모바일 버튼 조작에 의한 6면을 상하좌우 회전이 가능하도록 하였다. 입체도와 전개도는 동시에 보는 것을 기본으로 하나 사용자 선택에 의해 두 그림의 크기 위치 등이 다양하게 하였다. 바둑돌의 착점방식은 모바일 버튼 조작에 의해 커서의 이동으로 가능하다. 게임은 네트워크를 이용한 사람과 사람이 가능하도록 약식으로 구현하였다. 게임의 내용은 6면의 입체적 상황을 고려하면서 작전을 세워야 하므로 기존의 평면바둑에 비해 좀더 고난도의 사고와 전략을 요구하는 게임이다. 시간성, 이동성, 평면에서 입체공간으로의 발상의 전환 등, 모바일 특성을 고려하여 바둑게임을 구현하고자 한다.

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Tracking Controller Design Using Delayed Output Feedback For Systems With Stiff Nonlinearities (심한 비선형성을 갖는 시스템의 시간지연 출력궤환을 이용한 추종제어기의 설계)

  • 나승유
    • The Journal of Korean Institute of Communications and Information Sciences
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    • v.16 no.4
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    • pp.342-349
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    • 1991
  • In this paper, a method is presented for designing a tracking and disturbance rejecting controller for a nonlinear control system in which approximate linearization is not applicable due to a s stiff nonlinearity. Only the measurable variables are used for the controller synthesis. The system is augmented by a compensator at the output side for the tracking and disturbance rejection. An output delayed feedback controller is designed for the augmented system without nonlinearity. Then the feedback parameters are adjusted by describing function method to overcome the limit cycle due to the nonlinearity.

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Context Aware Role-Based Access Control Model Considering Surrounding Users (주변사용자를 고려한 상황인식 역할기반 접근제어 모델)

  • Jo, Min-Ji;Park, Seog
    • Proceedings of the Korean Information Science Society Conference
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    • 2011.06a
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    • pp.85-88
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    • 2011
  • 모바일 환경으로 업무 환경이 변화함에 따라 발생할 수 있는 요구사항인 탈 사무실화, 기기의 다양성, 실시간성을 만족하면서 보안성을 유지하기 위해 context aware RBAC 모델이 적용되고 있다. 하지만 기존의 상황인식 역할기반 접근제어 모델은 주변 사용자에 대한 고려가 없고 사용자의 단독적인 정보 유출이 가능하다는 단점을 가지고 있다. 이를 해결하기 위해 본 연구에서 제안하고 있는 사용자간의 관계를 고려한 상황인식 역할기반 접근제어 모델에서는 기존의 기법에서 고려하지 않은 주변 사용자의 역할 및 관련된 사용자와의 관계를 고려하여 위치와 시간만으로 제어되지 않는 정보에 대한 유출을 방지한다. 이 모델을 적용할 경우 주변사용자의 권한에 의해 사용자의 권한이 통제되므로 문서에 대한 내부자의 편법적인 사용을 방지하는 것이 가능하고 실시간으로 문서에 대한 권한을 부여할 수 있다. 또한 문서에 대한 권한을 모두 부여할 경우와 동일한 업무 효율성을 가지면서 필요하지 않은 시간에 발생할 수 있는 보안 위협을 방지할 수 있다.

Camera Tracking using Triangulation for Semi-Immersive Virtual Environment (반몰입 가상환경을 위한 삼각측랑법 기반 카메라 트래킹)

  • 김효선;김명희
    • Proceedings of the Korean Information Science Society Conference
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    • 2002.04b
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    • pp.586-588
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    • 2002
  • 본 논문에서는 반몰입 가상현실 장비인 프로젝션 월(projection wall)가 가상 워크벤치(virtual workbench) 시스템에 적응 가능한 카메라 트래킹 방법 을 제안한다. 제안하는 방법은 측량학에서 거리를 측정하기 위해 사용되어지는 삼각측량법(triangulation)이다. 이 방법은 스테레오 영상을 얻기 위해 사용되는 두 대의 카메라의 기종이 상이할 경우에도 적용이 가능하다는 장점이 있다. 또한, 넓은 트래킹 영역을 확보할 수 있기 때문에 프로젝션 월과 같은 수직형 스크린에 용할 경우 더욱 적합하다. 그리고, 본 논문에서는 신시간 드래킹 글 수행하기 위하여 변화 벡터(shift vector) 기반 위치 추정 방법을 도입하여 검색 시간을 단축시켰으며, 사용자 헤드 드래킹를 수행하기 위해 적외선 비컨을 서텨 글래스(shutter glass)에 부착하여 사용하였다.

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Design of a Low Power Reconfigurable DSP with Fine-Grained Clock Gating (정교한 클럭 게이팅을 이용한 저전력 재구성 가능한 DSP 설계)

  • Jung, Chan-Min;Lee, Young-Geun;Chung, Ki-Seok
    • Journal of the Institute of Electronics Engineers of Korea SD
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    • v.45 no.2
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    • pp.82-92
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    • 2008
  • Recently, many digital signal processing(DSP) applications such as H.264, CDMA and MP3 are predominant tasks for modern high-performance portable devices. These applications are generally computation-intensive, and therefore, require quite complicated accelerator units to improve performance. Designing such specialized, yet fixed DSP accelerators takes lots of effort. Therefore, DSPs with multiple accelerators often have a very poor time-to-market and an unacceptable area overhead. To avoid such long time-to-market and high-area overhead, dynamically reconfigurable DSP architectures have attracted a lot of attention lately. Dynamically reconfigurable DSPs typically employ a multi-functional DSP accelerator which executes similar, yet different multiple kinds of computations for DSP applications. With this type of dynamically reconfigurable DSP accelerators, the time to market reduces significantly. However, integrating multiple functionalities into a single IP often results in excessive control and area overhead. Therefore, delay and power consumption often turn out to be quite excessive. In this thesis, to reduce power consumption of dynamically reconfigurable IPs, we propose a novel fine-grained clock gating scheme, and to reduce size of dynamically reconfigurable IPs, we propose a compact multiplier-less multiplication unit where shifters and adders carry out constant multiplications.

A Design and Implementation of a Timing Analysis Simulator for a Design Space Exploration on a Hybrid Embedded System (Hybrid 내장형 시스템의 설계공간탐색을 위한 시간분석 시뮬레이터의 설계 및 구현)

  • Ahn, Seong-Yong;Shim, Jea-Hong;Lee, Jeong-A
    • The KIPS Transactions:PartA
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    • v.9A no.4
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    • pp.459-466
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    • 2002
  • Modern embedded system employs a hybrid architecture which contains a general micro processor and reconfigurable devices such as FPGAS to retain flexibility and to meet timing constraints. It is a hard and important problem for embedded system designers to explore and find a right system configuration, which is known as design space exploration (DSE). With DES, it is possible to predict a final system configuration during the design phase before physical implementation. In this paper, we implement a timing analysis simulator for a DSE on a hybrid embedded system. The simulator, integrating exiting timing analysis tools for hardware and software, is designed by extending Y-chart approach, which allows quantitative performance analysis by varying design parameters. This timing analysis simulator is expected to reduce design time and costs and be used as a core module of a DSE for a hybrid embedded system.