• Title/Summary/Keyword: 비 지연

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Propagation Characteristics of Fan Beam in Subway Tunnel Environment for 2.4 GHz Band Wireless LAN (2.4 GHz 대역 무선 랜을 위한 지하철 터널 환경에서 Fan Beam 의 전파특성)

  • 박노준;고거다;송문규;강영진
    • Proceedings of the IEEK Conference
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    • 2003.07a
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    • pp.298-301
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    • 2003
  • 본 논문에서는 2.4 [GHz] 대역에서 1(equation omitted)2 마이크로스트림 배열 안테나를 이용한 지하철 터널내의 전파특성을 고찰하였다. 445 [m]의 터널구간에서 협대역 측정결과 LOS (Line-of-Sight)구간에 비하여 NLOS(Non-Line-of-Sight)구간에서는 수신 전력 레벨이 급격히 감소 하였으며, 10단 길이의 PN Sequence를 이용한 광대역 채널 측정에서는 Fan Beam의 평균과도지연과 RMS 지연확산이 각각 3.5736 [ns]과 11.7327 [ns]로서 원편파와 지향성 빔에 비하여 우수함을 확인하였다. 또한 전체 측정구간에 대한 평균과도지연과 RMS 지연확산의 중간값과 표준편차를 구하였고 각각의 빔에 대하여 비교하였다.

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Delay Improvement Greedy Forwarding in Low-Duty-Cycle Wireless Sensor Networks (로우듀티사이클 환경을 고려한 무선센서네트워크에서 데이터 전송지연을 향상한 그리디 포워딩)

  • Choe, Junseong;Le, Huu Nghia;Shon, Minhan;Choo, Hyunseung
    • Proceedings of the Korea Information Processing Society Conference
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    • 2012.04a
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    • pp.609-611
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    • 2012
  • 논문에서는 로우듀티사이클 환경을 고려하여 목적지까지 데이터 전송의 신뢰성뿐만 아니라 낮은 데이터 지연도 보장하는 DIGF (Delay Improvement Greedy Forwarding) 기법을 제안한다. 초기에 제안된 그리디 포워텅 기법들은 무선링크가 갖는 비신뢰성 및 비대칭성의 문제점을 해결하기 위해 데이터 전송 성공률과 에너지 효율을 높이는 기법이 제안되었다. 하지만 많은 그리디 포워텅 기법들은 노드들이 데이터를 송수신하기 위해 대기하고 있는 수신대기상태로 인한 많은 에너지 소모를 고려하지 않아 네트워크 라이프타임을 감소시킨다. 이러한 문제점을 해결하고자 제안기법인 DIGF는 무선링크의 비신뢰성과 비대칭성을 고려할 뿐만 아니라 로우듀티사이클 환경을 고려한다. 또한 로우듀티사이클 환경을 고려할 때 발생되는 높은 수면지연성 (Sleep latency) 을 해결하기 위한 알고리즘을 제안하여 낮은 전송지연과 신뢰성 있는 데이터 전송을 보장한다.

급수제한에 의한 성성숙 지연방법

  • Kirkland W M;Fullre H L
    • KOREAN POULTRY JOURNAL
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    • v.4 no.6 s.32
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    • pp.88-89
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    • 1972
  • 무제한 급수하면 저에너지 사료를 섭취하는 닭은 모자란 에너지의 보충을 위해 사료를 더 많이 섭취하여 에너지의 제한 효과가거의 없었고 제한급수하면 사료를 충분히 섭취할 수 없기 때문에 대조구의 약 70$\%$밖에 섭취못했다. 따라서 이것이 성성숙을 4$\~$4 1/2주 지연시킨 요인이었으며 체지방 축적도 감소시켰다. 성성숙 지연결과 성숙이 지연된 닭은 총 산란수가 훨씬 많고 비정상란의 수가 훨씬 적으며 대란율도 훨씬 높다. 육성중 폐사율은 더운 여름철에도 급수의 제한과 상관없었으며 산란중 폐사율은 오히려 성성숙시의 체중 혹은 체지방 축적과 정비례 했다. 이상으로 저에너지 사료를 급여하면서 급수제한(격일제 급수)하는 방법이 대추의 에너지 섭취를 제한시키는 간단하고 효과적인 방법임이 입증되었다.

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Delay optimization algorithm for the high speed operation of FPGAs (FPGA를 고속으로 동작시키기 위한 지연시간 최적화 알고리듬)

  • 김남우;허창우;최익성;이범철
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 1999.11a
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    • pp.525-529
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    • 1999
  • 본 논문에서는 고속 FPGA 설계를 위한 논리 수준의 조합회로 합성 알고리듬을 제안한다. 제안 된 알고리듬은 회로의 지연시간을 줄이기 위해 critical path를 분할한 후 분할된 회로를 동시에 수행하는 구조의 회로를 생성한다. MCNC 표준 테스트 회로에 대한 실험에서 제안된 지연시간 최적화 알고리듬이 기존 알고리듬에 비해 지연시간이 평균 33.3 % 감소된 회로를 생성함을 보였다.

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Fuzzy Robust$H^{\infty}$ Controller Design of Nonlinear Uncertain Time Delay Systems (비선형 불확실성 시간지연 시스템의 퍼지 견실 $H^{\infty}$제어기 설계)

  • 김종해;이형호;박홍배
    • Journal of the Korean Institute of Telematics and Electronics S
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    • v.36S no.5
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    • pp.30-41
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    • 1999
  • 본 논문에서는 연속시간과 이산시간에서 파라미터 불확실성과 시간지연을 가지는 비선형시스템에 대한 퍼지 견실 H∞ 제어기 설계방법을 제시한다. 비선형시스템은 변형한 T-S(Takagi- Sugeno) 퍼지모델을 사용하여 나타내고, 퍼지제어는 PDC(parallel distributed compensation) 개념을 이용한다. 또한 Lyapunov 접근방법을 이용하여 불확실성, 외란과 시간지연을 가지는 변형한 T-S 퍼지모델의 H∞ 노옴 한계를 가지는 자승적 안정성을 언급하고, LMI(linear matrix inequality) 기법을 이용하여 퍼지 견실 H∞ 제어기의 존재 조건과 제어기 설계방법을 제시한다. 그러므로 제시한 기법은 구하여진 충분조건을 만족하는 해를 찾음과 동시에 제어기를 한번에 설계할 수 있다. 마지막으로 예제를 통하여 제시한 방법의 타당성을 확인한다.

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Enhanced Contiguous Link Scheduling for Wireless Sensor Networks (무선 센서 네트워크에서의 향상된 인접한 링크 스케줄링)

  • Kong, Taeho;Yeom, Sanggil;Shon, Min han;Choo, Hyunseung
    • Proceedings of the Korea Information Processing Society Conference
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    • 2015.04a
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    • pp.214-215
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    • 2015
  • 최근의 무선 센서 네트워크 분야에서는 노드의 배터리 수명을 늘리기 위하여 에너지 소모를 줄이는 연구가 진행되고 있다. 이러한 연구 중 같은 노드에서 수신 받는 링크는 전부 인접한 타임 슬롯에 스케줄링 하여 노드의 상태 변화를 최소화 할 수 있는 스케줄링 알고리즘이 존재한다. 이 알고리즘은 기존 스케줄링 알고리즘에 비해 에너지 소모율이 좋다는 장점이 있지만, 패킷 처리량이나 시간 지연 등 다른 부분에서는 기존 알고리즘에 비해 떨어진다는 단점을 가지고 있다. 본 논문에서는 높은 에너지 효율을 보이는 인접한 타임 슬롯 스케줄링 알고리즘을 기반으로, 링크 수를 일정하게 분할 처리하여 처리량 및 시간 지연 문제를 해결할 수 있는 알고리즘을 제안한다. 제안 기법에 의해 구축된 네트워크는 기존의 스케줄링 알고리즘에 비해 전력 효율, 처리량, 시간 지연의 효율성이 향상될 것이다.

Link-wirelength-aware Topology Generation for High Performance Asynchronous NoC Design (링크 도선 길이를 고려한 고성능 비동기식 NoC 토폴로지 생성 기법)

  • Kim, Sang Heon;Lee, Jae Sung;Lee, Jae Hoon;Han, Tae Hee
    • Journal of the Institute of Electronics and Information Engineers
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    • v.53 no.8
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    • pp.49-58
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    • 2016
  • In designing heterogeneous architecture based application-specific network-on-chips (NoCs), the opportunities of performance improvement would be expanded when applying asynchronous on-chip communication protocol. This is because the wire latency can be configured independently considering the wirelength of each link. In this paper, we develop the delay model of link-wire-length in asynchronous NoC and propose simulated annealing (SA) based floorplan-aware topology generation algorithm to optimize link-wirelengths. Incorporating the generated topology and the associated latency values across all links, we evaluate the performance using the floorplan-annotated sdf (standard delay format) file and RTL-synthesized gate-level netlist. Compared to TopGen, one of general topology generation algorithms, the experimental results show the reduction in latency by 13.7% and in execution time by 11.8% in average with regards to four applications.

A Zero-latency Cycle Detection Scheme for Enhanced Parallelism in Multiprocessing Systems (다중처리 시스템의 병렬성 증대를 위한 사이클의 비 지연 발견 기법)

  • Kim Ju Gyun
    • Journal of KIISE:Computer Systems and Theory
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    • v.32 no.2
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    • pp.49-54
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    • 2005
  • This Paper Presents a non-blocking deadlock detection scheme with immediate cycle detection in multiprocessing systems. We assume an expedient state and a special case where each type of resource has one unit and each request is limited to one resource unit at a time. Unlike the previous deadlock detection schemes, this new method takes O(1) time for detecting a cycle and O(n+m) time for blocking or handling resource release where n and m are the number of processes and that of resources in the system. The deadlock detection latency is thus minimized and is constant regardless of n and m. However, in a multiprocessing system, the operating system can handle the blocking or release on-the-fly running on a separate processor, thus not interfering with user process execution. To some applications where deadlock is concerned, a predictable and zero-latency deadlock detection scheme could be very useful.

A Design of Capacitive Sensing Touch Sensor Using RC Delay with Calibration (캘리브래이션 기능이 있는 RC지연 정전용량 방식 터치센서 설계)

  • Seong, Kwang-Su;Lee, Mu-Jin
    • Journal of the Korean Institute of Illuminating and Electrical Installation Engineers
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    • v.23 no.8
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    • pp.80-85
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    • 2009
  • In this paper, we propose a full digital capacitive sensing touch key reducing the effects due to the variations of resistance and clock frequency. The proposed circuit consists of two capacitive loads to measure and a resistor between the capacitive loads. The method measures the delays of the resistor and two capacitive loads, respectively. The ratio of the two delays is represented as the ratio of the two capacitive loads and is irrelative to the resistance and the clock frequency if quantization error is disregarded. Experimental results show the proposed scheme efficiently reduces the effects due to the variations of clock frequency and resistance. Further more the method has 1.04[pF] resolution and can be used as a touch key.

L-gained State Feedback Control for Continuous Fuzzy Systems with Time-Delay (시간 지연 연속 시간 퍼지 시스템에 대한 L-이득값 상태 궤환 제어)

  • Lee, Dong-Hwan;Joo, Young-Hoon;Park, Jin-Bae
    • Journal of the Korean Institute of Intelligent Systems
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    • v.18 no.6
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    • pp.762-767
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    • 2008
  • This paper introduces a $L_{\infty}$-gain state feedback fuzzy controller design for the time delay nonlinear system represented by Takagi-Sugeno(T-S) fuzzy model. First, the T-S fuzzy model is employed to represent the time delay nonlinear system. Next based on the fuzzy model, a fuzzy state feedback controller is developed to achieve $L_{\infty}$-gain performance. Finally, sufficient conditions are derived for $L_{\infty}$-gain performance. The sufficient conditions are formulated in the format of linear matrix inequalities (LMIs). The effectiveness of the proposed controller design methonology is finally demonstrated through numerical simulations.