• 제목/요약/키워드: 비디오 모듈

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TCP/IP 소켓을 이용한 실시간 감시 시스템 설계 및 구현 (Design and Implementation of Real-Time Surveillance System using TCP/IP Socket)

  • 이종서;김유두;문일영
    • 한국항행학회논문지
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    • 제12권1호
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    • pp.68-73
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    • 2008
  • 근래에 원격지 감시와 제어하는 기술이 발달하고 있다. 또한 홈 네트워크 서비스의 보편화와 초고속 통시망의 폭넓은 확대로 인하여 디지털 비디오 기술을 이용한 감시체계가 점차 늘어나고 있다. 웹에서 제공하던 감시 체계를 사용자가 좀 더 편리하게 사용할 수 있도록 기존의 웹을 기반으로 하던 디지털 감시 체계에 개인 단말기를 이용하여 사용자가 이동 중에도 인터넷이 되는 곳에서 이 모듈을 제어할 수 있도록 구현하였다.

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P2P 구조에 기반한 인터넷 방송 시스템 설계 및 구현 (Design and Implementation of Internet Broadcasting System Based on P2P Architecture)

  • 우문섭;정원태;김남윤;황기태
    • 한국정보처리학회:학술대회논문집
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    • 한국정보처리학회 2007년도 춘계학술발표대회
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    • pp.107-110
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    • 2007
  • 클라이언트-서버 구조의 스트리밍 시스템은 서버의 가용 능력에 따라 클라이언트의 개수가 제한되는 단점을 가진다. 본 논문에서는 인터넷 방송 시스템의 확장성과 안정성을 지원하기 위해 P2P에 기반한 모델을 제시한 후, 프로토타입 시스템을 설계 및 구현하였다. 본 논문에서 구현한 시스템 OmniCast264는 H.264 비디오 스트림을 제공하는 인코딩서버와 스트리밍서버, 피어노드, 프록시 서버로 구성된다. OmniCast264는 스트리밍 부하의 분산화, 실시간성, 에러 발생에 따른 강건함, 계층의 모듈화등의 개념을 가지고 있기 때문에 대용량의 인터넷 방송에 적합하다고 할 수 있다. 마지막으로 PC들을 병렬 및 직렬 구조의 유형으로 나누어 P2P를 구성한 후, OmniCast264의 성능을 평가하여 실시간 재생이 가능함을 검증하였다.

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계층적 블록매칭 알고리즘을 위한 파이프라인식 VLSI 아키텍쳐 (Pipelined VLSI Architectures for the Hierarchical Block-Matching Algorithm)

  • 김형철;맹승렬
    • 한국정보처리학회논문지
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    • 제5권7호
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    • pp.1691-1716
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    • 1998
  • 본 논문에서는 계층적 블록매칭 알고리즘(HBMA)을 위한 두 가지 병렬 VLSI 아키텍쳐를 제안한다. HBMA는 계층에 따른 반복수행과 공간 인터폴레이션을 기반으로 수행되며, 이러한 수행 특성은 병렬처리의 장애요소인 데이터 종속성을 내재하고 있다. 제안된 아키텍쳐는 HBMA의 계층간 데이터 종속성을 해결하기 위하여 기본적으로 파이프라인 구조를 채택하고 있으며, HBMA에서 주어진 매개변수에 따라 세 단계의 스테이지로 구성된다. 제안된 아키텍쳐는 입력 프레임 데이터의 흐름을 제어하는 방식에 따라 두 가지 종류로 구분된다. U-Architecture는 단방향 스캔 순서를 따르도록 설계되었으며, B-Architecture는 양방향 스캔 수서를 따르도록 설계되었다. 각 아키텍쳐의 내부 메모리와 인터폴레이션 모듈은 해당 스캔 순서에 따라 동기적으로 동작할 수 있는 구조를 가진다. 성능분석의 결과로서 본 논문에서 제안한 두 가지 아키텍쳐가 모두 방송용 비디오 포맷을 실시간으로 처리할 수 있음을 보이고, HDTV 포맷은 가까운 장래의 VLSI 기술로 실시간 성능을 얻을 수 있음을 보였다. 또한, B-Architecture는 공간 연결성 내부 메모리 구조를 채택함으로써 입력 데이터의 재활용도를 높이고, 이에 따라 Q-Architecture에 비해서 데이터 입출력 핀의 개수를 약 반정도 줄일 수 있는 특성을 보이고 있다.

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비디오 인코더용 양자화 및 역양자화기(Q_IQ unit) 모듈의 설계 (The design of quantization and inverse quantization unit (Q_IQ unit) module with video encoder)

  • 김은원;조원경
    • 전자공학회논문지C
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    • 제34C권11호
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    • pp.20-28
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    • 1997
  • In this paper, quantization and inverse quantizatio unit, a sa component of MPEG-2 moving picture compression system, ar edesigned. In the processing of quantization, this design adopted newly designed arithmetic units in which quantization matrices and scale code was expressed with SD(signed-digit) code. In the arithmetic unit of inverse quantization, quantization scale code, which has 5-bits length, is splited into two pieces; 2-bits for control code, 3-bits for quantization data, and the method to devise quantization step size is proposed. The design was coded with VHDL and synthesis results in that it consumed about 6,110 gates, and operating speed is 52MHz.

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HEVC 무손실 화면내 부호화를 위한 효율적인 차분 화소값 주사 방법 (Efficient Differential Pixel Value Scanning Method for HEVC Lossless Intra Coding)

  • 최정아;호요성
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송공학회 2012년도 하계학술대회
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    • pp.234-235
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    • 2012
  • 본 논문에서는 최근 표준화 활동이 진행 중인 HEVC(high efficiency video coding) 표준의 무손실 부호화 모드를 위한 효율적인 계수 주사 방법을 제안한다. 일반적으로 무손실 비디오 부호기에서는 부호화 손실을 없애기 위해 변환 및 양자화 모듈이 제거된다. 이 경우 부호화해야 할 잔여데이터는 양자화된 변환 계수가 아닌 예측 후의 차분 화소이므로 잔여데이터의 확률 분포가 변화된다. 제안한 방법에서는 무손실 부호화에서 화면내 예측 모드 별 잔여데이터의 발생 확률을 분석하고, 이를 고려해 역방향 모드 기반 차분 화소 주사 방법을 사용한다. 일반적으로 참조 화소와의 거리가 멀어질수록 예측 정확도가 떨어져 잔여데이터의 발생 확률이 높아지기 때문에 제안한 역방향 주사 방법을 사용하면 잔여데이터 부호화에서 이득을 얻을 수 있다. 실험을 통해, 제안한 방법이 HEVC 무손실 부호화에 비해 약 1.7%의 부호화 성능을 향상시키는 것을 확인했다.

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클러스터 기반 VOD 시스템의 QoS 아키텍처 설계 (A Design of QoS Architecture for VOD(Video On Demand) System Based on Cluster)

  • 정지아;정기동
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2000년도 봄 학술발표논문집 Vol.27 No.1 (A)
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    • pp.199-201
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    • 2000
  • 본 논문에서는 클러스터에 기반한 주문형 비디오 (VOD: Video On Demand) 시스템에서의 QoS (Quality of Service) 아키텍처를 제안한다. 제안하는 QoS 아키텍처는 IP 네트웍상에서 사용자에게 다양한 서비스 질의 선택과, 선택한 질의 보장을 제공하며, 클러스트 시스템의 자원관리를 통해 서버의 효율을 극대화 시킨다. 클러스터 VOD 시스템의 QoS 아키텍처는 사용자 요구의 협상을 위한 Weighted Price 함수와 요구분배 기법인 Max-min 함수를 이용하여 사용자에게 제공하는 QoS의 수준을 높여주고, 저장 서버들간의 부하균등을 통해 효율성을 높인다. QoS 아키텍처 내의 핵심 모듈인 QoS Mapper와 QoS Manager의 성능을 확인 하는 실험을 통하여 사용자에게 서비스되는 QoS 수준이 증가하였음을 확인할 수가 있었고, 저장서버들간의 부하를 효과적으로 분산시켜 VOD 시스템의 동시 사용자수를 증가 시키고, 안정적인 서비스를 할 수 있음을 확인하였다.

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경기장 모델을 이용한 가상 영상 삽입 시스템의 설계 및 구현 (Design and Implementation of a Virtual Image Insertion System with a Sports Field Model)

  • 유성;한송이;이성환
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2001년도 가을 학술발표논문집 Vol.28 No.2 (2)
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    • pp.391-393
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    • 2001
  • 본 논문에서 제안하는 가상 영상 삽입 시스템은 카메라의 조작이나 시스템 운영자의 개입 없이 모든 처리 과정이 자동으로 진행된다. 이를 위해 시스템은 경기장 좌표계를 정의하고 삽입할 영상의 크기와 위치를 정하는 과정, 경기장의 특징점들을 추출하는 과정, 경기장 좌표계와 참조 영상의 특징점들로부터 투영 변환 파라미터를 추출하는 과정, 실제 동영상에서 삽입 위치를 찾고 추적하여 가상 영상을 삽입하는 과정을 거치게 된다. 본 논문에서 제안한 시스템의 성능을 검증하기 위해 방송용 NTSC 비디오 데이터를 대상으로 실험을 하였으며 그 결과 각 모듈들과 시스템이 효율적임을 입증하였다.

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내장형 WiFi 휴대단말의 필드 성능평가 방법 및 안테나 위치 최적화 연구 (Study on the Performance Evaluation Method of Embedded WiFi Terminal and Optimizing Antenna Location)

  • 김영재;주원용;김정준;이상홍
    • 한국정보통신설비학회:학술대회논문집
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    • 한국정보통신설비학회 2005년도 하계학술대회
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    • pp.436-442
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    • 2005
  • 컨버전스시대의 도래에 따라 다양한 유무선통합서비스를 지원하기 위한 embedded WiFi 기술이 모바일 PC, PDA, 핸드폰, TV, PMP, 카메라, 비디오 게임기 및 로봇 장남감에 이르기 까지 다양하게 적용되고 있다. 이에 다양한 단말의 형태를 고려한 무선구간의 성능확보가 요구되고 있는 실정으로 본 논문에서는 DBDM (Dual Band Dual Mode) 단말인 NESPOT Swing 단말을 근간으로 안테나 위치 최적화에 대한 기술과 단말 RF 및 기지국 안테나의 특성을 고려한 필드 성능 측정 방법에 대하여 기술하고, 이론적 분석과 실측정치를 제시하고자 한다. 본 연구의 결과는 앞으로 다양한 환경에서 사용이 예상되는 WiFi 기지국의 설치 및 embedded WiFi 단말의 안테나 구성과 RE모듈 성능 확보에 활용될 수 있을 것으로 기대된다.

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치매노인을 위한 자동대화시스템 (Automatic Dialog System for the Elderly with Dementia)

  • Kim, Sung-ill;Joo, Chang-bok;Shin, Wee-jae
    • 융합신호처리학회 학술대회논문집
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    • 한국신호처리시스템학회 2003년도 하계학술대회 논문집
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    • pp.137-140
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    • 2003
  • 본 연구는 치매노인환자의 생활의 질을 향상시키기 위한 대화시스템의 개발에 목표를 둔다. 제안된 시스템은 주로 세 가지 모듈, 즉, 음성인식, 시간테이블에 의해 구분된 대화 데이터베이스의 자동검색, 그리고 간호사의 녹음음성에 의한 응답 등으로 구성되어 있다. 우선 치매환자가 요양시설에서 자주 발화하는 대화의 내용을 조사하고, 그들의 발화 음성을 인식하고 적절히 응답하도록 구성하였다. 시스템의 평가를 위해서 시스템이 도입되었을 때와 도입되지 않았을 때를 비교, 조사하였다. 시스템이 도입되지 않았을 때는 간호사가 자유로이 케어서비스를 행할 수 있도록 하였다. 비디오 촬영을 통해서 대상자의 행동 및 반응을 조사한 결과, 치매환자의 요구를 충족시키는데 있어서 대화 시스템이 간호사들보다 더 응답적이었다는 것을 알 수 있었다. 게다가, 제안된 시스템은 상호 대화에 있어서 환자가 더 많이 말하도록 유도함을 알 수 있었다.

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재구성 가능한 DCT/DWT 프로세서 설계 (The Reconfigurable Processor Design of DCT/DWT)

  • 김영진;이현수
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2005년도 한국컴퓨터종합학술대회 논문집 Vol.32 No.1 (A)
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    • pp.730-732
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    • 2005
  • 최근 이미지 압축, 워터마킹 또는 스케일러블 비디오 코딩 분야에서 DCT와 DWT 연산을 선택적으로 사용하거나, 혼합하여 사용하는 경우가 늘어나고 있다. 이러한 두개의 연산을 사용하는 방법은 소프트웨어적인 프로그램을 사용하거나 하드웨어를 따로 구현하여 사용하였다. 본 연구에서는 하나의 모듈로 두개의 연산을 수행할 수 있는 재구성 하드웨어를 제안한다. 또한 DCT와 DWT연산에 있어서, 가장 많은 연산을 수행하는 부분은 계수(Coefficient)값과 입력 값의 내적 연산(Inner Product)을 수행하는 것인데, 이 내적연산을 하는데 있어서 곱셈기를 사용하지 않는 분산연산을 사용함으로써 연산의 복잡도를 줄이고, 하드웨어의 속도를 빠르게 하였다. 실험 환경은 Altera FPGA를 사용한 Excalibur_ARM (EPXA10F1020Cl) 보드를 이용하여 구현하였으며, 동작속도는 47.85MHz이다.

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