본 논문은 비분리형 비등방성 완전정합충(UAPML)을 이용하여 이동통신용 원형편파 등각 마이크로스트립 패치 안테나를 해석하였다 또한 3차원 U따까1L에 대한 모서리 및 모퉁이 부분에 대하여 특별히 다루었다. 특히 동축 여기선을 갖는 마이크로스트립 패치 안테나를 해석하기 위해서 Mur의 1차 흡수경계조건을 혼합 적용하였다 결과적으로 본 논문은 UAPML법이 모서리 및 모퉁이 부분에서 수렴함은 물론 Mur의 1차 흡수 경계조건과 혼합하여 홈수경계조건으로서 충분히 사용 가능함을 제시한다. 수치해석 결과는 이동통신 대역인 L밴드 및 C 밴드에서 중심주파수 1.575 GHz, 1.778 GHz 그리고 4.8 GHz를 갖는 단일 및 병렬 패치에 대한 전자장의 $E_z$및 $H\chi$에 대한 시간응답, 동축선의 입력임피던스 및 마이크로 스트립 패치의 복사특성을 해석 하였다 본 논문의 해석 결과는 2차 분산 경계조건(SDBC) Mur의 1차 흡수경계조건을 혼합한 수치해석 방법 그리고 순수 Mur의 1차 흡수경계조건과 비교하였다. 따라서 본 논문에서 제시된 해석방법이 합당함을 입 증할 수 있다.
본 논문에서는 IEEE 802.113의 표준안에 정의된 OFDM (Orthogoanl Frequency Division Multiplexing) 기반의 무선 LAN 시스템의 수신기를 구현하였다. OFDM 방식은 데이터 전송시 다수의 직교 반송파를 사용하여 병렬전송을 하기 때문에 오류 정정 부호와 함께 사용할 때 고속 데이터 전송시에 나타나는 주파수 선택적 페이딩을 극복할 수 있다. 그러나 수신단에서 동기가 이루어지지 않는 경우 부반송파 사이에 직교성이 파괴되어 채널간 간섭이 발생하여 오류 성능이 크게 저하된다. 따라서 시스템의 동기를 이루기 위해 심볼을 구성하는 부반송파 사이의 위상관계를 이용하여 OFDM 신호의 주파수 옵셋을 추정하였으며 단일탭 등화기를 통하여 채널상의 잡음에 의한 오차를 개선하였다. 효율적인 하드웨어 구성을 위해 이들 블록을 Verilog HDL으로 모델링 하였으며 표준안의 벡터를 이용하여 기능 검증 및 성능 평가를 수행하였다.
본 논문은 IEEE 802.11i 무선 랜 보안을 위한 AES(Advanced Encryption Standard) 기반 CCMP Core의 설계에 대해서 기술한다. 설계된 CCMP 코어는 데이터 기밀성을 위한 counter 모드와 사용자 인증 및 데이터 무결성 검증을 위한 CBC(Cipher Block Chaining) 모드가 두개의 AES 암호 코어로 병렬 처리되도록 함으로써 전체 성능의 최적화를 이루었다. AES 암호 코어의 하드웨어 복잡도에 가장 큰 영향을 미치는 S-box를 composite field 연산방식을 적용하여 설계함으로써 기존의 LUT(Lookup Table)로 구현하는 방식에 비해 게이트 수가 약 $20\%$ 감소되도록 하였다. 0.25-um CMOS cell 라이브러리로 합성한 결과 13,360개의 게이트로 구현되었으며, 54-MHz의 클럭으로 안전하게 동작하여 168 Mbps의 성능이 예상된다. 설계된 CCMP코어는 Altera Excalibur SoC 칩에 구현하여 동작을 검증하였다.
본 논문은 고성능 공통 입력버퍼를 가지는 패킷 스위치 패브릭을 위한 새로운 3차원 라운드로빈 스케줄러에 관한 연구이다. 본 논문에서 제안된 스케줄러는 각 입력 버퍼에서 각 출력 큐를 독립적으로 관리하는 분산형 공통 버퍼를 가지는 스위치 패브릭구조에서 고속으로 동작하는 스케줄러이다. 제안된 스케줄러는 M 개의 각 공통 입력 버퍼가 K개의 입력 및 출력 포트를 가지고 N 개의 가상 출력 큐를 관리하고 $K\geq$M (K$\leq$M)일 때 매 K(M) 사이클 마다 MxK 개의 가상 출력 큐들이 목적 출력포트로 패킷을 전송할 수 있도록 스케줄링한다. 대량 병렬 스케줄링 구조를 이용하여 대용량의 스위칭 포트를 가지는 고성능 스위치 패브릭에의 고속 응용을 지원한다.
본 논문에서는 Modified Euclid 알고리즘을 이용하여 고속의 Reed-Solomon 복호기를 설계하였다. Reed-Solomon 부호의 복호 알고리즘은 오증을 계산하고, 에러 위치 다항식을 구한 후, 에러를 판단하여, 에러 크기 값을 구하는 4단계로 이루어지는데, 본 논문에서는 복호기의 속도를 증가시키고 Latency를 줄이기 위하여 병렬구조의 신드롬 생성기와 빠른 클록 속도의 Modified Euclid 알고리즘 블록을 사용하였으며, Chien Search 블록에서는 에러 위치 다항식을 짝수항과 홀수항으로 나누어 설계하였다. 먼저, 알고리즘과 회로의 동작을 확인하기 위해 C++로 프로그램을 작성하여 검증을 한 후, 이를 바탕으로 Verilog로 하드웨어를 기술하였다. 또한, 각 블록에 대한 로직 시뮬레이션을 거친 후, $.25{\mu}m$ CMOS 라이브러리를 이용하여 Synopsys사의 합성 툴로 합성을 하고, 최종적으로 후반부 설계인 레이아웃을 시행하였다. 본 논문의 칩은 최대 동작 주파수가 250MHz로서 최대 데이터 전송률은 1Gbps이다.
본 논문은 BLDC 서보모터를 사용하는 power-by-wire(PBW) 시스템을 위한 DSP 제어기와 IGBT 인버터 드라이버를 설계하는 연구를 제안한다. 이 BLDC 서보모터 시스템은 DSP(Digital Signal Processor)와 IGBT 인버터 모듈로써 구현되어진다. PBW 시스템은 직선 추력 동작을 위해 서보 모터의 속도 제어가 필요하다. 본 논문에서는 벡터 제어와 min-max PWM 기술로 이러한 서보 제어기를 구현한다. 제어기의 CPU로써, TMS320F2812 DSP는 PWM(펄스폭변조) 파형발생기, A/D변환기, SPI(직병렬인터페이스) 포트 그리고 많은 입/출력 포트 등을 가지고 있기 때문에 채택되었다.
본 논문에서는 Improved Normalized Min-Sum(INMS) 복호 알고리듬을 적용한 LDPC 복호기의 복호성능 및 복호 수렴속도를 고정소수점 Matlab 모델링과 시뮬레이션을 통해 분석한 후, Verilog-HDL로 하드웨어를 설계하였다. 설계된 LDPC 복호기는 IEEE 802.16e 모바일 WiMAX 표준의 19가지 블록길이(576~2304)에 따른 6가지 부호율(1/2, 2/3A, 2/3B, 3/4A, 3/4B, 5/6)을 지원한다. 하드웨어 복잡도를 고려하여 layered 복호방식의 블록-시리얼(부분병렬) 구조로 설계하였으며, SM(sign-magnitude) 수체계 연산을 기반으로 하는 DFU(Decoding Function Unit)를 적용하여 면적을 최소화하였다. 기존의 DFU에 적용된 min-sum 복호 알고리듬 보다 복호성능이 좋은 INMS 복호 알고리듬을 적용함으로써 LLR 비트 수를 1-비트 감소시켜 하드웨어를 최적화시켰다.
본 연구에서 공개 의료 빅데이터 분석을 지역사회건강조사 2012~2014년 자료를 이용해 개인의 건강관련 삶의 질 차이와 삶의 질에 영향을 미치는 요인을 분석하였다. 제안논문에서는 공개의료 빅데이터 분석을 위해 Hadoop 기반의 Spack을 이용해 병렬처리 지원을 위한 클라우드 메니저를 구성하고 개인의 삶의 질에 영향을 미치는 요인을 하드웨어의 제약없이 빠르게 분석하였다. 건강관련 삶의 질에 미치는 영향을 개인적 특성과 지역사회 특성으로 구분하여 단계별 다수준 회귀분석(ANOVA, t-test)을 실시하였다. 연구결과 개인별 삶의 질에 영향을 미치는 요인으로는 남자 평균 73.8점, 여자 평균 70.0점으로 남자가 여자보다 건강관련 삶의 질이 높은 것으로 나타났다.
산업 무선 센서 네트워크는 뛰어난 성능과 신뢰성 있는 통신을 요구한다. 클러스터 구조는 네트워크를 형성하기 위해 소모되는 비용을 줄인다. 그리고 예약 기반 MAC 프로토콜은 네트워크 경쟁 기반 프로토콜에 비해 통신 성능 및 신뢰성이 더 뛰어나다. 이러한 구조를 갖춘 깊이 기반 TDMA 스케줄링 기법은 클러스터 네트워크상에서 깊이 정보에 따라 타임 슬롯을 분산적으로 각 센서 노드에 할당하는 방식이다. DB-TDMA가 깊이 기반 TDMA 스케줄링 기법 중 하나이고 확장성과 에너지 효율성을 보장한다. 하지만 분산 기법의 한계로 네트워크 전체 상황을 파악할 수 없어, 병렬 처리된 타임 슬롯 할당을 수행하기 어렵고, 충돌 문제를 완벽히 피할 수 없다. 이를 위해 본 논문은 DB-TDMA의 종단 간 지연시간을 감소시키기 위한 향상된 알고리즘을 제시한다. 그리고 제안 알고리즘을 DRAND와 DB-TDMA와 비교한다.
3GPP LTE/LTE-Advanced 시스템에서 이종 네트워크 및 CSG(Closed Subscriber Group) 셀이 핵심 이슈 중 하나이다. 본 논문에서는 사용자 단말인 UE(User Equipment)가 CSG 셀로 핸드오버를 하기 위해 필수적으로 필요한 시스템 정보 측정 방법에 대해 분석하였다. 기존에 이러한 방법에 대한 명확한 논의가 부족하였기 때문에 먼저 5개의 가능한 방법들을 정리하고 분석하였다. 또한, 이러한 방식들에서 단점인 긴 시스템 정보 측정 지연 시간을 줄이기 위한 새로운 방식을 제안하였다. 제안한 AMPSG(Autonomous Measurement with Parallel Small Gaps) 방식에서는 UE가 주변의 CSG 셀들의 시스템 정보를 순차적으로 측정하지 않고 병렬적으로 측정한다. 그 결과 제안한 방식이 다른 방식들에 비해 좋은 지연 성능을 나타내었다. CSG 셀로의 핸드오버를 결정하기 위해서는 반드시 시스템 정보 측정이 선행되어야 하기 때문에 본 논문에서 제안한 AMPSG 방식을 사용할 경우 핸드오버 결정 시간을 단축할 수 있을 것이다.
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[게시일 2004년 10월 1일]
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