• 제목/요약/키워드: 막재료

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반도체 초격자

  • 이주신
    • Electrical & Electronic Materials
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    • v.3 no.3
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    • pp.161-177
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    • 1990
  • 최근의 재료합성기술 및 미세가공기술의 발전은 종래의 천연물질에는 없는 새로운 기능을 가진 신물질이나 새로운 디바이스의 제작을 가능하게 하고 있다. 여러가지 초박막 물질의 다층막이나 초격자는 그 형상 및 물질의 조합에 따라 모체의 물질과는 새로운 성질을 나타내는 것으로 크게 관심을 모으고 있다. 본 논문에서는 현재 연구가 활발히 진행되고 있는 반도체초격자에 관하여 그 종류 및 전자상태, 결정성장 및 평가법, 기초적 물성, 디바이스 응용 그리고 앞으로의 전망을 간단하게 총망라하여 소개해 보고자 한다.

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투과증발 분리법에 의한 CMC/PVA blend막의 물/유기용제 혼합액의 분리특성

  • 홍영기;배기서;이정민
    • Proceedings of the Membrane Society of Korea Conference
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    • 1993.10a
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    • pp.52-53
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    • 1993
  • 투과증발 분리를 위하여 여러가지 막 소재와 공정을 개발하기 위한 노력이 다방면에서 이루어지고 있으며, 이에 관한 자료도 많이 제시되고 있으나 고분자 분리막의 개발은 아직도 미흡한 상태이다. 한편 투과증발 분리는 공정자체는 매우 간단하면서도 분리막의 투과성능에 따라 분리효율이 달라지기 때문에 여러종류의 막의 개발이 필요하다. 따라서 본 연구에서는 물/유기용제 혼합액에서 물을 분리하기 위하여 친수성이 강한 두 고분자 재료인 poly(vinyl alcohol)(PVA)와 carboxymehtylcellulose(CMC)를 브랜드하여 목적하는 분리기능을 갖는 새로운 막을 제조하여, 물/유기용제, 혼합액의 분리특성을 브랜드비와 온도 및 농도 그리고 분리시간에 따라 각각 검토하였다.

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Relization of Low Temperature Oxide Using Porous Silicon (다공질 실리콘을 이용한 저온 산화막의제조)

  • Ryu, Chang-U;Sim, Jun-Hwan;Lee, Jeong-Hui;Lee, Jong-Hyeon;Bae, Yeong-Ho;Heo, Jeung-Su
    • Korean Journal of Materials Research
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    • v.6 no.5
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    • pp.489-493
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    • 1996
  • 다공질 실리콘층(Porous Silicon LayerLPSL)을 사용하여 저온 열산화 (50$0^{\circ}C$, 1시간)와 급속 열산화공정(rapid thermal oxidationLRTO)(115$0^{\circ}C$, 1분)을 통하여 저온 산화막을 제조하였다. 제조된 산화막의 특성을 IR흡수 스펙트럼, C-V 곡선, 절연파괴전압, 누설전류, 그리고 굴절률을 조사함으로써 알아보았다. 절연파괴전압은 2.7MV/cm, 누설전류는 0-50V 범위에서 100-500pA의 값을 보였다. 산화막의 굴절률은 1.49의 값으로서 열산화막의 굴절률에 근접한 값을 나타냈다. 이 결과로부터 다공질 실리콘층을 저온산화막으로 제조할 때, RTO공정이 산화막의 치밀화(densification)에 크게 기여함을 알 수 있었다.

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A Study on the Electrical Characteristics of Low Temperature Polycrystalline Thin Film Transistor(TFT) using Silicide Mediated Crystallization(SMC) (금속유도 결정화를 이용한 저온 다결정 실리콘 TFT 특성에 관한 연구)

  • 김강석;남영민;손송호;정영균;주상민;박원규;김동환
    • Proceedings of the Materials Research Society of Korea Conference
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    • 2003.03a
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    • pp.129-129
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    • 2003
  • 최근에 능동 영역 액정 표시 소자(Active Matrix Liquid Crystal Display, AMLCD)에서 고해상도와 빠른 응답속도를 요구하게 되면서부터 다결정 실리콘(poly-Si) 박막 트랜지스터(Thin Film Transistor, TFT)가 쓰이게 되었다. 그리고 일반적으로 디스플레이의 기판을 상대적으로 저가의 유리를 사용하기 때문에 저온 공정이 필수적이다. 따라서 새로운 저온 결정화 방법과 부가적으로 최근 디스플레이 개발 동향 중 하나인 대화면에 적용 가능한 공정인 금속유도 결정화 (Silicide Mediated Crystallization, SMC)가 연구되고 있다. 이 소자는 top-gated coplanar구조로 설계되었다. (그림 1)(100) 실리콘 웨이퍼위에 3000$\AA$의 열산화막을 올리고, LPCVD로 55$0^{\circ}C$에서 비정질 실리콘(a-Si:H) 박막을 550$\AA$ 증착 시켰다. 그리고 시편은 SMC 방법으로 결정화 시켜 TEM(Transmission Electron Microscopy)으로 SMC 다결정 실리콘을 분석하였다. 그 위에 TFT의 게이트 산화막을 열산화막 만큼 우수한 TEOS(Tetraethoxysilane)소스로 사용하여 실리콘 산화막을 1000$\AA$ 형성하였고 게이트는 3000$\AA$ 두께로 몰리브덴을 스퍼터링을 통하여 형성하였다. 이 다결정 실리콘은 3$\times$10^15 cm^-2의 보론(B)을 도핑시켰다. 채널, 소스, 드래인을 정의하기 위해 플라즈마 식각이 이루어 졌으며, 실리콘 산화막과 실리콘 질화막으로 passivation하고, 알루미늄으로 전극을 형성하였다 그리고 마지막에 TFT의 출력특성과 전이특성을 측정함으로써 threshold voltage, the subthreshold slope 와 the field effect mobility를 계산하였다.

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Preparation of Very Low Resistance Transparent Electrode with ITO/Ag/ITO Multilayer (ITO/Ag/ITO 다층 구조를 이용한 초저저항 투명 전도막 제조)

  • Choi, Kook-Hyun;Kim, Jin-Yong;Lee, Yoon-Seok;Kim, Hyeong-Joon
    • Korean Journal of Materials Research
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    • v.8 no.1
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    • pp.52-57
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    • 1998
  • 기존 산화물 투명전극에 비해 더욱 우수한 전기전도성을 가지는 다층구조의 투명전도막을 마그네트론 스퍼터링 장치를 이용해 제작하였다. 전기전도성을 극대화하기 위해 비저항이 가장 낮은 Ag 금속을 사용하고, 금속층의 상하부에 반사광을 재반사시키는 산화물층을 형성시킨 다층막구조를 이용하였다. Ag 금속막은 충분한 투과율과 전기전도성을 확보하기 위해 연속된 막을 이루기 시작하는 두께인 140$\AA$로 증착하였고, ITO 박막은 가시광 영역의 반사광을 재반사시키는 최적의 두께인 600$\AA$ 내외로 증차하였다. Ag 박막의 증착조건과 후속 ITO 박막증착공정은 Ag박막의 특성에 영향을 미치므로 다층막의 전기적, 광학적 특성은 이들 증착 조건에 민감한 영향을 받음을 확인하였다. 상온에서 Ag박막을 형성하고 ITO박막은 7mTorr의 낮은 압력에서 증착하여 제작한 투명전도막은 SVGA 급의 STN-LCD용 투명전극으로 사용 가능한 4Ω/ㅁ 이하의 낮은 면저항과 빛의 파장이 550nm일 때 85%이상의 투과도를 나타내었다.

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The method using dynamic load and static load figures out gust factor of the membrane structure (동적하중과 정적하중을 이용한 막구조의 거스트 계수 산출 방법)

  • Wang, Ben-Gang;Jeong, Jae-Yong;You, Ki-Pyo;Kim, Young-Moon
    • Proceeding of KASS Symposium
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    • 2008.05a
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    • pp.19-24
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    • 2008
  • The thesis is for gust factor needing when calculate the wind resistance design. For the gust factor, to the membrane structural model, carry through the wind tunnel test and the static load test. Therefore, at first through the tensile test of the fabric material, designate the material of the membrane structural model. Then, to saddle, wave, arch and point four kinds of basic shape membrane structural models, carry on the wind tunnel test, determine their dynamic load and distortion on lateral direction. Finally, according to distort situation of the membrane structure in the wind tunnel test, carry on the static load experiment outside of the wind tunnel, calculate static load which corresponding with distort. According to dynamic load and the static load, figure out gust factor of these kinds of basic membrane structure.

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The Improvement of Profile Tilt in High Aspect Ratio Contact (컨택 산화막 에칭에서의 바닥 모양 찌그러짐 변형 개선)

  • Hwang, Won-Tae;Choi, Sung-Gil;Kwon, Sang-Dong;Im, Jang-Bin;Jung, Sang-Sup;Park, Young-Wook
    • Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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    • 2004.11a
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    • pp.666-670
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    • 2004
  • VLSI 소자에서 design rule(D/R)이 작아져 각 단위 Pattern의 size가 작아짐에 따라 aspect ratio가 커지게 되었다. 산화막 contact etch를 하는데 있어 산화막 측벽을 보호하는데, 이러한 보호막은 주로 fluoro-carbon 계열의 polymer precursor들이 사용된다. Aspect ratio(A/R)가 5 이하일 때에는 측벽의 보호막에 의한 바닥 변형이 문제가 되지 않으나, 10 이상의 A/R를 가진 contact에서는 크기가 줄고, 모양이 불균형하게 변하는 바닥 변형을 쉴게 관찰할 수 있다. 이러한 바닥 변형이 커지면 contact 저항이 높아지는 것은 물론이고, 심하게는 하부 pattern과 overlap 불량을 유발할 수 있다. 본 논문에서는 바닥변형을 일으키는 원인을 분석하고 fluoro-carbon 계열의 polymer precursor의 종류$(C_4_F6\;vs.\;C_3F_8)$에 따른 polymer증착 상태 확인 및 pattern비대칭에 따른 바닥 변형의 고찰과 plasma etching 시 H/W 변형을 통해 바닥 변형이 거의 없는 조건을 찾아낼 수 있었다.

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Transparent electrode performance of $TiO_2$/ZnS/Ag/ZnS/$TiO_2$ multi-layer for PDP filter ($TiO_2$/ZnS/Ag/ZnS/$TiO_2$ 다층막의 PDP 필터용 전극 특성)

  • Oh, Won-Seok;Lee, Seo-Hee;Jang, Gun-Eik
    • Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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    • 2010.06a
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    • pp.217-217
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    • 2010
  • 산화물유전체/금속/산화물유전체(D/M/D) 구조의 투명전극은 우수한 통전성과 투광성을 갖는 동시에 근적외선 및 전자파 차폐가 가능하여 각종 디스플레이 장치로의 응용을 위해 많은 연구가 진행 중이다. 이러한 구조의 다층막의 경우 금속층과 산화물층간 계면에서의 산소확산으로 인한 광학적, 전기적 특성 저하가 문제가 되고 있다. 본 연구에서는 층간 산소확산방지를 통해 다층막의 전기적 특성을 개선하기 위해 $TiO_2$/Ag/$TiO_2$, $TiO_2$/ZnS/Ag/ZnS/$TiO_2$ 구조의 다층막을 DC/RF 마그네트론 스퍼터를 이용하여 제조하여 ZnS 박막이 다층막의 특성에 미치는 영향을 비교 평가하였다. 제조된 박막의 전기적, 광학적, 계면 특성을 4-point probe, Spctrophotometer, AES을 이용하여 분석하였으며 PDP필터용 전극으로의 적용 가능성을 평가하였다.

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A Study on The Cutting Pattern Generation of Membrane Structures and The Loss-Ratio of Material (막 구조물의 재단도 작성과 막재의 손실률에 관한 연구)

  • Shon, Su-Deok;Jeong, Eul-Seok;Kim, Seung-Deog
    • Journal of Korean Association for Spatial Structures
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    • v.6 no.1 s.19
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    • pp.117-127
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    • 2006
  • Membrane structures, a kind of lightweight soft structural system, are used for spatial structures. The design procedure of membrane structures are needed to do shape finding, stress-deformation analysis and cutting pattern generation, because the material property has strong axial stiffness, but little bending stiffness. The problem of cooing pattern is highly varied in their size, curvature and material stiffness. So, the approximation inherent in cutting pattern generation methods is quite different. Therefore the ordinary computer software of structural analysis & design is not suitable for membrane structures. In this study, we develop the program for cooing pattern generation using geodesic line, and investigate the result of example's cooing pattern in detail.

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The Influence of Leadframe Oxidation on the Cu/EMC Interface Adhesion (리드프레임의 산화가 Cu/EMC 계면 접착력에 미치는 영향)

  • Jo, Sun-Jin;Baek, Gyeong-Uk
    • Korean Journal of Materials Research
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    • v.7 no.9
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    • pp.781-788
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    • 1997
  • Cu/EMC 계면 접착력에 미치는 산화의 규명하기 위해 리드프레임의 저온 산화에 대하여 조사하였다. 이전의 보고와 달리, 저온에서도 Cu$_{2}$O위에 CuO산화물이 형성되어 Cu/Cu$_{2}$O(NiO)/Cu(NiO)/air의 산화층 구조를 나타내었다. Cu/EMC 계면 접착력은 산화가 진행됨에 따라 산화 초기에 급격히 증가하다 최대값에 이르고, 이후의 계속적인 산화로 감소하는 양상을 보였다. 접착력은 산화 온도나 리드프레임의 종류보다 산화막의 두께에 밀접한 상관 관계를 나타내었다. 최대 계면 접착력이 얻어지는 산화막의 두께는 리드프레임의 종류보다 산화막의 두께에 밀접한 상관 관계를 나타내었다. 최대 계면 접착력이 얻어지는 산화막의 두께는 리드프레임의 종류와 무관하게 대략 20nm 와 30nm 사이에 존재하였다. 산화 초기의 접착력 증가는 산화로 인한 EMC에 대한 젖음성의 증가와 기계적 고착 효과의 증가에 기인하였다. 리드프레임과 EMC의 파괴 표면에 대한 AES, XPS 분석으로 부터, 산화막의 두께가 얇을 때에는 Cu$_{2}$O//CuO의 계면 파괴 + EMC 자체 파괴가 복합적으로 발생함을 알 수 있었다. 반면에 과도한 산화로 낮을 접착력을 나타내는 시편은 Cu/Cu$_{2}$/O 계면의 파괴를 나타냈다.

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