• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2004.05b
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• pp.655-657
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• 2004

채널 레벨 컨트롤러는 DWDM(Dense Wavelength Division Multiplexing) 방식의 OXC(Optical Cross Connect), OADM(Optical Add/Drop Multiplexer), 광 증폭기(EDFA : Erbium Doped Fiber Amplifier) 둥의 시스템에서 채널별 광신호의 세기를 조절하여 시스템의 신뢰성을 높이는 중요한 제어기다. 본 논문에서는 12채널 VOA(Variable Optical Attenuator) 4개를 사용하여 40채널의 광 신호 레벨을 제어할 수 있는 컨트롤러를 구현하였다. 각 채널의 광 신호 레벨을 제어하는데 하나의 마이크로 프로세서가 5개의 채널을 제어하고 총 8개의 마이크로프로세서로 40채널을 분산 제어하도록 구성하였다. 또한 외부와 통신을 하고 사용자로부터의 명령을 각각의 마이크로프로세서에 전달하기 위한 마이크로프로세서를 추가하였으며, 출력되는 광 신호의 세기를 측정하여 VOA를 제어하는데 있어서 VOA 출력에서 바로 PD(Photo Detector)로 입력하여 AWC(Arrayed Waveguide Grating) 출력에서 광 신호를 다시 분파하여 PD에 입력하는 번거로움을 개선하였다.

• The Journal of Korean Institute for Practical Engineering Education
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• v.3 no.1
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• pp.25-31
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• 2011

These days, almost all of the embedded systems have microprocessors or micro-controllers in them as their brains. So microprocessor related subjects become very important and most engineering departments have those kinds of subjects in their curriculums with practice hours. However, in most universities in Korea, the number of students in a class is more than 40 and only one teaching assistant is assigned to the class. So it is very hard job to find out an appropriate method to evaluate the students' achievements in their practice hours fairly. In this study, the author introduces some suggestions for the evaluation of the students' achievements in microprocessor practice courses. In addition to it, the author also introduces some guidelines for contents of microprocessor related subjects.

• The Journal of the Institute of Internet, Broadcasting and Communication
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• v.23 no.5
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• pp.35-40
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• 2023

In this paper, a serial wireless LAN virtual communication module that allows microprocessors to communicate wirelessly with other peripheral devices is developed as part of a study to build an online virtual experiment system that allows them to practice virtually anytime, anywhere in microprocessor application education in electrical and electronic control engineering. The developed module is connected to the microprocessor in the virtual experiment system through serial interface. The serial data is sent to and received from peripheral devices through the wireless LAN interface of the host computer where the virtual experiment software is being performed. In order to verify the function of the developed serial wireless LAN virtual communication module, experiments were conducted in which a microprocessor in the virtual experiment system exchanged data with an Android smartphone through a wireless LAN interface of a host computer. The developed serial wireless LAN communication module is expected to enable virtual microprocessors to communicate with surrounding real devices through wireless LAN, which can be efficiently used in microprocessor application education.

• Journal of KIISE:Computer Systems and Theory
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• v.27 no.6
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• pp.558-566
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• 2000

Object recognition is a challenging application for high-performance computing. Currently, the superscalar architecture dominates todays microprocessor marketplace. As more transistors are integrated onto larger die, however, an on-chip multiprocessor is regarded as a promising alternative to the superscalar microprocessor. This paper examines the behavior of the object recognition on the on-chip multiprocessor, which will be employed in general-purpose parallel machines. To obtain the performance characteristics of the microprocessor, a program-driven simulator and its programming environment were developed. The simulation results showed that the on-chip multiprocessor can exploit thread level parallelisms effectively and offer a promising architecture for the object recognition application.

• Proceedings of the KSME Conference
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• 2005.11a
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• pp.220.2-220.2
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• 2005

• The Journal of the Institute of Internet, Broadcasting and Communication
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• v.13 no.2
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• pp.59-65
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• 2013

Microprocessors of 8 to 16 bits have become the first step of today's computer development with excellent capability and a lot of those are still used in the educational spots. In this study, execution times of Intel series microprocessors(${\mu}ps$) available to microprocessor systems of 8 to 32 bits are obtained and compared by I/O programs. The compared result showed that execution time related to the instruction cycles of 8 bit 8051 was longer than that of 8 bit 8051 and of 16 bit 8086 by a lot of number of clocks in cases of clock frequencies at 4 MHz and at 12 MHz. In cases of really many using ${\mu}p$ clock frequencies, it showed that execution times of instructions have become faster by the order of 8085, 8086, 8051 and 80386. It can be helped to interface with ${\mu}ps$ for real time control through comparing with execution times of I/O programs by mainly many usable Intel series ${\mu}ps$ in our nation.

• JOURNAL OF ELECTRICAL WORLD
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• no.12 s.108
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• pp.102-108
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• 1985

가변속시스템은 전력용 반도체소자의 발달, 마이크로엘렉트로닉스, 마이크로프로세서의 응용에 의한 제어의 고도화 등으로 지난 수년 사이에 크게 진보되었다. 여기서는 최근의 가변속시스템의 동향에 대하여 설명한다.

• Proceedings of the KIEE Conference
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• 2006.07d
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• pp.1897-1898
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• 2006

과거에는 하나의 제어시스템을 구축하기 위해서는 여러 개의 주변소자를 접목시켜서 구현해 왔다. 하지만 근래에 들어서 소형화, 간략화를 통해 계속해서 원 칩 마이크로프로세서의 사용이 늘고 있는 실정이다. 본 논문에서는 고성능의 원 칩 마이크로프로세서 및 Digital Signal Processor인 TMS320F2812를 이용하여 구동회로를 간략화 하여 3상모터 구동시스템을 구성하고 PI제어 알고리즘을 이용하여 3상 유도전동기의 속도제어 시스템을 구현하였다.

• The Proceedings of the Korean Institute of Illuminating and Electrical Installation Engineers
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• v.2 no.4
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• pp.70-74
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• 1988

계단파 5전위 PWM 출력전압은 CTI회로를 구성하는 스위칭 소자의 구동신호에 의하여 이루어진다. 이 CTI회로를 구동시키기 위한 구동신호는 Natural Sampling 방식의 변조신호를 10-6 범위인 변환 오차로 디지틀 변환하고, 이 신호의 데이터에 의한 마이크로프로세서 운전 시스템을 구성하였다. 이 방식에 의하면, CTI회로의 V/F제어를 위한 1[Hz]~60[Hz]의 시스템에 소요되는 메모리의 용량은 어드레스 카운터방식에 비하여 0.8%이었다.

• Proceedings of the Korean Information Science Society Conference
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• 2002.10c
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• pp.700-702
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• 2002

본 논문은 16-비트 고정된 명령어 형식을 갖는 32-비트 EISC(Extendable Instruction Set Computer) 코어 구현에 대하여 기술하였다. EISC구조는 코드 밀도가 높은 확장 오퍼랜드(operand) 형식을 사용하여 메모리 크기를 줄일 수 있으므로 ASIC 구현시 저전력 시스템 및 소형화된 임베디드 시스템을 위한 프로세서 구현을 가능하게 한다. 설계된 프로세서는 AE32000 명령어 셋과 호환이 가능하도록 설계되었으며 5단 파이프라인을 적용하여 프로세서의 성능을 높였다. 또한 BTB(Branch Target Buffer)를 사용하여 분기 지연을 줄여 낮은 CPI(Clock Per Instruction)을 유지하게 하였다.