다중 사용자 검출은 CDMA 시스템에서 가장 큰 문제인 원관 문제를 해결해 주는 하나의 방법이다. 동기식 다중 사용자 검출기는 크게 선형과 비선형으로 나누어지며, 선형 검출기에는 역상관기, MMSE 검출기, LMS 검출기, RLS 검출기가 있다. 비선형 검출기에는 SIC, PIC, DFD등이 있으며, 본 논문에서는 동기식 선형 및 비선형 다중 사용자 검출기와 비동기식 다중 사용자 검출기의 특성과 성능을 비교 평가하고, 학습 계열이 필요 없는 블라인드 다중 사용자 검출기를 위의 검출기 성능과 비교 평가함으로서 학습 계열을 이용할 수 없는 상황에서 같은 성능으로 블라인드 다중 사용자 검출기를 사용 할 수 있음을 확인하였다.
본 논문에서는 액체의 전기 전도도를 저잡음으로 검출하기 위하여 동기복조를 이용하는 전도도 검출기를 설계한다. 이를 위하여 검출기는 반송파 발생기, 전도도 검출 셀, 전류-전압 변환기 및 동기 복조기로 구성하며, 복조기의 대역폭을 조정하여 검출기의 신호 대 잡음비(SNR)를 개선함으로써, 액체의 극미한 전도도도 용이하게 측정할 수 있도록 한다. 이의 응용 예로써, 반도체 공정의 공기감시용 전도도 검출기를 동기복조를 이용하여 설계하며, 실험을 통하여 설계의 타당성을 확인한다. 실험 결과, 검출기는 설계 성능에 부합하는 특성을 나타내므로, 동기복조를 이용한 전도도 검출기는 액체의 극미한 전도도 측정에 유용하게 사용될 수 있음을 입증하였다.
본 논문은 연구자석 동기발전기의 병렬운전을 위한 동기 스위치 전압 검출에 의한 동기기 병렬구동에 관한 연구이다. 동기 스위치 전압검출은 동기기가 병렬구동 시, 스위치의 양단의 전압을 검출하고, 전위차가 0[V]에 근접하게 되면 스위치를 ON시켜 계통과 연계를 위해 본 논문에서 제안하는 기법이다. 제안된 기법은 각 동기기의 동일한 한 상(phase)의 정보를 통하여 병렬구동이 가능하다는 장점이 있다. 따라서 본 논문에서는 제안된 기법에 대하여 시뮬레이션을 통하여 그 타당성을 검증한다.
획기적으로 선명한 영상의 구현, 휴대 용이성 및 정확한 온도분포의 구현이 가능한 초점면 배열 방식의 적외선 검출기는 탐지도 및 분해능 향상을 위해 액체질소 온도수준의 극저온냉각을 요구한다. 냉동기의 저온부에 적외선 검출기를 직접 부착하는 일체형 스터링 극저온냉동기는 효율적인 적외선 검출기의 냉각이 가능할 뿐 만 아니라, 소형/경량화가 용이하여, 기동 및 휴대용 열상장비용 극저온냉각을 위해 많이 활용되고 있다. 적외선 검출기 냉각용 즉저온냉동기는 다양한 열/진동/충격/전자파 등의 운용환경조건에서 검출기를 액체질소 온도수준으로 냉각/유지할 수 있어야 하며, 안정적인 시스템의 운용을 위한 충분한 신뢰성이 확보되어야 한다. 본 고에서는 민군 겸용기술사업을 통해 국내에서 개발된 열상장비 냉각용 일체형 스터링냉동기의 기술적 특징 및 환경/신뢰성 시험 결과를 소개하고자 한다.
본 논문에서는 IR-UWB (Ultra Wideband-Impulse Radio) 시스템을 위한 선택적 가중치를 적용한 에너지 검출기와 이에 적합한 동기 방법이 제안되었다. 구현이 용이한 에너지 검출기(ED)는 IR-UWB 시스템의 수신기로 많이 사용되나, 심볼 주기로 샘플링 된 에너지를 데이터 검출에 이용하기 때문에 수신 성능이 좋지 않은 단점이 있다. 이러한 단순한 에너지 검출기의 성능을 개선하고자 가중치를 적용한 에너지 검출기가 제안 되었다. 가중치를 적용한 에너지 검출기는 데이터 검출 이전에 동기 획득과 함께 가중치의 결정이 요구된다. 한편, 에너지를 이용한 검출 방법에서 최적의 가중치는 에너지 값이 되기 때문에 동기 획득과 가중치 획득이 동시에 이루어질 수 있다. 본 논문에서는 이러한 점을 이용하여 심볼 동기와 가중치 획득을 동시에 얻는 간단한 동기 방법을 제안한다. 또한, 제안된 알고리즘에서는 잡음 레벨 이하의 구간은 에너지 누적에서 제외함으로써 기존의 WED 보다 간단하지만 낮은 SNR에서 좀 더 향상된 성능을 가진 수신기를 얻을 수 있게 된다. 제안된 알고리즘은 IEEE 802.15.4a의 프리앰블 심볼과 채널 모델을 이용해 모의실험을 통해 검증되었다.
본 논문에서는 위상/주파수 검출기을 설계시 문제가 되는 Reference Spur을 없게 하여 Low Noise를 구현할 수 있는 No Spike PFD(Phase Frequency Detector)를 제안한다. 위상동기루프의 특별한 형태로 차지 펌프 위상동기루프가 있다. 차지 펌프위상동기 루프는 일반적으로 3-state 위상/주파수 검출기를 이용한다. 이 3-state 위상/주파수 검출기는 기준 신호와 VCO 출력 신호의 위상차에 비례하는 디지털 파형으로 출력을 내보낸다. 차지 펌프 위상동기루프 그림 1 처럼 디지털 위상/주파수 검출기(PFD), 차지 펌프(CP), 루프 필터(LF), VCO로 구성된다. PFD 는 기준 신호와 VCO 에 의해 만들어진 출력 신호를 입력받아 각각의 위상과 주파수를 비교한다. 즉, 출력 신호가 기준 신호보다 느릴 때에는 출력 신호를 앞으로 당기기 위해서 up 신호를 넘겨주고, 출력 신호가 기준 신호보다 빠를 때에는 출력 신호를 뒤로 밀기 위해 down 신호를 넘겨준다. 차지 펌프(CP)의 전류를 Ip 라고 한다면, CP 에서 LF 로 흐르거나, LF에서 CP로 흐르는 전류 Ip의 평균량이 기준 신호와 VCO 출력 신호의 위상차에 비례하는 것이다.
본 논문에서는 비동기 CDMA 채널을 위한 의사 역행렬 형태의 역상관 검출기를 제안한다. 본 논문에서는 먼저 동기 CDMA 채널에서 역상관 검출기의 동작이 확산 수열로 구성된 행렬의 의사 역행렬 처리와 동일함을 보이고, 이 사실을 이용하여 역상관 검출기가 다중접속 간섭신호를 완전히 제거하는 선형 검출기들 중 최대의 신호대 잡음비를 가짐을 보인다. 그 후, 의사 역행렬 형태를 비동기 채널로 확장하여 새로운 역상관 검출기를 제안하고, QR-분해를 이용한 구현 방법에 대해 논의한다. 제안 방법은 각 사용자별로 분산적인 형태를 가지기 때문에 사용자 수 변화에 대한 검출기 계수의 갱신을 효율적으로 수행할 수 있다. 본 논문에서는 마지막으로 제안된 역상관 검출기의 성능을 비트오류율의 관점에서 분석한 후, 컴퓨터 모의 실험을 통해 기존의 정합 필터링 방법에 대한 성능 향상 정도를 확인한다.
동기식 암호통신은 암호기와 복호기 간에 암호동기를 일치시키기 위하여 동기신호를 암호문에 부가하여 전송한다. 따라서 평문통신에 비하여 데이터 전송률이 낮아지고 전송 지연이 발생하게 되는데, 특히 무선채널과 같이 열악한 환경 등에서는 동기신호의 주기적인 전송이 요구되므로 동기신호 전송 방식은 암호통신의 품질을 좌우할 수 있다. 본 논문에서는 암호통신에서 전송 대역의 추가 없이 동기신호를 전송할 수 있는 새로운 형태의 동기신호 전송 기법과 이를 이용한 재동기 방식을 제안하였다. 제안한 방법에서는 동기신호를 전송 데이터 내에 워터마크 형태로 삽입하여 전송하고, 수신기에서 추출된 워터마크로부터 동기신호를 검출한다. 영상 데이터를 대상으로 한 모의실험을 통해 제안한 워터마킹 기반의 동기신호 전송 방법이 전송률 측면에서 효율적이며, 동기 검출을 안정적으로 지원할 수 있음을 확인하였다.
음성 통신과는 달리 데이타 신호전송은 불규칙하게 순간적으로 발생하는 선로장애에 크게 영향을 받는다. 이런 장애로 인해 때로는 송수신기 사이의 동기를 잃게되어, 강제적으로 재 동기시키지 않는한. 회복이 스스로 되지 못한다. 따라서 이러한 순간적인 장애에 의한 동기 손실에 적절히 대처하기 위해 데이타통신 장비에 효율적인 검출기가 필요된다. 본 논문에서는 부속데이타 채녈이 주데이타 채널에 같이 통합되어있는 데이타 송수신기에 적당한 검출기를 설계하였다. 검출용 신호를 원래의 부속채널 데이타와 함께섞어 기존 채널의 운영에 영향이 없게 부속채널을 통해 보낸다. 데이타 전송중에 계속해서 동작하도록, 변형된 up/down 카운터를 이용한 검출방식을 사용한다. 설계된 검출기의 성능이 수학적으로 분석되었다.
본 논문에서는 위상획득과정과 동기과정에서 trade-off 현상을 향상시킨 듀얼 위상 주파수 검출기를 제안하여 차지펌프 PLL을 설계하였다. 듀얼 위상 주파수 검출기는 상승에지에서 동작하는 POSITIVE 위상 주파수 검출기와 하강에지에서 동작하는 NEGATIVE 위상 주파수 검출기로 구성되어 있다. 제안한 차지펌프는 전류뺄셈회로를 이용하여 전류 부정합을 감소시켰으며, reference spurs와 전압제어발진기의 변동을 감소시킬 수 있도록 구현하였다. 제안한 차지펌프 PLL은 0.25$\mu\textrm{m}$ CMOS 공정을 사용하여 SPICE로 시뮬레이션 하였으며, 그 결과 1.6~1.85GHz의 넓은 동기범위를 나타내었다.
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[게시일 2004년 10월 1일]
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