Suitable replacement materials for ultrathin SiO2 in deeply scaled MOSFETs such as lattice polarizable films, which have much higherpermittivities than SiO2, have bandgaps of only 3.0 to 4.0 eV. Due to these small bandgaps, the reliability of these films as a gate insulator is a serious concern. Ramped voltage, time dependent dielectric breakdown, and hot carrier effect measurements were done on 190 layers of TiO2 which were deposited through the metal-organic chemical vapor deposition of titanium tetrakis-isopropoxide (TTIP). Measurements of the high and low frequency capacitance indicate that virtually no interface state are created during constant current injection stress. The increase in leakage upon electrical stress suggests that uncharged, near-interface states may be created in the TiO2 film near the SiO2 interfacial layer that allow a tunneling current component at low bias.
Joining of $Si_3N_4$ to $Si_3N_4$ with crystallized glass solder was studied. $SiO_2-Al_2O_3-MgO$ glass with $P_2O_5$ as a crystallizing reagent was used as a solder. To improve the hish temperature toughness of joined specimen, two stage heat treatment was applied to Joined sample for the crystallization of joined layer, Two factors, i.e. thickness of soldered layer and crystallization were taken and thier effects on joining strength were investigated by a SEM-EDX observation of joined interface and bending strength both at room and elevated temperatures. Obtained results are summarized as follows: (1) Nitrogen diffused from $Si_3N_4$ to solder during the Joining process. Average amount of nitrogen in soldered layer depended on the thickness of the soldered layer and increased with decrease of the thickness. (2) Joining strength of the specimen having a thinner soldered layer was stronger than that of thicker layer. This can be mainly attributed to the difference of the nitrogen content in the soldered layer. (3) Higher content of nitrogen in solder brought forth higher viscosity of the solder. Hence the crystallization of the solder become more difficult in thinner layer of the solder than thicker one. (4) Thus, the effect of crystallization was evaluated mostly by the thicker layer specimen. Crystallization of soldered layer improved markedly the fracure strength of joining at higher temperatures than the softening temperature of glass solder.
Si nanocrystal (Si NC) memory device has several advantages such as better retention, lower operating voltage, reduced punch-through and consequently a smaller cell area, suppressed leakage current. However, the physical and electrical reasons for this behavior are not completely understood but could be related to interface states of Si NCs. In order to find out this effect, we characterized electrical properties of Si NCs embedded in a SiO$_{2}$ layer by scanning probe microscopy (SPM). The Si NCs were generated by the laser ablation method with compressed Si powder and followed by a sharpening oxidation. In this step Si NCs are capped with a thin oxide layer with the thickness of 1$\~$2 nm for isolation and the size control. The size of 51 NCs is in the range of 10$\~$50 m and the density around 10$^{11}$/cm$^{2}$ It also affects the interface states of Si NCs, resulting in the change of electrical properties. Using a conducting tip, the charge was injected directly into each Si NC, and the image contrast change and dC/dV curve shift due to the trapped charges were monitored. The results were compared with C-V characteristics of the conventional MOS capacitor structure.
$Al_2O_3$/TiC/SiC, $Al_2O_3$/SiC 및 $Al_2O_3$/TiC 복합체들을 고온가압소결로 제조하여 이들의 균열저항거동과 기계적 성질을 비교해 보았다. $Al_2O_3$에 $0.8{\mu}m$의 TiC가 30vol% 첨가된 $Al_2O_3$/TiC는 단일체 $Al_2O_3$와 비슷한 균열저항거동을 보이며 파괴인성은 전반적으로 10% 이내의 증가를 보이는데 그쳤지만 강도는 약 30% 증가하였다. $Al_2O_3$에 $3{\mu}m$ SiC가 30vol% 첨가된 $Al_2O_3$/SiC는 SiC 입자의 균열 접속으로 인해 증가하는 균열저항거동을 뚜렷이 보이면서 파괴인성이 긴 균열에서 약 75% 증가하였으나 강도는 다소 감소했다. $Al_2O_3$/TiC에 SiC 입자가 30 vol% 첨가된 $Al_2O_3$/TiC/SiC 복합체의 경우 단일체 $Al_2O_3$에 비해 긴 균열 거리에서 파괴인성이 50% 이상 증가된 6.6 MP${\cdot}\sqrt{m}$에 이르렀으며 강도 값도 약 20% 상승하였다. 그러나 큰 SiC 입자의 첨가로 인해 TiC 입자만 첨가된 $Al_2O_3$/TiC 복합체보다는 강도가 다소 낮았다. 또한 SiC 입자만 첨가된 $Al_2O_3$/SiC 복합체보다는 파괴인성이 다소 낮았는데, 이는 작은 TiC 입자들이 SiC 입계를 거칠게 만들어 균열접속을 일으키는 SiC 입자의 뽑힘 현상을 방해하였기 때문이다.
Gong, Y.F.;Song, T.J.;Kim, Han S.;Kwak, J.H.;De Cooman, B.C.
Corrosion Science and Technology
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제11권1호
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pp.1-8
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2012
The development of martensitic grades which can be processed in continuous galvanizing lines requires the reduction of the oxides formed on the steel during the hot dip process. This reduction mechanism was investigated in detail by means of High Resolution Transmission Electron Microscopy (HR-TEM) of cross-sectional samples. Annealing of a martensitic steel in a 10% $H_2+N_2$ atmosphere with the dew point of $-35^{\circ}C$ resulted in the formation of a thin $_{C-X}MnO.SiO_{2}$ (x>1) oxide film and amorphous $_{a-X}MnO.SiO_{2}$ oxide particles on the surface. During the hot dip galvanizing in Zn-0.13%Al, the thin $_{C-X}MnO.SiO_{2}$ (x>1) oxide film was reduced by the Al. The $_{a-X}MnO.SiO_{2}$ (x<0.9) and $a-SiO_{2}$ oxides however remained embedded in the Zn coating close to the steel/coating interface. No $Fe_{2}Al_{5-X}Zn_{X}$ inhibition layer formation was observed. During hot dip galvanizing in Zn-0.20%Al, the $_{C-X}MnO.SiO_{2}$ (x>1) oxide film was also reduced and the amorphous $_{a-X}MnO.SiO_{2}$ and $a-SiO_{2}$ particles were embedded in the $Fe_{2}Al_{5-X}Zn_{X}$ inhibition layer formed at the steel/coating interface during hot dipping. The results clearly show that Al in the liquid Zn bath can reduce the crystalline $_{C-X}MnO.SiO_{2}$ (x>1) oxides but not the amorphous $_{a-X}MnO.SiO_{2}$ (x<0.9) and $a-SiO_{2}$ oxides. These oxides remain embedded in the Zn layer or in the inhibition layer, making it possible to apply a Zn or Zn-alloy coating on martensitic steel by hot dipping. The hot dipping process was also found to deteriorate the mechanical properties, independently of the Zn bath composition.
Annealing of $Cu(B)/Ti/SiO_2$ in vacuum has been carried out to investigate the effects of Ti underlayer on microstructure in $Cu(B)/Ti/SiO_2$ structures. For comparison, $Cu(B)/Ti/SiO_2$ structures was also annealed in vacuum. Three different temperature dependence of Cu growth can be seen in $Cu(B)/Ti/SiO_2$; B precipitates- pinned grain growth, abnormal grain growth, normal grain growth. The Ti underlayer having a strong affinity for B atoms reacts with the out-diffused B to the Ti surface and forms titanium boride at the Cu-Ti interface. The formation of titanium boride acts as a sink for the out-diffusion of B atoms. The depletion of boron in grain boundaries of Cu films, as results of the rapid diffusion of B along the grain boundaries and the insufficient segregation of B to the grain boundaries, induces grain boundaries to migrate and causes the abnormal grain growth. The increased bulk diffusion coefficient of B within Cu grains can be responsible for the normal grain growth occurring in the annealed $Cu(B)/Ti/SiO_2\;at\;600^{\circ}C$. In contrast, the $Cu/SiO_2$ structures show only the abnormal growth of grains and their sizes increasing as the temperature increases above $400^{\circ}C$.
본 논문은 4세대 VNAND 공정으로 만들어진 고전압 SiO2 절연층 nMOSFET의 n+ 및 p+ poly-Si 게이트에서의 positive bias temperature instability(PBTI) 열화에 대해 비교하고 각각의 메커니즘에 대해 분석한다. 게이트 전극 물질의 차이로 인한 절연층의 전계 차이 때문에 n+/nMOSFET의 열화가 p+/nMOSFET의 열화보다 더 클 것이라는 예상과 다르게 오히려 p+/nMOSFET의 열화가 더 크게 측정되었다. 원인을 분석하기 위해 각각의 경우에 대해 interface state와 oxide charge를 각각 추출하였고, 캐리어 분리 기법으로 전하의 주입과 포획 메커니즘을 분석하였다. 그 결과, p+ poly-Si 게이트에 의한 정공 주입 및 포획이 p+/nMOSFET의 열화를 가속시킴을 확인하였다.
CF4 이온빔보조증착법으로 굴절률이 유리보다 낮은 SiOxFy 박막을 제작하고 광학적, 구조적 및 화학적 특성을 연구하였다. End-Hall 이온총의 양극전압의 간소에 따라 SiOxFy 박막의 굴절률은 1.455까지 변하였으며, 이온빔 전류밀도의 증가에 따라서 굴절률은 1.462에서 1.430까지 변하였다. XPS와 FT-IR 분석으로부터 SiOxFy 박막의 F양이 증가함에 따라 Si-O 결합은 파수가 높은 쪽으로 이동하였고, F이 약 8.5at.%인 SiOxFy 박막은 OH 결합이 매우 감소하였으여, 박막 표면의 F이 H2O와 결합하여 탈착되는 것을 알았다. SiOxFy 박막의 응력은 0.3GPa 이하의 압축응력이었으며, 결정구조는 비정질이었다. SiOxFy 박막의 응용으로서 SiOxFy 박막과 흡수층 Si 박막을 이용하여 2층 반사방지막을 제작하였다.
Hot carrier effects as a function of bias stress time and bias stress consitions were syste-matically investigated in p-channel poly-Si TFT s fabricated on the quartz substrate. The device degradation was observed for the negative bias stress, while improvement of electrical characteristic except for subthreshold slope was observed for the positive bias stress. It was found that these results were related to the hot-carrier injection into the gate oxide and interface states at the poly-Si/$SiO_2$interface rather than defects states generation within the poly-Si active layer under bias stress.
In the structure of ZnO/nip-SiC: H/metal substrate amorphous silicon (a-Si:H) solar cells, the effects of inserting a rear textured ZnO in the p-SiC:H/metal interface and a graded bandgap buffer layer in the i/p-SiC:H have been analysed by computer simulation. The incident light was taken to have an intensity of $100mW/cm^2$(AM-1). The thickness of the a-Si:H n, ${\delta}$-doped a-SiC:H p, and buffer layers was assumed to be $200{\AA},\;66{\AA}$, and $80{\AA}$, respectively. The scattering coefficients of the front and back ZnO were taken to be 0.2 and 0.7, respectively. Inserting the rear buffer layer significantly increases the open circuit voltage($V_{oc}$) due to reduction of the i/p interface recombination rate. The use of textured ZnO markedly improves collection efficiency in the long wavelengths( above ${\sim}550nm$ ) by back scattering and light confinement effects, resulting in dramatic enhancement of the short circuit current density($J_{sc}$).
By using the rear buffer and textured ZnO, the i-layer thickness of the ceil for obtaining the maximum efficiency becomes thinner(${\sim}2500{\AA}$). From these results, it is concluded that the use of textured ZnO and buffer layer at the backside of the ceil is very effective for enhancing the conversion efficiency and reducing the degradation of a-Si:H pin-type solar cells.
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[게시일 2004년 10월 1일]
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