• ETRI Journal
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• 제27권6호
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• pp.651-665
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• 2005

This paper proposes a generic security architecture designed for a multidomain and multiservice network based on programmable networks. The multiservice network allows users of an IP network to run programmable services using programmable nodes located in the architecture of the network. The programmable nodes execute codes to process active packets, which can carry user data and control information. The multiservice network model defined here considers the more pragmatic trends in programmable networks. In this scenario, new security risks that do not appear in traditional IP networks become visible. These new risks are as a result of the execution of code in the programmable nodes and the processing of the active packets. The proposed security architecture is based on symmetric cryptography in the critical process, combined with an efficient manner of distributing the symmetric keys. Another important contribution has been to scale the security architecture to a multidomain scenario in a single and efficient way.

• 제어로봇시스템학회:학술대회논문집
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• 제어로봇시스템학회 2004년도 ICCAS
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• pp.926-931
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• 2004

In this paper, we proposed security management architecture that combines programmable network technology and policy based network management technology to manage efficiently heterogeneous security systems. By using proposed security management architecture, a security administrator can manage heterogeneous security systems using security policy, which is automatically translated into a programmable security policy and executed on programmable middleware of security system. In addition, programmable middleware that has the features of programmable network can reduce excessive management traffic. We showed that the programmable middleware could reduce the load of management traffic by comparing processing time between the proposed architecture and PBNM architecture.

• 한국통신학회논문지
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• 제28권10C호
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• pp.1033-1044
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• 2003

본 논문에서는 이기종의 보안 장비를 보다 효율적으로 관리할 수 있는 보안 관리 구조와 관리 트래픽의 부하를 줄일 수 있는 프로그래머블 미들웨어를 제안하였다. 제안된 보안 관리 구조는 정책 기반 네트워크 관리 (Policy Based Network Management: PBNM) 구조에 프로그래머블 네트워크 기법을 접목한 것으로, 다양한 이기종의 보안 장비를 보안 정책을 통해 관리할 수 있으며, 보안 장비 간 연동을 제공한다. 또한, 미들웨어에서 보안 정책을 실행 가능한 형태로 변환해 줌으로써 관리상의 편이성을 제공하고 정책 서버의 부하를 줄일 수 있다. 본 논문에서는 제안된 구조와 PBNM 구조에서의 정책적용 및 변환시간과 메시지 전달시간을 비교함으로써 프로그래머블 미들웨어가 관리 트래픽의 부하를 줄일 수 있다는 것을 검증하였다.

• 한국정보처리학회:학술대회논문집
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• 한국정보처리학회 2012년도 춘계학술발표대회
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• pp.590-593
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• 2012

현재 인터넷은 하드웨어 종속적인 특징을 가지고 있어 급변하는 환경에 적응하기 힘들다. 이러한 제약사항은 관련 산업 발전을 더디게 하고 있다. 이와 같은 네트워크 환경에서 산업 발전을 위하여 네트워크 인프라에 유연성을 제공할 수 있는 기술의 개발이 필요하다. 그러한 문제를 해결하기 위해 오픈프로토콜인 OpenFlow의 Programmable Network의 특성을 이용하여 네트워크 가상화를 구현하였으며, 응용 서비스별 Virtual Network를 제공하는 방안에 대해 연구하였다. 이를 위하여 OpenFlow 기반의 Programmable Network를 구축하였으며, 동적으로 구성이 가능한 네트워크에서 가상화를 제공하기 위해 VNAPI를 개발하였다. 또한, VNAPI를 통하여 신뢰성 있고 효율적인 응용 서비스의 전달을 위하여 Virtual Network Topology에 대한 설계를 같이 수행하였다.

• 한국멀티미디어학회논문지
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• 제17권3호
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• pp.324-332
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• 2014

This paper presents a programmable System-On-a-chip for various embedded applications that need Neural Network computations. The system is fully implemented into Field-Programmable Gate Array (FPGA) based prototyping platform. The SoC consists of an embedded processor core and a reconfigurable hardware accelerator for neural computations. The performance of the SoC is evaluated using real image processing applications, such as optical character recognition (OCR) system.

• 제어로봇시스템학회:학술대회논문집
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• 제어로봇시스템학회 1989년도 한국자동제어학술회의논문집; Seoul, Korea; 27-28 Oct. 1989
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• pp.520-523
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• 1989

MAP(Manufacturing Automation Protocol), Network Protocol for FA has 7 Layer Structure of OSI. Being an Application Layer Protocol for Communication Interfaced with the Actual Programmable Devices, MMS(Manufacturing Message Specification) Consists of Three Factors of Services, Interfaces, and Protocol. For Details, It Classifies with the Followings ; Connection/Context Management, Remote Variable Access, Semaphore Management, File transfer and Management, Program UP/DOWN Load, Remote Program Fxecution. In this Paper Designing MAP Network Station of Programmable Device, we Analyze the Protocol of MMS, and Realize the State Diagram of each Services and Propose the Model of MMS Function Call Instructions.

• 전기학회논문지
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• 제58권10호
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• pp.2059-2063
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• 2009

This paper presents a programmable System-On-a-chip (SoC) for various embedded smart applications that need Neural Network computations. The system is fully implemented into a prototyping platform based on Field Programmable Gate Array (FPGA). The SoC consists of an embedded processor core and a reconfigurable hardware accelerator for neural computations. The performance of the SoC is evaluated using a real image processing application, an optical character recognition (OCR) system.

• 한국정보통신학회논문지
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• 제10권12호
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• pp.2166-2172
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• 2006

인터넷의 활성화와 인트라넷 구축을 통한 그룹웨어의 확산과 함께 LAM의 초고속화 기술이 급진적으로 발전되어 왔으며, 이러한 발전은 고품질의 실시간 서비스에 대한 사용자의 요구에 의해 새로운 형태의 통합네트워크 형태로 발전되어 가고 있다. 통합네트워크는 데이터, 음성 및 영상 응용 서비스가 함께 제공될 수 있는 통신망으로서 궁극적으로는 통합된 단일 네트워크 플랫폼으로 발전해 갈 것으로 보인다. 본 논문에서는 IP기반의 통합서비스를 제공하기 위하여 실질적인 GoS 제공 기술, 프로그래머블 스위치 네트워크 구조 기술과 통합 호 제어 처리 기술을 포함하는 차세대 통합 LAN에 관한 연구결과를 제시하고자 한다.

• 제어로봇시스템학회:학술대회논문집
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• 제어로봇시스템학회 1988년도 한국자동제어학술회의논문집(국내학술편); 한국전력공사연수원, 서울; 21-22 Oct. 1988
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• pp.396-400
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• 1988

This paper described network model system for FA with programmable devices such as PLC, CNC, Robot which basis on the MAP protocol and constructed with the broadband 1OMbps cables. Developed systems can comniunicate and control with programmable devices. Such systems we called are Remote PLC Control System, Remote CNC Control System, Remote Robot Control System.

• International Journal of Control, Automation, and Systems
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• 제4권5호
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• pp.567-574
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• 2006

This paper presents the hardware implementation of a neural network controller for a nonlinear system with a micro-controller unit (MCU) and a field programmable gate array (FPGA) chip. As an on-line learning algorithm of a neural network, the reference compensation technique has been implemented on an MCU, while PID controllers with other functions such as counters and PWM generators are implemented on an FPGA chip. Interface between an MCU and a field programmable gate array (FPGA) chip has been developed to complete hardware implementation of a neural controller. The developed neural control hardware has been tested for balancing the inverted pendulum while controlling a desired trajectory of a cart as a nonlinear system.