본 연구에서는 인산 용액 하에서 2차 양극 산화 기법에 의해 제작된 양극 산화 알루미나 기판 상에 최대 13 nm 두께의 얇은 니켈 박막을 증착하며 증착 시 박막 두께에 따라 감소하는 박막의 저항 변화를 살펴보았다. 양극 산화 알루미나 막 표면에 존재하는 미세 기공 구조를 따라 증착된 니켈 박막 역시 다공 구조의 박막으로 성장하게 되며 증착된 박막의 두께 범위 내에서 박막의 저항은 $150k{\Omega}$ 이상의 값을 보이면서 박막 두께에 따른 저항의 감소가 매우 천천히 일어나는 것을 확인할 수 있었다. 측정된 저항 값은 기존에 보고된 균일한 기판 상에 증착된 동일 두께의 니켈 박막에 비해 매우 큼을 볼 수 있었으며 기판 표면에 존재하는 기공 구조에 의해 핵자가 형성될 수 있는 표면 면적 비가 박막 성장을 설명하는 스미기(percolation) 현상이론에서 예측하는 임계 값보다 매우 적어 미세 기공에 의해 박막의 성장과 함께 나타나는 전자 전도 채널의 형성이 저해됨으로 이해될 수 있다. 이와 함께 기존의 박막 두께에 따른 비저항 모델과 비교해 보았을 때 미세 기공의 경계에서 나타나는 전자 산란 현상 역시 박막저항의 증가에 기여함을 알 수 있다.
In this paper, a nickel silicide technology with post-silicidation annealing effect for thin film SOI devices is investigated in detail. Although lower resistivity Ni silicide can be easily obtained at low forming temperature, poor thermal stability and changing of characteristic are serious problems during the post silicidation annealing like ILD (Inter Layer Dielectric) deposition or metallization. So these effects are observed as deposited Ni thickness differently on As doped SOI (Si film 30nm). Especially, the sheet resistance of Ni thickness deposited 20nm was lower than 30nm before the post silicidation annealing. But after the post silicidation annealing, the sheet resistance was changed. Therefore, in thin film SOI MOSFETs or Ni-FUSI technology that the Si film is less than 50nm, it is important to decide the thickness of deposited Ni in order to avoid forming high resistivity silicide.
그래핀은 저차원 구조에서 기인하는 우수한 특성으로 인해 슈퍼커패시터의 전극소재로 응용이 가능한 소재이다. 본 연구에서는 2차원 구조인 그래핀의 비 표면적 향상을 위해 다공성 니켈 나노구조체 표면에 열 화학기상증착법과 마이크로웨이브 플라즈마 화학기상증착법을 이용하여 3차원의 그래핀을 합성하였다. 주사전자현미경, 라만 분광법, X-선 광전자 분광법을 통해 합성된 그래핀의 구조적, 화학적 특성을 분석한 결과, 3차원 구조의 우수한 결정성을 지니는 다중층 그래핀이 다양한 기판 위에 합성된 것을 확인할 수 있었다.
Kim, Keon-Soo;Kim, Dong-Woo;Kim, Doo-Hyun;Kim, Hyung-Jin;Lee, Dong-Hyuck;Hong, Mun-Pyo
한국정보디스플레이학회:학술대회논문집
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한국정보디스플레이학회 2008년도 International Meeting on Information Display
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pp.270-271
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2008
The contact resistance between organic semiconductor and source-drain electrode in Bottom Contact Organic Thin-Film Transistors (BCOTFTs) can be effectively reduced by metal oxide/molybdenum double layer structure; metal oxide layers including nickel oxide (NiOx/Mo) and moly oxide(MoOx) under molybdenum work as a high performance carrier injection layer. Step profiles of source-drain electrode can be easily achieved by simultaneous etching of the double layers using the difference etching rate between metal oxides and metal layers.
Transactions on Electrical and Electronic Materials
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제16권4호
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pp.187-189
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2015
A charge-trap flash (CTF) thin film transistor (TFT) memory is proposed at a low-temperature process (≤ 450℃). The memory cell consists of a sputtered oxide-nitride-oxide (ONO) gate dielectric and Schottky barrier (SB) source/drain (S/D) junctions using nickel silicide. These components enable the ultra-low-temperature process to be successfully achieved with the ONO gate stacks that have a substrate temperature of room temperature and S/D junctions that have an annealing temperature of 200℃. The silicidation process was optimized by measuring the electrical characteristics of the Ni-silicided Schottky diodes. As a result, the Ion/Ioff current ratio is about 1.4×105 and the subthreshold swing and field effect mobility are 0.42 V/dec and 14 cm2/V·s at a drain voltage of −1 V, respectively.
열증착법으로 제작한 강자성체인 철박막에서 전류와 자기장이 이루는 각도의 변화에 따른 자기저항의 변화를 관찰하였다. 이방상자기저항현상에서 철박막인 경우에는 박막면이 중간자화용이축이므로 PMR 에서 NMR로의 전이가 $34^{\circ}$에서 일어나며 전류가 박막면에 수직인 현상에서는 자기저항피크간격이 니켈박막보다 더 크게 나타나지만 자기저항피크간격의 증가율은 비슷한 경향성을 보인다.
Amorphous (a-Si) films were epitaxially crystallized on a very thin large-grained poly-Si seed layer by a silicide-enhanced rapid thermal annealing (SERTA) process. The poly-Si seed layer contained a small amount of nickel silicide which can enhance crystallization of the upper layer of the a-Si film at lower temperature. A 5-nm thick poly-Si seed layer was then prepared by the crystallization of an a-Si film using the vapor-induced crystallization process in a $NiCl_2$ environment. After removing surface oxide on the seed layer, a 45-nm thick a-Si film was deposited on the poly-Si seed layer by hot-wire chemical vapor deposition at $200^{\circ}C$. The epitaxial crystallization of the top a-Si layer was performed by the rapid thermal annealing (RTA) process at $730^{\circ}C$ for 5 min in Ar as an ambient atmosphere. Considering the needle-like grains as well as the crystallization temperature of the top layer as produced by the SERTA process, it was thought that the top a-Si layer was epitaxially crystallized with the help of $NiSi_2$ precipitates that originated from the poly-Si seed layer. The crystallinity of the SERTA processed poly-Si thin films was better than the other crystallization process, due to the high-temperature RTA process. The Ni concentration in the poly-Si film fabricated by the SERTA process was reduced to $1{\times}10^{18}cm^{-3}$. The maximum field-effect mobility and substrate swing of the p-channel poly-Si thin-film transistors (TFTs) using the poly-Si film prepared by the SERTA process were $85cm^2/V{\cdot}s$ and 1.23 V/decade at $V_{ds}=-3V$, respectively. The off current was little increased under reverse bias from $1.0{\times}10^{-11}$ A. Our results showed that the SERTA process is a promising technology for high quality poly-Si film, which enables the fabrication of high mobility TFTs. In addition, it is expected that poly-Si TFTs with low leakage current can be fabricated with more precise experiments.
Ni oxide thin films with thermal sensitivity superior to Pt and Ni thin films were formed through annealing treatment after Ni thin films were deposited by a r.f. magnetron sputtering method. Resistivity values of Ni oxide thin films were in the range of $10.5{\mu}{\Omega}cm$ to $2.84{\times}10^{4}{\mu}{\Omega}cm$ according to the degree of Ni oxidation. Also temperature coefficient of resistance(TCR) values of Ni oxide thin films depended on the degree of Ni oxidation from 2,188 ppm/$^{\circ}C$ to 5,630 ppm/$^{\circ}C$ in the temperature range of $0{\sim}150^{\circ}C$. Because of the high linear TCR and resistivity characteristics, Ni oxide thin films exhibit much higher sensitivity to flow and temperature changes than pure Ni thin films and Pt thin films.
Carrier-selective contacts (CSCs) solar cells are considerably attractive on highly efficient crystalline silicon heterojunction (SHJ) solar cells due to their advantages of high thermal tolerance and the simple fabrication process. CSCs solar cells require a hole selective contact (HSC) layer that selectively collects only holes. In order to selectively collect holes, it must have a work function characteristic of 5.0 eV or more when contacted with n-type Si. The VOx, NiOx, and CuIx thin films were fabricated and analyzed respectively to confirm their potential usage as a hole-selective contact (HSC) layer. All thin films showed characteristics of band-gap engergy > 3.0 eV, work function > 5.0 eV and minority carrier lifetime > 1.5 ms.
Nickel oxide (NiO) thin films were deposited on Si(100) substrates at room temperature by RF magnetron sputtering from a NiO target. The effects of plasma gas and RF power on the crystallographic orientation and surface morphology of the NiO films were investigated. X-ray diffraction (XRD), field emission scanning electron microscopy (FE-SEM) and atomic force microscopy (AFM) were employed to characterize the deposited film. It was found that the type of plasma gases affected the crystallographic orientation, deposition rate, surface morphology, and crystallinity of NiO films. Highly crystalline NiO films with (100) orientation were obtained when it was deposited under Ar atmosphere. On the other hand, (l11)-oriented NiO films with poor crystallinity were deposited in $O_2$. Also, the increase in RF power resulted in not only higher deposition rate, larger grain size, and rougher surface but also higher crystallinity of NiO films.
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[게시일 2004년 10월 1일]
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