Kim, Hyeon-Seong;Lee, Seong-U;Kim, Jeong-Jun;Kim, Tae;Yu, Gi-Yeong
Journal of KIISE:Computer Systems and Theory
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제26권4호
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pp.406-419
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1999
RSA와 같은 공개키 암호시스템(public-key cryptography system)에서는 512 비트 또는 그 이상 큰수의 모듈러 곱셈 연산을 수행하여야한다. 본 논문에서는 Montgomery 알고리즘을 이용하여 모듈러 곱셈을 수행하는 두 가지의 고정-크기 선형 시스톨릭 어레이를 설계하고 분석한다. 제안된 임의의 고정-크기 선형 시스톨릭 어레이와 파이프라인된 고정-크기 선형 시스톨릭 어레이는 최적의 문제-크기 선형 시스톨릭 어레이로부터 LPGS(Locally Parallel Globally Sequential)분할방법을 적용하여 설계한다. VHDL 시뮬레이션 결과, 밴드이 크기를 4로 하여 분할 시 문제-크기 어레이와 비교하면 수행시간의 지연이 없었으며,어레이의 크기도 1/4로 줄일 수 있었다. 제안된 시스톨릭 어레이는 크기에 제한을 갖는 스마트카드 등에 이용될수 있을 것이다.
A novel mode of parallel operation of 3-phase AC-DC flyback converter for power factor correction along with tight regulation was recently analyzed and presented. The advantage of the proposed converter does not require expensive high voltage and high current devices that are normally needed in popular boost type 3-phase AC-DC flyback converter is provided for control purposes and also experimental results are included to confirm the validity of the analysis.
Proceedings of the Korean Information Science Society Conference
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한국정보과학회 2004년도 봄 학술발표논문집 Vol.31 No.1 (B)
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pp.394-396
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2004
원자력 산업계에서는 원전 MMIS(Man-Machine Interface System)의 디지털 기술 적용을 위해 많은 노력을 기울이고 있고, 특히 원자력 산업의 특수성인 안전성 확보에 필요한 개발기준과 규제방법 정립에 많은 연구가 수행되고 있다. 또한 디지털 MMIS의 핵심기반기술인 고 신뢰도 소프트웨어 개발 방법론이 확립되지 못하여 소프트웨어 공통모드고장 문제, 정량적인 소프트웨어 신뢰도 보장 문제 등이 현안으로 제기되고 있다. 이와 같이 원전 MMIS의 디지털화를 성공하기 위해서는 소프트웨어의 고 신뢰도 확보가 관건이며, 고 신뢰도를 확보하기 위한 소프트웨어 개발 방법론의 정립이 절실히 요구되고 있다. 본 논문에서는 원전 소프트웨어 개발에 적응되는 규제지침을 분석하고, 일체형원자로(SMART, System-integrated Modular Advanced ReacTor) MMIS 소프트웨어 개발에 적응될 소프트웨어 개발 방법론을 제시한다.
This paper describes what an operational change detection tool requires and the software which was designed and developed according to the requirements. The top requirement for the application of the software to operational change detection was identified: minimization of false detections, missing detections and operational cost. In order to meet such a requirement, the software was designed with the concept that the ultimate decision and isolation of changes must be performed manually by visual interpretation and all automatic algorithms and/or visualization techniques must be defined as support functions. In addition, the modular structure of the proposed software enables the addition of a new support function with the minimum development cost and minimum change of the operational environment.
In this paper, a RAID system is modeled and simulated by using the DEVS formalism. The RAID system interacts with a host system by using the high-speed Fibre channel protocol and stores data in an array of IDE disks. The DAVS formalism specifies discrete event systems in a hierarchical, modular manner. The RAID system model is composed of three units: primary-PCI unit, secondary-PCI unit and MCU unit. The primary-PCI unit interfaces with the host system and I/O data caches. The secondary-PCI unit includes disks. The MCU unit controls overall system. The control algorithm of MCU and PCI transactions are analyzed and modeled, From the analysis of simulation events, we can conclude that the proposed model satisfies given requirements.
최근 대용량 전력 전송 시스템에서 모듈형 다단 컨버터(Modular Multilevel Converter; MMC)를 이용한 고압 직류(high voltage DC; HVDC) 송전 시스템이 각광받고 있다. 일반적으로, 전압형 컨버터는 AC 단출력전압 합성 방법에 따라 AC 단 전압 사용률이 달라지며, MMC 시스템에 있어서도 마찬가지이다. 따라서, HVDC 송전시스템의 DC 단의 용량이 정해져 있는 경우에도 출력전압 합성 방법에 따라 AC 단으로 공급 가능한 최대 무효전력의 크기를 변화시킬 수 있다. 본 논문에서는 대표적인 전압 변조 방식에 따른 암 에너지 맥동을 수학적으로 분석하였으며, 이를 MMC의 실제 스케일의 시뮬레이션으로 검증하였다.
Kwon, Man Jae;Jang, Eunsu;Ahn, Hyo Min;Lee, Byoung Kuk
Proceedings of the KIPE Conference
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전력전자학회 2019년도 전력전자학술대회
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pp.236-238
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2019
본 논문에서는 반도체 세정용 플라즈마 발생장치의 인버터 구성에 따른 손실을 비교 및 분석한다. 플라즈마를 유지하기 위해 DC-AC 인버터는 고전압을 출력해야 한다. 따라서 고효율 동작을 위해 각 인버터 구성에 따른 trade-off를 고려한 회로 선정이 필요하다. 이를 위해 20 kW 급 시뮬레이션을 수행하고 이를 토대로 전력 반도체 소자 및 자성체에서 발생하는 손실, 부피, 가격 등 각 인버터 구성에 따른 장단점 분석을 진행한다. 또한 분석 결과를 통해 플라즈마 발생자치에 적합한 인버터 구성 방식을 제시한다.
A high boost dc-dc converter based on the switched-inductor cell (SL-cell) is suggested in this paper. The suggested converter can provide a high voltage gain that is more than 6. Moreover, the voltage gain can be easily increased by extending a SL cell or a modular voltage boost stage. This paper shows the key waveforms, the operating principles at the continuous conduction mode (CCM), and a comparison between the suggested converter and the other non-isolated converters. In addition, the extension of the suggested converter is presented. The simulation results were shown to reconfirm the theoretical analysis.
Two-dimensional torus network nodes are typically interconnected using XY routing algorithm for transmitting a packet from a source node to a destination node. In XY routing, if all the paths are used efficiently, the throughput and latency can be improved. In this paper, to utilize all the paths efficiently, we propose a novel binary optical routing algorithm (BORA) to improve the throughput and latency. The throughput is calculated according to the injection rate and number of packets received at the destination. The XY routing algorithm and proposed BORA are implemented using objective modular network testbed in C++ simulation software and the results are analyzed and compared. In this paper, the simulation results show that the network latency reduces to 50% while using the proposed algorithm; moreover, the throughput is also improved.
This paper includes a general version of Bessel multipliers in Hilbert C∗-modules. In fact, by combining analysis, an operator on the standard Hilbert C∗-module and synthesis, we reach so-called generalized Bessel multipliers. Because of their importance for applications, we are interested to determine cases when generalized multipliers are invertible. We investigate some necessary or sufficient conditions for the invertibility of such operators and also we look at which perturbation of parameters preserve the invertibility of them. Subsequently, our attention is on how to express the inverse of an invertible generalized frame multiplier as a multiplier. In fact, we show that for all frames, the inverse of any invertible frame multiplier with an invertible symbol can always be represented as a multiplier with an invertible symbol and appropriate dual frames of the given ones.
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[게시일 2004년 10월 1일]
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