• 제목/요약/키워드: carrier-frequency offset

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추가적인 부궤환 루프를 가지는 연속 미세 조절 위상 고정루프 (A Continuous Fine-Tuning Phase Locked Loop with Additional Negative Feedback Loop)

  • 최영식
    • 한국정보통신학회논문지
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    • 제20권4호
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    • pp.811-818
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    • 2016
  • 추가적인 부궤환 루프를 가지는 연속 미세 조절 위상 고정루프를 소개하였다. 위상고정루프가 위상이 고정되지 않았을 때 위상고정루프는 연속적인 밴드 선택 루프를 통하여 빠르게 위상을 고정시키는 특성을 가지고 있다. 위상고정루프가 고정 상태에 다다랐을 때 밴드 폭은 미세한 루프를 통해서 좁아진다. 추가적인 부궤환 루프는 안정성과 위상여유 성능을 향상시킨다. 0.18um CMOS 공정으로 제작한 위상고정루프의 결과 측정은 위상 잡음이 742.8MHz 캐리어 주파수로부터 2MHz 오프셋 주파수에서 -109.6dBc/Hz을 보여준다.

약 신호 환경에서의 Assisted-Galileo 신호 획득 성능 분석 (Performance Analysis of Assisted-Galileo Signal Acquisition Under Weak Signal Environment)

  • 임정민;박지원;성태경
    • 제어로봇시스템학회논문지
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    • 제19권7호
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    • pp.646-652
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    • 2013
  • EU's Galileo project is a market-based GNSS (Global Navigation Satellite System) that is under development. It is expected that Galileo will provide the positioning services based on new technologies in 2020s. Because Galileo E1 signal for OS (Open Service) shares the same center frequency with GPS L1 C/A signal, CBOC (Composite Binary Offset Carrier) modulation scheme is used in the E1 signal to guarantee interoperability between two systems. With E1 signal consisting of a data channel and a pilot channel at the same frequency band, there exist several options in designing signal acquisition for Assisted-Galileo receivers. Furthermore, compared to SNR worksheet of Assisted-GPS, some factors should be examined in Assisted-Galileo due to different correlation profile and code length of E1 signal. This paper presents SNR worksheets of Galileo E1 signals in E1-B and E1-C channel. Three implementation losses that are quite different from GPS are mainly analyzed in establishing SNR worksheets. In the worksheet, hybrid long integration of 1.5s is considered to acquire weak signal less than -150dBm. Simulation results show that the final SNR of E1-B signal with -150dBm is 19.4dB and that of E1-C signal is 25.2dB. Comparison of relative computation shows that E1-B channel is more profitable to acquire the strongest signal in weak signal environment. With information from the first satellite signal acquisition, fast acquisition of the weak signal around -155dBm can be performed with E1-C signal in the subsequent satellites.

Ku-Band용 위상 고정 고조파 발진기 설계 (Design of Ku-Band Phase Locked Harmonic Oscillator)

  • 이건준;김영식
    • 한국전자파학회논문지
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    • 제16권1호
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    • pp.49-55
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    • 2005
  • 본 논문에서는 아날로그 위상 고정 루프(PLL: Phase Locked Loop)를 이용한 무선 LAN(Wireless Local Area Network)용 위상 고정 고조파 발진기(PLHO: Phase Locked Harmonic Oscillator)를 설계 및 제작하였다. 이 고조파 발진기는 Ring 공진기, 주파수 동조를 위한 바랙터 다이오드 그리고 위상 고정 루프 회로로 구성된다. 발진기의 8.5 GHz의 기본 주파수는 위상 고정 루프를 위한 귀환 신호로 이용되고 17.0 GHz의 2차 고조파는 출력으로 이용되므로 위상 고정 시스템에서 위상 비교를 위한 주파수 분배기를 한 단계 줄일 수 있다. 위상 비교기로는 샘플링 위상 검출기(SPD: Sampling Phase Detector)를 사용하여 위상고정 루프 회로를 간단히 하였다. 위상고정 고조파 발진기의 발진 출력은 17.0 GHz에서 2.17 dBm, 기본 주파수와 3차 고조파 억압 특성은 각각 -31.5 dBc, -29.0 dBc이다. 위상잡음은 각각 -87.6 dBc/Hz at 1 kHz와 -95.4 dBc/Hz at 10 kHz이다.

유비쿼터스 센서 네트워크를 위한 IEEE 802.15.4 LR-WPAN 2.4GHz 베이스 밴드 설계 및 검증 (Design and Verification of IEEE 802.15.4 LR-WPAN 2.4GHz Base-band for Ubiquitous Sensor Network)

  • 이승열;김동순;김현식;정덕진
    • 대한전자공학회논문지TC
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    • 제43권1호
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    • pp.49-56
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    • 2006
  • 본 논문에서는 2003년 표준화된 저속, 저전력, 저가의 근거리 무선 통신망(WPAN, Wireless Personal Area Network)기술로서 유비쿼터스 센서 네트워크를 위한 IEEE 802.15.4 LR-WPAN 표준의 2.4GHz 대역의 물리계층에 대한 설계 및 검증에 관해 기술하였다. IEEE 802.15.4 LR-WPAN 표준에서 제시하는 주파수 tolerance 인 ${\pm}40ppm$을 만족하는 반송파 주파수 옵셋 보상 방법과 다양한 유비쿼터스 센서 네트워크 환경에 적절하게 반응하기 위한 임계값 재 설정 방법의 적응형 정합 필터에 기반한 심볼 동기부를 설계하였다. 본 논문에서 제안한 방법에 의해 동기를 위한 연산량이 i, q 위상에서 각각 1/l6으로 감소가 되었으며, 약 0.5dB의 성능 향상을 얻을 수 있었다. 하드웨어 구현은 verilog HDL을 사용하였고, FGPA를 이용한 테스트 보드를 통해 성능 검증을 수행하였다.

High-Order QAM에 적합한 반송파 동기회로 설계 - II부. 자동모드전환시점 검출기 및 평균모드전환회로를 적용한 Gear-Shift PLL 설계 및 성능평가 (Design of Carrier Recovery Circuit for High-Order QAM - Part II : Performance Analysis and Design of the Gear-shift PLL with ATC(Automatic Transfer-mode Controller) and Average-mode-change Circuit)

  • 김기윤;김신재;최형진
    • 대한전자공학회논문지TC
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    • 제38권4호
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    • pp.18-26
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    • 2001
  • 본 논문에서는 극성 판단(Polarity Decision) PD를 이용하여 모드 변환과 루프이득(Loop Gain)의 변환시점을 자동적으로 검출해 주는 ATC(Automatic Transfer mode Control)알고리즘을 설계하고 모드 전환시 안정적으로 주파수 오프셋을 추정하는 평균방식 Gear-shift PLL을 설계하였다. 제안하는 모드 전환 시점 검출 알고리즘인 ATC 알고리즘은 종전의 QPSK방식에 적용되던 Lock Detector 알고리즘보다 구현이 매우 간단하며 정확하게 모드 전환시점을 검출한다. 또한 Shift Register에 저장했던 주파수 추정 값들을 평균하는 평균전환방식은 모드 전환시 낮은 주파수 추정 에러값으로 다음 모드에서의 빠른 추적 성능을 가능하게 한다. 본 논문에서 제안하는 알고리즘은 적은 회로 면적과 고속 처리가 가능하도록 설계되어 ASIC 설계에 매우 유용하다. 아울러 본 논문에서는 극성판단 PD를 적용하여 위상 포착 및 추적 성능평가를 수행하고 성좌도(constellation)를 각 모드별로 분석하였다.

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무선랜 시스템을 위한 계산이 간단한 초기 동기부 설계 (Design of a computationally efficient frame synchronization scheme for wireless LAN systems)

  • 조준범;이종협;한진우;유연상;오혁준
    • 전자공학회논문지
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    • 제49권12호
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    • pp.64-72
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    • 2012
  • 주파수 옵셋 보상, 프레임 동기화, Timing Recovery를 포함하는 동기화는 모든 유/무선 통신 시스템에서 가장 중요한 신호 처리 블록이다. 대부분의 통신 시스템에서는 Training sequences 또는 프리앰블을 기반으로하는 동기화 방법이 사용된다. IEEE에서 제정한 802.11a/g/n의 무선랜 표준은 OFDM 시스템을 기반으로 한다. OFDM 시스템은 주파수와 타이밍 동기화 에러에 대해서 싱클캐리어 시스템보다 더 민감한 것으로 알려져 있다. 프레임의 시작점과 OFDM 심볼 및 훈련심볼의 시작점은 상관관계를 이용하여 추정될 수 있다. 상관관계를 처리 기능을 하는 블록은 일반적으로 많은 수의 곱셈기로 인하여 큰 복잡도를 갖게 된다. 본 논문에서는 IEEE 802.11a/g/n 시스템을 위한 훈련심볼 내의 심볼값이 반복되는 특성을 활용한 복잡도가 현저히 낮은 동기화 기법을 제안한다. 시뮬레이션과 구현결과 제안된 기법이 기존의 방법보다 성능저하는 없는 반면 훨씬 적은 복잡도를 갖는 결과를 보여준다.

Burst OFDM 시스템을 위한 차동 상관 기반의 프레임 동기 알고리즘 (Frame Synchronization Algorithm based on Differential Correlation for Burst OFDM System)

  • 엄중선;도주현;김민구;최형진
    • 한국통신학회논문지
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    • 제30권10C호
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    • pp.1017-1026
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    • 2005
  • 버스트 방식 OFDM 시스템에서의 프레임 동기는 수신된 프레임의 시작 위치를 판단하고, 정확한 FPT-window 위치 추정을 위해 가장 우선적으로 수행되어야 한다. 유효 OFDM 심볼 내의 규정된 반복 패턴 또는 보호 구간의 상관을 이용하는 기존의 일반적인 프레임 동기 방식은 연속적으로 증가하다 감소하는 상관 출력 특성에 의해 정확한 프레임 시작 지점 검출이 어려우며, 수신 신호와 기준 신호 간의 상관 특성을 이용하는 방식은 주파수 옵셋으로 인한 성능 열화를 초래한다. 따라서, 본 논문에서는 프레임 동기 방식으로서 주파수 옵셋에 강인하고 정확한 프레임 시점 검출이 가능한 차동 상관(Differential Correlation) 방식을 기반으로 한 새로운 알고리즘을 제안하였다. 그러나, 일반적인 차동 신호의 상관 결과는 프리앰블의 반복 구조에 의해 다수의 Peak를 가지게 되며 이로 인하여 정확한 프레임 동기의 검출 성능이 열화된다. 본 논문에서는 이러한 차동 검출 방식의 단점을 보완하기 위하여 차동 신호 생성 시 반복되는 동일 패턴 구간의 샘플을 이용하여 단일 상관 Peak를 갖는 알고리즘을 제안한다. 또한 다중경로 페이딩 채널 환경에서 페이딩에 의한 프레임 시작 위치 검출 에러를 줄이기 위하여 신호 전력으로 상관 출력 값을 정규화하는 블록을 도입함으로써 고속 이동 채널 환경에서의 프레임 시작 지점 검출 확률을 높였다.

위상 잡음의 거리 상관 효과에 따른 UHF RFID 리더의 성능 분석 (Performance Analysis of the UHF RFID Reader with the Range Correlation Effects of the Phase Noise)

  • 장병준;강민수;임재봉
    • 한국전자파학회논문지
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    • 제19권2호
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    • pp.152-160
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    • 2008
  • 본 논문에서는 위상 잡음의 거리 상관 효과에 따른 직접 변환 방식의 UHF 대역 RFID 리더의 성능을 분석한다. UHF RFID 시스템은 일반적 인 무선 통신 방식과는 다르게 송신 캐 리어를 발생하는 LO 신호가 동시에 수신기의 국부 발진기로 사용되며, 이에 따라 태그 신호와 LO 신호 간의 거리 상관 효과에 의한 주기적인 신호 간섭 및 위상 잡음 감소 효과가 발생한다. 주기적인 신호 간섭 효과는 이론 및 시뮬레이션을 통해 I와 Q신호를 I/Q 다이버시티 개념으로 전력 결합함으로써 제거할 수 있음을 확인하였다. 위상 잡음 감소 효과는 전형적인 UHF 대역에서 동작하는 LO의 위상 잡음에 대한 전력 밀도 스펙트럼이 태그-리더 거리 및 옵셋 주파수에 따라 변화됨을 확인하였고, 이를 이용하여 심볼 에러 성능을 시뮬레이션 하였다. 시뮬레이션 결과, 심볼 에러에서 위상 잡음의 영향은 태그 변조 방식 중 PSK에서 특히, 변조 각도가 작을 때 크게 나타나지만, 거리 상관 효과에 의해 실제 위상 잡음이 감소되어 그 영향이 미비해짐을 확인하였다.

고속 처리와 성능 향상을 위한 LDPC 코드 기반 결정 궤환 등화기 (Decision Feedback Equalizer Based on LDPC Code for Fast Processing and Performance Improvement)

  • 김도훈;최진규;유흥균
    • 한국전자파학회논문지
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    • 제23권1호
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    • pp.38-46
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    • 2012
  • 본 논문에서는 OFDM 시스템에서 고속 처리와 성능 향상을 위한 LDPC 코드 기반 결정 궤환 등화기(Decision Feedback Equalizer: DFE)를 제안한다. LDPC 코드는 우수한 오류 정정 능력과 Shannon의 채널 용량에 근접하는 성능을 갖는다. 그러나, 많은 parity 검사 행렬과 반복 횟수를 가진다는 단점이 있다. 제안된 시스템에서는 판정된 신호와 복호기 사이의 신호의 MSE(Mean Square Error)를 등화기로 피드백한다. 이러한 방법을 사용하면 추정된 채널 응답을 보정해 주기 때문에 성능을 향상시킬 수 있다. 또한, 동일한 성능에서 피드백이 포함되지 않은 시스템보다 낮은 반복 횟수를 갖기 때문에 시스템의 복잡도를 줄일 수 있다. 시뮬레이션을 통해 다중 경로 채널에서 CFO(Carrier Frequency Offset)와 위상 잡음이 고려된 OFDM 시스템의 성능을 평가하여 제안 시스템의 우수성을 보인다.

5㎓대역 OFDM 무선 LAM 모뎀 설계 및 FPGA 구현 (Design and FPGA Implementation of 5㎓ OFDM Modem for Wireless LAN)

  • 문대철;홍성협
    • 융합신호처리학회논문지
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    • 제5권4호
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    • pp.333-337
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    • 2004
  • 본 논문은 IEEE 802.11a 무선 LAN 규격을 OFDM을 적용한 5GHz 기저 대역의 송 수신부 모뎀을 설계하고 FPGA로 실현하였다. 고속 데이터 전송시 발생하는 심벌간 간섭(ISI)을 제거하기 위하여 Normalized LMS 알고리듬을 적용한 단일탬 등화기를 사용하여 제거하였고, 또한 반송파 주파수 옵셋 알고리듬을 이용하여 채널간 간섭(ICI)을 제거하였다. 송ㆍ수신기간의 전송은 에러없이 정확히 전송되어짐을 시뮬레이션을 통하여 입증하였으며, 또한 타이밍 시뮬레이션 결과 최대 동작주파수는 20.3MHz로 IEEE 802.11a 무선 LAN 방식의 동작속도를 만족하였다. 그리고 설계시 DSP와 EMB(Embedded Memory Block)블록을 사용하여 레지스터의 수를 상당히 줄일 수 있었다. 모뎀 설계는 VHDL를 이용하여 설계하고 Altera사의 Stratix EPIS25FC672 FPGA Chip을 사용하여 구현하였다.

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